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初步
2006年8月
XRT83VSH28
REV 。 P1.0.0
8路E1短程线路接口单元
概述
该XRT83VSH28是一个完全集成的8通道
短途线路接口单元(LIU ),采用
在1.8V和3.3V电源。使用内部
终止后,刘提供的材料之一法案
工作在E1 75Ω或者120Ω模式,以最小的
的外部元件。刘特点
通过一个标准的并行或串行编程
微处理器接口。 Exar的刘已申请专利
高阻抗电路,其允许发射机
输出和接收器输入为高阻抗
遇到停电时或当柳
断电。在廖内的关键设计特点
优化为1:1或1 + 1冗余和非侵入式
监视应用程序,以确保可靠性,而无需
使用继电器。
片上时钟合成器产生的E1时钟
参考。
其他功能还包括RLOS , 16位LCV
计数器对每个通道, AIS , QRSS代/
检测, TAOS , DMO和诊断环回
模式。
应用
ISDN基群速率接口
CSU / DSU E1接口
E1 LAN / WAN路由器
公共交换系统和PBX接口
E1多路复用器和信道
F
IGURE
1. B
LOCK
D
的作者IAGRAM
XRT83VSH28 E1刘(H
OST
M
ODE
)
MCLKE1
主时钟合成器
MCLKOUT
1的8个信道,信道
_n
TPOS_n / TDATA_n
TNEG_n / CODES_n
TCLK_n
QRSS
图案
发电机
HDB3/
编码器
TX / RX抖动
衰减器
TAOS
DRIVE
MONITOR
TX过滤器
& PULSE
整形
LINE
司机
DMO_n
TTIP_n
TRING_n
TxON_n
定时
控制
远程
环回
数字
环回
类似物
环回
QRSS
探测器
RClk_n
RNEG_n / LCV_n
RPOS_n / RDATA_n
HDB3/
解码器
TX / RX抖动
衰减器
时序&
数据
恢复
PEAK
探测器
&放大器;切片机
RTIP_n
RRING_n
LOS
探测器
AIS
探测器
RLOS_n
HW / HOST
WR_R / W
RD_ DS
ALE -AS
CS
RDY_ DTACK SDO
/
INT
SER_ PAR
TEST
微处理器串行接口控制器
/
信息和通信技术
PTS1
PTS2
D[7:0]
PCLK / SCLK
A [ 7 : 0 ] / SDI
RESET
Exar公司
公司48720加藤道,弗里蒙特CA, 94538
(510) 668-7000
传真( 510 ) 668-7017
www.exar.com
XRT83VSH28
初步
REV 。 P1.0.0
8路E1短程线路接口单元
F
IGURE
2. B
LOCK
D
的作者IAGRAM
XRT83VSH28 E1刘(H
ARDWARE
M
ODE
)
MCLKE1
主时钟合成器
MCLKOUT
TAOS_n
TAOS
DRIVE
MONITOR
TX过滤器
& PULSE
整形
LINE
司机
1的8个信道,信道
_n
TPOS_n / TDATA_n
TNEG_n / CODES_n
TCLK_n
QRSS
图案
发电机
HDB3/
编码器
TX / RX抖动
衰减器
DMO_n
TTIP_n
TRING_n
定时
控制
远程
环回
数字
环回
类似物
环回
TxON_n
QRSS
探测器
RClk_n
RNEG_n / LCV_n
RPOS_n / RDATA_n
HDB3/
解码器
TX / RX抖动
衰减器
时序&
数据
恢复
PEAK
探测器
&放大器;切片机
RTIP_n
RRING_n
LOOP1_n
LOOP0_n
LOS
探测器
AIS
探测器
RLOS_n
HW / HOST
JASEL1
JASEL0
RXTSEL
TXTSEL
TERSELR
XRES0
RXRES
1
TEST
信息和通信技术
RESET
Tratio
SR / DR
EQC [4 :0]的
TCLKE
RCLKE
RXMUTE
ATAOS
HARWARE控制
2
初步
REV 。 P1.0.0
XRT83VSH28
8路E1短程线路接口单元
特点
完全集成的八通道短程收发器E1 ( 2.048MHz的)应用程序
内部阻抗的匹配上接收和发送,对于75Ω (E1)和120Ω ( E1)的应用是每
通过软件端口选择不改变组件
断电对每个通道进行独立的接收和发送的选择
用户可编程任意脉冲模式
片上发送的短路保护和限流保护线路驱动器不受损坏对每个信道
基础
可选择的水晶无数字抖动衰减器( JA )与32位或64位的FIFO用于接收或发送
路径
驱动程序故障监视器输出( DMO )可能存在的系统或外部组件的问题提醒
发送输出和接收输入可能"High"阻抗的保护或冗余应用
每个通道
支持用于自动保护交换
1:1和无继电器1 + 1保护
接收监控模式处理0在6dB衰减电阻(平损失)以及0在6dB电缆损耗
信号( RLOS )根据ITU -T G.775 / ETS300233损失( E1 )
可编程的数据流时RLOS静音检测
片HDB3编码器/解码器,每个通道的内部16位计数器LCV
片高输入抖动容限的数字时钟恢复电路
QRSS / PRBS码型发生器和检测,测试和监控
错误和双极性违章插入和检测
传输所有的人( TAOS )发电机和探测器
支持本地模拟,远程,数字,和双回环模式
支持跳空的时钟映射器/多路转换器的应用
1.8V内部核心
3.3V的I / O电源供电
225球BGA封装
-40 ° C至+ 85°C温度范围
订购信息
P
艺术
N
棕土
XRT83VSH28IB
P
ACKAGE
225球BGA
O
操作摄像机
T
emperature
R
ANGE
-40
°
C至+ 85
°
C
3
A
RNEG_0 TCLK_1 TPOS_1 TAOS_2
RDY
ALE
保留DVDD1v8
A[1]
A[3]
A[7]
TXON_0 JASEL0 TCLK_2 RLOS_3 RCLK_3 DVDD3v3
RPOS_0 RCLK_0 TCLK_0 TNEG_1 TAOS_1
CS
版权所有
DGND
A[2]
A[6]
TX0N_3 JASEL1 TPOS_2 TNEG_3 RNEG_3 RPOS_3 JTAGRing
DGND
B
RVDD
RLOS_0 TNEG_0 TPOS_0 TAOS_3 RD_DS保留
DGND
A[0]
A[5]
TXON_2 DMO_3 TCLK_3 DMO_2
TTIP_3
TGND
RTIP_3
TDO
XRT83VSH28
C
RGND
TGND
DMO_1
DMO_0 TAOS_0 WR_R / W
DGND
DVDD3v3 DVDD1v8
A[4]
TXON_1 TNEG_2 TPOS_3 RPOS_2
RVDD
RGND
RTIP_0
D
TRING_O TTIP_0
TVDD
RVDD
TGND
TRING_3
RRING_0
RRING_3
E
TGND
TRING_1
TVDD
TRING_2
TMS
TVDD
JTAGTip
F
RPOS_1
RGND
TTIP_1
RRING_1
TVDD
TTIP_2 RRING_2
G
RTIP_1
DGND
RVDD
RGND
RTIP_2
H
AVDD
AVDD
DVDD3v3
MCLKOUT RNEG_1 RCLK_1 RLOS_1
RLOS_2 RCLK_2
DGND
RNEG_2
J
MCLKE1
XRT83VSH28
( TOP VIEW )
225球BGA
RLOS_6
PTS1
AGND
8路E1短程线路接口单元
K
DGND
AGND
SR / DR
RLOS_5 RCLK_5
AGND
版权所有
DVDD3v3
RXON
AVDDS DVDD1v8
初步
4
RGND
RPOS_5 RNEG_5
TTIP_5
RVDD
TRING_5
TRING_4
TGND
DMO_5
TTIP_4
TGND
TVDD
DMO_4 TAOS_7
D[0]
DGND
RGND
TCLK_4 RNEG_4 TCLK_5 TAOS_4
D[7]
RESET
DGND
RPOS_4 RCLK_4 TNEG_4 TPOS_5 TAOS_5
D[6]
D[2]
D[1]
DVDD1v8 RXTSEL
RVDD
RLOS_4 TPOS_4 TNEG_5 TAOS_6
D[5]
D[4]
D[3]
RXRES0
TXTSEL
L
RTIP_5
PTS2
INT
RPOS_6
RTIP_6
M
RRING_5
RCLK_6 RNEG_6
RGND
RRING_6
N
TCK
TVDD
TTIP_6
RVDD
NC
P
TVDD
TVDD
TTIP_7 TRING_7 SER_PAR
R
TDI
DVDD3v3 RXRES1 TERSEL0 TXON_6 TXON_7 TNEG_7 TRING_6
TGND
RGND
RRING_7
T
RRING_4
HW_HOST TERSEL1 RXMUTE μPCLK TPOS_7 RLOS_7
TGND
RPOS_7
RTIP_7
U
RTIP_4
TEST
TXON_5 TNEG_6 TCLK_7 RCLK_7
DMO_6
RVDD
V
2
3
4
DVDD1v8
信息和通信技术
TXON_4 DMO_7 TPOS_6 TCLK_6 RNEG_7
DGND
REV 。 P1.0.0
1
5
6
7
8
9
10
11
12
13
14
15
16
17
18
初步
REV 。 P1.0.0
XRT83VSH28
8路E1短程线路接口单元
一般DESCRIPTION................................................................................................. 1
A
PPLICATIONS
............................................................................................................................................... 1
F
IGURE
1. B
LOCK
D
的作者IAGRAM
XRT83VSH28 E1刘(H
OST
M
ODE
)........................................................................................ 1
F
IGURE
2. B
LOCK
D
的作者IAGRAM
XRT83VSH28 E1刘(H
ARDWARE
M
ODE
) ............................................................................... 2
F
EATURES
..................................................................................................................................................... 3
订购信息.................................................................................................................... 3
引脚说明按功能.............................................. ..................................... 5
R
ECEIVE
S
挠度
......................................................................................................................................... 5
T
RANSMIT
S
挠度
....................................................................................................................................... 8
P
ARALLEL
M
ICROPROCESSOR
I
覆盖整个院落
..................................................................................................... 10
抖动
A
TTENUATOR
.................................................................................................................................... 12
C
LOCK
S
YNTHESIZER
................................................................................................................................... 12
A
LARM
F
受膏
/R
EDUNDANCY
S
UPPORT
................................................................................................. 14
S
ERIAL
M
ICROPROCESSOR
I
覆盖整个院落
......................................................................................................... 16
P
OWER和
G
.................................................................................................................................. 16
功能说明................................................ ......................................... 19
1.0硬件模式VS主机模式............................................ .................................................. .. 19
在硬件模式下1.1的功能差异............................................ .......................................... 19
T
ABLE
1: D
IFFERENCES
B
ETWEEN
H
ARDWARE
M
ODE和
H
OST
M
ODE
.......................................................................................... 19
2.0接收通道线路接口............................................. .................................................. ..... 20
F
IGURE
3. S
IMPLIFIED
B
LOCK
D
的作者IAGRAM
R
ECEIVE
P
ATH
...................................................................................................... 20
2.1线路终端( RTIP / RRING ) .............................................................................................................. 20
2.1.1案例1:内部TERMINATION.......................................................................................................................... 20
T
ABLE
2: S
选举
I
NTERNAL
I
MPEDANCE
............................................................................................................................. 20
F
IGURE
4. T
YPICAL
C
ONNECTION
D
IAGRAM
U
I
NTERNAL
T
发芽
.................................................................................... 20
2.1.2案例2 :内部端接一个外部固定电阻器适用于所有模式.................... 21
T
ABLE
3: S
选举
V
的作者ALUE
E
XTERNAL
F
IXED
R
ESISTOR
............................................................................................. 21
F
IGURE
5. T
YPICAL
C
ONNECTION
D
IAGRAM
U
O
NE
E
XTERNAL
F
IXED
R
ESISTOR
....................................................................... 21
2.2时钟和数据恢复................................................................................................................... 22
F
IGURE
6. R
ECEIVE
D
ATA
U
PDATED ON THE
R
伊辛
E
作者: DGE
RCLK ................................................. ............................................. 22
F
IGURE
7. R
ECEIVE
D
ATA
U
PDATED ON THE
F
奥林
E
作者: DGE
RCLK ................................................. ........................................... 22
T
ABLE
4: T
即时通信
S
PECIFICATIONS FOR
RCLK / RPOS / RNEG .......................................................................................................... 22
2.2.1接收灵敏度.............................................................................................................................................. 23
F
IGURE
8. T
美东时间
C
ONFIGURATION FOR
M
EASURING
R
ECEIVE
S
ENSITIVITY
........................................................................................ 23
2.2.2干扰余量......................................................................................................................................... 23
F
IGURE
9. T
美东时间
C
ONFIGURATION FOR
M
EASURING
I
干涉现象
M
ARGIN
.................................................................................... 23
2.2.3一般报警检测和中断产生......................................... ............................... 23
2.3接收抖动衰减器.................................................................................................................. 24
2.4 HDB3解码器............................................................................................................................................ 25
2.5 RPOS / RNEG / RCLK ........................................................................................................................................ 25
F
IGURE
10. S
炉火
R
AIL
M
ODE
W
ITH一个
F
IXED
R
EPEATING
"0011" P
ATTERN
................................................................................... 25
F
IGURE
11. D
UAL
R
AIL
M
ODE
W
ITH一个
F
IXED
R
EPEATING
"0011" P
ATTERN
...................................................................................... 25
2.6 RXMUTE ( LOS接收器具有数据静音) ......................................... .............................................. 26
F
IGURE
12. S
IMPLIFIED
B
LOCK
D
的作者IAGRAM
R
X
静音F
油膏
............................................................................................ 26
3.0发送通道线路接口............................................. .................................................. .. 27
F
IGURE
13. S
IMPLIFIED
B
LOCK
D
的作者IAGRAM
T
RANSMIT
P
ATH
................................................................................................... 27
3.1 TCLK / TPOS / TNEG数字输入............................................................................................................ 27
F
IGURE
14. T
RANSMIT
D
ATA
S
AMPLED ON
F
奥林
E
作者: DGE
TCLK ................................................. .............................................. 27
F
IGURE
15. T
RANSMIT
D
ATA
S
AMPLED ON
R
伊辛
E
作者: DGE
TCLK ................................................. ................................................ 27
T
ABLE
5: T
即时通信
S
PECIFICATIONS FOR
TCLK / TPOS / TNEG ........................................................................................................... 28
3.2 HDB3编码器............................................................................................................................................ 28
T
ABLE
6: E
作者XAMPLES
HDB3 ê
NCODING
...................................................................................................................................... 28
3.3传输抖动衰减器............................................................................................................... 29
T
ABLE
7: M
AXIMUM
G
AP
W
ID FOR
M
ULTIPLEXER
/M
冲击片雷管
A
PPLICATIONS
.................................................................................... 29
3.4 TAOS (发送全1) ..................................................................................................................... 29
F
IGURE
16. TAOS (T
RANSMIT
A
LL
O
NES
)...................................................................................................................................... 29
3.5 TRANSMIT诊断功能.......................................................................................................... 29
3.5.1 ATAOS (自动传输所有ONES)......................................................................................................... 29
F
IGURE
17. S
IMPLIFIED
B
LOCK
D
的作者IAGRAM
ATAOS F
油膏
............................................................................................... 30
3.5.2 QRSS GENERATION..................................................................................................................................................三十
T
ABLE
8: R
ANDOM
B
IT
S
EQUENCE
P
OLYNOMIALS
........................................................................................................................... 30
I
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    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

    XRT83VSH28
    -
    -
    -
    -
    终端采购配单精选

QQ: 点击这里给我发消息 QQ:5645336 复制
电话:13910052844(微信同步)
联系人:刘先生
地址:北京市海淀区增光路27号院增光佳苑2号楼1单元1102室
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