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MPC855TTS/D
修订版0.1 ， 11/2001
MPC855T通信
控制器技术
摘要
在MPC855T通信控制器是MPC8xx系列定位于成本的一员
敏感的通用网络控制器应用。在MPC855T可以在使用
各种控制应用，低成本的通讯特别擅长和
网络产品，如SOHO路由器，ADSL和电缆调制解调器。
在MPC855T集成了三个独立的处理模块。对前两个，与所有
MPC8xx设备，包括：（1 ）一种高性能MPC8xx芯，它被用作一个
通用处理器为应用程序和（2）一个RISC通信
处理器（CP）的嵌入式通信处理器模块（CPM）中。所有MPC8xx
设备将有一个8 KB的双口RAM时， MPC855T可用。第三块
与集成的FIFO和DMA爆裂10 /100- Mbps快速以太网控制器。该
MPC855T的快速以太网控制器独立实施，提供
高性能快速以太网连接，而不影响CPM的性能。
另外，由于MPC855T的CPM是基于其他MPC8xx设备的CPM，
对于ATM ， HDLC ，而QMC （ QUICC多通道控制器）多渠道支持
协议也被提供。在QMC协议使MPC855T提供协议
处理（通过HDLC或透明模式）为32的时分多路复用信道
（对TDM通道A ）时， MPC855T在50 MHz的操作。本作支持
多协议处理， ATM和10/100 - Mbps以太网在一个芯片使
MPC855T非常适合成本敏感的网络和电信系统。
1.1
MPC855T主要特点
使用ATM UTOPIA以上时， 10/100 Mbps以太网支持（不可用
接口）
- 完全符合IEEE 802.3u标准， 10 /100- Mbps的
- 支持三种不同的物理接口
- 100 - Mbps的802.3介质无关接口（MII）
- 10 - Mbps的802.3介质无关接口
- 10 - Mbps的7线接口
- 半双工100 Mbps的操作支持（在33 MHz的系统时钟速率和
以上）
- 全双工100 Mbps的操作支持（在50MHz的系统时钟速率和
在MPC855T的主要特点归纳如下：
MPC855T主要特点
以上）
- 大容量片上发送和接收FIFO ，支持各种总线的延迟
- 船舶碰撞的发送FIFO转播
- 自动内部FL ushing接收FIFO的欠幅脉冲和碰撞
- 用户 - 德网络nable大小片外缓冲描述符环，使几乎无限的灵活性
发送的管理和接收缓冲存储器
10/100 - Mbps的媒体访问控制（ MAC ）功能
- 地址识别
- 广播
- 单站地址
- 混杂模式
- 组播散列
- 全面支持媒体独立接口
- 中断模式
- 每帧
- 每缓冲区（不支持使用I位选择的缓冲区中断功能）
- 自动中断向量生成的接收和发送事件
类别：发送中断，接收中断，非时间关键的中断
- 以太网信道的脉冲串数据到/从外部存储器
ATM支持
- 符合ATM论坛UNI 4.0特定网络阳离子
- 电池在50 MHz的系统时钟处理高达50-70 Mbps的
- 细胞复用/解复用
- 支持AAL5和AAL0协议对每个VC基础
- AAL0支持使OAM和软件实施的其他协议）
- ATM的速度控制（APC ）调度器，提供：
- 直接支持恒定比特率（ CBR ）
- 直接支持unspeci网络版比特率（ UBR ）
- 支持软件支持可用比特率的控制机制（ ABR ）
- 支持两种类型的物理接口
- UTOPIA （ 10/100 - Mbps的不支持此接口）
- 字节对齐的串行（例如， T1 / E1 / ADSL）的
- UTOPIA -模式（ATM）支持：
- 乌托邦水平1个主用单元级握手
- 多物理层（最多4个物理层的设备）
- 连接到25 Mbps的， 51 Mbps或155 Mbps的制定者
- 1 UTOPIA时钟速率： 2或1： 3的系统时钟速率
- 串行模式（ATM）连接支持：
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MPC855T通信控制器技术摘要
摩托罗拉
MPC855T主要特点
- 传输汇聚（ TC）功能的T1 / E1 / ADSL线路
- 小区划定
- 电池加扰/解扰
- 自动空闲/未分配的单元插入/剥
- 头差错控制（ HEC ）的生成，检查和统计
- 无缝接口摩托罗拉CopperGold ADSL收发器
- 接收VP / VC连接查找机制，其中包括：
- 内部顺序查找表，支持高达32个连接
- 支持使用外部存储器地址，通过压缩或高达64K的连接
内容可寻址存储器（ CAM）的
- 独立的发送/接收缓冲区描述符环的数据结构为每个连接
- 使用异常队列中每个通道的中断报告
- 支持53字节或64个字节（扩大） ATM信元
- AAL5分段和重组（ SAR ）功能的分割
- 段直接从系统内存CPCS_PDU
- CPCS_PDU填充
- CRC32代
- 自动最后一个单元格标记（在信元头的PTI网络ELD）
- 自动CS_UU ， CPI和长度的最后一个单元格插入
- AAL5分段和重组（ SAR ）功能的重组：
- 重组CPCS_PDU直接进入系统内存
- 删除CPCS_PDU填充
- CRC32校验
- CS_UU ， CPI和长度报告
- 中电和拥塞报告
- 每个缓冲区或每封邮件中断
- 错误报告，包括CRC ，长度不匹配，信息中止
- AAL0特征用于发送包括以下内容：
- 发送从发送缓冲区埃默里用户自网络斯内德细胞
- 自动生成HEC
- 可选CRC10插入
- AAL0功能受到包括以下内容：
- 将整个单元接收到内存缓冲区
- 提供中断每个细胞
- 可选CRC10校验
嵌入式MPC8xx核心，拥有106 MIPS在80兆赫（使用的Dhrystone 2.1 ）
- 单问题，嵌入式MPC8xx核心的32位版本（与完全兼容
用户的PowerPC指令集架构;参阅
编程环境手册
PowerPC架构的32位实现
了解更多信息）与32 ×32位
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MPC855T主要特点
科幻固定的点寄存器
- 嵌入式MPC8xx核心执行分支折叠和分支预测与条件
预取，但没有条件执行
- 4K字节的数据缓存和4 KB的指令高速缓存，每一个MMU
- 指令和数据高速缓存是双向的，组相联，物理地址， 4字线
一阵，最近最少使用（ LRU ）置换，可锁定在高速缓存行的粒度
- MMU的有32项，全相联指令和数据的TLB
- MMU的支持4K字节， 16字节， 256字节， 512字节的多个页面大小，并
8字节; 16个虚拟地址空间和8个保护组
- 先进的片上仿真调试模式
- 高达32位的数据总线（ 8动态母线调整，16和32位，通过存储器提供
控制器）
- 32根地址线
系统集成单元（ SIU ）
- 公交车监控
- 虚假中断监控
- 软件看门狗
周期性中断定时器
- 低功耗停止模式
时钟合成器
递减器
- 时基和RTC
- 复位控制器
- IEEE 1149.1测试访问端口（JTAG）
- 内存控制器（ 8行）
- 包含完整的动态随机存取存储器（DRAM）控制器
- 每家银行可能是一个片选或RAS支持DRAM银行
- 最多15个等待状态每个存储器组编程
- 无缝接口DRAM单列直插式内存模块（SIMM ） ，静态
随机存取存储器（ SRAM），电可编程只读存储器
（ EPROM ） ，闪存EPROM等。
- DRAM控制器，可编程，支持大多数的大小和高速存储器接口
- 中科院四线，四WE线，一条线OE
- 引导芯片复位时选择用（ 8,16或32位内存选项）
- 可变块大小为32 KB至256兆字节
- 可选择写保护
- 片上总线仲裁逻辑
- 通用定时器
- 4个16位定时器或两个32位定时器
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MPC855T主要特点
- 门模式下可以启用/禁用计数
- 中断可以在基准匹配和事件捕获屏蔽
中断
- 七外部中断请求（ IRQ ）线路
- 12端口引脚具有中断功能
- 13个内部中断源
- 可编程的最高优先级请求
- PCMCIA接口
- 主（插座）接口， 2.1版兼容
- 支持两个独立的PCMCIA插槽
- 8内存或I / O支持的窗户
通信处理器模块（ CPM ）
- 支持所有功能和MPC860T的性能
- RISC的通信处理器（CP）的
- 通讯 - 特定网络C命令（例如，正常停止发送，关闭接收缓冲区
描述符， RxBD ）
- 高达384缓冲描述符
- 支持所有串行通道连续模式下发送和接收
- 高达8 KB的双口RAM
- 10个串行DMA （ SDMA ）通道
- 三个并行I / O和漏极开路功能寄存器
- 四波特率发生器
- 独立
- 波特率运行过程中允许变动
- 自动波特率支持选项
- 一个SCC （串行通信控制器）
- QMC多通道协议处理32时分多路复用信道
- 以太网/ IEEE 802.3u标准，支持完整的10 - Mbps操作
- HDLC / SDLC （在2 Mbps的支持所有通道）
- HDLC总线（实现一个基于HDLC的局域网络（LAN） ）
- 异步HDLC支持PPP （点对点协议）
- 的AppleTalk
- 通用异步收发器（ UART ）
- 同步UART
- 串行红外（ IrDA）的
- 二进制同步通信（ BISYNC ）
- 完全透明（比特流）
- 完全透明（基于具有可选的循环冗余校验帧（ CRC ） ）
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