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Virtex-5系列概述
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DS100 ( V5.0 ) 2009年2月6日
产品speci fi cation
概述
在的Virtex - 5系列提供在FPGA市场上最新最强大的功能。采用第二代ASMBL (高级
硅片组合模块)列式架构,Virtex -5系列包含五个不同的平台(分户) ,最多的选择
任何FPGA系列提供。每个平台包含的特征的不同比例,以解决各种先进的逻辑的需要
设计。除了最先进的高性能逻辑架构,Virtex - 5 FPGA还包含多种硬IP系统级模块,
其中包括功能强大的36 - Kbit的块RAM / FIFO中,第二代的25× 18的DSP切片, SelectIO技术的内置式可数字
受控阻抗的ChipSync 源同步接口模块,系统监控功能,增强时钟管理
集成DCM (数字时钟管理器)和锁相回路( PLL )时钟发生器和高级配置选项。
其他依赖于平台的功能包括功率优化的高速串行收发器模块的增强型串行连接,
的PCI Express兼容的集成端点模块,三态以太网MAC (媒体访问控制器)和高性能
的PowerPC 440微处理器的嵌入式模块。这些功能使先进的逻辑设计师打造的最高水平
性能和功能集成到他们的基于FPGA的系统。建立在国家的最先进的65纳米铜工艺技术, Virtex-5的
FPGA是可编程替代方案定制ASIC技术。最先进的系统设计要求的可编程实力
中的FPGA。的Virtex - 5 FPGA提供最佳的解决方案解决了高性能逻辑设计人员的需求,高性能DSP
设计师和高性能的嵌入式系统设计人员提供了前所未有的逻辑, DSP ,硬/软微处理器,并
连接能力。在Virtex - 5 LXT , SXT ,TXT和FXT平台包括先进的高速串行连接和
链路/事务层功能。
中的Virtex - 5 FPGA特性总结
五大平台LX , LXT , SXT ,TXT和FXT
的Virtex - 5 LX :高性能通用逻辑应用
的Virtex - 5 LXT :拥有先进的系列高性能逻辑
连接
的Virtex - 5 SXT :高性能信号处理
凭借先进的串行连接应用
的Virtex - 5 TXT :双高性能系统
密度先进的串行连接
的Virtex - 5 FXT :高性能嵌入式系统
先进的串行连接
先进的DSP48E逻辑片
25× 18 , 2的补码,乘法
可选的加法器,减法器和累加器
可选流水线
可选位逻辑功能
专用级联
灵活的配置选项
SPI和并行Flash界面
多码流支持,专用备用
汽车总线宽度检测能力
在所有设备上的系统监控功能
片内/片外温度监控
片内/片外电源监控
JTAG访问所有监控量
集成端点模块的PCI Express设计
LXT , SXT ,TXT和FXT平台
符合PCI Express基本规范1.1
X1,X4 , X8或车道每块的支持
协同工作与RocketIO 收发器
三模10/100/1000 Mb / s的以太网MAC
LXT , SXT ,TXT和FXT平台
RocketIO收发器可以被用作物理层,或连接到
使用多种软MII (媒体独立外部PHY
接口)选项
重新配置逻辑
跨平台兼容性
LXT , SXT和FXT器件的占位面积兼容
采用可调式稳压器相同的包
最先进的,高性能的,最佳的利用率,
FPGA架构
实6-输入查找表(LUT)技术
双5 - LUT选项
改进减少了跳路由
64位分布式RAM选项
SRL32 /双SRL16选项
强大的时钟管理模块(CMT )的时钟
数字时钟管理器( DCM)的零延迟块
缓冲,频率合成器和时钟相移
PLL模块的输入抖动滤波,零延迟缓冲,
频率合成器和相位匹配时钟分频
36 - Kbit的块RAM / FIFO中
真双端口RAM模块
增强的可选可编程FIFO逻辑
可编程
-
真正的双端口宽度可达X36
-
简单双端口宽度可达X72
内置的可选的纠错电路
可选方案每块为两个独立的18 - Kbit的
高性能并行SelectIO技术
1.2至3.3V的I / O操作
使用的ChipSync 源同步接口
技术
数控阻抗( DCI )主动终止
灵活的细粒度I / O银行
高速存储接口支持
RocketIO GTP收发器100 Mb / s到3.75 Gb / s的
LXT和SXT平台
RocketIO GTX收发150 Mb / s到6.5 Gb / s的
TXT和FXT平台
的PowerPC 440微处理器
仅FXT平台
RISC架构
7级流水线
包括32 KB的指令和数据高速缓存
优化的处理器接口结构(纵横)
65纳米铜CMOS工艺技术
1.0V的核心电压
高信号完整性倒装芯片封装在标准可用
或无铅封装选项
本文2006-2009 Xilinx公司XILINX , Xilinx标,的Virtex ,斯巴达, ISE ,并且包括其它指定品牌Xilinx公司在美国和其它商标
国家。 PowerPC是IBM公司的注册商标,并许可使用。 PCI , PCI Express的,PCIe和PCI -X是PCI - SIG的注册商标。所有其他商标均为财产
其各自所有者所有。
DS100 ( V5.0 ) 2009年2月6日
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产品speci fi cation
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Virtex-5系列概述
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表1:
的Virtex - 5 FPGA系列成员
可配置逻辑块(CLB )
设备
块RAM块
最大
( KB的)
DSP48E
最大
ARRAY
Virtex-5
切片
(2)
分布
18 KB
(3)
36 KB
(行X列)片
(1)
RAM ( KB)
最大的RocketIO
终点
收发器
(6)
PowerPC的
最大
块以太网
CMTS
(4)
处理器
I / O
用户
(5)
PCI
互助
银行
(8)
I / O
(7)
表达
GTP
GTX
XC5VLX30
XC5VLX50
XC5VLX85
XC5VLX110
XC5VLX155
XC5VLX220
XC5VLX330
XC5VLX20T
XC5VLX30T
XC5VLX50T
XC5VLX85T
XC5VLX110T
XC5VLX155T
80 x 30
120 x 30
120 x 54
160 x 54
160 x 76
4,800
7,200
12,960
17,280
24,320
320
480
840
1,120
1,640
2,280
3,420
210
320
480
840
1,120
1,640
2,280
3,420
520
780
1,520
4,200
1,500
2,400
380
820
1,240
1,580
2,280
32
48
48
64
128
128
192
24
32
48
48
64
128
128
192
192
288
640
1,056
80
96
64
128
256
320
384
64
96
192
256
384
384
576
52
72
120
216
296
424
424
648
168
264
488
1,032
456
648
136
296
456
596
912
32
48
96
128
192
192
1,152
1,728
3,456
4,608
6,912
6,912
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不适用
不适用
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不适用
不适用
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3
3
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不适用
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不适用
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不适用
不适用
不适用
不适用
不适用
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不适用
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不适用
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不适用
不适用
不适用
不适用
不适用
不适用
不适用
不适用
不适用
不适用
不适用
40
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13
17
17
23
23
23
33
7
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15
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20
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19
20
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27
400
560
560
800
800
800
1,200
172
360
480
480
680
680
680
960
360
480
640
960
680
680
360
640
680
840
960
160 x 108 34,560
240 x 108 51,840
60 x 26
80 x 30
120 x 30
120 x 54
160 x 54
160 x 76
3,120
4,800
7,200
12,960
17,280
24,320
288 10,368
26
36
60
108
148
212
212
936
1,296
2,160
3,888
5,328
7,632
7,632
XC5VLX220T 160× 108 34560
XC5VLX330T 240× 108 51840
XC5VSX35T
XC5VSX50T
XC5VSX95T
XC5VSX240T
XC5VTX150T
XC5VTX240T
XC5VFX30T
XC5VFX70T
XC5VFX100T
XC5VFX130T
XC5VFX200T
80 x 34
120 x 34
160 x 46
240 x 78
200 x 58
240 x 78
80 x 38
160 x 38
160 x 56
200 x 56
240 x 68
5,440
8,160
14,720
37,440
23,200
37,440
5,120
11,200
16,000
20,480
30,720
324 11,664
84
132
244
3,024
4,752
8,784
516 18,576
228
8,208
324 11,664
68
148
228
2,448
5,328
8,208
298 10,728
456 16,416
注意事项:
1.的Virtex - 5 FPGA切片是从上一代不同的方式组织。每个Virtex - 5 FPGA Slice包含四个LUT和四个触发器(之前
这是两个LUT和两个触发器)。
2.每个DSP48E Slice包含一个25× 18乘法器,加法器和一个累加器。
3. Block RAM的基本上是36千位的大小。每个块也可以作为两个独立的18千位的块。
4.每个时钟管理模块( CMT )包含两个DCM和一个PLL 。
5.本表列出了每个单独设备的以太网MAC 。
6. RocketIO GTP收发器的设计运行速度为100 Mb / s到3.75 Gb / s的。的RocketIO GTX收发器的设计从150 Mb / s的运行
6.5 Gb / s的。
7,这个数字不包括RocketIO收发器。
8.包括配置Bank 0中。
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产品speci fi cation
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Virtex-5系列概述
的Virtex - 5 FPGA逻辑
平均而言,一到两个速度等级的改进
Virtex-4器件
可级联32位变量移位寄存器或64位
分布式存储能力
高级路由架构,增强的对角
路由支持模块到模块的连接带
最小跳数
高达330,000个逻辑单元,包括:
高达207,360的内部结构触发器时钟使能
(XC5VLX330)
高达207360真实6-输入查找表(LUT)以
大于13万总LUT位
两路输出的双5 -LUT模式使得增强
采用
逻辑扩展多路复用器和I / O寄存器
550 MHz的集成块存储器
高达16.4 Mbits的集成块内存
36 - Kbit的块,可选的双18 - Kbit的模式
真正的双端口RAM单元
独立的端口宽度选择( X1到X72 )
截至X36共有每个端口实现真正的双端口操作
截至X72共有每个端口的简单的双端口操作
(一个读端口和一个写端口)
存储位加上奇偶校验/边带内存的支持
X9 , X18 , X36 , X72和宽度
配置从32K x 1到512× 72
( 8K ×4至512× 72 FIFO操作)
满和空标志,与完全可编程几乎满
和近空标志
多速率FIFO支持逻辑
550 MHz时钟技术
多达六个时钟管理( CMTS)
每个CMT包含两个DCM和一个PLL行动
18个时钟发生器
灵活的DCM到PLL或PLL到DCM级联
精密时钟去歪斜和相移
灵活的频率综合
多种工作模式,以缓解性能的权衡
决定
改进的最大输入/输出频率
细粒度相移分辨率
输入抖动滤波
低功耗工作
宽移相范围
无标志的不确定性同步FIFO支持
可选流水线级数更高的性能
字节写入能力
专业的层级路由,形成64K ×1内存
不使用FPGA布线
集成的可选ECC的高可靠性存储
需求
特别省电设计, 18千位(及以下)
手术
550 MHz的DSP48E逻辑片
25× 18的二的补码乘法
可选流水线级数为增强性能
可选48位累加器的乘法累加
( MACC )操作,可选择蓄能器级联
到96位
集成加法器,用于复乘或乘加
手术
可选位逻辑操作模式
无关的C每片注册
完全可级联的DSP列,无需外部
路由资源
差分时钟树结构优化的低抖动
时钟和精确的占空比
32个全局时钟网络
区域,I / O ,以及本地除了全局时钟
SelectIO技术
最多1,200个用户I / O的
从1.2V至3.3V多种I / O标准
超高性能
高达800 Mb / s的HSTL和SSTL
(在所有的单端I / O )
高达1.25 Gb / s的LVDS (在所有差分I / O对)
ChipSync源同步
接口逻辑
作品结合的SelectIO技术
简化源同步接口
逐比特去歪斜功能内置到所有的I / O模块
(所有输入和输出变量延迟线)
专用I / O和区域时钟资源(销
和树)
内置数据串行器/解串器与逻辑
相应的时钟分频器支持所有的I / O
网络/通信接口最多
我每1.25 Gb / s的输入/输出
真正的差分端接片
在输入输出I / O的同一边捕捉
广泛的存储接口支持
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Virtex-5系列概述
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数控阻抗( DCI )
主动I / O端子
可选串行或并行端接
温度和电压补偿
使得电路板布局更容易
降低电阻
终端放置在理想的位置,在信号
源或目标
系统监视器
片上温度测量( ± 4 ° C)
片上电源测量( ± 1 % )
易于使用,自成一体
无需进行基本操作的设计
自动监控所有片上传感器
用户可编程报警阈值芯片
传感器
偏移和增益误差的自动校准
DNL = ± 0.9最大的LSB
0V至1V的输入范围
监视外部传感器例如,电压,温度
通用模拟输入
CON组fi guration
支持平台上的Flash ,标准的SPI Flash或
标准并行NOR Flash配置
用专用的后备支持码流
重新配置逻辑
256位AES比特流解密提供智力
财产安全,防止复制的设计
改进的比特流错误检测/校正能力
汽车总线宽度检测能力
通过ICAP端口部分重配置
预先设计的包装技术成熟
优异的信号完整性
从最小化信号感应线圈返回
最佳的信号 - 电源/接地比率
用户可访问的10位200ksps的ADC
支持多达17个外部模拟输入通道
从架构或JTAG TAP系统监视器完全访问
全面运作之前, FPGA配置和
在设备断电(通过JTAG TAP只能访问)
1.0V的核心电压
12层金属提供了最大的路由功能
可容纳硬IP浸泡
三栅极氧化层技术的成熟降低静态功耗
消费
先进的倒装芯片封装
65纳米铜CMOS工艺
降低SSO产生的噪声高达7倍
无铅和标准封装
系统模块具体到LXT , SXT , TXT和FXT器件
集成端点模块的PCI Express
合规
与RocketIO GTP收发器配合使用
( LXT和SXT )和GTX收发器( TXT和FXT )
提供完整的PCI Express端点功能与
最低的FPGA逻辑利用率。
符合PCI Express基本规范1.1
PCI Express端点模块和传统的PCI Express
端点模块
X8 , X4 , X1或车道宽度
电源管理支持
块RAM用于缓冲的
完全缓冲的发送和接收
管理接口来访问的PCI Express
配置空间和内部配置
支持全系列最大有效载荷大小
达6× 32位或3× 64位的BAR (或组合
32位和64位)
三态以太网媒体访问控制器
设计符合IEEE 802.3-2002规范
以10 ,100,和1000 Mb / s的
支持三模式自动协商
接收地址滤波器( 5地址表项)
与RocketIO完全单片个1000Base-X解决方案
GTP收发器
支持多个外部PHY连接( RGMII ,
GMII等),通过软逻辑和接口的SelectIO
资源
支持通过连接到外部物理层设备
使用SGMII软逻辑和RocketIO GTP收发器
接收和发送可以通过统计数据
单独的接口
单独的主机和客户端接口
对巨型帧的支持
支持VLAN
灵活的,用户可配置的主机接口
支持符合IEEE 802.3ah -2004单向模式
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Virtex-5系列概述
RocketIO GTP收发器( LXT / SXT只)
能够100 Mb / s的全双工串行收发器
3.75 Gb / s的波特率
8B / 10B ,用户自定义FPGA逻辑,或没有编码
选项
通道绑定支持
CRC生成和校验
可编程预加重或预均衡为
变送器
可编程的终止电压摆幅
可编程均衡的接收器
接收信号检测和信号指示灯的损失
使用辅助用户动态重配置
配置总线
出于对串行ATA带外(OOB )支持( SATA )
电气闲置,信标,接收器检测以及PCI
Express和SATA扩频时钟支持
低于100 mW的典型功耗
内置式PRBS发生器和校验器
能够150 Mb / s的全双工串行收发器
6.5 Gb / s的波特率
8B / 10B编码和可编程变速箱
支持64B / 66B和64B / 67B编码,用户自定义
FPGA逻辑,或者没有编码选项
通道绑定支持
CRC生成和校验
可编程预加重或预均衡为
变送器
可编程的终止电压摆幅
可编程的连续时间均衡的
接收器
可编程的判决反馈均衡的
接收器
接收信号检测和信号指示灯的损失
使用辅助用户动态重配置
配置总线
OOB支持( SATA )
电气闲置,信标,接收器的检测,并
PCI Express的扩频时钟支持
在所有线路速率低功率运行
的PowerPC 440 RISC内核(仅FXT )
嵌入式PowerPC 440 ( PPC440 )核
高达550 MHz运行
超过1000 DMIPS的每个内核
七级流水线
每个周期多条指令
乱序执行
32字节, 64路组相联一级指令
缓存
32千字节, 64路组相联1级数据高速缓存
本书E标准
128位处理器局域总线(小巴)
集成分散/集中DMA控制器
专用接口,用于连接的DDR2内存
调节器
对于非整数PLB到CPU的时钟的自动同步
从PPC440嵌入式块直接连接
FPGA架构为基础的协处理器
128位宽流水线APU加载/存储
支持自主指令:没有流水线停顿
自定义可编程指令解码
综合交叉,增强系统性能
辅助处理器单元( APU)接口和控制器
的RocketIO GTX收发器( TXT / FXT只)
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    电话:0755-82780082
    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

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    -
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电话:0755-88608510/88608316/83241196
联系人:朱小姐/吴小姐/朱先生
地址:深圳市龙岗中心城龙岗大道99号(CAZ)B座2206
XC5VLX50T-2FFG665C
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电话:0755-88608510/88608316/83241196
联系人:肖小姐/谢小姐/吴小姐
地址:深圳市龙岗中心城龙岗大道99号(CAZ)B座2206
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XILINX
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