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R
技术
数据
XC5200
逻辑单元阵列系列
初步（ V1.0 ）
1995年4月
和XACT是Xilinx公司的注册商标。所有XC-
预连接的X产品名称， XACT -性能，X - BLOX ， XChecker ，
XDM ， LCA ，逻辑单元，快速， VersaBlock和VersaRing是
赛灵思公司的商标。可编程逻辑公司和
可编程门阵列公司是Xilinx公司的服务商标。
导师是一个注册商标， NETED ，建筑设计师，
QuickSim和QuickSim II是Mentor Graphics公司， Inc.的商标。
OrCAD的是OrCAD的系统公司的注册商标。
Viewlogic系， Viewsim和Viewdraw是注册商标。
Viewlogic系统，新思科技公司是一个注册商标。
Synopsys公司赛灵思公司不承担因的任何法律责任
应用本文所述的任何产品或使用;也没有传达
根据其专利权，版权或maskwork权利或任何许可
他人的权利。
赛灵思公司保留随时修改的权利，在任何时间，以
提高可靠性，功能和设计，并提供最好的产品
可能。赛灵思公司将不承担使用任何电路的责任
描述比电路完全体现在它的产品中，等。
Xilinx器件和产品的一个或多个的下保护
R
以下美国专利： 4642487 ; 4695740 ; 4706216 ; 4713557 ;
4,746,822; 4,750,155; 4,758,985; 4,783,607; 4,820,937; 4,821,233;
4,835,418; 4,853,626; 4,855,619; 4,855,669; 4,902,910; 4,940,909;
4,967,107; 5,012,135; 5,023,606; 5,028,821; 5,047,710; 5,068,603;
5,140,193; 5,148,390; 5,155,432; 5,166,858; 5,224,056; 5,243,238;
5,267,187; 5,224,056; 5,245,277; 5,291,079; 5,295,090; 5,302,866;
5,319,252; 5,319,254; 5,321,704; 5,329,174; 5,329,181; 5,331,220;
5,331,226; 5,332,929; 5,337,255; 5,343,406; 5,349,248; 5,349,249;
5,349,250; 5,349,691; 5,357,153; 5,360,747; 5,361,229; 5,362,999;
5365125 ; 5367207 ; 5386154 ; RE 34363 ; RE 34444 ;和
RE 34808 。赛灵思公司并不代表显示设备或
本文描述的产品均不含专利侵权，或从任何
其他第三方权利。 Xilinx公司没有义务纠正错误
本文中，或通知任何修正，如果这个文本的任何用户
这样制成。赛灵思公司将不承担的准确性承担任何责任或
任何工程或软件支持或帮助正确性
提供给用户。
赛灵思产品并非设计用于生命支持设备，
设备或系统。在这样的应用程序，而不使用赛灵思的产品
禁止网络CER的适当赛灵思公司的书面同意。
R
目录
特色： 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
1
说明。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
1
XC5200系列相比， XC4000系列。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
2
结构概述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
3
开发系统。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
6
详细功能描述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
8
VersaBlock路由。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
12
通用布线矩阵。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
14
配置。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
17
物理尺寸。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
40
订购信息。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
43
R
XC5200
逻辑单元阵列系列
产品说明
完全支持XACT
开发系统
- 包括XACT -性能的完全支持，
X - BLOX ，统一网络版库，相关法摆
宏程序（RPM ） ， XDelay和XChecker
- 选择广泛的PC和工作站平台
- 接口100多个第三方CAE工具
初步（ V1.0 ）
特点
现场可编程门阵列的高密度系列
（ FPGA）器件
设计 - 和流程优化的低成本
- 0.6微米三层金属（ TLM ）的过程
系统性能高达50 MHz的
SRAM为基础的，在系统重新编程的架构
灵活的架构，丰富的布线资源
- VersaBlock 逻辑模块
- VersaRing I / O接口
- 专用的细胞穿心路
- 分层互连结构
- 广泛的寄存器/锁存器
- 算术功能的专用进位逻辑
- 梯级链宽输入功能
- 专用的IEEE 1149.1边界扫描逻辑
- 内部三态布辛能力
- 四个全球低偏移时钟或信号分配网
- 在全球范围内可选CMOS或TTL输入阈值
- 输出摆率控制
- 每个输出8 - mA的灌电流
刀豆网络加载的二进制文件连接gured
- 无限的可重编程
- 六编程模式，包括高速
快递模式
100 ％出厂测试
常见的包100 ％兼容的足迹
表1中。
设备
典型的浇口范围
VersaBlock阵列
个CLB数
触发器数量
的I / O数
每卧式延绳钓TBUFs
描述
在XC5200现场可编程门阵列家族
改造提供任何FPGA系列的最低成本。
通过优化新XC5200架构的TLM
技术和0.6微米CMOS SRAM工艺，显着
进展已经取得了硅EF网络效率。这些
前进位置的XC5200系列是高性价比，
高容量的替代栅阵列。
建立在经验积累与前面三个
成功的SRAM FPGA系列中， XC5200系列
带来了强大的功能设置为高密度可编程
逻辑设计。该VersaBlock逻辑模块，所述VersaRing
I / O接口，以及丰富的互联层次
资源相结合，提高设计的灵活性和
缩短产品的上市时间。
为XC5200系列完整支持交付
通过XACT熟悉的软件环境。该
XC5200系列完全支持流行的工作站上
和PC平台。流行的设计输入方法充分
支持包括ABEL ，原理图捕获和
合成。利用逻辑综合可以使用自己的设计师
现有的新思， Viewlogic系，导师，和卓越的工具
设计与XC5200器件。
最初的XC5200现场可编程门阵列家族成员
XC5202
2,200 -
2,700
8x8
64
256
84
10
XC5204
3,900 -
4,800
10 x 12
120
480
124
14
XC5206
6,000 -
7,500
14 x 14
196
784
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16
XC5210
10,000 -
12,000
18 x 18
324
1,296
196
20
XC5215
14,000 -
18,000
22 x 22
484
1,936
244
24
1
R
技术
数据
XC5200
逻辑单元阵列系列
初步（ V1.0 ）
1995年4月
和XACT是Xilinx公司的注册商标。所有XC-
预连接的X产品名称， XACT -性能，X - BLOX ， XChecker ，
XDM ， LCA ，逻辑单元，快速， VersaBlock和VersaRing是
赛灵思公司的商标。可编程逻辑公司和
可编程门阵列公司是Xilinx公司的服务商标。
导师是一个注册商标， NETED ，建筑设计师，
QuickSim和QuickSim II是Mentor Graphics公司， Inc.的商标。
OrCAD的是OrCAD的系统公司的注册商标。
Viewlogic系， Viewsim和Viewdraw是注册商标。
Viewlogic系统，新思科技公司是一个注册商标。
Synopsys公司赛灵思公司不承担因的任何法律责任
应用本文所述的任何产品或使用;也没有传达
根据其专利权，版权或maskwork权利或任何许可
他人的权利。
赛灵思公司保留随时修改的权利，在任何时间，以
提高可靠性，功能和设计，并提供最好的产品
可能。赛灵思公司将不承担使用任何电路的责任
描述比电路完全体现在它的产品中，等。
Xilinx器件和产品的一个或多个的下保护
R
以下美国专利： 4642487 ; 4695740 ; 4706216 ; 4713557 ;
4,746,822; 4,750,155; 4,758,985; 4,783,607; 4,820,937; 4,821,233;
4,835,418; 4,853,626; 4,855,619; 4,855,669; 4,902,910; 4,940,909;
4,967,107; 5,012,135; 5,023,606; 5,028,821; 5,047,710; 5,068,603;
5,140,193; 5,148,390; 5,155,432; 5,166,858; 5,224,056; 5,243,238;
5,267,187; 5,224,056; 5,245,277; 5,291,079; 5,295,090; 5,302,866;
5,319,252; 5,319,254; 5,321,704; 5,329,174; 5,329,181; 5,331,220;
5,331,226; 5,332,929; 5,337,255; 5,343,406; 5,349,248; 5,349,249;
5,349,250; 5,349,691; 5,357,153; 5,360,747; 5,361,229; 5,362,999;
5365125 ; 5367207 ; 5386154 ; RE 34363 ; RE 34444 ;和
RE 34808 。赛灵思公司并不代表显示设备或
本文描述的产品均不含专利侵权，或从任何
其他第三方权利。 Xilinx公司没有义务纠正错误
本文中，或通知任何修正，如果这个文本的任何用户
这样制成。赛灵思公司将不承担的准确性承担任何责任或
任何工程或软件支持或帮助正确性
提供给用户。
赛灵思产品并非设计用于生命支持设备，
设备或系统。在这样的应用程序，而不使用赛灵思的产品
禁止网络CER的适当赛灵思公司的书面同意。
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目录
特色： 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
1
说明。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
1
XC5200系列相比， XC4000系列。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
2
结构概述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
3
开发系统。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
6
详细功能描述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
8
VersaBlock路由。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
12
通用布线矩阵。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
14
配置。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
17
物理尺寸。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
40
订购信息。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
43
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XC5200
逻辑单元阵列系列
产品说明
完全支持XACT
开发系统
- 包括XACT -性能的完全支持，
X - BLOX ，统一网络版库，相关法摆
宏程序（RPM ） ， XDelay和XChecker
- 选择广泛的PC和工作站平台
- 接口100多个第三方CAE工具
初步（ V1.0 ）
特点
现场可编程门阵列的高密度系列
（ FPGA）器件
设计 - 和流程优化的低成本
- 0.6微米三层金属（ TLM ）的过程
系统性能高达50 MHz的
SRAM为基础的，在系统重新编程的架构
灵活的架构，丰富的布线资源
- VersaBlock 逻辑模块
- VersaRing I / O接口
- 专用的细胞穿心路
- 分层互连结构
- 广泛的寄存器/锁存器
- 算术功能的专用进位逻辑
- 梯级链宽输入功能
- 专用的IEEE 1149.1边界扫描逻辑
- 内部三态布辛能力
- 四个全球低偏移时钟或信号分配网
- 在全球范围内可选CMOS或TTL输入阈值
- 输出摆率控制
- 每个输出8 - mA的灌电流
刀豆网络加载的二进制文件连接gured
- 无限的可重编程
- 六编程模式，包括高速
快递模式
100 ％出厂测试
常见的包100 ％兼容的足迹
表1中。
设备
典型的浇口范围
VersaBlock阵列
个CLB数
触发器数量
的I / O数
每卧式延绳钓TBUFs
描述
在XC5200现场可编程门阵列家族
改造提供任何FPGA系列的最低成本。
通过优化新XC5200架构的TLM
技术和0.6微米CMOS SRAM工艺，显着
进展已经取得了硅EF网络效率。这些
前进位置的XC5200系列是高性价比，
高容量的替代栅阵列。
建立在经验积累与前面三个
成功的SRAM FPGA系列中， XC5200系列
带来了强大的功能设置为高密度可编程
逻辑设计。该VersaBlock逻辑模块，所述VersaRing
I / O接口，以及丰富的互联层次
资源相结合，提高设计的灵活性和
缩短产品的上市时间。
为XC5200系列完整支持交付
通过XACT熟悉的软件环境。该
XC5200系列完全支持流行的工作站上
和PC平台。流行的设计输入方法充分
支持包括ABEL ，原理图捕获和
合成。利用逻辑综合可以使用自己的设计师
现有的新思， Viewlogic系，导师，和卓越的工具
设计与XC5200器件。
最初的XC5200现场可编程门阵列家族成员
XC5202
2,200 -
2,700
8x8
64
256
84
10
XC5204
3,900 -
4,800
10 x 12
120
480
124
14
XC5206
6,000 -
7,500
14 x 14
196
784
148
16
XC5210
10,000 -
12,000
18 x 18
324
1,296
196
20
XC5215
14,000 -
18,000
22 x 22
484
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