4K
X4C105
NOVRAM / EEPROM
CPU监控与NOVRAM和输出端口
特点
4k位串行EEPROM
-400kHz串行接口速度
-16字节页写模式
一个半字节NOVRAM
-120ns NOVRAM访问速度
-AUTOSTORE
NOVRAM位 - 直接/总线访问
四个输出端口
工作电压为3.3V ± 10 ％
当低电压复位V
CC
＆ LT ; 3V
可用3％准确阈值
- 输出信号显示低电压状态
-Activates NOVRAM自动存储
对EEPROM的操作 - 内部块
最大EEPROM / NOVRAM非易失性写周期：
5ms
高可靠性
-1,000,000耐力周期
-Guaranteed数据保存：100年
20引脚TSSOP封装
描述
低电压X4C105集多种功能
成一个设备。该网络首先是一个2线， 4k位串行
EEPROM存储器写保护。一个写出的
TECT （ WP）引脚提供了硬件保障
防止意外写入此内存的上半部分。
一个一四位NOVRAM提供，并占据了赎罪
GLE位置。这使得4位访问在单个
为150ns周期。这是用于追踪系统操作有用
化或过程状态。该NOVRAM内存的COM
pletely分离从串行存储器部分。
低电压检测电路激活RESET引脚
当V
CC
低于3V 。此信号也阻止新
读或写操作和启动的NOVRAM
自动存储。该自动存储操作pow-
由一个外部电容器ERED以确保该值
在NOVRAM总是保持在一个事件
电源故障。
四NOVRAM位也出现在四个独立
输出引脚允许外部税务局局长的连续控制
cuitry ，诸如ASIC 。
Xicor公司的EEPROM进行设计和测试应用
系统蒸发散需要延长的续航能力。固有的数据
保持大于100年。
框图
WP
写控制逻辑
HV代
定时和控制
EEPROM
内存
静态RAM
内存
4Kbits
产量
缓冲器
和
锁存器
O0
O1
O2
O3
D0
D1
D2
D3
CE
OE
WE
帽
V
CC
V
SS
RESET
命令
解码
和
控制
逻辑
X解码器
SCL
SDA
S1
S2
EEPROM
ARRAY
I / O
缓冲器
Y译码
数据寄存器
低电压检测
上电复位
控制
逻辑
和
定时
电压
MONITOR
供应
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X4C105
PACKAGE /引脚配置
20引脚TSSOP
帽
S1
S2
CE
WE
OE
RESET
O3
O2
V
SS
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
V
CC
WP
SCL
SDA
D0
D1
D2
D3
O0
O1
一个WP引脚提供硬件写保护。在WP
引脚有效（高）防止写入的上半部分
内存。
这部分是一个4K位版本的一种工业标准
24C04器件。
NOVRAM节
该X4C105还包含NOVRAM的一个半字节，
与并行访问。此内存是完全异
从串行存储器部分迟来。该NOVRAM是
打算连接到系统存储器总线和
使用标准的CE， OE和WE引脚来控制访问。
一个NOVRAM （或非易失性RAM）由SRAM的
部和一个EEPROM的一部分。 SRAM被保存到
EEPROM只有当电源出现故障和EEPROM是
召回SRAM只有上电。
输出端口
引脚名称
针
V
SS
SDA
V
CC
SCL
WP
S1, S2
帽
D0–D3
RESET
CE
OE
WE
O0-O3
地
串行数据
动力
串行时钟
写保护
设备选择输入
外部自动存储电容器
NOVRAM的I / O
低电压检测输出
NOVRAM芯片使能
NOVRAM读信号
NOVRAM写信号
NOVRAM输出
描述
该X4C105有四只输出端口。这些都是
活性每当电源被施加到器件上。该
输出引脚重新FL学分的状态会将相应的价值
略去SRAM位。因此，这些端口引脚提供一个非
波动状态。在销的条件恢复
当电源被重新施加到器件上。这可以是
作为一个DIP开关的替代控制有价值
ASIC或其它系统逻辑的条件。
低电压检测
当内部低电压检测电路检测
即V
CC
低，几件事情发生：
- RESET引脚变为有效。
- 对SRAM的内容将自动保存
到的“阴影”的EEPROM 。
- 内部电路交换机提供电源的
从CAP引脚自动存储操作，从而在
存储操作可以在一个事件甚至完成
灾难性的停电。为了确保这一点，它是中建议
谁料，一个47μF的电容在使用CAP
引脚。电容器中连续加入
正常运行提供必要的电荷，以
完成存储操作。其他的内部电路
被关断，以减少电流消耗能很好地协同
荷兰国际集团的存储操作。
- 通信设备的中断，任何
命令中止。如果串行非易失性存储是
当电源出现故障的进步，操作的COM
完成并且后跟一个NOVRAM自动存储
周期。
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设备描述
串行内存条
该器件包含一个4k位EEPROM存储器阵列
具有内部地址计数器，它允许其是
顺序读取，通过它的整个地址空间
之后只接收1的详细地址。串行接口
包括当前地址读，无需输入
地址，但允许读取整个阵列的起始
从地址加上上次读或写的。该
地址计数器也用于写操作
其中，用户可以输入最多一页数据（16
字节）仅提供1个整体的地址后。
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X4C105
电容备份电路
在图1的图表显示了电容备份电路的表示。
图1 。
与内部
电源
V
CC
V
旅
当高
V
CC
＆ GT ; V
旅
当低
V
CC
＆ LT ; V
旅
-0.2V
开始
NOVRAM
自动存储
帽
串行接口
串行接口约定
该设备支持双向总线原型
山坳。该协议去连接网元发送数据的任何设备
到总线上作为发射器，以及所述接收装置
作为接收器。该设备控制传送是
称为主与被控制的设备是
所谓的奴隶。主人总是启动数据
传输，并提供时钟为发送和
接收操作。因此，在这个家庭设备
运行在所有应用程序的奴隶。
串行时钟和数据
SDA线上只能在改变数据状态
SCL为低电平。在SCL为高电平，SDA状态的改变是
用于指示启动和停止条件保留。看
图2中。
在SDA总线图2.有效数据的变化
SCL
SDA
数据稳定
数据更改
数据稳定
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X4C105
串行启动条件
所有的命令都冠以启动条件，
这是一个高到SDA从高到低的跳变时， SCL为
HIGH 。该设备持续监控SDA和
启动条件SCL线，也不会回应
直到这种情况下任何命令已经满足。看
网络连接gure 3 。
连续停止条件
所有的通信必须通过停止终止条件
化，这是一个由低到SDA时高过渡
SCL为高电平。停止条件也用来放置
该器件进入待机功耗模式后读
序列。可以后只能发出一个停止条件
发射装置已经发布了公交车。参见图2 。
串行确认
确认使用软件约定来表示
成功的数据传输。发射设备，无论是
主站或从站，将发送后释放总线
8比特。在第九个时钟周期，接收器将
拉SDA线拉低承认收到
的8位数据。请参考图4 。
该装置将使用后的消遣 - 应答响应
的起始条件，如果正确的设备ognition
Identi连接器和选位都包含在从
地址字节。如果选择一个写操作，则
设备将使用后的应答反应
收到每一个随后的8位字的。该装置
将确认所有的输入数据和地址字节，
除了从机地址字节时，该设备
identi网络连接器和/或选择位是不正确的，或者当
设备忙时，例如在一个非易失性写。
在读模式中，设备将发送8比特的
数据，释放SDA线，然后监视线的
承认。如果确认被检测到，没有
由主，该设备产生停止条件
将继续发送数据。该设备将终止
进一步的数据传输如果确认是不是
检测到。主机必须然后发出一个停止条件
返回设备进入待机模式，然后将
设备到已知状态。
图3.有效的起始和停止条件
SCL
SDA
开始
停止
图4.确认响应从接收器
从SCL
主
1
8
9
数据输出
来自发射机
数据输出
来自接收机
开始
应答
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X4C105
串行写操作
字节写
对于写操作，这种装置需要从
地址字节和字地址字节。这给出了
主机访问的数组中的词语的任何一种。
收到字地址字节的，该装置后
响应一个应答，并等待下一个
8位数据。接收到的8位的数据的后
字节时，器件再次产生确认。
然后主机终止传输通过生成
停止状态，此时，器件开始的
内部写周期到非易失性存储器。中
这个内部写周期，设备的投入被禁用，
因此该设备将无法从任何请求作出回应
高手。在SDA输出为高阻抗。参见图 -
URE 5 。
在尝试写入的内存保护块将
抑制应答位和操作
终止。
图5.字节写操作
从信号
法师
S
t
a
r
t
S
t
o
p
页写
该装置能够在页面写操作。这是
以相同的方式作为字节写入启动操作
化;但是，而不是终止在写周期之后的
科幻RST数据字节传送，主机可以发送
无限数量的8位字节。收到后
每个字节，该设备将与一个应答响应
缘，并且地址是内部加
1 。页面地址保持不变。当
计数器到达页面的结尾，它“翻转”和
返回到'0'在同一页上。这意味着该
主站可以写16字节的页面开始，在任何
位置在该网页上。如果主开始写作
位置10 ，并加载12个字节，则该网络连接第一个5个字节
被写入到15个位置10通过，而最后7
字节写入位置0到6之后，
地址计数器将指向该页面的位置7
这是刚刚写的。参见图6。如果主电源
超过16字节的数据，然后新的数据过写入
先前的数据，一次一个字节。
SLAVE
地址
字节
地址
数据
SDA总线
从信号
奴隶
0
A
C
K
A
C
K
A
C
K
图6.写入12字节到16字节的页起始地址为10 。
7字节
5个字节
地址
=6
地址指针
到此为止
地址= 7
地址
10
地址
n-1
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