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ICmic
TM
这X24C02设备已收购
IC微系统私人有限公司从Xicor公司,公司
IC MICROSYSTEMS
2K
X24C02
串行PROM ê
2
256 ×8位
特点
描述
该X24C02是CMOS 2048位串行PROM ê ,
内部组织256× 8 X24C02提供一个串行
接口和软件协议允许在一个操作
简单的两线总线。三个地址输入允许多达8个
2
2.7V至5.5V电源
低功耗CMOS
-active电流小于1mA
-Standby电流小于50
A
内部分为256 ×8
设备共享一个通用的两线总线。
Xicor公司ê的PROM的设计和测试应用程序
需要延长的续航能力。固有的数据
保持大于100年。提供DIP ,
MSOP和SOIC封装。
2
自定时写周期
5毫秒 - 典型写周期时间
2线串行接口
-Bidirectional数据传输协议
四字节页写操作
-Minimizes每字节写入时间总
高可靠性
-Endurance : 100,000次
- 数据保存: 100年
新的硬线 - 写控制功能
工作原理图
(8) V
CC
(4) V
SS
( 7 ) WC
启动循环
(5) ,SDA
开始
停止
H.V. GENERATION
定时
&放大器;控制
逻辑
控制
逻辑
从机地址
注册
( 6 ) SCL
(3) A2
(2) A1
(1) A0
+比较器
负载
INC。
XDEC
ê PROM
64 X 32
2
地址
计数器
读/写
YDEC
8
CK
数据寄存器
D
OUT
D
OUT
确认
3838 FHD F01
Xicor公司1991年专利待定
3838-1.2 96年7月30日T0 / C3 / D1 SH
1
特性如有变更,恕不另行通知
X24C02
引脚说明
串行时钟( SCL )
在SCL输入用于时钟的所有数据移入和移出的
装置。
串行数据( SDA )
SDA是用于传输数据流入和流出的双向引脚
该装置。这是一个漏极开路输出,可
线或任意数量的开漏或开
集电极输出。
漏极开路输出需要使用一个上拉
电阻器。选择典型值,请参考指南 -
计算的总线上拉典型值线
电阻器图。
地址(A
0
, A
1
, A
2
)
在地址输入用于设置至少显着的
3位7位从机地址。这些输入
可以是静态的或主动驱动。如果使用静态他们必须
连接到V
SS
或V
CC
适当的。如果积极
驱动时,它们必须被驱动到V
SS
或V
CC
.
写控制( WC )
写控制输入控制写入的能力
装置。当WC低(连接到V
SS
)的X24C02会
被使能来执行写操作。当WC是HIGH
(连接到V
CC
)内部的高压电路会
被禁用,所有的写操作将被禁止。
A
0
A
1
A
2
V
SS
引脚配置
DIP / SOIC / MSOP
1
2
3
4
X24C02
8
7
6
5
V
CC
WC
SCL
SDA
3838 FHD F02
引脚说明
符号
A
0
–A
2
SDA
SCL
WC
V
SS
V
CC
描述
地址输入
串行数据
串行时钟
写控制
+5V
3838 PGM T01
2
X24C02
设备操作
该X24C02支持双向总线协议
该协议去连接的网元将数据发送到任何设备
总线作为一个发送器和接收器的接收器。
该设备控制转移是一个主站,
设备被控制的奴隶。法师会永远
启动数据传输,并提供时钟为发射
和接收操作。因此, X24C02将
认为在所有应用中的奴隶。
时钟和数据约定
SDA线上的数据状态可以在SCL只能改变
低。在SCL为高电平,SDA状态的改变是重
曾用于指示启动和停止条件。请参阅
图1和图2 。
启动条件
所有的命令都冠以启动条件,
这是一个高到SDA从高到低的跳变时, SCL为
HIGH 。该X24C02连续监视SDA和SCL
为开始状态线,并且不会响应
直到这种情况下任何命令已经满足。
图1.数据有效性
SCL
SDA
数据稳定
数据
变化
3838 FHD F06
3
X24C02
该X24C02将一个应答响应
承认一个起始条件和从机地址。如果
停止条件
所有的通信必须通过一个停止条件终止,
这是一个由低到高的SDA的过渡,当SCL为
HIGH 。停止条件也用于由X24C02到
将器件置于备用电源模式后,读
序列。可以后只能发出一个停止条件
发射装置已经发布了
总线。
应答
确认使用软件约定来表示
成功的数据传输。发射设备,无论是
两个器件和一个写操作已经
选择后, X24C02将发出一个应答响应
每接收随后的8位字之后。
在读取模式中X24C02将发送8个数据位,
释放SDA线并监视线的
承认。如果确认被检测到,并没有停止
是由主机产生的条件,在X24C02
将继续发送数据。如果确认是不是
检测到时, X24C02将终止进一步的数据传输
任务。主机必须然后发出一个停止条件
返回X24C02到待机功率模式和
主站或从站,将发送后释放总线
8比特。在第九个时钟周期,接收器将
将SDA线拉低承认收到的
8位数据。请参考图3 。
将设备置于一个已知状态。
启动和停止图2.定义
SCL
SDA
开始位
停止位
3838 FHD F07
图3.确认从接收响应
从SCL
1
8
9
数据
产量
发射机
数据
产量
接收器
开始
应答
3838 FHD F08
4
X24C02
设备寻址
在开始状态之后,主机必须输出
它正在访问的从站的地址。最显着的
4位从属的是设备类型标识符
(参见图4) 。对于X24C02这个固定为1010 [B ] 。
继启动条件之后, X24C02监视
比较从地址SDA总线上传送
与A的从地址(设备类型和状态
0
, A
1
A
2
输入) 。当一个正确的比较X24C02输出
承认在SDA线上。根据不同的状态
R / W位, X24C02将执行一个读或写
操作。
图4.从地址
写操作
设备类型
识别码
1
0
1
0
A2
A1
A0
读/写
字节写
对于写操作, X24C02需要第二
解决网络连接场。该地址连接场是字地址,
由8位,提供访问的任何一个
256字的内存。一旦接收到该字的
设备
地址
3838 FHD F09
解决X24C02响应一个应答,并
等待下一个8位数据,再次响应
产生确认。然后主机终止
通过产生一个停止条件转移,在该时间的
X24C02开始内部写周期到非易失性
内存。而内部写周期正在进行中的
X24C02输入被禁止,并且设备不会
响应来自主站的请求。请参阅
图5为地址,确认和数据传输
序列。
接下来的三个显著位地址的特定设备。
系统可以有多达八个X24C02设备
总线(参见图10) 。八个地址由定义
在A的状态
0
, A
1
AND A
2
输入。
从机地址的最后一位定义操作要
进行。当设置为1的读出操作是
选择,当设定为零的写操作被选择。
图5.字节写
S
T
总线活动:
A
R
T
S
SLAVE
地址
地址
数据
S
T
O
P
SDA线
总线活动:
X24C02
P
A
C
K
A
C
K
A
C
K
3838 FHD F010
图6.页写
S
T
总线活动:
A
R
SLAVE
地址
ADDRESS (N )
数据N
数据n + 1
数据n + 3
S
T
O
P
T
S
A
C
A
C
A
C
A
C
A
C
SDA线
总线活动:
X24C02
P
K
K
K
K
K
注:在本例中,N = XXXX 000( B) ; x = 1或0
3838 FHD F011
5
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