W83195AR-We
3 200MHZ -DIMM时钟WHITNEY CHIPSET
1.0概述
该W83195AR ，我们是一个时钟合成器的英特尔索拉诺芯片组。 W83195AR ，我们提供所有
所需的高速RISC或CISC微处理器的时钟，并且还提供64个不同的
的CPU ，SDRAM ，PCI 3V66的频率， IOAPIC钟表频率设置。所有时钟都从外部
可选择具有平滑的过渡。
该W83195AR -我们提供集成电路串行总线接口进行编程寄存器来启用或禁用
每个时钟输出，并提供了0.5 ％和0.75 ％中心型扩频降低EMI 。
该W83195AR ，我们接受14.318 MHz参考晶振作为输入并运行在一个3.3V电源。
高驱动PCI和SDRAM时钟输出通常为大于1 V / ns的转换速率为30
pF的负载。 CPU时钟输出通常提供优于1 V / ns的转换速率为20 pF的负载为
保持50±5 ％的占空比。固定频率输出， REF ， 24MHz的，和48兆赫提供
比0.5V更好/ ns的压摆率。
2
2.0产品特点
2个CPU时钟
12 SDRAM的时钟3的DIMM
8个PCI同步时钟。
可选择单一或混合供电：
（ VDDR = VDDP = VDDS = Vdd48 = VDD3 = 3.3V ， VddLAPIC = VddLCPU = 2.5V ）
斜形的CPU与PCI时钟-1至4纳秒，中心2.6纳秒
与选择，从66.8到平滑的频率开关
200
兆赫
2
2
I C 2线串行接口和I C回读
为0.5％和0.75％的中心型扩频
可编程寄存器使能/停止每个输出和选择模式
（模式三态或正常）
两个48 MHz的引脚， USB
24 MHz的超级I / O
56 -pin SSOP封装
-1-
出版日期： 1999年7月
修订版0.51
W83195AR-We
初步
4.0频率选择硬件
SSEL4 SSEL3 SSEL2 SSEL1 SSEL0
中央处理器
（兆赫）
SDRAM
（兆赫）
中央处理器
/ SDRAM
3V66
（兆赫）
PCI （兆赫） IOAPIC （兆赫） IOAPIC （兆赫）
APIC_SEL = 1 APIC_SEL = 0
0
0
0
0
0
0
0
0
0
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0
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1
0
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0
1
0
1
83.3
90
75
72
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95.25
121
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119
114
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105
66.8
100.2
133.6
133.6
135
125
127
130
140
136
166
155
150
117
107
100.9
145
140
138
137
124.95
90
112.5
108
133.6
95.25
121
124
119
114
110
105
100.2
100.2
133.6
100.2
101.25
125
127
130
140
136
166.00
155
112.5
117
107
100.9
108.75
105
103.5
102.75
2/3
1
2/3
2/3
2/3
1
1
1
1
1
1
1
2/3
1
1
4/3
4/3
1
1
1
1
1
1
1
4/3
1
1
1
4/3
4/3
4/3
4/3
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60.00
75.00
72.00
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63.50
80.67
82.67
79.33
76.00
73.33
70.00
66.80
66.80
66.80
66.80
67.50
83.33
84.67
86.67
70.00
68.00
83.00
77.50
75.00
78.00
71.33
67.27
72.50
70.00
69.00
68.50
41.65
30.00
37.50
36.00
44.53
31.75
40.33
41.33
39.67
38.00
36.67
35.00
33.40
33.40
33.40
33.40
33.75
41.67
42.33
43.33
35.00
34.00
41.50
38.75
37.50
39.00
35.67
33.63
36.25
35.00
34.50
34.25
20.83
15.00
18.75
18.00
22.27
15.88
20.17
20.67
19.83
19.00
18.33
17.50
16.70
16.70
16.70
16.70
16.88
20.83
21.17
21.67
17.50
17.00
20.75
19.38
18.75
19.50
17.83
16.82
18.13
17.50
17.25
17.13
41.65
30.00
37.50
36.00
44.53
31.75
40.33
41.33
39.67
38.00
36.67
35.00
33.40
33.40
33.40
33.40
33.75
41.67
42.33
43.33
35.00
34.00
41.50
38.75
37.50
39.00
35.67
33.63
36.25
35.00
34.50
34.25
-3-
出版日期： 1999年7月
修订版0.51
W83195AR-We
初步
5.0
串行控制0REGISTERS
引脚列列出受影响的引脚数量和@PowerUp列给出的状态真
上电。寄存器被设置为只对真正的力量了显示的值。 "Command Code"字节
"Byte Count"字节必须按照地址字节的确认发送。虽然数据
（比特）在这两个字节被认为是"don't care" ，它们必须被发送，并且将确认。
在此之后，下面描述的序列（寄存器0和寄存器1 ，寄存器2，... ），将是有效的，并
承认。
频率表设置由I2C （ SEL5 SEL0 ）
上证
L5
SS
EL4
SS
EL3
SS
EL2
SS
EL1
SS
EL0
中央处理器
（兆赫）
SDRAM
（兆赫）
CPU / S
DRAM
3V66
（兆赫）
PCI （M
赫兹）
IOAPIC （兆赫）
APIC_SEL=1
IOAPIC （兆赫）
APIC_SEL=0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
1
1
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1
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0
0
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0
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0
0
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0
0
0
0
0
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0
0
1
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0
0
0
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0
0
0
0
1
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0
0
0
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0
0
0
0
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0
0
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0
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0
0
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0
0
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0
0
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1
0
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0
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0
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0
1
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0
1
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0
1
0
1
0
1
0
1
0
83.3
90
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72
89.07
95.25
121
124
119
114
110
105
66.8
100.2
133.6
133.6
135
125
127
130
140
136
166
155
150
117
107
100.9
145
140
138
124.95
90
112.5
108
133.6
95.25
121
124
119
114
110
105
100.2
100.2
133.6
100.2
101.25
125
127
130
140
136
166.00
155
112.5
117
107
100.9
108.75
105
103.5
2/3
1
2/3
2/3
2/3
1
1
1
1
1
1
1
2/3
1
1
4/3
4/3
1
1
1
1
1
1
1
4/3
1
1
1
4/3
4/3
4/3
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60.00
75.00
72.00
89.07
63.50
80.67
82.67
79.33
76.00
73.33
70.00
66.80
66.80
66.80
66.80
67.50
83.33
84.67
86.67
70.00
68.00
83.00
77.50
75.00
78.00
71.33
67.27
72.50
70.00
69.00
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36.00
44.53
31.75
40.33
41.33
39.67
38.00
36.67
35.00
33.40
33.40
33.40
33.40
33.75
41.67
42.33
43.33
35.00
34.00
41.50
38.75
37.50
39.00
35.67
33.63
36.25
35.00
34.50
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15.00
18.75
18.00
22.27
15.88
20.17
20.67
19.83
19.00
18.33
17.50
16.70
16.70
16.70
16.70
16.88
20.83
21.17
21.67
17.50
17.00
20.75
19.38
18.75
19.50
17.83
16.82
18.13
17.50
17.25
41.65
30.00
37.50
36.00
44.53
31.75
40.33
41.33
39.67
38.00
36.67
35.00
33.40
33.40
33.40
33.40
33.75
41.67
42.33
43.33
35.00
34.00
41.50
38.75
37.50
39.00
35.67
33.63
36.25
35.00
34.50
-4-
出版日期： 1999年7月
修订版0.51
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