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W83194AR-W

150MHZ时钟WHITNEY CHIPSET

1.0概述

该W83194AR -W是一个时钟合成器的英特尔惠特尼芯片组。 W83194AR -W提供了所有

所需的高速RISC或CISC微处理器的时钟，并且还提供64个不同的

的CPU ，SDRAM ，PCI 3V66的频率， IOAPIC钟表频率设置。所有时钟都从外部

可选择具有平滑的过渡。

该W83194AR -W提供了我

C串行总线接口进行编程的寄存器来启用或禁用

每个时钟输出，并提供了0.5 ％和0.75 ％中心型扩频降低EMI 。

该W83194AR -W接受14.318 MHz参考晶振作为输入并运行在一个3.3V电源。

高驱动PCI和SDRAM时钟输出通常为大于1 V / ns的转换速率为30

pF的负载。 CPU时钟输出通常提供优于1 V / ns的转换速率为20 pF的负载为

保持50 5 ％的占空比。固定频率输出， REF ， 24MHz的，和48兆赫提供

比0.5V更好/ ns的压摆率。

2.0产品特点

2个CPU时钟

9 SDRAM的时钟2个DIMM

8个PCI同步时钟。

可选择单一或混合供电：

（ VDDR = VDDP = VDDS = Vdd48 = VDD3 = 3.3V ， VDDA = VDDC = 2.5V ）

斜形的CPU与PCI时钟-1至4纳秒，中心2.6纳秒

与选择平滑的频率切换，从66.8到150MHz的

C 2线串行接口和I

回读

为0.5％和0.75％的中心型扩频

可编程寄存器使能/停止每个输出和选择模式

（模式三态或正常）

两个48 MHz的引脚， USB

24 MHz的超级I / O

48引脚SSOP封装

-1-

出版日期：五月。 1999

修订版0.50

W83194AR-W

初步

3.0引脚配置

REFX2/*FS3

VDDR

XIN

XOUT

VSS

Vdd3

3V66-0

3V66-1

Vss3

PCICLK0 / * FS0

PCICLK1 / FS1 ＃

PCICLK2/*FS2

VSSP

PCICLK3/FS4#

PCICLK4

VDDP

PCICLK5

PCICLK6

PCICLK7

Vss48

48MHz_0

48MHz_1

*SIO_SEL/24_48MHz

Vdd48

VddLAPIC

IOAPIC

VddLCPU

CPUCLK0

CPUCLK1

VSSC

VDDS

SDRAM 0

SDRAM 1

SDRAM 2

VssS

SDRAM 3

SDRAM 4

SDRAM 5

VDDS

SDRAM 6

SDRAM 7

SDRAM 8

VssS

PD ＃

* SDCLK

VDDA

VSSA

* SDATA

-2-

出版日期：五月。 1999

修订版0.50

W83194AR-W

初步

4.0引脚说明

IN - 输入

输出 - 输出

I / O - 双向引脚

＃ - 低电平有效

* - 内部250kΩ拉

4.1水晶I / O

符号

XIN

XOUT

针

I / O

OUT

功能

晶振输入，带内部负载电容和

反馈电阻。

晶体输出14.318MHz标称。

4.2的CPU ， SDRAM ， PCI ， IOAPIC时钟输出

符号

CPUCLK [0：1 ]

PD ＃

IOAPIC

SDRAM的[0： 8]

针

45,44

41,40,

39,37,36,35,33

,32,31

I / O

OUT

功能

低偏移（ < 250PS ）的主机时钟输出

频率，诸如CPU和芯片组。

掉电模式驱动为低电平时。

时钟输出同步于PCI时钟

本站由VDDA 。

SDRAM时钟输出。

PCICLK0 / * FS0

I / O

PCICLK1 / FS1 ＃

I / O

PCICLK2 / * FS2

I / O

PCICLK3 / FS4 ＃

I / O

PCICLK [4： 7]

3V66 [0:1]

15,17,18,19

7,8

OUT

在正常操作期间的3.3V 33MHz的PCI时钟。

锁存输入FS0在初始上电的H / W

选择的CPU， SDRAM的输出频率与

PCI时钟。

低偏移（ < 250PS ） PCI时钟输出。

锁存输入FS1在初始上电的H / W

选择的CPU， SDRAM的输出频率与

PCI时钟。

低偏移（ < 250PS ） PCI时钟输出。

锁存输入FS2在初始上电的H / W

选择的CPU， SDRAM的输出频率与

PCI时钟。

低偏移（ < 250PS ） PCI时钟输出。

锁存输入FS4在初始上电的H / W

选择的CPU， SDRAM的输出频率与

PCI时钟。

低偏移（ < 250PS ） PCI时钟输出。

3.3V输出的时钟芯片组。

-3-

出版日期：五月。 1999

修订版0.50

W83194AR-W

初步

4.3 I

C控制接口

符号

* SDATA

* SDCLK

针

I / O

功能

我的串行数据

内部C 2线控制接口

上拉电阻。

我串行时钟

与C 2线控制接口

内部上拉电阻。

4.4固定频率输出

符号

REFX2 / * FS3

针

I / O

功能

14.318MHz的参考时钟。这REF输出为

更强的缓冲ISA总线的负载。

暂停PCICLK （ 0 ： 4 ）时钟的逻辑0电平，当输入

低（在移动模式。 MODE = 0时）

*SIO_SEL/24_48MHz

I / O

的24MHz或48MHz的输出时钟。

锁存输入SIO_SEL在初始上电的

24MHz的输出频率（高）和48MHz的（低）

时钟。

48MHz的[ 0 ： 1 ]

21,22

I / O

48MHz的输出用于USB正常操作期间。

4.5电源引脚

符号

VDDL

Vdd48

Vdd3

VDDP

VDDR

VDDS

VDDA

VSS

针

42,34

功能

电源为CPU & IOAPIC ， 2.5V或3.3V 。

电源的输出为48MHz ， 3.3V 。

电源为3V_66输出， 3.3V 。

电源为PCICLK ， 3.3V 。

电源为REFX2 ， 3.3V 。

电源的SDRAM [ 0 ： 8 ] ，标称3.3V 。

电源I2C CLK和数据。

5,9,13,20,26,30,38 ，电路接地。

-4-

出版日期：五月。 1999

修订版0.50

W83194AR-W

初步

5.0频率选择硬件

FS4

FS3

FS2

FS1

FS0

中央处理器

（兆赫）

SDRAM

（兆赫）

3V66(MHz)

PCI （兆赫）

= 3V66/2

IOAPIC （兆赫）

= PCI / 2

83.3

150

138

95.25

129

124

119

114

110

105

66.8

100.2

133.6

125

113

150

138

95.25

129

124

119

114

110

105

100.2

133.3

125

127

130

140

136

145

155

121

117

112

107

66.8

100.2

100.9

133.3

125

127

130

108

140

136

145

155

121

117

112

107

100.2

100.9

63.5

73.3

66.8

66.7

83.33

84.67

86.67

66.8

67.3

41.7

37.7

37.5

34.6

31.75

41.4

39.8

36.7

33.4

33.3

33.6

33.3

41.67

42.34

43.33

36.1

35.1

33.9

36.3

38.8

40.5

38.9

37.3

35.7

33.4

33.6

20.85

18.85

18.75

17.3

15.88

21.5

20.7

19.9

18.35

17.5

16.7

16.8

16.7

20.83

21.17

21.67

18.05

17.55

16.95

18.15

19.4

20.25

19.45

18.65

17.85

16.7

16.8

133.6

66.7

33.3

16.7

-5-

出版日期：五月。 1999

修订版0.50

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