VSP7500
VSP7502
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SBES015A - 2010年12月 - 修订2011年1月
四通道图像传感器模拟前端
检查样品：
VSP7500 ， VSP7502
1
特点
四通道信号路径
- VSP7500 ：支持CDS输入
- VSP7502 ：支持SH输入
最大数据吞吐量： 56兆赫
双输入的每一个信号路径
16位A / D转换：
- 无失码有保证的
可编程增益放大器（ PGA ） ：
- 模拟前端增益：0 dB到9.6分贝
（ 0.28 - dB步进）
- 数字增益：0 dB到32分贝
（ 0.032 dB的步）
的输入共模电压范围广
工作电压和功耗：
- 电压： 1.65 V至1.95 V和2.7 V至3.6 V
功率： 400毫瓦
（在VDD = 1.8 V，F
MCLK
= 50兆赫）
应用
数码摄像机（DVC ）
数码相机（DSC ）
对于多通道传感器前端
高速机器视觉
高分辨率监控摄像机
高速/高分辨率扫描仪
医
2
描述
该VSP7500 / VSP7502是四通道模拟
前端（ AFE的）进行成像的信号。这些设备
包括相关双采样（ CDS）
可编程增益放大器（PGA） ，模拟 - 数字
转换器（ADC ） ，输入钳位，光学黑色（OB ）的水平
夹紧环，串行接口，和可调节的采样
定时控制。该VSP7502提供相同的
功能与采样/保持（S / H）的模式，以
支持
CMOS
和
CIS
传感器。
该
VSP7500 / VSP7502提供的BGA -159
封装。
1
2
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
所有商标均为其各自所有者的财产。
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PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
VSP7500
VSP7502
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这个集成电路可以被ESD损坏。德州仪器建议所有集成电路与处理
适当的预防措施。如果不遵守正确的操作和安装程序，可以造成损坏。
ESD损害的范围可以从细微的性能下降，完成设备故障。精密集成电路可能会更
容易受到伤害，因为很小的参数变化可能导致设备不能满足其公布的规格。
订购信息
(1)
产品
VSP7500
VSP7502
(1)
套餐 -
领导
BGA-159
BGA-159
包
代号
zwv
zwv
特定网络版
温度
范围
-25 ° C至+ 85°C
-25 ° C至+ 85°C
包
记号
VSP7500ZWV
VSP7502ZWV
订购
数
VSP7500ZWV
VSP7500ZWVR
VSP7502ZWV
VSP7502ZWVR
传输介质，
QUATITY
纸盒， 360
磁带和卷轴， 3000
纸盒， 360
磁带和卷轴， 3000
对于最新的封装和订购信息，请参阅封装选项附录本文档的末尾，或者访问
器件产品文件夹在
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绝对最大额定值
(1)
在工作自由空气的温度范围内，除非另有说明。
VSP7500 ， VSP7502
电源电压
（ AVDD2 ， DLLVDD2 ， REFVDD ， DRVDD2 ， DVDD2 ， DVDD2_SPI ）
电源电压
（ AVDD3 ， RGVDD3 ， H1VDD3 ， H2VDD3 ， DVDD3 ， DVDD3_SPI ）
电源电压差（除电源引脚）
接地电压差（其中GND引脚）
数字输入电压
（ ATPG ， MN_DM ， MN_KBLK ， MN_OB ， MN_PBLK ）
数字输入电压
（HD ， VD ， MCLK ， RST ， SCLK ， SCS ， SDI ）
模拟输入电压
（ IN_W ， IN_X ， IN_Y ， IN_Z ， IP_W ， IP_X ， IP_Y ， IP_Z ）
输入电流（所有引脚除了电源）
在偏置环境温度
储存温度
结温
封装温度（回流，峰值）
(1)
2.4
4
±0.1
±0.1
-0.15至（ DVDD2 + 0.15 ）
-0.3 （ DVDD3 + 0.3 ）
-0.3 （ AVDD3 + 0.3 ）
±10
-40到+125
-55到+150
+150
+260
单位
V
V
V
V
V
V
V
mA
°C
°C
°C
°C
强调以上这些额定值可能会造成永久性的损害。长期在绝对最大条件下工作会
降低设备的可靠性。这些压力额定值只，设备的这些功能操作或以后的任何其他条件
这些规定是不是暗示。
2
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VSP7500 VSP7502
VSP7500
VSP7502
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电气特性
(1)
所有规格在T
A
= + 25 ℃，所有的电源电压= 3 V，且转化率= 36兆赫，除非另有说明。
VSP7500 ， VSP7502
参数
电源
AVDD2
REFVDD
模拟电源
电压
DLLVDD2
LVAVDD
LVDLLVDD
AVDD3
DVDD2
DVDD2_SPI
DRVDD2
数字电源
电压
DVDD2_SPI
LVDVDD
DRVDD2
DVDD3
DVDD3_SPI
H- TG供应
电压
功耗
决议
决议
吞吐率
最大的数据吞吐速率
信号路径
信号路径
数字输入
逻辑系列
I
IH
I
IL
输入电容
数字输出（ CMOS缓冲器RG ， H1 ， H2 ， LH ）
V
OH
V
OL
模拟量输入
输入信号电平为满量程出
输入电压
输入电容
输入极限
参考
正参考电压
负参考电压
输入钳位
夹式电阻
钳位电平
2
1.8
k
V
1.25
0.75
V
V
GND - 0.3
为INP引脚
对于INN引脚
GND
10
VCC + 0.3
增益= 0分贝
1
VCC
V
PP
V
V
pF
V
输出电压
逻辑高，我
OH
= -2毫安
逻辑低电平时，我
OL
= 2毫安
VDD - 0.3
VDD + 0.3
V
V
输入电流
逻辑高电平，V
IN
= +1.8 V
逻辑低电平时， V
IN
= 0 V
40
50
5
CMOS
1
1
60
mA
mA
%
pF
VCC = 3 V
4
频道
50
56
兆赫
16
位
HVDD3
VDD = （典型值） ，女
MCLK
= 50MHz的
掉电模式（F
MCLK
= 0兆赫）
2.7
2.7
3
3
400
10
3.6
3.6
V
V
mW
mW
1.65
1.8
1.95
V
2.7
3
3.6
V
1.65
1.8
1.95
V
测试条件
民
典型值
最大
单位
MCLK时钟占空比
(1)
所有列出的值是初步。评价后才能确定最终值。
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VSP7500 VSP7502
VSP7500
VSP7502
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电气特性
(1)
（续）
所有规格在T
A
= + 25 ℃，所有的电源电压= 3 V，且转化率= 36兆赫，除非另有说明。
VSP7500 ， VSP7502
参数
传输特性
微分非线性（ DNL ）
积分非线性（ INL ）
无失码
阶跃响应稳定时间
过载恢复时间
数据延迟
信噪比
(2)
测试条件
民
典型值
最大
单位
±1
±32
保证
满量程阶跃输入
阶跃输入1.8 V至0 V
1
2
11
接地输入电容
–200
其中每个通道
–77
77
200
最低位
最低位
像素
像素
钟
dB
mV
dB
传感器偏移校正范围
通道隔离度
可编程增益（模拟）
模拟增益的可编程范围
模拟增益的可编程步
模拟增益步monotonocity
模拟增益误差
可编程增益（数字）
数字增益可编程范围
数字增益可编程步
光学黑CLAMP （ OBCLP ） LOOP
环路时间常数
可编程范围
钳位电平
光学黑色钳位电平
OBCLP水平代码=
1000 0000 0000B （中）
OB级程序步骤
主要的模拟OB CLAMP LOOP
OB DAC分辨率
OB DAC满量程电压
LVDS缓冲器（ D0 ， D1 ， CKS）
R
L
|V
OD
|
Δ|V
OD
|
差分负载阻抗
微分稳态输出电压
大小
改变稳态差分输出
相反的二进制之间的电压幅值
国
稳态共模输出电压
峰对峰的共模输出
输出短路电流
高阻态输出电流
输出= GND
V
O
= 0 V至VCC
R
L
= 100
R
L
= 100
COM_SEL = 0（ 0.9 V模式）
COM_SEL = 1（ 1.2 V模式）
对于设定增益
0
0.28
保证
+9.6
dB
dB
0.5
dB
0
0.032
32
dB
dB
40.7
1024
2048
1
3072
ms
最低位
最低位
最低位
6
±250
位
mV
90
90
100
110
110
mV
15
0.7
1
20
–6
–10
1.1
1.4
50
6
10
mV
V
V
mV
mA
mA
V
OC （ SS ）
V
OC （ PP ）
I
OS
I
OZ
温度范围
工作温度
–25
+85
°C
(2)
SNR = 20日志（满量程电压/均方根噪声） 。
4
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VSP7500
VSP7502
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功能框图
Mn_HBLK
Mn_PBLK
Mn_DM
Mn_OB
HD
VD
MCLK RST SDATA SCLK SCS
串行接口与内部时序控制
长×宽
MCLK
卜FF器
电压DAC
解码器
RP_W
国内
参考
CM_W
RN_W
IN_W
IP_W
SHP
CDS
S / H
频道W
16位ADC
OB
更正
数字
块
DW_0+
D8
-
D15
串行器
并行加载
8位移位寄存器
D0
-
D7
LVDS
DW_1-
L_X
LVDS
DW_0-
钳
SHP / SHD一
ADCK
DIGCK
DIGCK
DW_1+
卜FF器
电压DAC
解码器
RP_X
国内
参考
CM_X
RN_X
IN_x
IP_X
SHP
CDS
S / H
通道x
16位ADC
OB
更正
数字
块
DX_0+
D8
-
D15
串行器
并行加载
8位移位寄存器
D0
-
D7
LVDS
DX_1-
BYPD
RG
H1
H2
DLL
CKS_0+
LVDS
CKS_0-
LV_DLL
CKS_1+
MCLK
LVDS
CKS_1-
升？
BYPD_LV
LVDS
DX_0-
钳
SHP / SHD一
ADCK
DIGCK
DIGCK
DX_1+
卜FF器
电压DAC
解码器
RP_Y
国内
参考
CM_Y
RN_Y
IN_Y
IP_Y
SHP
CDS
S / H
通道Y
16位ADC
OB
更正
数字
块
DY_0+
D8
-
D15
串行器
并行加载
8位移位寄存器
D0
-
D7
DY_1-
L_Z
DY_0-
钳
SHP / SHD一
ADCK
DIGCK
DIGCK
DY_1+
卜FF器
电压DAC
解码器
RP_Z
国内
参考
CM_Z
RN_Z
IN_Z
IP_Z
SHP
CDS
S / H
通道Z
16位ADC
OB
更正
数字
块
DZ_0+
D8
-
D15
串行器
并行加载
8位移位寄存器
D0
-
D7
DZ_1-
DZ_0-
钳
SHP / SHD一
ADCK
DIGCK
DIGCK
DZ_1+
注： VSP7500 = CDS ， VSP7502 = SH 。
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