【Vitesse公司半导体公司数据表VSC834特点 17输入17输出交叉点开关 2.5Gb / s的】,IC型号VSC834UB,VSC834UB PDF资料,VSC834UB经销商,ic,电子元器件-51电子网

Vitesse公司

半导体公司

数据表

VSC834

特点

17输入17输出交叉点开关

2.5Gb / s的NRZ数据带宽

42 Gb / s的总带宽

TTL兼容

接口

差分PECL数据输入

2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

片上50Ω输入端接

50Ω电源端接PECL输出驱动器

3.3V单电源供电

9W最大功率耗散

高性能256引脚BGA封装

概述

该VSC834是一款单芯片17x17异步交叉点开关设计进行宽带数据

流以高达2.5Gb / s的。无阻塞交换机核心是通过一个并行微处理器编程接口

面，可以让每个输出端口的随机存取程序。信号完整性的高度就会维持

通过芯片通过完全差分信号路径tained 。

的交叉点函数是基于一个多路转换器树结构。 1：各数据输出是由17驱动

复用器树，可以被编程到一个且仅一个的17个输入端，每个数据输入可以是亲

编程为多路输出。信号路径被注销，所以没有时钟所需的数据输入。该

信号路径是异步的，所以有在相位，频率或信号在每一个输入模式没有任何限制。

每个输入信道具有可以被用来识别活性（ LOA）的损失活动监测器的功能。一个跨

中断引脚提供到信号总长度，在这之后的外部控制器可以查询该芯片以确定信

NEL （多个）在其上发生故障。

每路输出驱动器是一个全差分开关电流驱动器与模背终端的马克西 -

妈妈的信号完整性。数据输入是通过50端接在模

电阻器连接到V

TERM

并行接口采用TTL电平，并提供地址，数据和控制管脚可以兼容

微处理器风格的界面。控制端口可以访问所有的芯片功能，包括LOA和

编程。程序的缓冲设置，以允许多个程序分配给排队并发出

通过一个单一的configure命令同时进行。

VSC834框图

A16

控制逻辑

接口

Y16

G52247-0 ，版本4.2

02/09/01

Vitesse公司

半导体公司

741卡莱普莱诺卡马里奥， CA 93012

联系电话：（ 800 ） VITESSE 传真：（ 805 ） 987-5896 电子邮件： prodinfo@vitesse.com

互联网： www.vitesse.com

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2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

图1 ：详细的框图：

数据表

VSC834

A， AN [ 16 ： 0 ]

LOA

MONITOR

程序存储器

输出驱动器

17x17

核心交换机

Y， YN [ 16 ： 0 ]

控制界面

DATA [ 4：0] ，ADDR [5：0 ]

ALE ， CSB ， WRB ， RDB INTB ，

MONCLK ， CONFIG

功能说明

数据路径

所有的输入数据必须是微分并偏置到PECL电平。片上端接提供了

50标称阻抗

。所有的输入端接电阻连接到V

TERM

数据输出通过带片上端接差动电流开关产生一个提供

PECL电平输出摆幅。输出电路的驱动电平被设计为产生标准的PECL电平

当50终止

至2.0V 。其它终止电压是可能的，如到V

或1.3V ，但电压

的输出摆动的年龄水平将从其标称值进行移位。输出的共模电压

摆动可以使用VCOM引脚进行调节。调整范围未校准，但通常允许

关于调整输出共模电压为+ 200mV的。

输出信道可以在对断电如果少于17输出是必需的。通过连接VEE

销与给定对输出到V相关联的

，输出对将拉至V

和芯片功耗会

减少了约200mW的。

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VSC834

2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

编程接口

交换机核心可以通过并行接口电路，它允许随机读或写操作的编程

程序存储器阵列。程序存储器阵列进行缓冲，以允许将多个编程指令

可以同时装载有将CONFIG管脚。并行编程可以主频高达50MHz的速度。

节目数据是由两部分组成：输出地址和输入地址。输出地址，记

由ADDR [ 5：0] ，则指定该输出信道是要被编程。输入地址，记为DATA [ 4：0] ，

指定开关片应该连接到哪个输入端口。节目数据的格式是简单的二进制，

其中二进制值直接映射到交换机切片位置和/或输入端口号。例如：

ADDR [ 5：0] （ 000100 ） / DATA [4： 0]（ 00110 ）就直接输出通道Y4连接到输入通道的A6 。该

编程状态可被验证（回读）通过将期望的输出的地址和断言

RDB 。编程状态是未知的，在电源接通。附加的地址空间提供了一种用于访问

显示器寄存器（见表2）。微处理器接口由以下信号。水平TTL

（见表6）。

表1 ：信号表

针

D[5:0]

A[5:0]

ALE

CSB

WRB

RDB

INTB

I / O

描述

双向数据总线将数据从内部程序寄存器传输到/

地址总线，选择内部程序寄存器的读写操作

地址锁存使能：与复用的地址/数据总线使用。内部锁存地址总线

当低。

片选（低电平有效）：断言该引脚每当一部分被读取或编程。

写（低电平有效）：程序数据将被传输到所述第一级的内部寄存器的上升

这个信号的上升沿（当CSB也低）。

阅读（低电平有效）：从内部程序的程序数据或监控寄存器将读出的

当该信号变低（与CSB还低）的数据总线。

中断（低电平有效）：此信号置位时，发现了一个LOA条件

配置（高电平有效）：断言这个信号，从第一级传送队列中的节目信息

内部寄存器的第二级寄存器中，使得编程生效。这个信号可以是

拉高离开第二级寄存器透明的，所以所有的编程生效

马上。公务员事务局必须有效（低）时， CONFIG是断言。 CONFIG可连接到高

地址总线的位序

监视器的状态被转移并监控该信号的上升沿寄存器。 MONCLK不

预计超过3MHz的。

CONFIG

MONCLK

活性的丧失（ LOA ）监测

的总长功能包括在每个输入信道活动监测器，直接连接到焊盘的。

一个监视器的状态（是否已经过位变由一个输入转换）可以通过应用被观察

的地址（见表2）的对应于感兴趣的信号的监控寄存器和断言的RDB 。每

监控寄存器为4位的长度，面积达4输入或输出状态。还有一个额外的一比特

监控每个的17

输入和17

输出。每个监视器的状态传送到寄存器周期就

ically上MONCLK的上升沿，于是活动监视器clered直到更多的活动被检测到。

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与输入信号的活动（ ISA ）监测

数据表

VSC834

如果通过MONCLK取样后出现在监控状态的任何变化，中断将被发信号

断言INTB ，并且用户必须通过读取显示器状态识别出错的信道。中断

当相应的活动监视器读取将被清除，但显示器的状态不会改变。如果

多显示器已触发中断，它会继续下去，直到所有的相应的显示器一直

读取。

该LOA电路需要30-150 mV峰峰值的最小信号电平来识别输入的

活跃的。这是必需的，以区分于未连接的信号（其中两个输入端浮到终止噪声

电压）由一个活信号活性。最少两个转变的定义活动。阈值信号

电平可以与VHYS销，它可以从零设置阈值，以允许的最大输入来调整

摆动。该VHYS引脚将自偏置到一个二项式值，这将是适合于大多数应用程序（ 30-150mV

P-P的输入电平）。虽然未标定的额定电平，增益和线性度，在VHYS引脚可以从外部

集调整在输入信号的整个范围内的阈值电平，从零到最大电平

在输入允许的。

表2 ：存储器映射

地址

00h

01h

...

10h

11h

...

20h

21h

22h

23h

24h

25h

ACCESS

读/写

...

读/写

...

读/写

R / O

输出Y1的编程输入通道

...

输出Y16的编程输入通道

描述

输出Y0的编程输入通道（写，然后断言CONFIG编程）

内部输出Y17的编程输入通道

...

内部输出Y32的编程输入通道

接收活动监视器输入A0 ， A1 ， A2，A3

接收活动监视器的输入A4 ， A5 ， A6 ， A7

接收活动监控输入A8 ， A9 ， A10 ， A11

接收活动监视器的输入A12 ， A13 ， A14 ， A15

接收活动监视器的输入A16

（逻辑'1'=无活动）

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数据表

VSC834

AC特性

表3 ：数据路径

参数

率

ISKW

OSKW

, t

数据速率

输入通道的时延差（ 1 ）

输出通道时延差（ 2 ）

高速输入上升/下降时间， 20％至80 ％（3）

高速输出上升/下降时间， 20 ％至80％

输出数据眼图抖动，峰峰值， 2

PRBS （4）

2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

描述

民

典型值

300

最大

2.5

150

100

单位

Gb / s的

注意：除非另有说明，所有规格均保证，但未经测试。

注1：斜交任何两个输入通道，以给定的输出之间。

注2 ：在两个输出信道从相同的输入通道之间的歪斜。

注3 ：对于要求高速输出的上升/下降规格以F

率

= 2.5 Gb / s的。对于低速率的信号，用0.375 /女

率

注4 ：宽带抖动添加到一个无抖动的信号的装置;抖动是主要的ISI为随机数据的形式

图2 ：中断时序（变更监控状态寄存器）

MONCLK

监控状态

监控状态寄存器

INTB

CSB

RDB

sRDB

HRDB

tsDATA

ADDR [ 5：0]

DATA [ 4：0]

图3 ：中断时序（没有改变监控状态寄存器）

MONCLK

监控状态

监控状态寄存器

INTB

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特点

17输入17输出交叉点开关

2.5Gb / s的NRZ数据带宽

42 Gb / s的总带宽

TTL兼容

P接口

差分PECL数据输入

2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

片50

输入端接

电源端接PECL输出驱动器

3.3V单电源供电

9W最大功率耗散

高性能256引脚BGA封装

概述

该VSC834是一款单芯片17x17异步交叉点开关设计进行宽带数据

流以高达2.5Gb / s的。无阻塞交换机核心是通过一个并行微处理器编程接口

面，可以让每个输出端口的随机存取程序。信号完整性的高度就会维持

通过芯片通过完全差分信号路径tained 。

的交叉点函数是基于一个多路转换器树结构。 1：各数据输出是由17驱动

复用器树，可以被编程到一个且仅一个的17个输入端，每个数据输入可以是亲

编程为多路输出。信号路径被注销，所以没有时钟所需的数据输入。该

信号路径是异步的，所以有在相位，频率或信号在每一个输入模式没有任何限制。

每个输入信道具有可以被用来识别活性（ LOA）的损失活动监测器的功能。一个跨

中断引脚提供到信号总长度，在这之后的外部控制器可以查询该芯片以确定信

NEL （多个）在其上发生故障。

每路输出驱动器是一个全差分开关电流驱动器与模背终端的马克西 -

妈妈的信号完整性。数据输入是通过50端接在模

电阻器连接到V

TERM

并行接口采用TTL电平，并提供地址，数据和控制管脚可以兼容

微处理器风格的界面。控制端口可以访问所有的芯片功能，包括LOA和

编程。程序的缓冲设置，以允许多个程序分配给排队并发出

通过一个单一的configure命令同时进行。

VSC834框图

A16

控制逻辑

接口

Y16

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06/01/01

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与输入信号的活动（ ISA ）监测

图1 ：详细的框图：

数据表

VSC834

A， AN [ 16 ： 0 ]

LOA

MONITOR

程序存储器

输出驱动器

17x17

核心交换机

Y， YN [ 16 ： 0 ]

控制界面

DATA [ 4：0] ，ADDR [5：0 ]

ALE ， CSB ， WRB ， RDB INTB ，

MONCLK ， CONFIG

功能说明

数据路径

所有的输入数据必须是微分并偏置到PECL电平。片上端接提供了

50标称阻抗

。所有的输入端接电阻连接到V

TERM

数据输出通过带片上端接差动电流开关产生一个提供

PECL电平输出摆幅。输出电路的驱动电平被设计为产生标准的PECL电平

当50终止

至2.0V 。其它终止电压是可能的，如到V

或1.3V ，但电压

的输出摆动的年龄水平将从其标称值进行移位。输出的共模电压

摆动可以使用VCOM引脚进行调节。调整范围未校准，但通常允许

关于调整输出共模电压为+ 200mV的。

输出信道可以在对断电如果少于17输出是必需的。通过连接VEE

销与给定对输出到V相关联的

，输出对将拉至V

和芯片功耗会

减少了约200mW的。

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与输入信号的活动（ ISA ）监测

编程接口

交换机核心可以通过并行接口电路，它允许随机读或写操作的编程

程序存储器阵列。程序存储器阵列进行缓冲，以允许将多个编程指令

可以同时装载有将CONFIG管脚。并行编程可以主频高达50MHz的速度。

节目数据是由两部分组成：输出地址和输入地址。输出地址，记

由ADDR [ 5：0] ，则指定该输出信道是要被编程。输入地址，记为DATA [ 4：0] ，

指定开关片应该连接到哪个输入端口。节目数据的格式是简单的二进制，

其中二进制值直接映射到交换机切片位置和/或输入端口号。例如：

ADDR [ 5：0] （ 000100 ） / DATA [4： 0]（ 00110 ）就直接输出通道Y4连接到输入通道的A6 。该

编程状态可被验证（回读）通过将期望的输出的地址和断言

RDB 。编程状态是未知的，在电源接通。附加的地址空间提供了一种用于访问

显示器寄存器（见表2）。微处理器接口由以下信号。水平TTL

（见表6）。

表1 ：信号表

针

D[5:0]

A[5:0]

ALE

CSB

WRB

RDB

INTB

I / O

描述

双向数据总线将数据从内部程序寄存器传输到/

地址总线，选择内部程序寄存器的读写操作

地址锁存使能：与复用的地址/数据总线使用。内部锁存地址总线

当低。

片选（低电平有效）：断言该引脚每当一部分被读取或编程。

写（低电平有效）：程序数据将被传输到所述第一级的内部寄存器的上升

这个信号的上升沿（当CSB也低）。

阅读（低电平有效）：从内部程序的程序数据或监控寄存器将读出的

当该信号变低（与CSB还低）的数据总线。

中断（低电平有效）：此信号置位时，发现了一个LOA条件

配置（高电平有效）：断言这个信号，从第一级传送队列中的节目信息

内部寄存器的第二级寄存器中，使得编程生效。这个信号可以是

拉高离开第二级寄存器透明的，所以所有的编程生效

马上。公务员事务局必须有效（低）时， CONFIG是断言。 CONFIG可连接到高

地址总线的位序

监视器的状态被转移并监控该信号的上升沿寄存器。 MONCLK不

预计超过3MHz的。

CONFIG

MONCLK

活性的丧失（ LOA ）监测

的总长功能包括在每个输入信道活动监测器，直接连接到焊盘的。

一个监视器的状态（是否已经过位变由一个输入转换）可以通过应用被观察

的地址（见表2）的对应于感兴趣的信号的监控寄存器和断言的RDB 。每

监控寄存器为4位的长度，面积达4输入或输出状态。还有一个额外的一比特

监控每个的17

输入和17

输出。每个监视器的状态传送到寄存器周期就

ically上MONCLK的上升沿，于是活动监视器clered直到更多的活动被检测到。

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2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

数据表

VSC834

如果通过MONCLK取样后出现在监控状态的任何变化，中断将被发信号

断言INTB ，并且用户必须通过读取显示器状态识别出错的信道。中断

当相应的活动监视器读取将被清除，但显示器的状态不会改变。如果

多显示器已触发中断，它会继续下去，直到所有的相应的显示器一直

读取。

该LOA电路需要30-150 mV峰峰值的最小信号电平来识别输入的

活跃的。这是必需的，以区分于未连接的信号（其中两个输入端浮到终止噪声

电压）由一个活信号活性。最少两个转变的定义活动。阈值信号

电平可以与VHYS销，它可以从零设置阈值，以允许的最大输入来调整

摆动。该VHYS引脚将自偏置到一个二项式值，这将是适合于大多数应用程序（ 30-150mV

P-P的输入电平）。虽然未标定的额定电平，增益和线性度，在VHYS引脚可以从外部

集调整在输入信号的整个范围内的阈值电平，从零到最大电平

在输入允许的。

表2 ：存储器映射

地址

00h

01h

...

10h

11h

...

20h

21h

22h

23h

24h

25h

ACCESS

读/写

...

读/写

...

读/写

R / O

输出Y1的编程输入通道

...

输出Y16的编程输入通道

描述

输出Y0的编程输入通道（写，然后断言CONFIG编程）

内部输出Y17的编程输入通道

...

内部输出Y32的编程输入通道

接收活动监视器输入A0 ， A1 ， A2，A3

接收活动监视器的输入A4 ， A5 ， A6 ， A7

接收活动监控输入A8 ， A9 ， A10 ， A11

接收活动监视器的输入A12 ， A13 ， A14 ， A15

接收活动监视器的输入A16

（逻辑'1'=无活动）

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数据表

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AC特性

表3 ：数据路径

参数

率

ISKW

OSKW

, t

数据速率

输入通道延迟偏差

(1)

2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

描述

民

典型值

300

最大

2.5

单位

Gb / s的

输出通道延迟偏差

(2)

高速输入上升/下降时间， 20 ％至80％

(3)

高速输出上升/下降时间， 20 ％至80％

输出数据眼图抖动，峰峰值， 2

PRBS

(4)

150

100

注意：除非另有说明，所有规格均保证，但未经测试。

注1：斜交任何两个输入通道，以给定的输出之间。

注2 ：在两个输出信道从相同的输入通道之间的歪斜。

注3 ：对于要求高速输出的上升/下降规格以F

率

= 2.5Gb / s的。对于低速率的信号，用0.375 /女

率

注4 ：宽带抖动添加到一个无抖动的信号的装置;抖动是主要的ISI为随机数据的形式

图2 ：中断时序（变更监控状态寄存器）

MONCLK

监控状态

监控状态寄存器

INTB

CSB

RDB

sRDB

HRDB

tsDATA

ADDR [ 5：0]

DATA [ 4：0]

图3 ：中断时序（没有改变监控状态寄存器）

MONCLK

监控状态

监控状态寄存器

INTB

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Vitesse公司

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数据表

VSC834

特点

17输入17输出交叉点开关

2.5Gb / s的NRZ数据带宽

42 Gb / s的总带宽

TTL兼容

接口

差分PECL数据输入

2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

片上50Ω输入端接

50Ω电源端接PECL输出驱动器

3.3V单电源供电

9W最大功率耗散

高性能256引脚BGA封装

概述

该VSC834是一款单芯片17x17异步交叉点开关设计进行宽带数据

流以高达2.5Gb / s的。无阻塞交换机核心是通过一个并行微处理器编程接口

面，可以让每个输出端口的随机存取程序。信号完整性的高度就会维持

通过芯片通过完全差分信号路径tained 。

的交叉点函数是基于一个多路转换器树结构。 1：各数据输出是由17驱动

复用器树，可以被编程到一个且仅一个的17个输入端，每个数据输入可以是亲

编程为多路输出。信号路径被注销，所以没有时钟所需的数据输入。该

信号路径是异步的，所以有在相位，频率或信号在每一个输入模式没有任何限制。

每个输入信道具有可以被用来识别活性（ LOA）的损失活动监测器的功能。一个跨

中断引脚提供到信号总长度，在这之后的外部控制器可以查询该芯片以确定信

NEL （多个）在其上发生故障。

每路输出驱动器是一个全差分开关电流驱动器与模背终端的马克西 -

妈妈的信号完整性。数据输入是通过50端接在模

电阻器连接到V

TERM

并行接口采用TTL电平，并提供地址，数据和控制管脚可以兼容

微处理器风格的界面。控制端口可以访问所有的芯片功能，包括LOA和

编程。程序的缓冲设置，以允许多个程序分配给排队并发出

通过一个单一的configure命令同时进行。

VSC834框图

A16

控制逻辑

接口

Y16

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2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

图1 ：详细的框图：

数据表

VSC834

A， AN [ 16 ： 0 ]

LOA

MONITOR

程序存储器

输出驱动器

17x17

核心交换机

Y， YN [ 16 ： 0 ]

控制界面

DATA [ 4：0] ，ADDR [5：0 ]

ALE ， CSB ， WRB ， RDB INTB ，

MONCLK ， CONFIG

功能说明

数据路径

所有的输入数据必须是微分并偏置到PECL电平。片上端接提供了

50标称阻抗

。所有的输入端接电阻连接到V

TERM

数据输出通过带片上端接差动电流开关产生一个提供

PECL电平输出摆幅。输出电路的驱动电平被设计为产生标准的PECL电平

当50终止

至2.0V 。其它终止电压是可能的，如到V

或1.3V ，但电压

的输出摆动的年龄水平将从其标称值进行移位。输出的共模电压

摆动可以使用VCOM引脚进行调节。调整范围未校准，但通常允许

关于调整输出共模电压为+ 200mV的。

输出信道可以在对断电如果少于17输出是必需的。通过连接VEE

销与给定对输出到V相关联的

，输出对将拉至V

和芯片功耗会

减少了约200mW的。

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数据表

VSC834

2.5Gb / s的17x17交叉点开关

与输入信号的活动（ ISA ）监测

编程接口

交换机核心可以通过并行接口电路，它允许随机读或写操作的编程

程序存储器阵列。程序存储器阵列进行缓冲，以允许将多个编程指令

可以同时装载有将CONFIG管脚。并行编程可以主频高达50MHz的速度。

节目数据是由两部分组成：输出地址和输入地址。输出地址，记

由ADDR [ 5：0] ，则指定该输出信道是要被编程。输入地址，记为DATA [ 4：0] ，

指定开关片应该连接到哪个输入端口。节目数据的格式是简单的二进制，

其中二进制值直接映射到交换机切片位置和/或输入端口号。例如：

ADDR [ 5：0] （ 000100 ） / DATA [4： 0]（ 00110 ）就直接输出通道Y4连接到输入通道的A6 。该

编程状态可被验证（回读）通过将期望的输出的地址和断言

RDB 。编程状态是未知的，在电源接通。附加的地址空间提供了一种用于访问

显示器寄存器（见表2）。微处理器接口由以下信号。水平TTL

（见表6）。

表1 ：信号表

针

D[5:0]

A[5:0]

ALE

CSB

WRB

RDB

INTB

I / O

描述

双向数据总线将数据从内部程序寄存器传输到/

地址总线，选择内部程序寄存器的读写操作

地址锁存使能：与复用的地址/数据总线使用。内部锁存地址总线

当低。

片选（低电平有效）：断言该引脚每当一部分被读取或编程。

写（低电平有效）：程序数据将被传输到所述第一级的内部寄存器的上升

这个信号的上升沿（当CSB也低）。

阅读（低电平有效）：从内部程序的程序数据或监控寄存器将读出的

当该信号变低（与CSB还低）的数据总线。

中断（低电平有效）：此信号置位时，发现了一个LOA条件

配置（高电平有效）：断言这个信号，从第一级传送队列中的节目信息

内部寄存器的第二级寄存器中，使得编程生效。这个信号可以是

拉高离开第二级寄存器透明的，所以所有的编程生效

马上。公务员事务局必须有效（低）时， CONFIG是断言。 CONFIG可连接到高

地址总线的位序

监视器的状态被转移并监控该信号的上升沿寄存器。 MONCLK不

预计超过3MHz的。

CONFIG

MONCLK

活性的丧失（ LOA ）监测

的总长功能包括在每个输入信道活动监测器，直接连接到焊盘的。

一个监视器的状态（是否已经过位变由一个输入转换）可以通过应用被观察

的地址（见表2）的对应于感兴趣的信号的监控寄存器和断言的RDB 。每

监控寄存器为4位的长度，面积达4输入或输出状态。还有一个额外的一比特

监控每个的17

输入和17

输出。每个监视器的状态传送到寄存器周期就

ically上MONCLK的上升沿，于是活动监视器clered直到更多的活动被检测到。

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与输入信号的活动（ ISA ）监测

数据表

VSC834

如果通过MONCLK取样后出现在监控状态的任何变化，中断将被发信号

断言INTB ，并且用户必须通过读取显示器状态识别出错的信道。中断

当相应的活动监视器读取将被清除，但显示器的状态不会改变。如果

多显示器已触发中断，它会继续下去，直到所有的相应的显示器一直

读取。

该LOA电路需要30-150 mV峰峰值的最小信号电平来识别输入的

活跃的。这是必需的，以区分于未连接的信号（其中两个输入端浮到终止噪声

电压）由一个活信号活性。最少两个转变的定义活动。阈值信号

电平可以与VHYS销，它可以从零设置阈值，以允许的最大输入来调整

摆动。该VHYS引脚将自偏置到一个二项式值，这将是适合于大多数应用程序（ 30-150mV

P-P的输入电平）。虽然未标定的额定电平，增益和线性度，在VHYS引脚可以从外部

集调整在输入信号的整个范围内的阈值电平，从零到最大电平

在输入允许的。

表2 ：存储器映射

地址

00h

01h

...

10h

11h

...

20h

21h

22h

23h

24h

25h

ACCESS

读/写

...

读/写

...

读/写

R / O

输出Y1的编程输入通道

...

输出Y16的编程输入通道

描述

输出Y0的编程输入通道（写，然后断言CONFIG编程）

内部输出Y17的编程输入通道

...

内部输出Y32的编程输入通道

接收活动监视器输入A0 ， A1 ， A2，A3

接收活动监视器的输入A4 ， A5 ， A6 ， A7

接收活动监控输入A8 ， A9 ， A10 ， A11

接收活动监视器的输入A12 ， A13 ， A14 ， A15

接收活动监视器的输入A16

（逻辑'1'=无活动）

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AC特性

表3 ：数据路径

参数

率

ISKW

OSKW

, t

数据速率

输入通道的时延差（ 1 ）

输出通道时延差（ 2 ）

高速输入上升/下降时间， 20％至80 ％（3）

高速输出上升/下降时间， 20 ％至80％

输出数据眼图抖动，峰峰值， 2

PRBS （4）

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与输入信号的活动（ ISA ）监测

描述

民

典型值

300

最大

2.5

150

100

单位

Gb / s的

注意：除非另有说明，所有规格均保证，但未经测试。

注1：斜交任何两个输入通道，以给定的输出之间。

注2 ：在两个输出信道从相同的输入通道之间的歪斜。

注3 ：对于要求高速输出的上升/下降规格以F

率

= 2.5 Gb / s的。对于低速率的信号，用0.375 /女

率

注4 ：宽带抖动添加到一个无抖动的信号的装置;抖动是主要的ISI为随机数据的形式

图2 ：中断时序（变更监控状态寄存器）

MONCLK

监控状态

监控状态寄存器

INTB

CSB

RDB

sRDB

HRDB

tsDATA

ADDR [ 5：0]

DATA [ 4：0]

图3 ：中断时序（没有改变监控状态寄存器）

MONCLK

监控状态

监控状态寄存器

INTB

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