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Vitesse公司
半导体公司
数据表
VSC8021/VSC8022
特点
串行数据速率高达2.5Gb / s的
并行数据传输速率高达312.5Mb / s的
ECL 100K兼容的并行数据的I / O
除以8的时钟同步
并行数据接口芯片
SONET帧恢复电路
(VSC8022)
与STS- 3 STS- 48
SONET应用
2.5Gb / s的SONET兼容
8位复用器/解复用器芯片组
差分或单端输入和输出
低功耗: 2.3W (每个芯片典型值)
标准ECL电源:
V
EE
= -5.2V, V
TT
= -2.0V
提供商业级(0
°
C至+70
°
C)或产业
(-40
°
C至+ 85
°
C)温度范围
经过验证的E / D模式砷化镓技术
52针引线陶瓷芯片载体
功能说明
该VSC8021和VSC8022能够在处理串行数据高速SONET接口设备
速率高达2.5Gb / s的。这些器件可用于STS-3通过STS-48 SONET应用。
这些产品都采用了Vitesse的H-砷化镓制造的砷化镓
E / D MESFET工艺,
而实现高速和低功耗。这些产品被包装在陶瓷52引脚引线
陶瓷芯片载体。
VSC8021
该VSC8021包含一个8 :1多路复用器和一个自定位定时器。 8 : 1多路复用器可接受8 paral-
LEL ECL差分数据输入( D1 - D8 , D1N - D8N )速率高达312.5Mb / s和复用成一个串行
差分位流输出( DO , DON )速率高达2.5Gb / s的。
该VSC8021的内部定时是围绕高速时钟(高达2.5GHz )递送到
芯片通过一个差分输入( CLKI , CLKIN ) 。这个信号随后回荡在高速differen-
TiAl基输出(CO , CON ) 。
该并行数据输入时钟到芯片上的输入寄存器与外部提供的差分ECL
输入( BYCLK , BYCLKN )以相同的速率作为数据输入操作。内部字节时钟,这是一种
除以- 8版本的高速时钟,用来将数据传输到一组缓冲寄存器。这种内部
字节时钟被带到片外的ECL输出CLK8 , CLK8N 。
内部电路监视内部和外部字节时钟,如果一个定时产生一个ERR信号
检测到冲突。这个信号可以被选通到SYNC输入是边沿敏感的高。活动同步
输入允许VSC8021时间转移,定位得当对外部字节时钟, CLK8 ,
CLK8N 。当一个CLK8定时开关制成,正常的数据流将是无效的为1个字节。
有两个时钟输入, CLKI和BYCLK ,进入了VSC8021 。这两个时钟作为计时
为VSC8021的不同部分的引用。该BYCLK用于触发输入寄存器的并行
数据输入,而CLKI用于触发所述的高速串行输出寄存器,以及一些定时的
电路,用于将并行到串行转换。另外,为了使这部分容易使用,用户不
假设CLKI和BYCLK之间的已知相位关系需要。
G52028-0 ,版本4.1
05/25/01
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741卡莱普莱诺卡马里奥, CA 93012
联系电话: ( 800 ) VITESSE 传真: ( 805 ) 987-5896 电子邮件: prodinfo@vitesse.com
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VSC8021/VSC8022
内部相位检测器和相位调整电路被用于促进两个异步电路
与对方合作。鉴相器和相位调整电路一起努力调整内部
时钟CLK8以确保建立和保持的条件被满足的内部寄存器。 CLK8源自
CLKI和RCLK为一个非相变字节时钟输出。边缘敏感的同步信号是简单的
控制信号,使所述相位检测电路系统。
作为一个总结,与CLKI是高速时钟输入。该BYCLK是外部字节时钟。该CLK8
是从CLKI来自内部字节时钟,相位调整,如果同步被启用。所述RCLK为一个非相位
从CLKI调整分频的8个时钟产生。 RCLK的相位, RCLKN不会受自
调整电路,因此它可被用作一个系统基准时钟。 RCLK , RCLKN可以使用由系统
TEM设计师产生BYCLK , BYCLKN 。的自定位定时器和RCLK , RCLKN允许cre-
ATION为VSC8021非常紧张并行数据时序。
图1 : VSC8021框图
D1
D1N
并行
数据
D8
D8N
CLK8
SYNC
调整
8
8
8:1
多路复用器
DO
DON
串行数据输出
CLK8N
相位可调
字节时钟输出
字节时钟
输入
BYCLK
BYCLKN
定时
发电机
RCLK
RCLKn
CO
CON
ERR
独立
字节时钟输出
高速
时钟输入
CLKI
CLKIN
高速
时钟
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VSC8022
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该VSC8022同时含有1:8多路分解器和SONET帧恢复电路。的1:8多路分解器
接收的串行数据输入(DI ,
DIN )
速率高达2.5Gb / s的并将其转换成8位并行差分ECL数据输出
(D1-D8,
D1N-D8N)
速率高达312.5Mb / s的。有效的并行数据输出显示的8分频差
时钟输出
BYCKO , BYCKON 。
该VSC8022还包含一个SONET帧恢复电路。帧恢复电路由一个下降沿继续使
荷兰国际集团的边缘上
OOFN
ECL的输入时
FDIS
输入是低的。一旦启用,该帧恢复电路开始还要寻
荷兰国际集团的SONET帧序列。一旦帧被检测到,则字边界被拉直时,证实
信号通过发送芯片外
FP
电致化学发光输出和帧恢复电路被禁用。而框架
对准被通缉的框架,
BYCKO , BYCKON
和并行数据是无效的。
图2 : VSC8022框图
D1
D1N
在串行数据
DI
DIN
1:8
多路解复用器
D8
D8N
并行
数据输出
高速
时钟输入
CLKI
CLKIN
定时
发电机
帧恢复禁用 -
FDIS
帧恢复时钟 -
OOFN
SONET
FRAME
检测&
恢复
FP
- 帧检测信号
BYCKO
BYCKON
字节时钟输出
帧恢复电路由帧检测(导致FP)禁用或通过在OOFN下降沿
输入而FDIS高。
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VSC8021复用器交流特性
(在推荐的工作条件)
图3: VSC8021复用器波形
t
C
(1)
CLKI , CLKIN
高速差分时钟输入
t
D
BYCLK ( BYCLKN )
字节时钟输入
(1)
CLK8
(2)
相可调÷ 8输出
t
DSU
t
DH
tBCLK8
D1D8 , D1N - D8N
并行差分数据输入
有效数据(1)
有效数据(2)
t
CMD
CO , CON
高速差分时钟输出
DO , DON
高速差分数据输出
D01
D02
D03
D04
D05
D06
D07
D08
SYNC
CLK8调整输入
注: ( 1 )负边沿触发沿。
( 2 ) BYCLK /时未连接SYNC要求CLK8时间走错了路。
CLKI ( CLKIN )
段×8 = BYCLK ( BYCLKN )
期。
=无关。
序列化字节1
表1 : VSC8021复用器AC特性(在推荐的工作条件下)
参数
t
C
t
D
t
DSU
t
DH
t
CMD
t
BCLK8
抖动( P-P )
时钟周期
(1)
字节时钟期间(t
D
= t
C
x 8)
并行数据建立时间
数据保持时间
高速时钟输出量(CO , CON)定时,下降
CO对数据的复用功能输出的边缘, ( DO , DON )时序
字节时钟CLK8时机
(2)
CLKI , CLKIN做, DON (最大值 - 最小值) , ( HI到LO )
同一部位,同一引脚在恒定条件
描述
400
3.2
0.6
1.4
220
0.5
典型值
最大
单位
ps
ns
ns
ns
条件
350
1.0
<50
1.5
ps
ns
ps
注: ( 1)部分由设计保证在DC工作到2.5GHz的最高频率。
( 2 )当SYNC没有连接到ERR要求。
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VSC8022 AC特征
(在推荐的工作条件)
t
C
CLKI
(1)
( CLKIN )
t
OOFNPW
t
OOFN
SONET STS - 3帧序列
数据
数据
数据
数据
数据
高速差分时钟输入
OOFN
帧恢复时钟输入
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二( DIN)
高速串行数据输入
A1
A1
A1
A2
A2
A2
图4 : VSC8022解复用器波形
t
D
BYCKO ( BYCKON )
字节时钟输出
BYCKO
RESYNCH
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t
BD
有效
有效
有效
有效
有效
有效
有效
有效
数据
数据
数据
数据
数据
数据
数据
数据
有效
有效
有效
有效
有效
有效
有效
有效
数据
数据
数据
数据
数据
数据
数据
数据
D1 ( D1N )
D2 ( D2N )
D3 ( D3N )
D4 ( D4N )
D5 ( D5N )
D6 ( D6N )
D7 ( D7N )
D8 ( D8N )
并行数据
(2)
输出摘要
FP
帧检测确认输出
注意事项:
1 )下降沿有效边缘。
A1
A1
t
DFP广告管理系统
A2
A2
A2
t
亲民党
数据
数据
数据
数据
2.5Gb / s的SONET兼容
8位复用器/解复用器芯片组
2)并行数据输出端才开始显示的SONET帧序列的最后一个A2后的有效数据。该示例
如上图所示的波形使用STS - 3帧序列的方便,从而有效数据之后的第三输出
A2的序列中。
=无关。
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