V436516Y04V
128MB 144针SDRAM UNBUFFERED
SODIMM ， 16MX64 3.3VOLT
初步
s
JEDEC标准的144针脚，小外形，双列
直插式内存模块（ SODIMM ）
s
串行存在检测为E
2
舞会
s
无缓冲
s
完全同步，所有的信号就注册
系统时钟的上升沿，
s
单+ 3.3V （ ± 0.3V ）电源
s
所有器件引脚兼容LVTTL
s
4096刷新周期每64毫秒
s
自刷新模式
s
内部流水线操作;列地址
可以改变每一个系统时钟
s
可编程突发长度：1， 2，4，或8个
s
自动预充电和预充电所有银行通过A10
s
通过DQM数据屏蔽功能
s
模式寄存器编程设置
s
可编程（ CAS延迟： 2 ， 3个时钟）
s
SDRAM性能
CILETIV LESOM
特点
8M ×16
描述
该V436516Y04V内存模块组织
16777216 ×64位144针SODIMM 。该
16M ×64的内存模块采用8茂矽 - 华智8M
×16 SDRAM 。在x64模块非常适合于使用
高性能计算机系统中
提高存储密度和快速的访问时间
是必需的。
产品型号
V436516Y04VATG-75PC
V436516Y04VATG-75
V436516Y04VATG-10PC
速度等级
-75PC,CL=2,3(133MHZ)
-75 ， CL = 3
(133MHZ)
CON组fi guration
16Mx64
16Mx64
16Mx64
-10PC,CL=2,3(100MHZ)
8M ×16
8M ×16
8M ×16
1
59
61
143
在背面针脚2
背面上的144引脚
V436516Y04V修订版2001年1.0月
1
V436516Y04V
前
DQMB1
DQMB5
VDD
VDD
A0
A3
A1
A4
A2
A5
VSS
VSS
DQ8
DQ40
DQ9
DQ41
DQ10
DQ42
DQ11
DQ43
VDD
VDD
DQ12
DQ44
针
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
前
DQ13
DQ45
DQ14
DQ46
DQ15
DQ47
VSS
VSS
NC
NC
NC
NC
CLK0
CKE0
VDD
VDD
RAS
CAS
WE
CKE1
CS0
NC
CS1
NC
针
73
74
75
76
77
78
79
80
81
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
后
NC
CLK1
VSS
VSS
NC
NC
NC
NC
VDD
VDD
DQ16
DQ48
DQ17
DQ49
DQ18
DQ50
DQ19
DQ51
VSS
VSS
DQ20
DQ52
DQ21
DQ53
针
97
98
99
100
101
102
103
104
105
106
107
108
109
110
111
112
113
114
115
116
117
118
119
120
后
DQ22
DQ54
DQ23
DQ55
VDD
VDD
A6
A7
A8
BA0
VSS
VSS
A9
BA1
A10
A11
VDD
VDD
DQMB2
DQMB6
DQMB3
DQMB7
VSS
VSS
针
121
122
123
124
125
126
127
128
129
130
131
132
133
134
135
136
137
138
139
140
141
142
143
144
后
DQ24
DQ56
DQ25
DQ57
DQ26
DQ58
DQ27
DQ59
VDD
VDD
DQ28
DQ60
DQ29
DQ61
DQ30
DQ62
DQ31
DQ63
VSS
VSS
SDA
SCL
VDD
VDD
CILETIV LESOM
针
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
前
VSS
VSS
DQ0
DQ32
DQ1
DQ33
DQ2
DQ34
DQ3
DQ35
VDD
VDD
DQ4
DQ36
DQ5
DQ37
DQ6
DQ38
DQ7
DQ39
VSS
VSS
DQMB0
DQMB4
针
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
引脚配置（正面/背面）
注意：
1. RAS ， CAS ， WE CASx ， CSX为低电平有效的信号。
引脚名称
A0 A11 ， BA0 ， BA1
DQ0–DQ63
RAS
CAS
WE
CS0 ， CS1
DQMB0–DQMB7
CKE0 ， CKE1
CLK0–CLK1
SDA
SCL
VDD
VSS
NC
地址，银行选择
数据输入/输出
行地址选通
列地址选通
写使能
芯片选择
OUTPUT ENABLE
时钟使能
时钟
串行输入/输出
串行时钟
电源
地
无连接（开放）
V436516Y04V修订版2001年1.0月
2
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