数据表
MOS集成电路
PD16342
96位的AC- PDP的驱动
描述
该
PD16342是高耐压CMOS驱动器设计用于平板显示面板用诸如PDP中
VFD或EL面板。它由一个96位双向移位寄存器，96位锁存器和高耐压CMOS
驱动程序。逻辑块与一个5伏电源接口（ CMOS电平输入）进行操作，以便它可以直接
连接到门阵列和CPU 。驱动电路提供了一个高耐压输出： 80伏， + 15 / -30毫安
MAX 。逻辑和驱动程序块是由CMOS电路，消耗更低的功耗。
特点
3个32位双向移位寄存器和6个16位之间切换由IBS销电路结构
双向移位寄存器。
与传输时钟（外部）数据控制和锁存
高速数据传输（F
马克斯。
=
40兆赫MIN 。在数据锁存器）
(f
最大
.
=
25兆赫MIN 。在级联）
高耐压输出电压（ 80 V， + 15 / -30 mA（最大值） 。 ）
高耐压CMOS结构
订购信息
产品型号
包
模块/ TCP
PD16342
备注
请教关于模块的我们的销售代表。由于该模块的特点是
基于该模块的规格，有可能写入该内容之间的差异
文档和实时特性。
本文档中的信息如有更改，恕不另行通知。使用本文档，请前
证实，这是最新版本。
不是所有的设备/类型在每个国家都可用。请与当地的NEC代表检查
供应及其他信息。
一号文件S15090EJ2V0DS00 （第2版）
发布日期2001年9月NS CP （ K）
日本印刷
商标
#
表示主要修改点。
2000
PD16342
#
1.框图（ 1 ） （ IBS = H ， 3位输入， 32位长的移位寄存器）
HZ
/ LBLK
/ HBLK
V
DD2
/ LE
SR
1
记
A
1
CLK
R， / L
B
1
/ CLR
SR
2
记
A
2
A
2
CLK
R， / L
B
2
B
2
CLR S
95
S
2
S
5
A
1
CLK
R， / L
B
1
CLR S
94
S
1
S
4
S
1
S
2
S
3
LE
/L
1
O
1
V
SS2
SR
3
记
A
3
A
3
CLK
R， / L
B
3
B
3
CLR S
96
S
94
S
95
S
96
S
3
S
6
V
DD2
/L
96
O
96
V
SS2
记
SR
n
： 32位的移位寄存器
备注
/ xxx表示低电平有效的信号。
2
数据表S15090EJ2V0DS
PD16342
1.框图（ 2 ） （ IBS = L ， 6位输入， 16位长的移位寄存器）
HZ
/ LBLK
/ HBLK
V
DD2
/ LE
SR
1
记
A
1
S
1
S
7
CLK
R， / L
S
91
B
1
CLR
SR
2
记
A
2
S
2
S
8
CLK
R， / L
B
2
CLR S
92
SR
3
记
A
3
S
3
S
9
CLK
R， / L
B
3
CLR S
93
SR
4
记
A
4
S
4
S
10
CLK
R， / L
B
4
CLR S
94
SR
5
记
A
5
S
5
S
11
CLK
R， / L
B
5
CLR S
95
SR
6
记
A
6
S
6
S
12
CLK
R， / L
B
6
CLR S
96
S
93
S
94
S
95
S
96
/L
96
O
96
A
1
CLK
R， / L
B
1
/ CLR
A
2
S
1
LE
S
2
/L
1
S
3
S
4
S
5
S
6
V
SS2
O
1
B
2
A
3
B
3
A
4
B
4
A
5
B
5
A
6
V
DD2
B
6
V
SS2
记
SR
n
： 16位移位寄存器
数据表S15090EJ2V0DS
3
PD16342
2.引脚功能
符号
/ LBLK
/ HBLK
/ LE
HZ
/ CLR
A
1
到A
3(6)
引脚名称
低消隐
高冲
LATCH ENABLE
输出高阻抗
注册清晰
正确的数据
I / O
输入
输入
输入
输入
输入
I / O
记
I / O
记
/ LBLK
=
L：所有的输出
=
L
/ HBLK
=
L：所有的输出
=
H
锁存下降沿
H：所有的输出设定为高阻抗状态
L：清零为L电平的所有移位寄存器的数据
R， / L
=
H，A
1
到A
3(6)
：输入，B
1
到B
3(6)
：输出
括号内的引脚用于在6位的输入模式。
B
1
到B
3(6)
左数据
R， / L
=
L，A
1
到A
3(6)
：输出，B
1
到B
3(6)
：输入
括号内的引脚用于在6位的输入模式。
CLK
R， / L
时钟
SHIFT控制
输入
输入
按住Shift键在上升沿
H：右移模式
SR
1
: A
1
→
S
1
.......S
94
→
B
1
（ SR
2
和SR
6
也移在相同的方向）。
左移模式
SR
1
: B
1
→
S
94
.......S
1
→
A
1
（ SR
2
和SR
6
也移在相同的方向）。
肠易激综合征
输入模式切换
输入
H： 32位移位寄存器， 3位的输入模式
L： 16位的移位寄存器， 6位输入模式
O
1
与O
96
V
DD1
V
DD2
V
SS1
V
SS2
高耐压
逻辑电源
驱动电源
逻辑地
地面驱动
产量
80 V， + 15 / -30 mA（最大值） 。
5 V
±
5%
15至70 V
连接到系统接地
连接到系统接地
描述
记
在3位输入模式下，未使用的I / O引脚都必须在低电平举行。
用于模块， IC芯片的背面侧，必须在V举行
SS
（GND）的电平。
4
数据表S15090EJ2V0DS
数据表
MOS集成电路
PD16342
96位的AC- PDP的驱动
描述
该
PD16342是高耐压CMOS驱动器设计用于平板显示面板用诸如PDP中
VFD或EL面板。它由一个96位双向移位寄存器，96位锁存器和高耐压CMOS
驱动程序。逻辑块与一个5伏电源接口（ CMOS电平输入）进行操作，以便它可以直接
连接到门阵列和CPU 。驱动电路提供了一个高耐压输出： 80伏， + 15 / -30毫安
MAX 。逻辑和驱动程序块是由CMOS电路，消耗更低的功耗。
特点
3个32位双向移位寄存器和6个16位之间切换由IBS销电路结构
双向移位寄存器。
与传输时钟（外部）数据控制和锁存
高速数据传输（F
马克斯。
=
40兆赫MIN 。在数据锁存器）
(f
最大
.
=
25兆赫MIN 。在级联）
高耐压输出电压（ 80 V， + 15 / -30 mA（最大值） 。 ）
高耐压CMOS结构
订购信息
产品型号
包
模块/ TCP
PD16342
备注
请教关于模块的我们的销售代表。由于该模块的特点是
基于该模块的规格，有可能写入该内容之间的差异
文档和实时特性。
本文档中的信息如有更改，恕不另行通知。使用本文档，请前
证实，这是最新版本。
不是所有的设备/类型在每个国家都可用。请与当地的NEC代表检查
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商标
#
表示主要修改点。
2000
PD16342
#
1.框图（ 1 ） （ IBS = H ， 3位输入， 32位长的移位寄存器）
HZ
/ LBLK
/ HBLK
V
DD2
/ LE
SR
1
记
A
1
CLK
R， / L
B
1
/ CLR
SR
2
记
A
2
A
2
CLK
R， / L
B
2
B
2
CLR S
95
S
2
S
5
A
1
CLK
R， / L
B
1
CLR S
94
S
1
S
4
S
1
S
2
S
3
LE
/L
1
O
1
V
SS2
SR
3
记
A
3
A
3
CLK
R， / L
B
3
B
3
CLR S
96
S
94
S
95
S
96
S
3
S
6
V
DD2
/L
96
O
96
V
SS2
记
SR
n
： 32位的移位寄存器
备注
/ xxx表示低电平有效的信号。
2
数据表S15090EJ2V0DS
PD16342
1.框图（ 2 ） （ IBS = L ， 6位输入， 16位长的移位寄存器）
HZ
/ LBLK
/ HBLK
V
DD2
/ LE
SR
1
记
A
1
S
1
S
7
CLK
R， / L
S
91
B
1
CLR
SR
2
记
A
2
S
2
S
8
CLK
R， / L
B
2
CLR S
92
SR
3
记
A
3
S
3
S
9
CLK
R， / L
B
3
CLR S
93
SR
4
记
A
4
S
4
S
10
CLK
R， / L
B
4
CLR S
94
SR
5
记
A
5
S
5
S
11
CLK
R， / L
B
5
CLR S
95
SR
6
记
A
6
S
6
S
12
CLK
R， / L
B
6
CLR S
96
S
93
S
94
S
95
S
96
/L
96
O
96
A
1
CLK
R， / L
B
1
/ CLR
A
2
S
1
LE
S
2
/L
1
S
3
S
4
S
5
S
6
V
SS2
O
1
B
2
A
3
B
3
A
4
B
4
A
5
B
5
A
6
V
DD2
B
6
V
SS2
记
SR
n
： 16位移位寄存器
数据表S15090EJ2V0DS
3
PD16342
2.引脚功能
符号
/ LBLK
/ HBLK
/ LE
HZ
/ CLR
A
1
到A
3(6)
引脚名称
低消隐
高冲
LATCH ENABLE
输出高阻抗
注册清晰
正确的数据
I / O
输入
输入
输入
输入
输入
I / O
记
I / O
记
/ LBLK
=
L：所有的输出
=
L
/ HBLK
=
L：所有的输出
=
H
锁存下降沿
H：所有的输出设定为高阻抗状态
L：清零为L电平的所有移位寄存器的数据
R， / L
=
H，A
1
到A
3(6)
：输入，B
1
到B
3(6)
：输出
括号内的引脚用于在6位的输入模式。
B
1
到B
3(6)
左数据
R， / L
=
L，A
1
到A
3(6)
：输出，B
1
到B
3(6)
：输入
括号内的引脚用于在6位的输入模式。
CLK
R， / L
时钟
SHIFT控制
输入
输入
按住Shift键在上升沿
H：右移模式
SR
1
: A
1
→
S
1
.......S
94
→
B
1
（ SR
2
和SR
6
也移在相同的方向）。
左移模式
SR
1
: B
1
→
S
94
.......S
1
→
A
1
（ SR
2
和SR
6
也移在相同的方向）。
肠易激综合征
输入模式切换
输入
H： 32位移位寄存器， 3位的输入模式
L： 16位的移位寄存器， 6位输入模式
O
1
与O
96
V
DD1
V
DD2
V
SS1
V
SS2
高耐压
逻辑电源
驱动电源
逻辑地
地面驱动
产量
80 V， + 15 / -30 mA（最大值） 。
5 V
±
5%
15至70 V
连接到系统接地
连接到系统接地
描述
记
在3位输入模式下，未使用的I / O引脚都必须在低电平举行。
用于模块， IC芯片的背面侧，必须在V举行
SS
（GND）的电平。
4
数据表S15090EJ2V0DS
数据表
MOS集成电路
PD16342
96位的AC- PDP的驱动
描述
该
PD16342是高耐压CMOS驱动器设计用于平板显示面板用诸如PDP中
VFD或EL面板。它由一个96位双向移位寄存器，96位锁存器和高耐压CMOS
驱动程序。逻辑块与一个5伏电源接口（ CMOS电平输入）进行操作，以便它可以直接
连接到门阵列和CPU 。驱动电路提供了一个高耐压输出： 80伏， + 15 / -30毫安
MAX 。逻辑和驱动程序块是由CMOS电路，消耗更低的功耗。
特点
3个32位双向移位寄存器和6个16位之间切换由IBS销电路结构
双向移位寄存器。
与传输时钟（外部）数据控制和锁存
高速数据传输（F
马克斯。
=
40兆赫MIN 。在数据锁存器）
(f
最大
.
=
25兆赫MIN 。在级联）
高耐压输出电压（ 80 V， + 15 / -30 mA（最大值） 。 ）
高耐压CMOS结构
订购信息
产品型号
包
模块/ TCP
PD16342
备注
请教关于模块的我们的销售代表。由于该模块的特点是
基于该模块的规格，有可能写入该内容之间的差异
文档和实时特性。
本文档中的信息如有更改，恕不另行通知。使用本文档，请前
证实，这是最新版本。
不是所有的设备/类型在每个国家都可用。请与当地的NEC代表检查
供应及其他信息。
一号文件S15090EJ2V0DS00 （第2版）
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商标
#
表示主要修改点。
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#
1.框图（ 1 ） （ IBS = H ， 3位输入， 32位长的移位寄存器）
HZ
/ LBLK
/ HBLK
V
DD2
/ LE
SR
1
记
A
1
CLK
R， / L
B
1
/ CLR
SR
2
记
A
2
A
2
CLK
R， / L
B
2
B
2
CLR S
95
S
2
S
5
A
1
CLK
R， / L
B
1
CLR S
94
S
1
S
4
S
1
S
2
S
3
LE
/L
1
O
1
V
SS2
SR
3
记
A
3
A
3
CLK
R， / L
B
3
B
3
CLR S
96
S
94
S
95
S
96
S
3
S
6
V
DD2
/L
96
O
96
V
SS2
记
SR
n
： 32位的移位寄存器
备注
/ xxx表示低电平有效的信号。
2
数据表S15090EJ2V0DS
PD16342
1.框图（ 2 ） （ IBS = L ， 6位输入， 16位长的移位寄存器）
HZ
/ LBLK
/ HBLK
V
DD2
/ LE
SR
1
记
A
1
S
1
S
7
CLK
R， / L
S
91
B
1
CLR
SR
2
记
A
2
S
2
S
8
CLK
R， / L
B
2
CLR S
92
SR
3
记
A
3
S
3
S
9
CLK
R， / L
B
3
CLR S
93
SR
4
记
A
4
S
4
S
10
CLK
R， / L
B
4
CLR S
94
SR
5
记
A
5
S
5
S
11
CLK
R， / L
B
5
CLR S
95
SR
6
记
A
6
S
6
S
12
CLK
R， / L
B
6
CLR S
96
S
93
S
94
S
95
S
96
/L
96
O
96
A
1
CLK
R， / L
B
1
/ CLR
A
2
S
1
LE
S
2
/L
1
S
3
S
4
S
5
S
6
V
SS2
O
1
B
2
A
3
B
3
A
4
B
4
A
5
B
5
A
6
V
DD2
B
6
V
SS2
记
SR
n
： 16位移位寄存器
数据表S15090EJ2V0DS
3
PD16342
2.引脚功能
符号
/ LBLK
/ HBLK
/ LE
HZ
/ CLR
A
1
到A
3(6)
引脚名称
低消隐
高冲
LATCH ENABLE
输出高阻抗
注册清晰
正确的数据
I / O
输入
输入
输入
输入
输入
I / O
记
I / O
记
/ LBLK
=
L：所有的输出
=
L
/ HBLK
=
L：所有的输出
=
H
锁存下降沿
H：所有的输出设定为高阻抗状态
L：清零为L电平的所有移位寄存器的数据
R， / L
=
H，A
1
到A
3(6)
：输入，B
1
到B
3(6)
：输出
括号内的引脚用于在6位的输入模式。
B
1
到B
3(6)
左数据
R， / L
=
L，A
1
到A
3(6)
：输出，B
1
到B
3(6)
：输入
括号内的引脚用于在6位的输入模式。
CLK
R， / L
时钟
SHIFT控制
输入
输入
按住Shift键在上升沿
H：右移模式
SR
1
: A
1
→
S
1
.......S
94
→
B
1
（ SR
2
和SR
6
也移在相同的方向）。
左移模式
SR
1
: B
1
→
S
94
.......S
1
→
A
1
（ SR
2
和SR
6
也移在相同的方向）。
肠易激综合征
输入模式切换
输入
H： 32位移位寄存器， 3位的输入模式
L： 16位的移位寄存器， 6位输入模式
O
1
与O
96
V
DD1
V
DD2
V
SS1
V
SS2
高耐压
逻辑电源
驱动电源
逻辑地
地面驱动
产量
80 V， + 15 / -30 mA（最大值） 。
5 V
±
5%
15至70 V
连接到系统接地
连接到系统接地
描述
记
在3位输入模式下，未使用的I / O引脚都必须在低电平举行。
用于模块， IC芯片的背面侧，必须在V举行
SS
（GND）的电平。
4
数据表S15090EJ2V0DS
QQ：2880707522 复制
