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TSB83AA22C

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SLLS851 - 2007年6月

TSB83AA22C IEEE标准1394B -2002 PHY和OHCI Link设备

特点

完全支持IEEE标准的规定

1394B -2002修订版1.33+ 1千兆位

信令速率

完全支持IEEE标准的规定

1394A -2000和IEEE标准1394-1995标准

对于高性能串行总线

完全兼容Firewire ， i.LINK ，

IEEE标准1394和SB1394实现

提供了两个完全向后兼容，

IEEE标准1394A -2000完全兼容）

双语IEEE标准1394B -2002电缆端口处

每秒高达800兆比特（Mbps）的

全IEEE标准1394 -2000支持包括：

- 连接防抖动

- 仲裁短复位

- 多速级联

- 仲裁加速

- 飞通过串联

- 端口禁用/暂停/恢复

延长恢复信号的兼容性

与传统DV设备

省电功能，以节约能源的

电池供电应用

低功耗休眠模式

完全符合开放式主机控制器

接口（OHCI ）要求

电力线缆存在监测

电缆端口监视线路条件

主动连接到远程节点

寄存器位给出了软件控制

竞争者位，电源位级，链路活动

控制位和IEEE标准1394 -2000产品特点

能够与其他1394物理层

（ PHY）采用1.8 V， 3.3 V和5 V电源

低抖动，外部晶体振荡器

提供发送和接收数据

100/200/400/800 Mbps和链路层

控制器时钟在49.152 MHz和

98.304兆赫

独立的偏置（ TPBIAS ）为每个端口

软件设备复位（ SWR ）

故障保护电路检测的突然消失

电源设备和禁用端口

确保TSB83AA22C不加载

对任何连接的设备的TPBIAS和

阻止任何泄漏的端口返回

电源平面

IEEE标准1394A -2000兼容

传入偏置共模噪声滤波器

检测电路来滤除串扰噪声

端口可编程强制IEEE标准

1394A -2000模式，从而允许使用IEEE标准

1394A -2000连接器（ IEEE标准1394B -2002

信号不能被跨IEEE标准将

1394A -2000连接器或电缆）

3.3 V和5 V PCI信号环境

串行总线的数据传输速率100 Mbps的200 Mbps的，

400 Mbps的，和800 Mbps的

最多三个物理写入发帖

优秀的交易

串行ROM或引导ROM接口支持

2线串行EEPROM器件

33 - MHz的/ 32位PCI接口

多功能终端（ MFUNC端子1 ）：

- 每PCI_CLKRUN协议

PCI手机

设计指南

- 通用I / O

- CYCLEIN / CYCLEOUT外部循环

定时器控制的定制

同步

PCI突发传输和深的FIFO

容忍大型主机的延迟：

- 发送FIFO ，异步5K

- 发送FIFO -2K同步

- 接收FIFO ，异步2K

- 接收FIFO -2K同步

D0，D1， D2和D3电源状态和PME

每个事件

PCI总线电源管理

接口特定网络阳离子

可编程异步发送

请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用

仪器的半导体产品和免责条款及其出现在此数据表的末尾。

FireWire是苹果电脑公司的商标。

i.LINK是索尼株式会社TA Sony Corporation的商标。

PRODUCTION数据信息为出版日期。

产品符合占德州条款规范

仪器标准保修。生产加工过程中不

不一定包括所有参数进行测试。

2007 ，德州仪器

TSB83AA22C

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门槛

同步接收双缓冲模式

外的顺序流水线异步

发送请求

最初的带宽，并提供

最初的通道，可用的寄存器

数字视频和音频性能

增强

描述

该TSB83AA22C是IEEE标准的1394b -2002链路层设计和物理层设计组合在单个封装

以满足当今的1394总线应用的苛刻要求。该TSB83AA22C装置能够

卓越的800 - Mbps的性能;因此，提供的吞吐量和带宽有效地移动数据和

很快之间的PCI和1394总线。该TSB83AA22C器件还提供了出色的超低功耗

操作和智能电源管理功能。该装置提供了IEEE 1394 LLC功能和

物理层功能，并与100 Mbps的200 Mbps的400 Mbps的，和800 Mbps的串行总线的数据传输速率兼容。

该TSB83AA22C运行33 - MHz的/ 32位PCI局部总线和IEEE标准1394 -2000之间的接口

或IEEE标准1394B -2002串行总线接口。它能够支持的串行数据速率98.304 ， 196.608 ，

393.216 ， 491.52 ，或786.432 Mbps的（简称为S100 ，S200 ， S400中， S400B ，或S800的速度，分别地）。

当作为PCI总线主代理，所述TSB83AA22C装置能够数据的多个超高速缓存行突发，

可在132M字节/秒连接到内存控制器后转让的32位传输。

由于TSB83AA22C装置的高通量的潜力，它可能会遇到大的PCI和遗留

1394总线的延迟，这可能导致在1394数据被溢出。为了克服这个潜在的问题，该

TSB83AA22C实现了深深的发送和接收FIFO （见第1.1节，

特点，

为FIFO的大小

信息）来缓冲1394数据，从而防止可能的，因为总线延迟问题。这也确保

该设备可以用于接收和发送的持续最大尺寸的同步或异步的数据有效载荷

在S800 。

该TSB83AA22C有限责任公司部分实现了其他性能增强，以提高整体性能

该装置中，如：为提高SBP-2的性能，物理交写入一个高度优化的物理数据路径

缓冲器，多个同步环境，以及先进的内部仲裁。

该TSB83AA22C有限责任公司部分还实现了硬件改进，以更好地支持数字视频（ DV ）

和MPEG数据流的接收和发送。这些增强功能通过同步启用

接收数字视频增强注册德州仪器扩展偏移A80H （参见第6.3.4节，

同步接收

数字视频增强功能寄存器）。

这些增强功能包括自动时间戳插入的

发送DV和MPEG格式的数据流和公共同步数据包（CIP）首标汽提

收到DV流。

1998年规格：本CIP格式是由IEC 61883-1定义。这些增强的同步数据

上下文被实现为用于同步的时间戳为DV和音频/视频硬件支持

CIP格式。该TSB83AA22C设备支持同步时间戳字段的修改，以确保

即通过软件插入的值不是陈旧的 - 即，小于当前周期定时器在分组是

传输。

该TSB83AA22C的性能和增强的吞吐量，使其成为今天的1394 PC的最佳选择

市场;然而，便携，移动，甚至今天的台式电脑的电源管理方案继续

要求设备使用越来越少的功率，和德州仪器的1394产品线也不断提高

通过提供功耗最低的1394设备在行业内的酒吧。该TSB83AA22C装置代表了下一代

德州仪器（TI）致力于发展，以满足功耗敏感的应用的挑战。该

TSB83AA22C器件具有超低运行功率需求和智能电源管理

功能，允许它以节省电力自主地根据设备的使用情况。该TSB83AA22C有限责任公司

部完全支持D0，D1， D2和D3

热/冷

如在规定的电源状态

2001年的PC设计指南

要求和

PCI电源管理规范。

PME事件唤醒的支持是受工作

系统支持和实施。

所要求的

1394开放式主机控制器接口规范

（ OHCI）和IEEE标准1394A -2000 ，内部

控制寄存器是存储器映射和nonprefetchable 。 PCI配置头通过访问

所指定的配置周期

PCI本地总线规范，

并提供插件和播放（ PNP）

兼容性。此外， TSB83AA22C LLC部分完全符合最新的

PCI局部总线

规格， PCI总线电源管理接口规范，

IEEE标准1394B -2002 ， IEEE标准

1394 -2000，和

1394开放式主机控制器接口规范。

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该TSB83AA22C物理层部分提供了实现所需要的数字和模拟收发器功能

在一个基于电缆的IEEE 1394网络中的两个端口节点。每根电缆的端口包括两个差分线

收发器。该收发器电路，包括根据需要来确定监测的线路条件

连接状态，初始化和仲裁，并为数据包的接收和发送。

该TSB83AA22C由多个电源电压供电， 3.3 V电源， I / O和LLC段，以及

核心电压电源为所述物理层设备部分。核心电压电源被提供给PLLVDD_CORE和

按照推荐的工作条件的要求DVDD_CORE终端。该

PLLVDD_CORE终端必须从DVDD_CORE终端，所述PLLVDD_CORE终端分离

分别分离以1μF和较小的去耦电容，并在DVDD_CORE端子

去耦用1μF和较小的去耦电容。 DVDD_CORE和之间的分离

PLLVDD_CORE可通过单独的电源导轨来实现，或者通过单个电源轨，其中该

DVDD_CORE和PLLVDD_CORE由滤波器的网络分开，以将噪音从PLLVDD_CORE

供应量。此外， REG_EN必须被拉低，以便为有限责任公司部分内部稳压器。如果

REG_EN不拉低时，一个1.8 V电源轨必须被施加到REG18引脚。

该TSB83AA22C需要一个外部98.304 MHz的晶体振荡器来生成参考时钟。外部

时钟驱动一个内部锁相环（PLL），其产生所需的基准信号。该参考

信号提供了控制出站编码信息传输的时钟信号。该

掉电（PD）的功能，当通过断言PD端子高使能时，停止PLL的操作。

数据比特以通过电缆端口被内部锁存被传输，组合串联，编码，和

在98.304 ， 196.608 ， 393.216 ， 491.52 ，或983.04 Mbps的（简称为S100 ，S200 ， S400中， S400B ，或者发送

S800的速度，分别）作为出站信息流。

以确保TSB83AA22C符合IEEE标准的1394b -2002标准中， BMODE终端必须

断言。

注意：

该BMODE终端不选择操作的电缆接口模式。该

BMODE终端选择的内部PHY部分， LLC部分接口模式

动作，并影响电缆上的仲裁模式。 BMODE必须拉

在正常操作期间高。

电缆接口可以按照任意的IEEE标准1394A -2000协议或IEEE标准1394B -2002协议上

这两个端口。操作模式是通过被连接的端口的接口能力来确定。当

端口的任一连接到IEEE标准1394 -2000兼容装置，在该端口上的有线接口

运行在兼容的S100 ， S200 ， S400或速度的IEEE标准1394A -2000数据选通模式。当一个

双语端口连接到一个IEEE标准1394B -2002兼容节点，在该端口上的电缆接口

每次在S400B或S800速度IEEE标准1394B -2002标准。该TSB83AA22C自动确定

正确的网线接口连接方法的双语端口。

操作端口为IEEE标准1394B -2002双语端口，数据选通信号，只为港口码头（或DS0

DS1 ）必须被拉到地通过一个1- kΩ电阻。该端口必须在IEEE标准1394B -2002操作

双语模式，每当一个IEEE标准1394B -2002双语或IEEE标准1394B -2002测试版仅连接器

连接到该端口。操作端口为IEEE标准1394 -2000专用端口，数据选通仅终端

（ DS0或DS1 ），必须通过一个1kΩ电阻上拉至3.3V的VCC 。该端口必须强制的唯一一次

数据选通的唯一模式是当该端口被连接到一个IEEE标准1394 -2000连接器（或者6针，这是

建议，或4针）。提供这种模式，以确保IEEE标准的1394b -2002的信号不会发送

整个IEEE标准1394 -2000电缆。

在分组接收时，串行数据位被由PHY部分分成2-，4-，或8位并行数据流和

发送到链路层控制器（LLC）部分。所接收的数据也被发送（重复）的其他

连接和有源电缆端口。

无论是双绞线A（ TPA ）和双绞线B（城规会）网线接口集成差分比较器

初始化和仲裁过程中，当连接到一个IEEE标准来监视线路状态

1394A -2000兼容的设备。这些比较器的输出被使用的内部逻辑，以确定

仲裁状态。所述TPA信道监视输入电缆的共模电压。此值

共模电压在IEEE标准1394 -2000模式的仲裁使用，并设置下一个的速度

数据包传输。此外， TPB信道监视对输入电缆的共模电压

TPB对用于远程提供双绞线偏压（ TPBIAS ）电压的存在。

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当连接到一个IEEE标准1394 -2000兼容节点，在TSB83AA22C物理层部分提供了一个1.86 -V

额定偏置电压为端口终止TPBIAS终端。物理层部分包含两个独立的

TPBIAS电路（每个端口一个）。这个偏置电压，通过线缆由遥控接收器时看到的，

表示活动连接的存在。这个偏置电压源必须用外部的过滤器来稳定

1电容器

μF.

在TSB83AA22C图部分线路驱动器的设计与外部112 Ω的终端电阻工作

为了网络相匹配的110 Ω电缆的阻抗。一个终端网络，需要在一个两端

双绞线电缆。每一个网络是由一对串联连接的56 - Ω的电阻器。的中点

一对连接到所述的TPA端子电阻器中的一个连接到其相应的TPBIAS电压

终奌站。该对直接连接到TPB终端电阻器的中点连接到接地

通过并联RC网络的5 kΩ和270 pF的推荐值。外的值

线路端接电阻的选择要满足的标准规格并联连接的时

内部接收电路。连接在R0和R1终端之间的外部精密电阻设置

驱动器的输出电流，以及其他内部工作电流。

当TSB83AA22C的电源是关闭的，而双绞线电缆连接，所述

TSB83AA22C发射器和接收器电路本电缆高阻信号，即不加载

该装置在电缆的另一端。

当TSB83AA22C物理层部分被用于在没有一个端口的一个或多个带出到连接器，该

的未使用的端口的双绞线终端必须终止进行可靠操作。对于每一个未使用的端口时，

端口必须强制为IEEE标准1394 -2000 - only模式（数据选通-only模式），在此之后， TPB +和

TPB-终端可以连在一起，然后拉至地面;或TPB +和TPB-终端可

连接到所建议的正常终止的网络。未使用的端口的TPA +和TPA-终端可以

悬空。该TPBIAS终端可以通过一个1 μF电容连接到地或左

悬空。

该TESTM ， TESTW ，SE和SM端子用于设置各种制造的测试条件。为

正常操作时， TESTM和TESTW终端必须连接到VDD通过一个1kΩ电阻。该

SE和SM端子必须连接到地通过一个1kΩ电阻。

三个封装端子被用作输入来设置默认值在三个配置状态位

自ID信息包。它们可以被拉高通过一个1kΩ电阻器或硬连线低的设备装置的功能

设计。的PC0 ， PC1， PC2和终端指示为节点（需要缺省功率级的状态

功率从电缆或将电源提供给所述电缆）的能力。在PHY寄存器组的竞争者位

表示该节点是一个竞争者要么为同步资源管理器（IRM）或用于总线

经理（ BM ）。在TSB83AA22C ，该位只能通过写PHY寄存器组进行设置。如果一个节点是成为

一个竞争者IRM或BM ，则该节点的软件必须设置在PHY寄存器设置该位。

物理层部分的LPS （链路功率状态）终端工作原理与LKON终端来管理电源

使用中的节点。从LLC部的PHY_LPS信号用于在与LCtrl位结合（见表

1和表2中的应用信息部分）来表示的有限责任公司的主动/电源状态

部分。脂多糖信号也会重置，关闭，并初始化物理层部分， LLC部分接口（州

该LCtrl状态的PHY部分， LLC部分界面完全控制受LPS不管输入

位）。的物理层部的内毒素终端必须连接到LLC节期间PHY_LPS终端

正常操作。

脂多糖输入被认为是不活动的，如果它保持低电平超过LPS_RESET时间（见LPS终端

定义），被认为是积极的，否则。当PHY部检测出的LPS的输入是无效的，该

PHY部- LLC部接口被置于低功率复位状态，其中的CTL和D输出

在逻辑0状态下保持和LREQ输入被忽略;然而， PCLK输出仍然有效。如果LPS

输入端保持低电平的时间超过了LPS_DISABLE时间（见脂多糖终端定义），则物理层

部- LLC部接口被置于低功耗禁用状态，其中PCLK输出也保持

无效。该TSB83AA22C需要继续进行正常的网络所需的物理层中继器的功能

无论操作的物理层部分， LLC部分接口的状态。当接口处于复位或

禁用状态和LPS的输入被再次观察到活性，物理层部初始化接口，并返回到

正常操作。物理层部分， LLC部分接口也处于禁用状态的硬件期间举行

复位。当LPS终端正被感测为已进入后返回到活动状态

LPS_DISABLE时， TSB83AA22C发出一个总线复位。这个广播节点的自ID信息包，这

包含已更新的L比特状态（ PHY部分， LLC部分现在被访问）。

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在PHY部使用LKON终端通知了LLC部上电和被激活。当

激活时，输出LKON信号是一个方波。在PHY部激活LKON输出，当LLC。

部分处于非活动状态和唤醒事件发生。该LLC节被认为是不活动时，无论是LPS

输入无效，如上所述，或LCtrl位清0唤醒事件发生时，链路上的物理层

数据包发往该节点接收，或有条件时的PHY中断。物理层部分

释放了LKON输出时， LLC部分被激活（无论LPS检测为活跃和LCtrl位

设置为1）。当总线复位时，除非PHY中断PHY部分也拉高了LKON输出

状态存在，否则将导致LKON被激活。如果TSB83AA22C重新上电和

功率等级为0至4，则物理层部断言LKON约167

μs

或直到两者的LPS是

积极的LCtrl位为1 。

特别提示：

本品仅适用于大批量的PC应用程序。联系support@ti.com了解更多

信息。

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