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TNETE2201B
1.25千兆以太网收发器
SLLS367A - 1999年6月 - 修订1999年8月
D
D
D
D
D
1.25千兆比特每秒( Gbps)的千兆位
以太网收发器
的基础上P802.3Z规格
发送串行数据高达1.25 Gbps的
工作在3.3 V电源电压
5V容限的TTL输入
D
D
D
D
D
接口电力电缆/背板或
光模块
PECL电压差分信令负荷,
1 V典型值50
– 75
接收器差分输入电压
200mV的最小
低功耗
64引脚四方扁平封装具有热
增强型封装
描述
该TNETE2201B吉比特以太网收发器提供了用于超高速双向点至点的数据
传输。此设备是根据所提出的10位接口规范的定时要求
在P802.3z千兆工作组。
博士或PJD包装
( TOP VIEW )
GND_A
V
CC
_A
DOUT_TXP
DOUT_TXN
V
CC
_A
V
CC
_A
GND_CMOS
V
CC
_A
GND_A
V
CC
_A
DIN_RXP
V
CC
_A
DIN_RXN
GND_Rx
GND_CMOS
TD0
TD1
TD2
V
CC
-CMOS
TD3
TD4
TD5
TD6
V
CC
-CMOS
TD7
TD8
TD9
GND_CMOS
GND_Tx
TC1
1
2
3
4
5
6
7
8
9
64 63 62 61 60 59 58 57 56 55 54 53 52 51 50 49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
V
CC
-rX
RC1
RC0
SYNC
GND_TTL
RD0
RD1
RD2
V
CC
_TTL
RD3
RD4
RD5
RD6
V
CC
_TTL
RD7
RD8
RD9
GND_TTL
版权
1999年,德州仪器
10
11
12
13
14
15
33
16
1718 19 20 21 22 23 24 25 26 27 28 29 30 31 32
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
TC0
V
CC
_TX
LOOPEN
V
CC
_A
GND_A
REFCLK
V
CC
-CMOS
SYNCEN
GND_CMOS
版权所有
LCKREFN
V
CC
_A
V
CC
_A
RBC1
RBC0
GND_A
邮政信箱655303
达拉斯,德克萨斯州75265
1
TNETE2201B
1.25千兆以太网收发器
SLLS367A - 1999年6月 - 修订1999年8月
描述(续)
该设备的预期应用是提供一种积木显影点至点的基带数据
传输大约50受控阻抗媒体
75
.
传输介质可以是
印刷电路板布线,背板,电缆或光纤介质。最终的速率和距离的数据
转移是依赖于介质的衰减特性和噪声耦合到所述
环境。
该TNETE2201B执行数据序列化和反序列化器(SERDES )功能的千兆位
以太网物理层接口。该收发器工作在1.25Gbps的(典型值) ,可提供高达1000 Mbps的速度
的带宽以上的铜或光学介质接口。该串行器/发送器接收8B / 10B并行
编码的数据的字节。并行数据字节序列化和传输差分单向到零
(NRZ)处的伪电致化学发光( PECL )的电压电平。解串器/接收器从输入中提取时钟信息
串行数据流和反串行化的数据,并输出一个10位并行数据字节。该10位数据的字节被输出
相对于两个接收字节时钟( RBC0 , RBC1 ) ,允许协议设备时钟的并行字节
红细胞时钟上升边缘。
该收发器将自动锁定到输入的数据,而不需要prelock 。然而,该收发器
可以命令锁定到外部提供的基准时钟( REFCLK ),为复位功能,如果需要的话。
该TNETE2201B提供了自我测试目的的内部回送能力。从串行串行数据
被直接传递到解串器,允许该协议的设备的功能性自检物理接口。
该TNETE2201B的特点是操作从0℃至70℃。
2
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TNETE2201B
1.25千兆以太网收发器
SLLS367A - 1999年6月 - 修订1999年8月
功能框图
LOOPEN
TX +
TX ±
TD0 - TD9
10
/
10-Bit
注册
10
/
注册
REFCLK
125兆赫
时钟
倍增器
SYNCEN
SYNC
同步
检测
RD0 - RD9
10
/
10-Bit
注册
10
/
注册
62.5兆赫
RBC0
RBC1
62.5兆赫
÷
2
125兆赫
PLL时钟
恢复和
数据再定时
2:1
MUX
RX +
RX ±
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3
TNETE2201B
1.25千兆以太网收发器
SLLS367A - 1999年6月 - 修订1999年8月
I / O结构
PECL输入( DIN_RXP , DIN_RXN )
VDD
100
DIN_RXP
4 k
VCM
4 k
DIN_RXN
DOUT_TXN
+
_
VDD
DOUT_TXP
PECL输出( DIN_TXP , DIN_TXN )
VDD
VDD
CMOS输入( TD0 - TD9 , LOOPEN , REFCLK , SYNCEN , LCKREFN )
VDD
VDD
P
R1
120
输入
R2
码头
REFCLK , TD0 - TD9
LOOPEN
SYNCEN , LCKREFN
N
R1
R2
开路开路
开路
400 k
400 k
开路
CMOS输出( RD0 - RD9 , RBC0 , RBC1 , SYNC)
VDD
P
产量
N
4
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TNETE2201B
1.25千兆以太网收发器
SLLS367A - 1999年6月 - 修订1999年8月
终端功能
终奌站
名字
DOUT_TXP
DOUT_TXN
62
61
TYPE
I / O和数据
产量
差分输出传输。 DOUT_TXP和DOUT_TXN是差分串行输出,接口
到一个铜或光学I / F模块。这些终端发送的NRZ数据以1.25 Gbps的速率。
DOUT_TXP和DOUT_TXN保持静态时LOOPEN高,是活跃在LOOPEN是
低。
差分输入接收。 DIN_RXP和DIN_RXN一起是差分串行输入接口
由铜或光学I / F模块。这些终端接收的NRZ数据以1.25 Gbps的速率和
活跃在LOOPEN保持低电平。
锁定参考。当LCKREFN为低电平时,接收PLL相位锁定到所提供的
REFCLK信号。 LCKREFN prelocks或复位接收PLL 。
环能。当LOOPEN为高电平(有效)时,内部环回路径被激活。该
发送的串行数据被直接路由到接收器的输入端。这提供了一种自检
能力与该协议的设备一起使用。该DOUT_TXP和DOUT_TXN输出保持
环回测试期间是静态的。 LOOPEN是在与外部标准的运行状态保持为低电平
串行输出和积极投入。
接收字节时钟。 RBC0和RBC1是62.5兆赫回收用于同步的时钟
10位上的RD0输出数据 - RD9 。该10位输出数据字是有效的RBC0的上升沿
和RBC1 。这些时钟与同步配合调整,以半字边界
察觉。时钟在数据调整总是扩大,从不slivered或截断。
RBC0寄存器的字节1和3接收到的数据。 RBC1寄存器字节0和2接收到的数据。
接收电容。 RC0和RC1是用于接收机的内部外部电容器连接
锁相环滤波器。对于该外部电容的推荐值为2 nF的( 0.1的值
F
也可以被使用,
见注1 ) 。
接收数据。这些输出传送来自收发器输出的10位并行数据的协议
层。的数据被引用到端子RBC0和RBC1 。接收到的数据字节0 ,其中包含了
K28.5字符是字节对齐RBC1的上升沿。 RD0的是第一个比特接收。
参考时钟。 REFCLK是外部125 MHz的输入时钟同步的接收器和
发射器接口。发射机使用这个时钟寄存器是10位的输入数据( TD0..TD9 )为
序列化。 REFCLK也被用来作为一个接收的PLL预设或参考时LCKREFN被启用。
同步检测。 SYNC被置为高电平时检测到的K28.5字符中的串行数据
路径。 SYNC为高电平1/2 REFCLK周期。 SYNC脉冲输出只有当SYNCEN是
激活(高电平) 。注意: SYNC为活跃字节0 ,因此,有源上的上升沿
RCB1.
同步功能使能。当SYNCEN被置为高电平时,内部同步功能
被激活。当此功能开启时,收发器检测到K28.5字符( 0011111010
负开始视差)的串行数据流中,并重新排列在字节的边界上,如果数据
所需。当SYNCEN为低电平时,串行输入数据成帧在RD0 - RD9 。
传输电容。 TC0和TC1是用于发射机内部外部电容器连接
锁相环滤波器。这种外部电容的推荐值是2 NF( 0.1的值
F
也可以是
用过的,见注1 ) 。
传输数据。这些输入携带来自协议设备输出的10位并行数据到收发信机
序列化和传输。这10位并行数据被移入的上升收发器
REFCLK的边缘和发送与TD0一个串行数据流发送的第一个位。
描述
DIN_RXP
DIN_RXN
LCKREFN
LOOPEN
54
52
27
19
输入
输入
输入
RBC0
RBC1
31
30
产量
RC1,
RC0
RD0 - RD9
49
48
45,44,43,41
40,39,38,36
35,34
22
类似物
产量
REFCLK
输入
SYNC
47
产量
SYNCEN
24
输入
TC1
TC0
TD0 - TD9
16
17
2,3,4,6
7,8,9,11
12,13
类似物
输入
注1 : 0.1滤波电容值
F
可以用下面的考虑可以使用: PLL的跟踪带宽将减小,由于
到较大的滤波电容器。这减少了传输和接收的PLL的拒绝低频噪声或惊奇的电压能力
电源或数据流。必须注意,在供给VCC_TX (端子18)和VCC_RX (端子50)的滤波,以抑制功率
电源噪声。
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