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TNETA1570
ATM划分和组装设备
具有集成的64位PCI主机接口
SDNS033B - 1995年6月 - 修订1996年5月
D
单芯片分割和重组
D
设备( SAR)的全双工
ATM的适配层( AAL )处理
集成的64位外设组件
用于传送数据和控制接口
对于数据包分割和信息
数据包重组
提供完整的封装和
终止AAL5的数据包
同时支持发送和接收缓冲
链接(缓冲分散/集中)
提供的早期分割
发送数据包由开始的
分割过程一旦传输
缓冲区而不是等待的可用
整个数据包进行缓冲
D
提供完整的VPI / VCI支持,并允许
为的同时分割
1023数据包和同步
30720的数据包重组
字节宽度的单元接口为全双工及
符合ATM -论坛的UTOPIA
文件
电池接口可以被编程为
操作为任一物理(PHY )层
接口或作为ATM的层接口
提供重组超时的
传入数据包
提供了一个高优先级机制
发送恒定比特率业务
提供支持透明/空AAL
D
D
D
D
D
D
D
D
描述
该TNETA1570是一个异步传输模式(ATM)的分割和重组(SAR )设备与
一个64位的外围组件互连(PCI )总线接口。该器件集成了ATM适配层
( AAL )处理,ATM SAR处理全双工操作高达STS -3C率
155.52兆比特/秒,而对PHY层上的寄存器接口的控制。该器件可提供完整的
封装和终端硬件AAL5的数据包。
该TNETA1570支持使用ATM协议无论是作为高速网络应用
骨干网/背板或桌面技术。功能包括: VPI / VCI支持高层次,高优先级
/聚集为恒定比特率业务,早缓冲器分割,缓冲散射分割选项能力,并
32位/ 64位PCI总线的支持。
该设备包含用于传输数据和控制信息的集成32- / 64位PCI接口。该
分段和重新组装过程中使用的主存储器,用于存储被发送或接收的分组。
无本地数据包存储器是必需的。该设备能够同时分割高达1023包
同时重装30720包。该器件支持全系列的VPI / VCI值两者
发送和接收操作。
该TNETA1570还支持传输透明/ null的AAL用于传输的两种方法
专有信息。此外,该设备可识别的ATM层的OAM信元,并提供了一种机制,用于
处理这些细胞。该器件包含一个全双工的字节宽的单元格界面符合ATM论坛
UTOPIA规范。电池接口可以被编程来操作,可以是PHY层接口或一个
ATM层接口。
该集成的PCI主机接口工作,可以是32位或64位的接口,用于DMA操作。该装置
操作为如果目标设备可以接受64位传送64位的接口;否则,它作为一个32位的
界面。在PCI主机接口提供主机和从机功能,工作频率高达
33兆赫。在PCI -主机接口在功能上符合PCI本地总线规范2.0修订版。该
TNETA1570操作进行了详细的说明
操作原理
部分。
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
1996年,德州仪器
邮政信箱655303达拉斯,德克萨斯州75265
邮政信箱1443休斯敦,得克萨斯州77251-1443
1
SDNS033B - 1995年6月 - 修订1996年5月
TNETA1570
ATM划分和组装设备
具有集成的64位PCI主机接口
多功能一体机包装
( TOP VIEW )
V
CC
CMAD16
CMAD15
CMAD14
GND
CMAD13
CMAD12
CMAD11
CMAD10
CMAD9
CMAD8
V
CC
CMAD7
GND
CMAD6
CMAD5
CMAD4
CMAD3
CMAD2
CMAD1
GND
CMAD0
V
CC
CMWE
CMOE
CMDATA31
CMDATA30
CMDATA29
GND
CMDATA28
CMDATA27
CMDATA26
V
CC
CMDATA25
CMDATA24
CMDATA23
GND
CMDATA22
CMDATA21
CMDATA20
CMDATA19
CMDATA18
CMDATA17
V
CC
CMDATA16
GND
CMDATA15
CMDATA14
CMDATA13
CMDATA12
CMDATA11
CMDATA10
GND
CMDATA9
V
CC
CMDATA8
CMDATA7
CMDATA6
CMDATA5
CMDATA4
59
57
55
53
51
49
47
45
43
41
39
37
35
33
31
29
27
25
23
21
19
17
15
13
11
9
7
5
3
1
121
123
125
127
129
131
133
135
137
139
141
143
145
147
149
151
153
155
157
159
161
163
165
167
169
171
173
175
177
PAD29
GND
PAD28
PAD27
V
CC
PAD26
PAD25
GND
PAD24
PCBE3
PIDSEL
V
CC
PAD23
PAD22
GND
PAD21
PAD20
PAD19
PAD18
GND
PAD17
PAD16
V
CC
PCBE2
PFRAME
GND
PIRDY
PTRDY
PDEVSEL
PSTOP
GND
pperr
V
CC
NC - 无内部连接
2
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邮政信箱1443休斯敦,得克萨斯州77251-1443
PSERR
PPAR
PCBE1
GND
PAD15
PAD14
PAD13
V
CC
PAD12
GND
PAD11
PAD10
PAD9
PAD8
GND
PCBE0
V
CC
PAD7
PAD6
PAD5
GND
PAD4
PAD3
PAD2
V
CC
PAD1
GND
179
CMAD17
NC
NC
NC
NC
RESCLK
RESEN
V
CC
RESCLAV
RESSOC
RESPAR
RESDATA7
RESDATA6
RESDATA5
RESDATA4
GND
RESDATA3
RESDATA2
RESDATA1
RESDATA0
RESPERR
ATMCLK
PHY / ATM
SEGDATA7
SEGDATA6
SEGDATA5
SEGDATA4
GND
SEGDATA3
SEGDATA2
SEGDATA1
SEGDATA0
V
CC
SEGPAR
SEGCLK
SEGEN
SEGSOC
SEGCLAV
NC
NC
TESTMODE
TRST
TCK
TMS
TDO
TDI
GND
HPSACK
HPSREQ
PSB1
PSB0
PINTA
PRST
PCLK
V
CC
PGNT
GND
PREQ
PAD31
PAD30
61
63
239
237
65
235
67
233
69
231
71
229
73
227
75
225
77
223
79
221
81
219
83
217
85
215
87
213
89
211
91
209
93
207
95
205
97
203
99
201
101
199
103
197
105
195
107
193
109
191
111
189
113
187
115
185
117
183
119
181
CMDATA3
GND
CMDATA2
CMDATA1
CMDATA0
PAD32
GND
PAD33
PAD34
PAD35
V
CC
PAD36
GND
PAD37
PAD38
PAD39
PAD40
GND
PAD41
V
CC
PAD42
PAD43
PAD44
PAD45
GND
PAD46
PAD47
V
CC
PAD48
PAD49
GND
PAD50
PAD51
PAD53
PAD53
V
CC
PAD54
GND
PAD55
PAD56
PAD57
PAD58
GND
PAD59
V
CC
PAD60
PAD61
PAD62
GND
PAD63
PPAR64
PCBE4
V
CC
PCBE5
GND
PCBE6
PCBE7
PREQ64
PACK64
PAD0
TNETA1570
ATM划分和组装设备
具有集成的64位PCI主机接口
SDNS033B - 1995年6月 - 修订1996年5月
终端功能
PCI总线接口
终奌站
名字
I / O
描述
PCI确认64位传输。 PACK64由当前目标指示的能力,以驱动
支持一个64位的连接。当确认64位访问, PACK64的说法
暗合了PDEVSEL的说法。如果PACK64不主张一致PDEVSEL ,
交易默认为32位。
PACK64
182
I / O
( 3态)
PAD31 -PAD0
119 121,
123 124,
126 127,
129,
133 134,
136 139,
141 142,
158 160,
162,
164 167,
171 173,
175 177,
179, 181
191,
193 195,
197,
199 202,
204,
206 209,
211 212,
214 215,
217 220,
222,
224 227,
229,
231 233,
235
130, 144,
156, 169
184 185,
187 , 189
114
149
PCI地址总线和数据总线。 PAD31 -PAD0复用在相同的物理终端。
在一个事务处理的地址阶段的第一阶段, PAD31 -PAD0包含一个32位的物理层
地址。这个阶段是时钟周期时, PFRAME中被置位。
I / O
( 3态)
在数据阶段, PAD7 -PAD0包含至少显著字节及PAD31 -PAD24
包含最显著字节。写入的数据是稳定的,当PIRDY断言。读取数据
稳定时PTRDY断言。在这些时钟周期的数据传输时,这两个PIRDY
和PTRDY断言。
PCI地址总线和数据总线。 PAD63 -PAD32复用在相同的物理终端。
在一个事务处理的地址阶段的第一阶段, PAD63 -PAD32包含一个32位的
PHY的地址。这个阶段是时钟周期时, PFRAME中被置位。
I / O
( 3态)
在数据阶段, PAD39 -PAD32包含至少显著字节及PAD63 -PAD56
包含最显著字节。写入的数据是稳定的,当PIRDY断言。读取数据
稳定时PTRDY断言。在这些时钟周期的数据传输时,这两个PIRDY
和PTRDY断言。
PAD63 -PAD32
PCBE3 -PCBE0
I / O
( 3态)
I / O
( 3态)
I
I / O
( 3态)
I / O
( 3态)
I
PCI总线命令和字节使能。 PCBE3 -PCBE0线被复用在相同的PCI
终端。在一个事务处理的地址相, PCBE3 -PCBE0行定义了总线
命令。在数据阶段, PCBE3 -PCBE0线定义哪些字节是有效的。
PCI总线命令和字节使能。 PCBE7 -PCBE4线被复用在相同的PCI
终端。在一个事务处理的地址相, PCBE7 -PCBE4行定义了总线
命令。在数据阶段, PCBE7 -PCBE4线定义哪些字节是有效的。
PCI时钟。 PCLK提供定时的PCI接口上的所有交易。
PCI设备选择。当积极推动下, PDEVSEL表明驾驶的地址
装置被解码为当前访问的目标。作为输入, PDEVSEL指示是否
总线上的任何设备被选中。
PCI框架。 PFRAME中被驱动通过当前主指示的开始和持续时间
访问。 PFRAME中被认定的总线事务的开始和保持有效
在数据传送期间。当PFRAME为无效,该交易正处于最后阶段的数据。
PCI总线授权。 PGNT指示给仲裁器已授予访问总线代理。 PGNT
是一个点 - 对 - 点信号和每一个主站具有其自己的。
PCBE7 -PCBE4
PCLK
PDEVSEL
PFRAME
145
PGNT
116
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邮政信箱1443休斯敦,得克萨斯州77251-1443
3
SDNS033B - 1995年6月 - 修订1996年5月
TNETA1570
ATM划分和组装设备
具有集成的64位PCI主机接口
终端功能(续)
PCI总线接口(续)
终奌站
名字
PIDSEL
131
I / O
I
O
(开
漏)
I / O
( 3态)
描述
PCI初始化和设备选择。 PIDSEL作为一个芯片中读取配置选择
事务和写事务。
PCI中断。 PINTA是从PCI特区中断请求。
PCI引发准备。 PIRDY表示引发剂的(总线主控)的能力来完成
该事务的当前数据段。在写, PIRDY表示对有效数据
PAD31 -PAD0 。在读, PIRDY指示主准备接受数据。
PIRDY使用与PTRDY时,等待周期被插入,直到两者都有效。
PCI奇偶校验。 PPAR是跨PAD31 -PAD0和PCBE3 -PCBE0偶校验。对于数据的阶段,
PPAR是有效的一个时钟周期后,无论是PIRDY断言在写或PTRDY断言在读。
一旦断言, PPAR完成当前数据后仍然有效,直至一个时钟
阶段。主驱动PPAR的寻址和写入数据的阶段,并且目标硬盘
PPAR对所读取的数据相位。
PCI奇偶校验。 PPAR64对面AD63 -AD32和CBE7 -CBE4偶校验。对于数据的阶段,
PPAR64是有效的一个时钟周期后,无论是PIRDY断言在写或PTRDY断言上
一读。一旦断言, PPAR64完成当前后仍然有效,直至一个时钟
数据阶段。主驱动器的PPAR- 64为地址和写入数据相,并且目标
驱动PPAR对读数据阶段。
PCI奇偶校验错误。 PPERR上除特殊周期中的所有命令的报告数据奇偶校验错误。一
代理不能报告,直到它已声称PDEVSEL接入,并完成了数据的PPERR
阶段。
PCI请求。 PREQ指示此代理希望使用总线仲裁器。每一个主
有它自己的PREQ 。
PCI要求64位传输。 PREQ64是由当前主表示了欲望的驱使
64位访问。当启动64位事务, PREQ64的断言是一致
PFRAME中的断言。如果一个64位的存取不会被PFRAME中,接入确认
默认为32位。传输类型( 32或64位)被动态地协商为每个事务
并保持恒定的事务的长度。
PCI复位。 PRST迫使每个器件的一个已知的状态,在PCI序列。
PCI边带。 PSB1 -PSB0行定义了传输的大小时TNETA1570是总线
高手。是这些信号的定义如下:
00:
01:
10:
11:
4个字节的传输
16字节的传输(除接收完成环)
有效载荷转移
传送到接收完成环( 16字节传输)
PINTA
112
PIRDY
147
PPAR
155
I / O
( 3态)
PPAR64
190
I / O
( 3态)
pperr
152
I / O
( 3态)
O
PREQ
118
PREQ64
183
I / O
( 3态)
PRST
113
I
PSB1 -PSB0
110 111
O
PSB1 -PSB0是同步的总线主控操作的地址相
TNETA1570 。在总线重试断开后的边带信号不发生变化。
PSERR
154
I / O
(开
漏)
I / O
( 3态)
I / O
( 3态)
PCI系统错误。 PSERR报告特殊周期地址奇偶校验错误和数据奇偶校验错误
命令。
PCI停止。 PSTOP表示当前目标正在请求主停止当前
交易。
PCI目标做好了准备。 PTRDY指示目标代理(选择设备)的能力来完成
该事务的当前数据段。在读, PTRDY表示有效数据是本
在PAD31 -pad 0在写, PTRDY表示目标是准备接受数据。
PSTOP
150
PTRDY
148
4
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邮政信箱1443休斯敦,得克萨斯州77251-1443
TNETA1570
ATM划分和组装设备
具有集成的64位PCI主机接口
SDNS033B - 1995年6月 - 修订1996年5月
终端功能(续)
细胞分割界面
终奌站
名字
I / O
可分割单元
SEGCLAV
98
O
( CMOS)的
PHY模式
ATM模式
SEGCLAV ( RXEMPTY / RXCLAV )表示一个完整的细胞是可用的。
SEGCLAV ( TXENB )为低电平时, SEGDATA包含一个有效字节。
SEGCLK ( RXCLK )用于上SEGDATA同步传输。 SEGCLK是
从UTOPIA接口来源。
SEGCLK ( TXCLK )用于上SEGDATA同步传输。 SEGCLK是
从ATMCLK来源。
描述
分割时钟
SEGCLK
95
I
( TTL)的
PHY模式
ATM模式
细分数据
SEGDATA7 -
SEGDATA0
84 87,
89 92
O
( CMOS)的
PHY模式
ATM模式
SEGDATA7 -SEGDATA0 ( RXDATA ) ]是由源字节宽的真实数据
TNETA1570 。 SEGDATA7是MSB。
SEGDATA7 -SEGDATA0 ( TXDATA )是字节宽的由来源于真实数据
TNETA1570 。 SEGDATA7是MSB。
分割使
SEGEN
96
I
( TTL)的
PHY模式
ATM模式
O
( CMOS)的
SEGEN ( RXENB )表示有效字节将在下一时钟周期被发送。
SEGEN ( TXFULL / TXCLAV )表示至少1个字节SEGDATA将
接受的。
分割平价
SEGPAR
94
PHY模式
ATM模式
SEGPAR ( RXPAR )是奇校验位在SEGDATA7 -SEGDATA0 。
SEGPAR ( TXPAR )是奇校验位在SEGDATA7 -SEGDATA0 。
SEGSOC ( RXSOC )是当SEGDATA包含的第一个有效字节的高有效
的细胞。
SEGSOC ( TXSOC )是当SEGDATA包含的第一个有效字节的高有效
的细胞。
细胞的分割开始
SEGSOC
97
O
( CMOS)的
PHY模式
ATM模式
高优先级划分(请求和应答)
终奌站
名字
I / O
描述
高优先级的分割请求。 HPSREQ进行采样,每一个新的细分机会
并且是同步的PCI总线时钟。当HPSREQ是活动的, TNETA1570启动
程序,用于发送由发送DMA通道1的细胞为了确保高优先级的
分割请求被处理后, HPSREQ一直有效,直到HPSACK被设置为低。 HPSREQ
在当HPSACK是断言两个PCI总线时钟周期为无效。
高优先级的划分进行确认。 HPSACK保持一个PCI总线时钟周期
确认检测到HPSREQ 。
HPSREQ
109
I
( TTL)的
HPSACK
108
O
( CMOS)的
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    地址:深圳市福田区振兴路156号上步工业区405栋3层

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    -
    -
    -
    -
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电话:13910052844(微信同步)
联系人:刘先生
地址:北京市海淀区增光路27号院增光佳苑2号楼1单元1102室
TNETA1570
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