TMS320VC5421
数字信号处理器
SPRS098 - DECEMBER 1999
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200 -MIPS双核DSP组成的两
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独立的子系统
每个核心具有先进的多总线
建筑和三个独立的16位
数据存储器总线和一个程序总线
40位算术逻辑单元（ ALU ）
包括一个40位的桶形移位器和两个
40位每个核心蓄电池
每个核心拥有17位
×
17位并行
乘法器耦合到40位加法器的
非流水线单周期乘法/
累加（ MAC）运算
每个核心拥有比较，选择和
存储单元（ CSSU ）的添加/比较
选择维特比算的
每个核心拥有指数编码器来
计算一个40位的指数值
在一个周期内累加器的值
每个核心拥有两个地址发生器
与8个辅助寄存器和两个
辅助寄存器算术单元
（ ARAUs ）
16位数据总线和数据总线持有人
特征
512K-Word
×
16位扩展计划
地址空间
总共256K字
×
16位双核和
单访问片内RAM （ 128K字X
16位共享内存）
单指令重复和
块重复操作
说明随着32位长的字
操作数
说明2或3操作数读
快速返回从中断
算术指令采用并行存储
和并行加载
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条件存储指令
CLKOUT的输出控制
TOUT的输出控制
功耗控制使用IDLE1 ，
IDLE2和IDLE3说明
双1.8 -V （核心）和3.3 V （ I / O）电源
耗材低功耗，快速操作
10 ns的单周期定点指令
通过两个处理器间通信
内置8元的FIFO
十二通道直接存储器访问
（ DMA）传输数据而无需CPU
加载（六通道每子系统
外部访问）
六个多通道缓冲串行端口
（ McBSP的） 128通道选择
能力（每个子系统3 McBSP的）
16位主机端口接口（ HPI ）复
与外部存储器接口引脚
软件可编程锁相环
环路（ APLL ）提供了几个时钟
选项（需要外部TTL振荡器）
包括JTAG功能进行在线
仿真
片基于扫描的仿真逻辑，
IEEE标准1149-1
{
（JTAG） Boundary-
扫描逻辑
两个软件可编程定时器
（每个子系统）
软件可编程等待状态
发电机（ 14等待美国最大）
提供144引脚微创球栅
阵列（ GGU后缀）和144引脚薄型四方
扁平封装（ TQFP ） （ PGE后缀）包
描述
在TMS320VC5421的定点数字信号处理器（DSP）是在200 MIPS的运行的双核溶液
性能。在“ 5421由两个核心能力到核心的通信和对DSP子系统
128K字零等待状态的片内程序存储器由两个DSP子系统共享。每个子系统
由一个“ 54X DSP内核， 32K字的程序/数据DARAM ， 32K字数据SARAM ， 2K字ROM ，三
多通道串行接口， XDMA逻辑，一个定时器， 1 APLL和其他杂项电路。
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
微星是德州仪器的商标。
IEEE标准1149.1-1990 ， IEEE标准测试接入端口和边界扫描结构。
预告信息涉及新产品的采样或
开发试制阶段。特征数据和其他
特定网络阳离子如有更改，恕不另行通知。
版权
1999年，德州仪器
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超前信息
TMS320VC5421
数字信号处理器
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描述（续）
的' 5421还包含一个主机端口接口（HPI ） ，其允许' 5421可以看作是一个存储器映射
外围设备到主机处理器。在“ 5421是引脚兼容的TMS320VC5420 。
每个子系统都有其独立的程序和数据空间，允许同时访问程序
指令和数据。两个读操作和一次写操作可以在一个周期内被执行。说明
与并行存储和应用程序特定的指令可以充分利用这种结构。此外，数据可以
程序和数据空间之间传送。这种并行性支持一组功能强大的算术，逻辑，
和位操作操作都可以在一个机器周期内完成。在“ 5421包括
控制机制来管理中断，反复操作，和函数调用。此外， “ 5421具有
片上程序存储器128K的话，可以在两个子系统之间共享。
的' 5421的目的是作为一种高性能，低成本，高密度DSP用于远程数据访问或画外音
IP子系统。它的目的是保持当前的调制解调器架构，以最小的硬件和软件
的影响，从而使现有的调制解调器技术开发力度重用。
注意：
此数据表被设计为用于与所述
TMS320C5000 DSP系列的功能
概观
（文献编号SPRU307 ） 。
超前信息
从迁移“到5420的” 5421
谁是从迁移“ 5420到” 5421需要用户考虑到的以下差异
在两个设备之间。
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的' 5421的存储器结构已被改变，其中包含共享存储器的128K ×16位字。
的“ 5421的DMA得到了增强，以提供对外部和内部存储器。
在HPI和DMA存储器映射已更改，以纳入新的记忆“ 5421 。
ROM中的2K ×16位字被添加到“ 5421只引导装入的目的。
在压控振荡器引脚“ 5420已经被替换上了HOLDA针' 5421和HOLD引脚加入
在“ 5421在之前未使用的引脚位置。
该McBSP的已经更新了一个新模式，使128信道选择功能。
McBSP的CLKX / R引脚可以作为输入内部时钟频率发生器，无需CLKS样的功能
额外引脚的处罚。
在“ 5421拉美经济体系/ B引脚变为输入的I / O / Z的附加功能。
注意：
欲了解更多详细信息，请参阅5420至5421迁移问题的文档。
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DVDD是用于I / O引脚的电源而CVDD为CPU核心电源。 VSS是接地同时为I / O管脚和芯
中央处理器。
显示仅非复用模式引脚配置。见引脚分配表的TMS320VC5421PGE复用功能
特定引脚和具体针数。
该TMS320VC5421PGE 144引脚薄型四方扁平封装（ TQFP ）是footprint-和引脚兼容' 5420 。
PPD15
PPD14
VSS
PPD13
PPD12
A_BFSR0
A_BDR0
A_BCLKR0
A_BFSX0
VSS
CVDD
A_BDX0
A_BCLKX0
MSTRB
DS
PS
B_BCLKX0
B_BDX0
DV DD
V SS
B_BFSX0
B_BCLKR0
B_BDR0
CVDD
V SS
B_BFSR0
读/写
PPA2
PPA3
拉美经济体系/ B
PPD8
PPD9
PPD10
PPD11
VSS
VSS
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超前信息
PPD7
PPA8
PPA0
DVDD
PPA9
PPD1
A_INT1
A_NMI
IOSTRB
A_GPIO2/BIO
A_GPIO1
A_RS
A_GPIO0
VSS
VSS
CVDD
A_BFSR1
A_BDR1
A_BCLKR1
A_BFSX1
CVDD
VSS
A_BDX1
A_BCLKX1
A_XF
A_CLKOUT
HOLDA
TCK
TMS
TDI
TRST
EMU1/OFF
DVDD
A_INT0
EMU0
TDO
109
VSS
PPD0
PPD5
PPD4
PPD6
A_BFSX2
A_BDX2
A_BFSR2
A_BDR2
A_BCLKR2
VSS
CV DD
A_BCLKX2
准备
DVDD
CLKIN
HOLD
VSSA
AV DD
VSS
B_BCLKX2
B_BDX2
B_BFSX2
B_BCLKR2
CVDD
VSS
B_BDR2
B_BFSR2
PPD2
PPD3
PPA1
PPA5
DV DD
PPA4
PPA6
PPA7
PGE包装
（ TOP VIEW ）
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
108
107
106
105
104
103
102
101
100
99
98
97
96
95
94
PPA14
PPA15
VSS
PPA16
PPA17
B_INT0
B_INT1
B_NMI
IS
B_GPIO2/BIO
B_GPIO1
B_GPIO0
B_BFSR1
B_BDR1
CVDD
VSS
B_BCLKR1
B_BFSX1
VSS
B_BDX1
B_BCLKX1
CVDD
VSS
TEST
XIO
B_RS
B_XF
B_CLKOUT
HMODE
HPIRS
PPA13
PPA12
VSS
DVDD
PPA11
PPA10
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数字信号处理器
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GGU包装
（ BOTTOM VIEW ）
13 12 11 10 9
8
7
6
5
4
3
2
1
A
B
C
D
E
F
G
H
J
超前信息
K
L
M
N
该引脚分配表的TMS320VC5421GGU列出了每个引脚的名称和它的相关引脚数
这144引脚的球栅阵列（BGA）封装，它是footprint-和管脚兼容的' 5420 。
该信号说明表列出了每个引脚的名称，功能和操作模式（ S）为' 5421设备。
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