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TMS320VC5420
定点数字信号处理器
SPRS080C - 1999年3月 - 修订2000年4月
D
200 -MIPS双核DSP组成的两
D
D
D
独立的子系统
每个核心具有先进的多总线
建筑和三个独立的16位
数据存储器总线和一个程序总线
40位算术逻辑单元( ALU )
包括一个40位的桶形移位器和两个
40位每个核心蓄电池
每个核心拥有17-
×
17位并行
乘法器耦合到40位加法器的
非流水线单周期乘法/
累加( MAC)运算
每个核心拥有比较,选择和
存储单元( CSSU )的添加/比较
选择维特比算的
每个核心拥有指数编码器来
计算一个40位的指数值
在一个周期内累加器的值
每个核心拥有两个地址发生器
与8个辅助寄存器和两个
辅助寄存器算术单元
( ARAUs )
16位数据总线和数据总线持有人
特征
256K
×
16扩展程序地址
空间
共200K
×
16双核和单访问
片上RAM
单指令重复和
块重复操作
说明随着32位长字
操作数
说明2或3操作数读
快速返回从中断
D
算术指令采用并行存储
D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
和并行加载
条件存储指令
CLKOUT的输出控制
TOUT的输出控制
功耗控制使用IDLE1 ,
IDLE2和IDLE3说明
双1.8 -V (核心)和3.3 V ( I / O)电源
供应低功耗,运算速度快
10 ns的单周期定点指令
执行
通过两个处理器间通信
内置8元的FIFO
12通道直接存储器访问
( DMA)传输数据而无需CPU
装载( 6个通道子系统)
六个多通道缓冲串行端口
( McBSP的) (每子系统三个McBSP的)
16位主机端口接口( HPI16 )
复用外部存储器接口
引脚
软件可编程锁相环
回路( PLL )提供了几个时钟
选项(需要外部TTL振荡器)
片基于扫描的仿真逻辑
两个软件可编程定时器
(每个子系统)
软件可编程等待状态
发电机( 14等待美国最大)
提供144引脚BGA球栅阵列
( GGU后缀)和144引脚薄型四方
扁平封装( TQFP ) ( PGE后缀)包
D
D
D
D
D
D
D
D
D
D
注:此
数据片被设计为一起使用的
TMS320C5000 DSP系列的功能概述
(文献编号SPRU307 ) 。
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2000年,德州仪器
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
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1
TMS320VC5420
定点数字信号处理器
SPRS080C - 1999年3月 - 修订2000年4月
目录
引脚分配。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。五
信号说明。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 9
功能概述。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 15
内存。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 16
多核的复位信号。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 18
片上外设。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 20
16位主机端口接口( HPI16 ) 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 23
多通道缓冲串行端口( McBSP的) 。 。 。 。 。 。 。 。 。 。 。 25
直接存储器访问单元( DMA)中。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 26
子系统通信。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 28
通用I / O 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 29
内存映射寄存器。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 32
中断。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 36
IDLE3掉电模式。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 38
模仿“ 5420设备。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 38
文档支持。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 39
绝对最大额定值。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
推荐工作条件。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
电气特性。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
外部乘乘n ClockOption 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
旁路选项。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
外部存储器接口时序。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
准备好时机。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
并行I / O接口时序。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
复位, BIO ,中断,以及XIO时间。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
外部标志( XF ) ,和定时器输出( TOUT )定时。 。
通用输入输出( GPIO )定时。 。 。 。 。 。 。 。
拉美经济体系/ B时机。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
多通道缓冲串行端口时序。 。 。 。 。 。 。 。 。 。 。 。 。
多通道缓冲串行端口时序(续) 。 。 。 。
HPI16时机。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
机械数据。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。 。
40
40
41
42
43
44
48
50
54
56
57
58
59
60
67
75
描述
在TMS320VC5420定点数字信号处理器( DSP )是一种双CPU设备能够实现高达200 MIPS
性能。在“ 5420由两个独立的” 54X子系统的核心能力到核心
通信。
每个子系统的CPU是基于先进的,改进的哈佛架构,有一个程序存储器
总线和3条数据存储器总线。所述处理器还提供了一种算术逻辑单元(ALU) ,其具有高
并行,应用程序特定的硬件逻辑,片内存储器程度,以及额外的片上外设。
每个子系统都有独立的程序和数据空间,允许同时访问程序
指令和数据。两个读操作和一次写操作可以在一个周期内被执行。说明
与并行存储和应用程序特定的指令可以充分利用这种结构。此外,数据可以
程序和数据空间之间传送。这种并行性支持一组功能强大的算术,逻辑,
和位操作,可以在一个机器周期来执行。此外, “ 5420包括
该控制机制来管理中断,反复操作,和函数调用。
的' 5420被提供在两个温度范围和个别零件号如下所示。 (请注意
工业温度装置零件号不遵循典型的传统的编号)。
商业设备温度(0° C至85°C )
TMS320VC5420PGE200 ( 144引脚LQFP )
TMS320VC5420GGU200 ( 144引脚BGA )
工业温度范围设备( -40 ° C至100 ° C)
TMS320C5420PGEA200 ( 144引脚LQFP )
TMS320C5420GGUA200 ( 144引脚BGA )
2
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TMS320VC5420
定点数字信号处理器
SPRS080C - 1999年3月 - 修订2000年4月
111
119
118
117
116
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114
113
144
143
142
141
140
139
138
137
136
135
134
133
132
131
130
129
128
127
126
125
124
123
122
121
120
112
110
PPD7
PPA8
PPA0
DVDD
PPA9
PPD1
A_INT1
A_NMI
IOSTRB
A_GPIO2/BIO
A_GPIO1
A_RS
A_GPIO0
VSS
VSS
CVDD
A_BFSR1
A_BDR1
A_BCLKR1
A_BFSX1
CVDD
VSS
A_BDX1
A_BCLKX1
A_XF
A_CLKOUT
VCO
TCK
TMS
TDI
TRST
EMU1/OFF
DVDD
A_INT0
EMU0
TDO
109
VSS
PPD0
PPD5
PPD4
PPD6
A_BFSX2
A_BDX2
A_BFSR2
A_BDR2
A_BCLKR2
VSS
CV DD
A_BCLKX2
准备
DVDD
CLKIN
NC
VSSA
AV DD
VSS
B_BCLKX2
B_BDX2
B_BFSX2
B_BCLKR2
CVDD
VSS
B_BDR2
B_BFSR2
PPD2
PPD3
PPA1
PPA5
DV DD
PPA4
PPA6
PPA7
TMS320VC5420 PGE包装§
( TOP VIEW )
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
108
107
106
105
104
103
102
101
100
99
98
97
96
95
94
93
92
91
90
89
88
87
86
85
84
83
82
81
80
79
78
77
76
75
74
73
PPA14
PPA15
VSS
PPA16
PPA17
B_INT0
B_INT1
B_NMI
IS
B_GPIO2/BIO
B_GPIO1
B_GPIO0
B_BFSR1
B_BDR1
CVDD
VSS
B_BCLKR1
B_BFSX1
VSS
B_BDX1
B_BCLKX1
CVDD
VSS
TEST
XIO
B_RS
B_XF
B_CLKOUT
HMODE
HPIRS
PPA13
PPA12
VSS
DVDD
PPA11
PPA10
NC =无内部连接
DVDD是用于I / O引脚的电源而CVDD为CPU核心电源。 VSS是地同时为I / O
销和核心的CPU。
§显示仅非复用模式下的引脚配置。见的引脚分配为多路的TMS320VC5420PGE表
具体的引脚功能。
PPD15
PPD14
VSS
PPD13
PPD12
A_BFSR0
A_BDR0
A_BCLKR0
A_BFSX0
VSS
CVDD
A_BDX0
A_BCLKX0
MSTRB
DS
PS
B_BCLKX0
B_BDX0
DV DD
V SS
B_BFSX0
B_BCLKR0
B_BDR0
CVDD
V SS
B_BFSR0
读/写
PPA2
PPA3
拉美经济体系/ B
PPD8
PPD9
PPD10
PPD11
VSS
VSS
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3
TMS320VC5420
定点数字信号处理器
SPRS080C - 1999年3月 - 修订2000年4月
TMS320VC5420 GGU包装
( BOTTOM VIEW )
13 12 11 10 9
8
7
6
5
4
3
2
1
A
B
C
D
E
F
G
H
J
K
L
M
N
该引脚分配表的TMS320VC5420GGU列出了每个引脚的名称和它的相关引脚数
这144引脚的球栅阵列(BGA)封装。
4
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TMS320VC5420
定点数字信号处理器
SPRS080C - 1999年3月 - 修订2000年4月
引脚分配
在“ 5420引脚分配表列出了每个引脚的名称和两种封装类型对应的引脚数量。
一些的' 5420引脚可以配置为两个功能之一。对于这些引脚,主销的名字被列
在主柱。次级引脚名称列在第二列中,并且灰色阴影。
引脚分配TMS320VC5420PGE
( 144引脚薄型四方扁平封装)
信号名称
PPD7
PPA0
PPA9
A_INT1
A_GPIO3
IOSTRB
A_GPIO1
A_GPIO0
VSS
A_BFSR1
A_BCLKR1
CVDD
A_BDX1
A_XF
VCO
TMS
TRST
DVDD
EMU0
VSS
PPD14
PPD13
A_BFSR0
A_BCLKR0
VSS
A_BDX0
MSTRB
PS
B_BDX0
VSS
B_BCLKR0
CVDD
B_BFSR0
PPA2
拉美经济体系/ B
PPD9
PPD11
HD9
HD11
HCNTL1
HCS
HDS1
HD14
HD13
A_TOUT
9
11
13
15
17
19
21
23
25
27
29
31
33
35
37
39
41
43
45
47
49
51
53
55
57
59
61
63
65
67
69
71
A_GPIO2/BIO
一个GPIO2 / BIO
A_RS
VSS
CVDD
A_BDR1
A_BFSX1
VSS
A_BCLKX1
A_CLKOUT
TCK
TDI
EMU1
A_INT0
TDO
PPD15
VSS
PPD12
A_BDR0
A_BFSX0
CVDD
A_BCLKX0
DS
B_BCLKX0
DVDD
B_BFSX0
B_BDR0
VSS
读/写
PPA3
PPD8
PPD10
VSS
HR / W
HCNTL0
HD8
HD10
HDS2
HD15
HD12
10
12
14
16
18
20
22
24
26
28
30
32
34
36
38
40
42
44
46
48
50
52
54
56
58
60
62
64
66
68
70
72
信号名称
HD7
A_HINT
1
3
5
7
信号名称
PPA8
DVDD
PPD1
A_NMI
HD1
信号名称
2
4
6
8
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