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TMS320C6727B , TMS320C6726B , TMS320C6722B , TMS320C6720
浮点数字信号处理器
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SPRS370E - 2006年9月 - 修订2008年7月
1 TMS320C6727B , TMS320C6726B , TMS320C6722B , TMS320C6720 DSP的
1.1特性
C672x : 32位/ 64位350 MHz的浮点DSP
升级的C67x + CPU从的C67x DSP
代:
- 2倍的CPU寄存器[ 64通用]
- 新的音频专用指令
- 兼容的C67x CPU
增强的存储系统
- 256K字节统一的程序/数据RAM
- 384K字节统一的程序/数据ROM
- 单周期访问的数据从CPU
- 大程序高速缓存( 32K字节)支持
RAM ,ROM和外部存储器
外部存储器接口( EMIF )支持
- 133 MHz的SDRAM ( 16位或32位)
- 异步NOR闪存, SRAM ( 8,16或
32-Bit)
- NAND闪存( 8位或16位)
增强的I / O系统
- 高性能交叉开关
- 专用的McASP DMA总线
- 强大的I / O性能
的dMAX (双数据移动加速)
支持:
- 16个独立通道
- 两个转移并发处理
请求
- 1-,2-和3-维
存储器到存储器和
存储器到外设数据传输
- 循环寻址凡的大小
圆形缓冲器( FIFO)的不限制为2
n
- 基于表格的多抽头延迟读取和
写往/返循环缓冲区
三个多通道音频串行端口
- 发送/接收时钟高达50 MHz
- 6个时钟区和16个串行数据引脚
支持TDM , I2S ,以及类似的格式
- DIT-可( McASP2 )
通用主机端口接口( UHPI )
- 对高带宽的32位宽的数据总线
- 多路复用和非多路复用地址和数据
两个10MHz的SPI端口3-, 4-,和5引脚
选项
两个内部集成电路( I2C )端口
实时中断计数器/看门狗
Oscillator-和软件控制的PLL
应用范围:
- 专业音响
调音台
效果器
音频合成
仪器/放大器建模
音频会议
音频广播
音频编码器
- 新兴音频应用
生物识别技术
医疗
=工业
商业或扩展温度
144引脚, 0.5毫米,使用PowerPad 薄型四方
扁平封装( TQFP ) RFP后缀]
256端子, 1.0毫米, 16×16阵列塑料球
栅阵列( PBGA ) [ GDH和ZDH后缀]
请注意,一个重要的通知有关可用性,标准保修,并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在本文档的末尾。
的C67x ,使用PowerPad , TMS320C6000 , C6000 , DSP / BIOS , XDS , TMS320是德州仪器的商标。
飞利浦Koninklijki飞利浦电子公司的注册商标。
所有其他商标均为其各自所有者的财产。
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
版权所有 2006-2008 ,德州仪器
TMS320C6727B , TMS320C6726B , TMS320C6722B , TMS320C6720
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1.2说明
该TMS320C672x是新一代德州仪器的C67x新一代高性能
32位/ 64位浮点数字信号处理器。该TMS320C672x包括TMS320C6727B ,
TMS320C6726B , TMS320C6722B , TMS320C6720和设备。
(1)
增强的C67x + CPU 。
的的C67x + CPU是的C67x CPU对C671x采用增强版
DSP的。它与CPU的C67x兼容,但提供了速度,代码密度显著改善,并
每个时钟周期的浮点性能。在350 MHz时, CPU可以在最大性能
2800 MIPS / 2100 MFLOPS通过执行多达8条指令(其中六个是浮点
指令)并联的每个周期。 CPU的原生支持32位定点, 32位单精度
浮点和64位双精度浮点运算。
高效的存储系统。
内存控制器映射的大容量片上256K字节的RAM和384K字节
ROM作为统一的程序/数据存储器。开发得以简化,因为之间不存在固定的分工
程序和数据存储器大小的一些其它设备。
存储器控制器支持从的C67x + CPU对RAM和ROM的单周期数据存取。
多达三个并行访问到内部RAM和ROM从三个下列四个来源是
支持:
从的C67x + CPU两个64位的数据访问
从核心和程序缓存一个256位的程序取
从外围系统的一个32位的数据存取(无论的dMAX或UHPI )
大( 32K字节)程序高速缓存转换到一个高命中率对于大多数应用程序。这可以防止大多数
程序/数据的访问冲突到片上存储器。它也支持从一个有效的程序执行
片外存储器,如SDRAM中。
高性能交叉开关。
高性能交叉开关充当之间的中心枢纽
不同的总线主设备( CPU ,的dMAX , UHPI )和不同的目标(外设和存储器) 。该
横梁部分连接;一些连接不支持(例如, UHPI到外设
连接)。
多次转移发生在平行交叉开关,只要有公交车之间没有冲突
主人为特定目标。当冲突的确发生时,仲裁是一种简单的确定性
固定优先级方案。
DMAX的被赋予优先级最高的,因为它是负责大部分时间要求严格的I / O传输,其次
未来由UHPI ,最后通过CPU 。
的dMAX双数据移动加速。
DMAX的是设计用来执行数据迁移模块
加速。数据移动加速(的dMAX )控制器处理用户编程的数据传输
内部数据存储器的控制器和在C672x的DSP设备外设之间。 DMAX的
允许数据/运动从任何可寻址的存储器空间,包括内部存储器,外围设备
和外部存储器。
DMAX的控制器包括功能,如进行三维数据传输的能力
对于先进的数据的排序,并且该能力来管理存储器的一部分作为循环缓冲器/ FIFO
与延时抽头基于读写数据。 DMAX的控制器能够同时
处理中的两个传输请求(只要它们到/从不同的源/目的地) 。
外部存储器接口( EMIF)的灵活性和扩展。
对外部存储器接口
C672x支持SDRAM和单一银行的异步存储器单银行。 EMIF的数据
宽度是16位宽的C6726B , C6722B和C6720和32位宽的C6727B 。
SDRAM支持包括1 , 2 , 4或银行X16和X32 SDRAM器件。
该C6726B , C6722B和C6720支持SDRAM器件高达128M位。
(1)
2
整个文档的其余部分, TMS320C6727B (或C6727B ) , TMS320C6726B (或C6726B ) , TMS320C6722B (或C6722B ) ,
和/或TMS320C6720 (或C6720 )将被称为TMS320C672x (或C672x ) 。
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该C6727B延伸到256M位和512M位的SDRAM器件的支持。
异步存储器支持通常用来引导从一个平行非多路复用NOR闪存设备
这可以是8位,16位或32位宽。从更大的闪存设备进行引导是比原生的支持
专用的EMIF地址线是通过使用通用I / O引脚为高位地址线来实现的。
异步存储器接口还可以被配置为支持8位或16位宽的NAND闪存。它
包括硬件ECC计算(单比特错误),可以对数据块运行在高达
512字节。
通用主机端口接口( UHPI)可实现高速并行I / O 。
通用主机端口接口
( UHPI )是通过该外部主机CPU可以访问存储器在DSP的并行接口。
三种模式由C672x UHPI支持:
复用的地址/数据 - 半字(16位宽)模式(类似于C6713 )
复用的地址/数据 - 全字( 32位宽)模式
非复用模式 - 16位地址和32位数据总线
该UHPI也可以限制为在任何地方访问的存储器单页(64K字节)
解决C672x的空间;此页面是可以改变的,而仅由C672x的CPU。此功能允许
要使用的UHPI用于高速数据传输,即使在系统中的安全性是一个重要的
要求。
该UHPI仅适用于C6727B 。
多通道音频串行端口( MCASP0 , McASP1和McASP2 ) - 多达16个立体声I2S通道。
多通道音频串行端口(的McASP )无缝连接到编解码器,数模转换器,模数转换器,以及其他
设备。它支持这个格式的无处不在的IIS的格式,以及许多变型,包括时间
时分多路复用( TDM)的格式具有多达32个时隙。
每个的McASP包括可以独立地或同步地进行操作的发射和接收部分;
此外,每个部分包括其自身的灵活的时钟发生器和广泛的错误检查逻辑。
作为数据通过的McASP ,可以重新调整,使得所使用的定点表示法
应用程序代码可以是独立的,而无需使用外部设备的表示
任何CPU开销进行转换。
该的McASP是一个可配置模块和2至16个串行数据引脚支持。它也有
支持数字接口发送器( DIT)模式,采用了全384位的信道状态选项
用户数据存储器。
McASP2不可对C6722B和C6720 。
内部集成电路串行端口( I2C0 , I2C1 ) 。
该C672x包括两个内部集成电路(I2C)
串行端口。一个典型的应用是配置一个I2C串行端口作为从外部用户界面
微控制器。其他I2C串行端口然后,可以使用由C672x的DSP控制外部
的外围设备,诸如编解码器或网络控制器,它是在DSP的功能性的外围设备
装置。
两个I2C串行端口引脚复用的SPI0串行端口。
串行外设接口端口( SPI0 , SPI1 ) 。
正如在I2C串行端口, C672x的DSP的情况下
还包括两个串行外设接口( SPI)的串行端口。这使得一个SPI端口配置为
从属控制的DSP ,而另一个SPI串行端口用于由DSP控制外部
外设。
该SPI端口支持基本的三针模式以及可选的4和5引脚模式。可选引脚
包括从片选引脚和一个使能引脚,实现了自动握手
硬件SPI最大的吞吐量。
该SPI0端口引脚复用的两个I2C串行端口( I2C0和I2C1 ) 。 SPI1的串行端口
销复用5从MCASP0和McASP1串行数据引脚。
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实时中断定时器( RTI) 。
的实时中断定时器模块包括:
2个32位计数器/分频器对
两个输入捕获(绑的McASP直接存储器存取[ DMA]事件的采样率测量)
四比较具有自动更新功能
数字看门狗(可选),增强系统的鲁棒性
时钟发生器( PLL和OSC ) 。
该C672x DSP包括支持晶体的片上振荡器
在12兆赫至25兆赫范围内。或者,该时钟可以从外部通过CLKIN提供
引脚。
该DSP包括一个柔性的,软件可编程锁相环(PLL)的时钟发生器。三
不同的时钟域( SYSCLK1 , SYSCLK2和SYSCLK3 )是由分频锁相环产生
输出。 SYSCLK1是使用由CPU ,存储器控制器和存储器时钟。 SYSCLK2所使用的
外围子系统和Dmax 。 SYSCLK3专门用于EMIF 。
1.2.1设备兼容性
在TMS320C672x浮点数字信号处理器基于新的C67x + CPU上。这是核心
代码兼容于TMS320C671x DSP的使用的C67x CPU内核,但显著
增强功能包括额外的浮点指令。看
第2.2节
4
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1.3功能框图
图1-1
示出了C672x装置的功能框图。
程序/数据
内存
256K字节
JTAG动车组
McASP0
16串行器
32
的McASP DMA总线
32
32
32
32
外设配置巴士
32
32
32
32
32
32
UHPI
EMIF
32
32
PLL
D1
数据
读/写
的C67x + CPU
D2
数据
读/写
节目
256
256
64
32
程序/数据
ROM第0页
256K字节
64
内存
调节器
256
McASP1
6串行器
I / O
INT
256
程序/数据
ROM第1页
128K字节
McASP2
2串行器
+ DIT
SPI1
SPI0
I2C0
I2C1
RTI
节目
缓存
32K字节
CSP
256
PMP DMP
32
32
32
32
高性能
交叉开关
32
32
32
32
32
I / O中断
OUT
MAX0
控制
DMAX
MAX1
活动
In
外设中断和DMA活动
A.
UHPI仅在C6727B 。 McASP2不可对C6722B和C6720 。
图1-1 。 C672x DSP结构图
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