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TLV5628C ， TLV5628I

八路8位数字 - 模拟转换器

SLAS108A - 1995年1月 - 修订1995年11月

8个8位电压输出DAC

3 -V单电源供电

串行接口

高阻抗基准输入

可编程12次输出

范围

同步更新工具

内部上电复位

低功耗

半缓冲输出

DW或N包装

（ TOP VIEW ）

DACB

DACA

GND

数据

CLK

鲮鱼

DACF

DACC

DACD

REF1

LDAC

负载

REF2

DACH

DACG

应用

可编程电压源

数字控制放大器/衰减器

移动通信

自动测试设备

过程监测和控制

信号合成

描述

该TLV5628C和TLV5628I是八进制的8位电压输出数字 - 模拟转换器（DAC ），用缓冲

基准输入（高阻抗）。这些DAC产生的一个或两个时间之间的变化的输出电压

参考电压和GND以及DAC的单调性。该装置使用简便，从运行中的

单电源3 3.6 V的上电复位功能整合，以确保可重复的启动条件。

在TLV5628C TLV5628I和数字控制是通过简单的3线串行总线，是CMOS兼容，

轻松连接到所有流行的微处理器和微控制器设备。 12位指令字

包含8位数据，3个DAC选择位和一系列位，时代1之间，后者允许选择

或2倍的输出范围。 DAC寄存器双缓冲，使一套完整的新值是

写入设备，那么所有DAC输出同时通过LDAC终端的控制更新。

数字输入施密特触发器高噪声抗扰度。

16端小外形，D封装允许模拟功能的空间要求严格的应用数字化控制。

该TLV5628C的特点是操作从0℃至70℃。该TLV5628I的特点是操作

从 - 40 ° C至85°C 。该TLV5628C和TLV5628I不需要外部调整。

可选项

包

0 ° C至70℃

- 40 ° C至85°C

小尺寸

（ DW ）

TLV5628CDW

TLV5628IDW

塑料DIP

(N)

TLV5628CN

TLV5628IN

请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用

德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。

PRODUCTION数据信息为出版日期。

产品符合每德州仪器条款规范

标准保修。生产加工并不包括

所有测试参数。

版权

1995年，德州仪器

邮政信箱655303

达拉斯，德克萨斯州75265

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功能框图

REF1

–

LATCH

DAC

–

DACA

DAC

LATCH

REF2

–

LATCH

–

DACD

DAC

–

鲮鱼

DAC

LATCH

–

DACH

CLK

数据

负载

串行

接口

LDAC

POWER- ON

RESET

终端功能

终奌站

名字

CLK

DACA

DACB

DACC

DACD

鲮鱼

DACF

DACG

DACH

数据

GND

LDAC

负载

REF1

REF2

VDD

号

I / O

描述

串行接口的时钟，数据输入的下降沿

DACA模拟输出

DACB模拟输出

DACC模拟输出

DACD模拟输出

鲮鱼模拟输出

DACF模拟输出

DACG模拟输出

DACH模拟输出

串行接口的数字数据输入

接地回路和参考端

DAC更新锁存控制

串行接口的负载控制

参考电压输入到DACA

参考电压输入DACB

正电源电压

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详细说明

该TLV5628 ，以8电阻串DAC实现。每个DAC的核心是用单个电阻

256个抽头，对应于表中列出的256个可能的码1.每个电阻器串的一端连接

到GND端，另一端是从基准输入缓冲器的输出馈电。单调性

通过使用电阻器串保持。线性度取决于电阻元件并且在所述匹配

输出缓冲器的性能。由于输入缓冲DAC的总是呈现

高阻抗负载的参考来源。有两个输入端的参考端子; REF1用于DACA

通过DACD和REF2通过DACH用鲮鱼。

每个DAC输出通过一个可配置的增益输出放大器，它可以被编程为1倍或缓冲

2倍的增益。

上电时，这些DAC被重置为码0 。

每个输出电压由下式给出：

V（ DACA | B | C | D | E | F | G | H ）

REF

CODE

256

)

RNG位值）

其中，码是0 255，且该范围器（RNG）位的范围是串行控制字中的0或1 。

数据接口

带负载高时，数据被锁存到在CLK的每个下降沿数据终端。当所有数据位

送入之后，负载是低脉冲将数据从串行输入寄存器转移到选定的DAC

如图1所示当LDAC为低电平时，选择的DAC输出电压被更新和负荷变低。当

LDAC是串行编程时高时，新值被存储在该设备内，并且可以被转移到

DAC的输出在以后的时间通过脉冲LDAC为低电平，如图2的数据首先被输入的MSB 。数据

使用两个8个时钟周期期间转移示于图3和图4 。

CLK

TSU （ DATA- CLK ）

电视（ DATA- CLK）

数据

RNG

TSU （ LOAD ， CLK ）

总重量（负载）

TSU （ CLK -LOAD ）

负载

DAC更新

图1.负载控制更新（ LDAC =低）

CLK

TSU （ DATA- CLK ）

电视（ DATA- CLK）

数据

RNG

TSU （ LOAD - LDAC ）

负载

总重量（ LDAC ）

LDAC

DAC更新

图2. LDAC控制的更新

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CLK低

CLK

数据

RNG

负载

LDAC

图3.负载控制更新使用8位串行字（ LDAC =低）

CLK低

CLK

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数据

RNG

负载

LDAC

图4. LDAC控制更新使用8位串行字

模板发布日期： 94年7月11日

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数据接口（续）

表2列出了A2，A1和A0位，且更新后的DAC的选择。该RNG位控制DAC输出

范围内。当RNG =低时，输出范围是所施加的基准电压和GND ，并且当间

RNG =高，范围为两倍于施加的基准电压和GND之间。

表1.理想的输出转移

输出电压

GND

(1/256)

REF （ 1 + RNG ）

(127/256)

REF （ 1 + RNG ）

(128/256)

REF （ 1 + RNG ）

(255/256)

REF （ 1 + RNG ）

表2.串行输入解码

DAC已更新

DACA

DACB

DACC

DACD

鲮鱼

DACF

DACG

DACH

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