TLC5620C , TLC5620I
翻两番8位数字 - 模拟转换器
SLAS081E - 1994年11月 - 修订2001年11月
D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
4个8位电压输出DAC
5 V单电源供电
串行接口
高阻抗基准输入
可编程12次输出范围
同步更新工具
内部上电复位
低功耗
半缓冲输出
N或,D封装
( TOP VIEW )
GND
REFA
REFB
REFC
REFD
数据
CLK
1
2
3
4
5
6
7
14
13
12
11
10
9
8
V
DD
LDAC
DACA
DACB
DACC
DACD
负载
应用
可编程电压源
数字控制放大器/衰减器
移动通信
自动测试设备
过程监测和控制
信号合成
描述
该TLC5620C和TLC5620I为四倍的8位电压输出数字 - 模拟转换器(DAC )与
缓冲基准输入(高阻抗) 。这些DAC产生输出电压,要么之间的范围
一次或两次的参考电压和GND ,而DAC的单调性。该装置是使用简单,
从5 V的单电源运行的上电复位功能整合,以确保可重复启动
条件。
在TLC5620C和TLC5620I的数字控制是通过简单的三线串行总线,是CMOS兼容
并轻松连接到所有流行的微处理器和微控制器设备。 11位指令字
包括8个数据位, 2的DAC选择位,以及一系列位,所述倍之间,后者允许选择
1或2倍的输出范围。 DAC寄存器双缓冲,使一套完整的新值是
写入设备,那么所有DAC输出同时通过LDAC控制更新。数码
输入施密特触发器高噪声抗扰度。
14端小外形( D)封装允许模拟功能在空间有限的数字控制
应用程序。该TLC5620C的特点是操作从0℃至70℃。该TLC5620I的特点
从操作 - 40 ° C至85°C 。该TLC5620C和TLC5620I不需要外部调整。
可选项
包
TA
0 ° C至70℃
- 40 ° C至85°C
小尺寸
(D)
TLC5620CD
TLC5620ID
塑料DIP
(N)
TLC5620CN
TLC5620IN
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2001年,德州仪器
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
邮政信箱655303
达拉斯,德克萨斯州75265
1
TLC5620C , TLC5620I
翻两番8位数字 - 模拟转换器
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功能框图
REFA
2
+
–
8
REFB
3
+
–
8
REFC
4
+
–
8
REFD
5
+
–
8
LATCH
LATCH
8
DAC
×
2
+
–
9
DACD
LATCH
LATCH
8
LATCH
LATCH
8
LATCH
LATCH
8
DAC
×
2
+
–
12
DACA
DAC
×
2
+
–
11
DACB
DAC
×
2
+
–
10
DACC
CLK 7
6
数据
LOAD 8
串行
接口
13
LDAC
POWER- ON
RESET
终端功能
终奌站
名字
CLK
DACA
DACB
DACC
DACD
数据
号
7
12
11
10
9
6
I / O
I
O
O
O
O
I
描述
串行接口的时钟。输入的数字数据被移入串行接口
上施加到CLK端的时钟的下降沿进行注册。
DAC A的模拟输出
DAC B的模拟输出
DAC C模拟输出
DAC D模拟输出
串行接口的数字数据输入。对于DAC的数字码移入
连续串行接口寄存器。每个数据位的移入在登记册
落下的时钟信号的边沿。
接地回路和参考端
加载DAC 。当LDAC信号为高电平时,不会发生DAC输出更新时
输入的数字数据被读入串行接口。 DAC输出仅
当LDAC被从高分到低分进行更新。
串行接口负载控制。当LDAC为低电平时,在LOAD的下降沿
信号锁存的数字数据转换成输出锁存器,并立即产生
模拟电压,在DAC的输出端子。
参考电压输入到DAC A.该电压定义输出的模拟范围。
参考电压输入到DAC B.该电压定义输出的模拟范围。
参考电压输入到DAC C.该电压定义输出的模拟范围。
参考电压输入到DAC D.该电压定义输出的模拟范围。
正电源电压
GND
LDAC
1
13
I
I
负载
8
I
REFA
REFB
REFC
REFD
VDD
2
3
4
5
14
I
I
I
I
I
2
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详细说明
TLC5620的使用四个电阻串DAC实现。每个DAC的核心是用单个电阻
256个抽头,对应于表中列出的256个可能的码1.每个电阻器串的一端连接
到GND端,另一端是从基准输入缓冲器的输出馈电。单调性
通过使用电阻器串保持。线性度取决于电阻元件并且在所述匹配
输出缓冲器的性能。由于输入被缓冲,则DAC总是呈现高阻抗
加载到引用来源。
每个DAC输出通过一个可配置的增益输出放大器,可以被编程到次1次或缓冲
2增益。
上电时, DAC的被重置为代码0 。
每个输出电压由下式给出:
V( DACA | B | C | D )
O
+
REF
CODE
256
(1
)
RNG位值)
其中,代码的范围是从0到255,且该范围器(RNG)位是串行控制字内为0或1 。
表1.理想的输出转移
D7
0
0
0
1
1
D6
0
0
1
0
1
D5
0
0
1
0
1
D4
0
0
1
0
1
D3
0
0
1
0
1
D2
0
0
1
0
1
D1
0
0
1
0
1
D0
0
1
1
0
1
输出电压
GND
(1/256)
×
REF ( 1 + RNG )
(127/256)
×
REF ( 1 + RNG )
(128/256)
×
REF ( 1 + RNG )
(255/256)
×
REF ( 1 + RNG )
数据接口
带负载高时,数据被锁存到在CLK的每个下降沿数据终端。当所有数据位
送入之后,负载是低脉冲将数据从串行输入寄存器转移到选定的DAC
如图1所示当LDAC为低电平时,选择的DAC输出电压时,负载变低时更新。当
LDAC是串行编程时高时,新值被存储在该设备内,并且可以被转移到
如示于图2中的DAC的输出在以后的时间通过脉冲LDAC为低电平数据输入最显著位
( MSB)在前。使用两个8时钟周期期间的数据传输分别示于图3和图4 。
CLK
TSU ( DATA- CLK )
电视( DATA- CLK)
数据
A1
A0
RNG
D7
D6
D5
D4
D3
TSU ( LOAD , CLK )
D2
D1
D0
TSU ( CLK -LOAD )
负载
总重量(负载)
DAC更新
图1.负载控制更新( LDAC =低)
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3
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CLK
TSU ( DATA- CLK )
电视( DATA- CLK)
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
TSU (负载LDAC )
负载
总重量( LDAC )
LDAC
DAC更新
图2. LDAC控制的更新
CLK低
CLK
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
负载
LDAC
图3.负载控制的更新使用8位串行字( LDAC =低)
CLK低
CLK
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
负载
LDAC
图4. LDAC控制的更新使用8位串行字
表2列出了A1和A0位,且更新后的DAC的选择。该RNG位控制DAC输出
范围内。当RNG =低时,输出范围是所施加的基准电压和GND ,并且当间
RNG =高,范围为两倍于施加的基准电压和GND之间。
表2.串行输入解码
A1
0
0
1
1
A0
0
1
0
1
DAC已更新
DACA
DACB
DACC
DACD
4
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达拉斯,德克萨斯州75265
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线性,偏移量,以及使用单端用品增益误差
当放大器由单电源供电,该电压偏移仍然可以为正或负。同
一个正偏置电压,对所述第一代码的变化的输出电压变化。具有负偏移的输出
电压可能不与第一代码依赖于偏置电压的大小发生变化。
输出放大器将尝试把输出驱动到负电压。然而,因为大多数负
供电线是接地时,输出不能驱动低于地面和钳位输出在0V。
的输出电压则保持在零,直到输入代码值产生一个足够的正输出电压
克服了负偏置电压,从而导致在图5中示出的传递函数。
产量
电压
0V
负
OFFSET
DAC码
负图5.效应所抵消(单电源)
这种偏移误差,而不是线性误差,产生断点。传递函数也会跟随
虚线如果输出缓冲器可驱动地面之下。
对于DAC ,线性度之间的零输入码测得的( 0所有输入)和满量程代码(所有输入1 )之后,
偏移和满度调整出或占以某种方式。然而,单电源工作不
允许调整时的偏移量为负时,由于在传递函数中设置断点。因此,线性度
测量满量程编码并产生一个正的输出电压最低的代码之间。该代码是
从最大规格为负偏置电压来计算。
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D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
4个8位电压输出DAC
5 V单电源供电
串行接口
高阻抗基准输入
可编程12次输出范围
同步更新工具
内部上电复位
低功耗
半缓冲输出
N或,D封装
( TOP VIEW )
GND
REFA
REFB
REFC
REFD
数据
CLK
1
2
3
4
5
6
7
14
13
12
11
10
9
8
V
DD
LDAC
DACA
DACB
DACC
DACD
负载
应用
可编程电压源
数字控制放大器/衰减器
移动通信
自动测试设备
过程监测和控制
信号合成
描述
该TLC5620C和TLC5620I为四倍的8位电压输出数字 - 模拟转换器(DAC )与
缓冲基准输入(高阻抗) 。这些DAC产生输出电压,要么之间的范围
一次或两次的参考电压和GND ,而DAC的单调性。该装置是使用简单,
从5 V的单电源运行的上电复位功能整合,以确保可重复启动
条件。
在TLC5620C和TLC5620I的数字控制是通过简单的三线串行总线,是CMOS兼容
并轻松连接到所有流行的微处理器和微控制器设备。 11位指令字
包括8个数据位, 2的DAC选择位,以及一系列位,所述倍之间,后者允许选择
1或2倍的输出范围。 DAC寄存器双缓冲,使一套完整的新值是
写入设备,那么所有DAC输出同时通过LDAC控制更新。数码
输入施密特触发器高噪声抗扰度。
14端小外形( D)封装允许模拟功能在空间有限的数字控制
应用程序。该TLC5620C的特点是操作从0℃至70℃。该TLC5620I的特点
从操作 - 40 ° C至85°C 。该TLC5620C和TLC5620I不需要外部调整。
可选项
包
TA
0 ° C至70℃
- 40 ° C至85°C
小尺寸
(D)
TLC5620CD
TLC5620ID
塑料DIP
(N)
TLC5620CN
TLC5620IN
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
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功能框图
REFA
2
+
–
8
REFB
3
+
–
8
REFC
4
+
–
8
REFD
5
+
–
8
LATCH
LATCH
8
DAC
×
2
+
–
9
DACD
LATCH
LATCH
8
LATCH
LATCH
8
LATCH
LATCH
8
DAC
×
2
+
–
12
DACA
DAC
×
2
+
–
11
DACB
DAC
×
2
+
–
10
DACC
CLK 7
6
数据
LOAD 8
串行
接口
13
LDAC
POWER- ON
RESET
终端功能
终奌站
名字
CLK
DACA
DACB
DACC
DACD
数据
号
7
12
11
10
9
6
I / O
I
O
O
O
O
I
描述
串行接口的时钟。输入的数字数据被移入串行接口
上施加到CLK端的时钟的下降沿进行注册。
DAC A的模拟输出
DAC B的模拟输出
DAC C模拟输出
DAC D模拟输出
串行接口的数字数据输入。对于DAC的数字码移入
连续串行接口寄存器。每个数据位的移入在登记册
落下的时钟信号的边沿。
接地回路和参考端
加载DAC 。当LDAC信号为高电平时,不会发生DAC输出更新时
输入的数字数据被读入串行接口。 DAC输出仅
当LDAC被从高分到低分进行更新。
串行接口负载控制。当LDAC为低电平时,在LOAD的下降沿
信号锁存的数字数据转换成输出锁存器,并立即产生
模拟电压,在DAC的输出端子。
参考电压输入到DAC A.该电压定义输出的模拟范围。
参考电压输入到DAC B.该电压定义输出的模拟范围。
参考电压输入到DAC C.该电压定义输出的模拟范围。
参考电压输入到DAC D.该电压定义输出的模拟范围。
正电源电压
GND
LDAC
1
13
I
I
负载
8
I
REFA
REFB
REFC
REFD
VDD
2
3
4
5
14
I
I
I
I
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详细说明
TLC5620的使用四个电阻串DAC实现。每个DAC的核心是用单个电阻
256个抽头,对应于表中列出的256个可能的码1.每个电阻器串的一端连接
到GND端,另一端是从基准输入缓冲器的输出馈电。单调性
通过使用电阻器串保持。线性度取决于电阻元件并且在所述匹配
输出缓冲器的性能。由于输入被缓冲,则DAC总是呈现高阻抗
加载到引用来源。
每个DAC输出通过一个可配置的增益输出放大器,可以被编程到次1次或缓冲
2增益。
上电时, DAC的被重置为代码0 。
每个输出电压由下式给出:
V( DACA | B | C | D )
O
+
REF
CODE
256
(1
)
RNG位值)
其中,代码的范围是从0到255,且该范围器(RNG)位是串行控制字内为0或1 。
表1.理想的输出转移
D7
0
0
0
1
1
D6
0
0
1
0
1
D5
0
0
1
0
1
D4
0
0
1
0
1
D3
0
0
1
0
1
D2
0
0
1
0
1
D1
0
0
1
0
1
D0
0
1
1
0
1
输出电压
GND
(1/256)
×
REF ( 1 + RNG )
(127/256)
×
REF ( 1 + RNG )
(128/256)
×
REF ( 1 + RNG )
(255/256)
×
REF ( 1 + RNG )
数据接口
带负载高时,数据被锁存到在CLK的每个下降沿数据终端。当所有数据位
送入之后,负载是低脉冲将数据从串行输入寄存器转移到选定的DAC
如图1所示当LDAC为低电平时,选择的DAC输出电压时,负载变低时更新。当
LDAC是串行编程时高时,新值被存储在该设备内,并且可以被转移到
如示于图2中的DAC的输出在以后的时间通过脉冲LDAC为低电平数据输入最显著位
( MSB)在前。使用两个8时钟周期期间的数据传输分别示于图3和图4 。
CLK
TSU ( DATA- CLK )
电视( DATA- CLK)
数据
A1
A0
RNG
D7
D6
D5
D4
D3
TSU ( LOAD , CLK )
D2
D1
D0
TSU ( CLK -LOAD )
负载
总重量(负载)
DAC更新
图1.负载控制更新( LDAC =低)
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CLK
TSU ( DATA- CLK )
电视( DATA- CLK)
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
TSU (负载LDAC )
负载
总重量( LDAC )
LDAC
DAC更新
图2. LDAC控制的更新
CLK低
CLK
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
负载
LDAC
图3.负载控制的更新使用8位串行字( LDAC =低)
CLK低
CLK
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
负载
LDAC
图4. LDAC控制的更新使用8位串行字
表2列出了A1和A0位,且更新后的DAC的选择。该RNG位控制DAC输出
范围内。当RNG =低时,输出范围是所施加的基准电压和GND ,并且当间
RNG =高,范围为两倍于施加的基准电压和GND之间。
表2.串行输入解码
A1
0
0
1
1
A0
0
1
0
1
DAC已更新
DACA
DACB
DACC
DACD
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线性,偏移量,以及使用单端用品增益误差
当放大器由单电源供电,该电压偏移仍然可以为正或负。同
一个正偏置电压,对所述第一代码的变化的输出电压变化。具有负偏移的输出
电压可能不与第一代码依赖于偏置电压的大小发生变化。
输出放大器将尝试把输出驱动到负电压。然而,因为大多数负
供电线是接地时,输出不能驱动低于地面和钳位输出在0V。
的输出电压则保持在零,直到输入代码值产生一个足够的正输出电压
克服了负偏置电压,从而导致在图5中示出的传递函数。
产量
电压
0V
负
OFFSET
DAC码
负图5.效应所抵消(单电源)
这种偏移误差,而不是线性误差,产生断点。传递函数也会跟随
虚线如果输出缓冲器可驱动地面之下。
对于DAC ,线性度之间的零输入码测得的( 0所有输入)和满量程代码(所有输入1 )之后,
偏移和满度调整出或占以某种方式。然而,单电源工作不
允许调整时的偏移量为负时,由于在传递函数中设置断点。因此,线性度
测量满量程编码并产生一个正的输出电压最低的代码之间。该代码是
从最大规格为负偏置电压来计算。
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D
D
D
D
D
D
D
D
D
D
D
D
D
D
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5 V单电源供电
串行接口
高阻抗基准输入
可编程12次输出范围
同步更新工具
内部上电复位
低功耗
半缓冲输出
N或,D封装
( TOP VIEW )
GND
REFA
REFB
REFC
REFD
数据
CLK
1
2
3
4
5
6
7
14
13
12
11
10
9
8
V
DD
LDAC
DACA
DACB
DACC
DACD
负载
应用
可编程电压源
数字控制放大器/衰减器
移动通信
自动测试设备
过程监测和控制
信号合成
描述
该TLC5620C和TLC5620I为四倍的8位电压输出数字 - 模拟转换器(DAC )与
缓冲基准输入(高阻抗) 。这些DAC产生输出电压,要么之间的范围
一次或两次的参考电压和GND ,而DAC的单调性。该装置是使用简单,
从5 V的单电源运行的上电复位功能整合,以确保可重复启动
条件。
在TLC5620C和TLC5620I的数字控制是通过简单的三线串行总线,是CMOS兼容
并轻松连接到所有流行的微处理器和微控制器设备。 11位指令字
包括8个数据位, 2的DAC选择位,以及一系列位,所述倍之间,后者允许选择
1或2倍的输出范围。 DAC寄存器双缓冲,使一套完整的新值是
写入设备,那么所有DAC输出同时通过LDAC控制更新。数码
输入施密特触发器高噪声抗扰度。
14端小外形( D)封装允许模拟功能在空间有限的数字控制
应用程序。该TLC5620C的特点是操作从0℃至70℃。该TLC5620I的特点
从操作 - 40 ° C至85°C 。该TLC5620C和TLC5620I不需要外部调整。
可选项
包
TA
0 ° C至70℃
- 40 ° C至85°C
小尺寸
(D)
TLC5620CD
TLC5620ID
塑料DIP
(N)
TLC5620CN
TLC5620IN
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
版权
2001年,德州仪器
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
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功能框图
REFA
2
+
–
8
REFB
3
+
–
8
REFC
4
+
–
8
REFD
5
+
–
8
LATCH
LATCH
8
DAC
×
2
+
–
9
DACD
LATCH
LATCH
8
LATCH
LATCH
8
LATCH
LATCH
8
DAC
×
2
+
–
12
DACA
DAC
×
2
+
–
11
DACB
DAC
×
2
+
–
10
DACC
CLK 7
6
数据
LOAD 8
串行
接口
13
LDAC
POWER- ON
RESET
终端功能
终奌站
名字
CLK
DACA
DACB
DACC
DACD
数据
号
7
12
11
10
9
6
I / O
I
O
O
O
O
I
描述
串行接口的时钟。输入的数字数据被移入串行接口
上施加到CLK端的时钟的下降沿进行注册。
DAC A的模拟输出
DAC B的模拟输出
DAC C模拟输出
DAC D模拟输出
串行接口的数字数据输入。对于DAC的数字码移入
连续串行接口寄存器。每个数据位的移入在登记册
落下的时钟信号的边沿。
接地回路和参考端
加载DAC 。当LDAC信号为高电平时,不会发生DAC输出更新时
输入的数字数据被读入串行接口。 DAC输出仅
当LDAC被从高分到低分进行更新。
串行接口负载控制。当LDAC为低电平时,在LOAD的下降沿
信号锁存的数字数据转换成输出锁存器,并立即产生
模拟电压,在DAC的输出端子。
参考电压输入到DAC A.该电压定义输出的模拟范围。
参考电压输入到DAC B.该电压定义输出的模拟范围。
参考电压输入到DAC C.该电压定义输出的模拟范围。
参考电压输入到DAC D.该电压定义输出的模拟范围。
正电源电压
GND
LDAC
1
13
I
I
负载
8
I
REFA
REFB
REFC
REFD
VDD
2
3
4
5
14
I
I
I
I
I
2
邮政信箱655303
达拉斯,德克萨斯州75265
TLC5620C , TLC5620I
翻两番8位数字 - 模拟转换器
SLAS081E - 1994年11月 - 修订2001年11月
详细说明
TLC5620的使用四个电阻串DAC实现。每个DAC的核心是用单个电阻
256个抽头,对应于表中列出的256个可能的码1.每个电阻器串的一端连接
到GND端,另一端是从基准输入缓冲器的输出馈电。单调性
通过使用电阻器串保持。线性度取决于电阻元件并且在所述匹配
输出缓冲器的性能。由于输入被缓冲,则DAC总是呈现高阻抗
加载到引用来源。
每个DAC输出通过一个可配置的增益输出放大器,可以被编程到次1次或缓冲
2增益。
上电时, DAC的被重置为代码0 。
每个输出电压由下式给出:
V( DACA | B | C | D )
O
+
REF
CODE
256
(1
)
RNG位值)
其中,代码的范围是从0到255,且该范围器(RNG)位是串行控制字内为0或1 。
表1.理想的输出转移
D7
0
0
0
1
1
D6
0
0
1
0
1
D5
0
0
1
0
1
D4
0
0
1
0
1
D3
0
0
1
0
1
D2
0
0
1
0
1
D1
0
0
1
0
1
D0
0
1
1
0
1
输出电压
GND
(1/256)
×
REF ( 1 + RNG )
(127/256)
×
REF ( 1 + RNG )
(128/256)
×
REF ( 1 + RNG )
(255/256)
×
REF ( 1 + RNG )
数据接口
带负载高时,数据被锁存到在CLK的每个下降沿数据终端。当所有数据位
送入之后,负载是低脉冲将数据从串行输入寄存器转移到选定的DAC
如图1所示当LDAC为低电平时,选择的DAC输出电压时,负载变低时更新。当
LDAC是串行编程时高时,新值被存储在该设备内,并且可以被转移到
如示于图2中的DAC的输出在以后的时间通过脉冲LDAC为低电平数据输入最显著位
( MSB)在前。使用两个8时钟周期期间的数据传输分别示于图3和图4 。
CLK
TSU ( DATA- CLK )
电视( DATA- CLK)
数据
A1
A0
RNG
D7
D6
D5
D4
D3
TSU ( LOAD , CLK )
D2
D1
D0
TSU ( CLK -LOAD )
负载
总重量(负载)
DAC更新
图1.负载控制更新( LDAC =低)
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3
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CLK
TSU ( DATA- CLK )
电视( DATA- CLK)
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
TSU (负载LDAC )
负载
总重量( LDAC )
LDAC
DAC更新
图2. LDAC控制的更新
CLK低
CLK
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
负载
LDAC
图3.负载控制的更新使用8位串行字( LDAC =低)
CLK低
CLK
数据
A1
A0
RNG
D7
D6
D5
D4
D3
D2
D1
D0
负载
LDAC
图4. LDAC控制的更新使用8位串行字
表2列出了A1和A0位,且更新后的DAC的选择。该RNG位控制DAC输出
范围内。当RNG =低时,输出范围是所施加的基准电压和GND ,并且当间
RNG =高,范围为两倍于施加的基准电压和GND之间。
表2.串行输入解码
A1
0
0
1
1
A0
0
1
0
1
DAC已更新
DACA
DACB
DACC
DACD
4
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TLC5620C , TLC5620I
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线性,偏移量,以及使用单端用品增益误差
当放大器由单电源供电,该电压偏移仍然可以为正或负。同
一个正偏置电压,对所述第一代码的变化的输出电压变化。具有负偏移的输出
电压可能不与第一代码依赖于偏置电压的大小发生变化。
输出放大器将尝试把输出驱动到负电压。然而,因为大多数负
供电线是接地时,输出不能驱动低于地面和钳位输出在0V。
的输出电压则保持在零,直到输入代码值产生一个足够的正输出电压
克服了负偏置电压,从而导致在图5中示出的传递函数。
产量
电压
0V
负
OFFSET
DAC码
负图5.效应所抵消(单电源)
这种偏移误差,而不是线性误差,产生断点。传递函数也会跟随
虚线如果输出缓冲器可驱动地面之下。
对于DAC ,线性度之间的零输入码测得的( 0所有输入)和满量程代码(所有输入1 )之后,
偏移和满度调整出或占以某种方式。然而,单电源工作不
允许调整时的偏移量为负时,由于在传递函数中设置断点。因此,线性度
测量满量程编码并产生一个正的输出电压最低的代码之间。该代码是
从最大规格为负偏置电压来计算。
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