【TFP513TIPanelBus数字发射机SLLS611 - 2004年8月D数字视频接口（ DVI】,IC型号TFP513PAPG4,TFP513PAPG4 PDF资料,TFP513PAPG4经销商,ic,电子元器件-51电子网

TFP513

PanelBus

数字发射机

SLLS611 - 2004年8月

数字视频接口（ DVI ）标准

支持的分辨率从VGA到UXGA

（ 25兆赫至165兆赫像素速率）

通用图形控制器接口

- 12位，双缘和24位，

单刃输入模式

- 可调节的1.1 V至1.8 V和标准

3.3 V CMOS输入信号电平

- 全差分和单端输入

时钟模式

- 标准的英特尔12位数字视频端口

兼容作为Intel 81X芯片组

增强型锁相环噪声抗扰度

- 片上稳压器和旁路

电容降低系统成本

增强的抖动性能

- 无HSYNC抖动异常

- 忽略数据相关抖动

使用可编程我

C接口

监测检测通过热插拔和

接收器检测

采用3.3 V单电源供电

64引脚TQFP使用TI的PowerPAD

包

TI先进的0.18

EPIC- 5 CMOS

工艺技术

引脚兼容SiI164和SiI168 DVI

变送器

高带宽数字内容保护

（ HDCP ）规格标准

嵌入式预编程HDCP密钥

描述

该TFP513是德州仪器

PanelBus

平板显示产品，全面的家庭的一部分

终端到终端的DVI 1.0标准的解决方案，针对个人电脑和消费电子行业。

该TFP513提供了一个通用的接口，实现无缝连接，最常用的图形

控制器。其中的一些通用接口的优点包括：可选的总线宽度，可调信号

水平，并且差动和单端时钟。可调节的1.1 V至1.8 V数字接口，提供了一个

低EMI ，连接无缝地与一个12位或24位接口的高速总线。 DVI接口支持

平板显示分辨率最高可达UXGA在165 MHz的24位真彩色像素格式。

该TFP513联合收割机

PanelBus

创新的电路与TI先进的0.18

EPIC - 5 CMOS工艺

技术与TI的超低接地电感PowerPAD封装。其结果是一个紧凑的64引脚TQFP

包提供可靠，低噪声，高速，数字接口解决方案。该TFP513自带

嵌入预编程HDCP密钥，从而省去了外部存储装置来存储

HDCP密钥和需要，为客户发牌当局购买HDCP密钥。加密

方案确保了嵌入式HDCP密钥从而提供加密密钥安全的最高水平。

请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用

德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。

脚注：

数字视频接口（ DVI）规格是由用于数字显示工作组（ DDWG ）制定的工业标准

高速数字连接到数字显示。该TFP513是兼容的数字视频接口

（ DVI）的

修订版1.0

规范。 DVI 1.0规格已经通过了业界领先的PC和消费电子产品制造商。

高带宽数字内容保护系统（ HDCP ），保护的DVI输出被复制的行业标准。

HDCP是由Intel公司开发的，并通过数字内容保护，LLC的许可。该TFP513是兼容的

HDCP 1.0规范。

PanelBus ，使用PowerPad和EPIC -5是德州仪器公司的注册商标。

Intel是Intel Corporation的注册商标。

其他商标均为其各自所有者的财产。

PRODUCTION数据信息为出版日期。

产品符合每德州仪器条款规范

标准保修。生产加工并不包括

所有测试参数。

版权

2004年，德州仪器

邮政信箱655303

达拉斯，德克萨斯州75265

TFP513

PanelBus

数字发射机

SLLS611 - 2004年8月

该器件包含电路，以保护其投入和对输出的伤害，由于高静电压或静电场。这些

电路已合格，根据MIL -STD- 883C ，以保护该器件免受高达2kV的静电放电（ ESD ）

方法3015 ;然而，建议采取预防措施，以避免应用高于任何电压的最大额定

电压对这些高阻抗电路。在储存或处理，该器件引脚必须一起短路或设备必须

被放置在导电泡沫。在一个电路中，未使用的输入必须始终连接到拨逻辑电压电平，最好是

VCC或地。用于处理这种类型的设备的具体准则中包含的出版物

处理指南

静电放电敏感（ ESDS ）器件和组件

从德州仪器。

引脚分配

PAP包装

（ TOP VIEW ）

DATA11

DATA10

DATA9

DATA8

DATA7

DATA6

IDCK-

IDCK +

DATA5

DATA4

DATA3

DATA2

DATA1

DATA0

DGND

48 47 46 45 44 43 42 41 40 39 38 37 36 35 34 33

1 2

3 4

6 7 8 9 10 11 12 13 14 15 16

DGND

DATA12

DATA13

DATA14

DATA15

DATA16

DATA17

DATA18

DATA19

DATA20

DATA21

DATA22

DATA23

TGND

TX2+

TX2

TX1+

TX1

TGND

TX0+

TX0

TXC +

TXC-

TGND

TFADJ

保护地

REF

HSYNC

VSYNC

DK3

RDA

RCL

EDGE / HTPLG

MSEN

ISEL / RST

DSEL / SDA

BSEL / SCL

DGND

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达拉斯，德克萨斯州75265

TFP513

PanelBus

数字发射机

SLLS611 - 2004年8月

功能框图

IDCK-

DATA [ 23：0]

VSYNC

HSYNC

VREF

EDGE / HTPLG

编码器

MSEN

ISEL / RST

控制

TXC-

串行器

TX0±

通用输入

HDCP

加密

HDCP

暗号

T.M.D.S.发射机

12-/24-Bit

I / F

数据

格式

编码器

串行器

TX2±

编码器

串行器

TX1±

BSEL / SCL

DSEL / SDA

I2C从I / F

对于DDC

TFADJ

RDA

RCL

加密

嵌入式

HDCP密钥

密钥解密

1.8 V稳压器

与绕道

电容器

PLL

终端功能

终奌站

名字

输入引脚

DATA [ 23:12 ]

3647

的高12位的24位像素总线。

在24位，单边沿输入模式（ BSEL =高），该总线输入的24位象素总线的上半部分。

在12位，双沿输入模式（ BSEL =低），这些位不输入像素数据。在这种模式下，状态

DATA [ 23:16]被输入到I2C寄存器CFG 。这使8位的用户配置数据，以通过读取

通过I2C接口的图形控制器（参见I2C

注册说明

部分）。

注：所有未使用的数据输入必须连接到GND或VDD 。

DATA [ 11 ：0]的

5055,

5863

的低12位中的24位象素总线/ 12位像素总线输入的。

在24位，单边输入模式（ BSEL =高），这种总线输入底部的24位像素总线的一半。

在12位，双沿输入模式（ BSEL =低），这种公交车的投入1/2像素（ 12位）在每个锁边（都

上升沿和时钟的下降沿）。

数据使能。如DVI 1.0规格所定义的， DE信号使得发射机的像素进行编码

在任何给定的输入时钟周期的数据或控制数据。在活动视频（ DE =高），发射器

编码的像素数据， DATA [ 23：0] 。在消隐间隔（ DE =低），发射器编码

HSYNC， VSYNC ，和CTL [3： 1] 。

数

I / O

描述

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TFP513

PanelBus

数字发射机

SLLS611 - 2004年8月

终端功能（续）

终奌站

名字

DK3

HSYNC

IDCK-

IDCK +

数

I / O

描述

输入引脚（续）

这个输入引脚不用于TFP513 。它包含了一个弱下拉电阻器，并且可以向左

悬空。如果上拉电阻被连接到VDD时，它必须是在900的范围内

5 kΩ的。

水平同步输入

差分时钟输入。该TFP513同时支持单端和全差分时钟输入模式。

在单端时钟输入模式中， IDCK +输入（引脚57）必须被连接到所述单端

时钟源和IDCK输入（引脚56 ）必须连接到GND 。在差分时钟输入模式中，

TFP513使用IDCK +和IDCK-信号之间的交叉点作为定时基准

锁存输入数据DATA [ 23：0] ，DE， HSYNC和VSYNC 。差分时钟输入模式是仅

可在低信号摆幅模式。

垂直同步输入

输入总线选择/ I2C时钟输入。该引脚的操作取决于I2C接口是否

启用或禁用。此引脚仅3.3 -V宽容。

当I2C被禁用（ ISEL =低），高级别选择24位输入，单边输入模式。低

电平选择12位输入，双沿输入模式。

当I2C使能（ ISEL =高），此引脚用作I2C时钟输入（见I2C

说明

部分）。在这种配置下，该引脚具有开漏输出，需要一个外部

5 kΩ的上拉电阻连接到VDD 。

DSEL / I2C数据。该引脚的操作取决于I2C接口是否启用或禁用。

此引脚仅3.3 -V宽容。

当I2C被禁用（ ISEL =低）时，此引脚用于BSEL和VREF选择单端或

差分输入时钟模式（见

通用图形控制器接口模式

部分）。

当I2C使能（ ISEL =高）时，此引脚用作I2C双向数据线。在这

配置方面，这款引脚具有开漏输出，需要一个外部的5 kΩ的上拉电阻连接

至VDD 。

边选择/热插拔的输入。该引脚的操作取决于I2C接口是否已启用

禁用。该输入只有3.3 -V宽容。

当I2C被禁用（ ISEL =低），高级别选择主锁闩发生的上升沿

输入时钟IDCK + 。一个低电平选择主闩上发生的输入时钟的下降沿

IDCK + 。这是两个单端和差分输入时钟模式的情况下。

当I2C使能（ ISEL =高）时，此引脚监测热插拔检测信号（见DVI或VESA

P&D和DFP广告管理系统标准）。当用于热插拔检测，该引脚需要一系列1 - kΩ电阻。

I2C接口选择/ I2C RESET （低电平有效，异步）。

如果ISEL为高，则I2C接口处于活动状态。对于I2C寄存器缺省值可以在I 2 C中找到

注册说明

部分。

如果ISEL为低，则I2C被禁用，并通过配置引脚指定的芯片配置

（ BSEL ， DSEL ， EDGE ， VREF）和状态引脚（ PD ）。

如果ISEL被拉低，然后再高， I2C状态机被复位。该寄存器的值是

更改为默认值，不能从复位之前保留。

监视器感/可编程输出1该引脚的操作取决于I2C接口

为启用或禁用。该引脚具有漏极开路输出，仅3.3 -V宽容。外部5 kΩ的

上拉电阻连接到VDD需要在该引脚。

当I2C被禁用（ ISEL =低），高位表明已启动的接收器在检测

差分输出。低电平表示未检测到启动的接收器。这个功能是有效

只有在直流耦合系统。

当I2C使能（ ISEL =高），这个输出是通过I2C接口编程（见I2C

寄存器说明）。

VSYNC

BSEL / SCL

I / O

配置/编程引脚

DSEL / SDA

I / O

EDGE / HTPLG

ISEL / RST

MSEN

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TFP513

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SLLS611 - 2004年8月

终端功能（续）

终奌站

名字

数

I / O

描述

配置/编程引脚（续）

掉电（低电平有效）。在掉电状态下，只有数字I / O缓冲器和I2C接口保持

活跃的。

当I2C被禁用（ ISEL =低），高级别选择正常工作模式。低级别选择

在掉电模式。

当I2C使能（ ISEL =高），掉电状态下通过I2C选择。在此配置中，

PD引脚必须连接到GND 。

注：为PD的默认寄存器值低，因此该设备在断电模式时， I2C是第一

启用或I2C复位后。

这些端子是I2C接口与内部HDCP密钥的EEPROM 。每个终端需要

在900的范围内上拉电阻

至5kΩ的连接到VDD。

输入参考电压。选择的数字数据输入的摆动范围（ DATA [ 23：0] ，DE， HSYNC，

VSYNC和IDCK ±）。

对于高摆幅3.3 V的输入信号电平， VREF必须连接到VDD 。

对于低摆幅输入信号电平（VREF）必须被设置为一半的最大输入电压电平的。见

推荐工作条件

部分，用于在允许范围为VREF。

所需的参考电压VREF电平通常是来自用一个简单的分压器电路。

TFADJ

TX0+

TX0

TX1+

TX1

TX2+

TX2

TXC +

TXC-

34, 35

无需连接。如果该终端连接，配合其VDD 。

这些引脚被保留，必须连接到GND正常运行。

全面的调整。该引脚控制的DVI输出电压摆幅的幅度，由确定

连接到TVDD上拉电阻R（ TFADJ ）的值。

通道0 DVI差分输出对。 TX0 ±有效视频期间发送8比特蓝色的像素数据和

HSYNC和VSYNC的消隐间隔期间。

信道1的DVI差分输出端对。 TX1 ±有效视频期间发送8位绿色像素数据和

CTL [1]在消隐间隔期间。

通道2个DVI差分输出对。 TX2 ±有效视频期间发送的8位红色的像素数据和

CTL [3：2 ]在消隐间隔。

DVI差分输出时钟。

RDA

RCL

VREF

I / O

DVI差分信号输出引脚

电源和地引脚

DGND

DVDD

保护地

PVDD

TGND

TVDD

16, 48, 64

1, 12, 33

20, 26, 32

23, 29

数字地

数字电源。必须设置为3.3 V额定

PLL地面

PLL电源。必须设置为3.3 V额定

发射机差分输出驱动器地

发射机差分输出驱动器的电源。必须设置为3.3 V额定

邮政信箱655303

达拉斯，德克萨斯州75265