【集成电路数据表TDA8752A三重高速模拟到数字转换器（ADC）的产品speci fi cation】,IC型号TDA8752AH/8,TDA8752AH/8 PDF资料,TDA8752AH/8经销商,ic,电子元器件-51电子网

集成电路

数据表

TDA8752A

三重高速模拟到数字

转换器（ADC）的

产品speci fi cation

取代1998年的数据12月14日

在集成电路， IC02文件

1999年2月24日

飞利浦半导体

产品speci fi cation

三重高速模拟到数字

转换器（ADC）的

特点

三重8位ADC

采样速率高达100 MHz

集成电路通过一个串行接口控制的，它可以是

C总线线或3线，通过TTL输入引脚选择

集成电路的模拟电压输入，从0.4到1.2伏（页）到

产生1伏（峰 - 峰值）的满量程ADC输入

3夹具的编程之间的夹紧码

63.5

并在步骤64

最低位

3可控放大器：增益可通过串行控制

接口，以产生一个满刻度分辨率

最低位

峰 - 峰值

250 MHz的放大器带宽ER

温度低增益变化

锁相环，通过串行接口控制的，以产生所述

ADC时钟，它可以从被锁定到一个行频

15到280千赫

集成PLL分频

可编程相位时钟调节细胞

内部电压调节器

TTL兼容的数字输入和输出

芯片使能高阻抗ADC输出

掉电模式

可能使用多达四个集成电路在同一系统中，

使用I

C总线接口，或更多，使用3线

串行接口

1瓦的功耗。

应用

的R，G和B的高速数字化

液晶面板驱动

LCD投影系统

VGA和更高的分辨率

并行使用两个芯片，更高的显示分辨率

获得; 200 MHz的像素频率。

订购信息

包

类型编号

名字

TDA8752AH/6

TDA8752AH/8

描述

概述

TDA8752A

该TDA8752A是一款三8位ADC具有可控

放大器和夹具进行大带宽的数字化

RGB信号。

的钳位电平，增益和所有的其他设置是

通过串行接口进行控制（任我

C总线线或3线

串行总线，通过一个逻辑输入选择）。

该集成电路还包括可以锁定在一个锁相环

水平线的频率和产生的ADC时钟。

该PLL抖动最小的高分辨率PC图像

应用程序。外部时钟，也可以输入到

ADC。

所以能够设定TDA8752A串行总线地址

四个固定值之间，在该事件是几个

TDA8752A IC用于在一个系统中，采用了我

C总线

接口（例如，用于一个奇数两个IC /偶

CON组fi guration ）。

VERSION

SOT317-2

采样

频率

（兆赫）

100

QFP100塑料四方扁平的封装; 100导线（引线长度

1.95毫米） ;身体14

2.8 mm

1999年2月24日

飞利浦半导体

产品speci fi cation

三重高速模拟到数字

转换器（ADC）的

快速参考数据

符号

CCA

DDD

CCD

CCO

CCA （ PLL ）

CCO （PLL）的

CCA

DDD

CCD

CCO

CCA （ PLL ）

CCO （PLL）的

CLK

REF （PLL）的

VCO

INL

参数

模拟电源电压

逻辑电源电压

数字电源电压

输出级电源电压

模拟PLL电源电压

PLL的输出电压

模拟电源电流

逻辑电源电流

数字电源电流

输出级的电源电流

模拟PLL电源电流

PLL的输出电源电流

最大时钟频率

PLL参考时钟的频率

VCO输出的时钟频率

DC积分非线性

从模拟输入

数字输出;满量程;

斜坡输入;

CLK

= 100兆赫

从模拟输入

数字输出;满量程;

斜坡输入;

CLK

= 100兆赫

REF

= 2.5 V带

100 PPM / ° C（最大值）

分贝;牛逼

AMB

= 25

°C

TDA8752A/6

TDA8752A/8

CLK

= 100 MHz的;

斜坡输入

对于我

C总线和3线

用于R，G和B通道

条件

用于R，G和B通道

对于我

C总线和3线

分钟。

4.75

100

典型值。

5.0

120

1.0

±0.5

TDA8752A

马克斯。

5.25

280

100

±1.5

单位

兆赫

千赫

兆赫

最低位

DNL

DC差分非线性

±0.5

±1.0

最低位

AMP

SET

PLL

合计

PLL （ RMS）

放大器增益呃稳定的函数

温度

扩增fi er带宽

ADC模块加上AGC稳定时间

PLL分频比

总功耗

最大的PLL相位抖动（ RMS值）

250

1.0

0.3

200

4095

PPM /°C的

兆赫

输入信号稳定

时间< 1纳秒;牛逼

AMB

= 25

°C

100

CLK

= 100 MHz的;

斜坡输入

REF

= 66.67 kHz的;

CLK

= 100兆赫

1999年2月24日

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dbook ，全页宽

1999年2月24日

Ragc

RGAINC

凛

行政院研考会

VREF

GAGC

GGAINC

杜松子酒

GDEC

bAGC

框图

飞利浦半导体

三重高速模拟到数字

转换器（ADC）的

VCCAR

VCCAB

VCCor

VCCOB VCCA （ PLL ）

VCCD

电

AGNDG

VSSD

OGNDG AGNDPLL

DGND

VCCAG

VDDD

VCCOG

VCCO （ PLL ）

AGNDR

AGNDB

OGNDR

OGNDB OGNDPLL

RCLP

瑞波

钳

MUX

输出

ADC

71 78

R0至R7

ROR

红色通道

61至68

GCLP

GBOT

G0至G7

49岁， 52 58

GOR

BCLP

BBOT

B0到B7

BOR

绿色通道

BGAINC

箱子

BDEC

蓝色通道

TDO

TCK

ADD2

ADD1

SEN

SCL

SDA

DIS

C/3W

1, 5, 30, 31, 43 , 44

50, 51, 100

北卡罗来纳州

串行

接口

C总线

3-WIRE

C总线; 1位

（H电平）

的HsyncI

CKADCO

CKBO

CKAO

CKREFO

CkExt

INV

COAST

CKREF

TDA8752A

调节器

PLL

HSYNC

DEC1

FCE079

产品speci fi cation

TDA8752A

DEC2 PWDWN

图1框图。

飞利浦半导体

产品speci fi cation

三重高速模拟到数字

转换器（ADC）的

TDA8752A

电

手册，全页宽

Ragc

clkADC都

RCLP

150

MUX

钳

控制

DAC

AGC

ADC

C总线; 8位

（OR）的

输出

DAC

≥

粗增益调整

C总线; 7位

（CR）的

串行

C总线

瑞波

凛

VREF

ROR

VCCAR

R0至R7

精细增益调整

C总线; 5位

（ FR）

MGG364

的HsyncI RGAINC

图2红色通道示意图。

1999年2月24日

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