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1999年08月20
Q_OUT1 I_IN1
A1VCC
6
9
LNA_IN
8
LNA_OUT
DEMOD_IN
CLK
数据
EN
TUNE
CP
数字
相
比较
可编程
主分频器
1/4
7
14
15
16
19
18
21
22
TKB
TKA
3 -Wire总线收发器
90
1/2
A2VCC
23
A3VCC
25
DVCC
13
OUTVCC
27
AGC_IN
11
I_OUT1
5
Q_IN1
28
29 4
3
1
2
I_OUT2
I_OUT
I_OUTC
Q_OUT
Q_OUTC
Q_OUT2
框图
飞利浦半导体
QPSK接收器
×
×
TDA8051
0
32
31
30
图1框图。
手册，全页宽
3
收费
可编程
REF分频器
1/2
12
OSC_IN
17
TEST
北卡罗来纳州
10
A1GND
24
26
20
FCE112
A2GND OUTGND
DGND
产品speci fi cation
TDA8051
飞利浦半导体
产品speci fi cation
QPSK接收器
功能说明
对QPSK调制信号被施加到输入端作为
在带宽44到130 MHz的不对称的RF信号。
频谱扩展，该波形必须限制
通过一个带通滤波器取代的集成电路。
RF输入要么是在LNA的输入，如果电平是
30
到0 dBmVrms或解调输入，如果电平是
20
+10 dBmVrms 。放大的RF信号被
有两个时钟正交提供混合
基带解调的同相（ I）和四相（Q）的
信号。
VCO的工作在射频载波频率的两倍
带宽的88 - 260兆赫（一个八度） ，因此，
通过一个除法器产生由2 0 90°的时钟。
VCO的频率可以通过一个集成的编程
PLL的调谐外部LC谐振电路。
TDA8051
原始I和Q信号产生含有虚假
尖峰，因此每个信号通过第三传递
订购有源低通滤波器（RC细胞中+ Sallen-Key滤波器
结构），其截止频率是由外部设定
组件。经滤波的I和Q数据信号然后
放大，以提供平衡的缓冲输出。
发送到PLL中的数据被加载在脉冲串，由框
信号EN 。编程时钟边沿，连同其
相关数据位，被忽略，直到EN变得活跃
（ LOW ） 。内部锁存器的最新更新
当EN返回到无效（高电平）编程数据。
最后14位仅是编程中所保留
注册。没有进行检查，在时钟脉冲的数量
而编程启用接收。有效时钟
边缘引起的数据比特的移位时，将产生
EN变为高电平，同时时钟仍然偏低。主要分
比与基准分频器比率是通过所提供的
串行总线（见表1） 。
极限值
按照绝对最大额定值系统（ IEC 134 ） 。
符号
V
CC
V
（最大）
t
sc
T
英镑
T
J（下最大）
T
AMB
V
CC （调）
处理
HBM ESD ： IC引脚承受2kV的除外引脚26 （ 1750 V） 。
MM ESD ：在IC管脚耐压为100V ，除了引脚2和31 （ 75 V ） 。
热特性
符号
R
号（j -a）的
参数
从结点到环境的热阻
条件
在自由空气
价值
65
单位
K / W
电源电压
所有引脚上的最大电压，除了脚9 （ 5 V ）
在输出端最大短路持续时间
储存温度
最高结温
工作环境温度
调谐电压输入
参数
分钟。
0.3
0.3
40
0
0.3
马克斯。
6.0
V
CC
10
+150
150
70
30
V
V
s
°C
°C
°C
V
单位
1999年08月20
5
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