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TC74HC123AP/AF/AFN
东芝CMOS数字集成电路
硅单片
TC74HC123AP,TC74HC123AF,TC74HC123AFN
双可重触发单稳多谐振荡器
该TC74HC123A是一款高速CMOS单稳态
多谐振荡器制造与硅栅
2
MOS
技术。
它实现了类似于等效的高速操作
输入通道，同时保持CMOS低功耗。
有两个触发输入，
A输入（下降沿）和B
输入（上升沿） 。这些输入的有效期为缓慢上升/下降
时间信号（ TR = TF = 1秒），因为它们是施密特触发器输入。这
装置还可以通过使用触发
CLR
输入（正
边缘）。
触发，输出停留在一个单稳态状态后，
由外部电阻器和电容器确定的时间周期
（ RX， CX） 。在一个低的水平
CLR
输入打破这种状态。在
单稳态状态下，如果一个新的触发被应用，它扩展了
单稳态期间（再触发模式）。
限制Cx和接收是：
外部电容Cx的：没有限制
外部电阻器，接收： V
CC
= 2.0V，超过5千欧
V
CC
≥
3.0V，超过1千欧
所有的输入都配备了防静电保护电路
解除或瞬态过电压。
注意： xxxFN （JEDEC SOP）不在可用
日本。
TC74HC123AP
TC74HC123AF
TC74HC123AFN
特点（注）
高速：吨
pd
= 25 ns（典型值），在V
CC
= 5 V
低功耗
待机状态：我
CC
= 4
μ
A（最大值）在TA = 25℃
活动状态：我
CC
= 700
μ
A（最大值）在TA = 25℃
高抗干扰性： V
美国国立卫生研究院
= V
NIL
= 28% V
CC
（分钟）
输出驱动能力： 10输入通道负载
对称的输出阻抗： | I
OH
| = I
OL
= 4 MA（ MIN ）
平衡传输延迟：吨
PLH
t
PHL
宽工作电压范围： V
CC
（OPR ）= 2到6伏
引脚和功能与74LS123兼容
注意：
在只使用一个电路的情况下，
CLR
should be tied to GND, Rx/Cx½Cx½Q½
Q
应该连接到开放的，
其他的输入应连接到V
CC
或GND 。
重量
DIP16-P-300-2.54A
SOP16-P-300-1.27A
SOL16-P-150-1.27
：1.00克（典型值）。
0.18克（典型值）。
0.13克（典型值）。
1
2007-10-01
TC74HC123AP/AF/AFN
引脚分配
IEC逻辑符号
2
2007-10-01
TC74HC123AP/AF/AFN
框图（注1 ） （注2 ）
注1 ：CX ，RX霉素是外部
电容器，电阻器和二极管，分别。
注2 ：外部钳位二极管，霉素;
外部电容被充电到V
CC
在等待状态电平，即当没有触发应用。
如果电源电压被关断， Cx的是放电主要是通过内部的（寄生）二极管。如果Cx的是
足够大和V
CC
迅速下降，会出现通过在高峰损坏IC的一些可能性
电流或闭锁。如果电源电压滤波器的电容足够大，且V
CC
缓慢下降时，
在冲击电流自动限制和损坏IC得以避免。
正向电流通过寄生二极管的最大值为
±20
毫安。
在一个大的Cx的情况下，在电源电压的下降时间的上限被确定为如下：
t
f
≥
(V
CC
0.7 ） CX / 20毫安
（TF是在电源电压之间的时间关断和电源电压达到0.4伏
CC
.)
在事件的系统不满足上述条件，一个外部钳位二极管（霉素）是需要的
保护IC免受浪涌电流。
真值表
输入
A
输出
CLR
B
H
Q
Q
功能
OUTPUT ENABLE
H
H
H
H
L
L
H
H
X
H
L
L
X
L
X
抑制
抑制
OUTPUT ENABLE
OUTPUT ENABLE
H
X
L
L
H
抑制
X ：无关
3
2007-10-01
TC74HC123AP/AF/AFN
系统框图
V
CC
V
REF
L
V
REF
H
Q
P
C
1
C
2
R
X
/C
X
Q
N
V
CC
，D R
Q
C
X
F/F
A
B
CK
Q
Q
Q
CLR
时序图
4
2007-10-01
TC74HC123AP/AF/AFN
功能说明
(1)
待机状态
外部电容（ Cx的）被完全充电至V
CC
在待机状态。这意味着，前
触发时， Q
P
和Q
N
它们被连接到的Rx / Cx的节点晶体管处于截止状态。两
这涉及到输出脉冲的定时，并且两个参考电压供给比较器关断。
总电源电流仅为漏电流。
触发操作
触发器的操作是有效的，在任何下列三种情况的。首先，该状态下的
A
输入为低，且B输入端有一个上升的信号的装置;第二，其中的B输入端为高电平时，与A输入端
有一个下降的信号;和第三，当A输入端为低电平和B输入端为高电平，且
CLR
输入有一个上升信号。
后一个触发器变为有效，比较器C1和C2开始运作，且Q
N
被接通。该
通过Q外部电容放电
N
。在与Rx / Cx的节点处的电压电平下降。如果在Rx / Cx的
电压电平下降到内部基准电压Vref L时， C 1的输出变成低电平。触发器
然后复位和Q
N
关闭。在那一刻停止C1 C2 ，但继续运行。
Q后
N
关断时，在接收/ Cx的节点处的电压开始在由时间确定的速率上升
恒外部电容Cx和电阻器接收的。
一旦触发，输出Q变为高，继内部的F / F和门的一些延迟时间。它
居高不下即使接收/ Cx的电压下降至上升变化。当接收/国泰到达
内部基准电压Vref H， C2的输出变低时，输出端Q变为低电平和C2站
其操作。这意味着，触发之后，当Rx / Cx的节点的电压电平达到Vref的H，
该IC返回到它的单稳态状态。
使用Cx和Rx ，较大的值，而忽略了电容和内部的放电时间
该IC时，输出脉冲，总重量（OUT）的宽度，延迟如下：
总重量（OUT）
=
1.0 Cx的接收
RETRIGGER操作
当一个新的触发器被加于输入端A或B ，而在单稳状态，这是
有效只有当IC被充电Cx的。在Rx / Cx的节点的电压电平，然后下降至Vref的L电平
再次。因此，如果下一次触发来自于由Cx的设定的时间段之前的Q输出保持为高电平的
和Rx 。
如果新的触发很接近原来的触发，如发生在放电循环期间，
它不会有任何效果。
最短时间为触发有效触发2次， TRR （最小） ，依赖于V
CC
与Cx的。
复位操作
在正常操作中，
CLR
输入保持高电平。如果
CLR
为低电平时，触发器有，因为没有影响
Q输出保持低电平，触发控制F / F复位。此外，Q
P
接通和Cx的被充电
迅速V
CC
.
这意味着如果
CLR
被设置为低时，IC将进入一个等待状态。
(2)
(3)
(4)
5
2007-10-01
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