TAS5705
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SLOS549 - 2008年6月
具有EQ和DRC的20W立体声数字音频功率放大器
1
特点
音频输入/输出
- 20 -W为8 Ω负载从一个18 V电源
- 宽电源电压范围从（ 8 V
至23 V）
- 高效D类操作消除
极品散热器
- 只需要两个电源轨
- 两个串行音频输入（四个音频
频道）
- 支持32 kHz至192 kHz的采样率
（ LJ / RJ / I
2
S)
- 耳机PWM输出
- 低音炮PWM输出
音频/ PWM处理
- 独立通道音量控制与
24 - dB到-100 dB范围
- 软静音（ 50 ％占空比）
- 可编程动态范围控制
- 16适应双二阶滤波器的扬声器均衡
- 七双二阶滤波器的左，右
频道
- 两个双二阶滤波器的重低音通道
- 自适应系数为刚果（金）过滤器
- 可编程的输入和输出混音器
- 直流阻塞过滤器
- 响度补偿低音炮
- 自动采样率检测和
银行业系数为刚果（金）和EQ
一般特点
- 串行控制接口操作不
MCLK
- 工厂校准内部振荡器
23
启用自动检测传入的
样品价格
- 过热和短路保护
好处
- EQ ：扬声器均衡改善音频
性能
- 刚果（金） ：动态范围压缩。
启用功率限制，音箱
保护，轻音乐，夜间模式
听
- 自助银行交换：预载系数
对于不同的采样率。没有必要
写任何系数的一部分，当
采样率的变化。
- 自动检测：自动检测
采样率的变化。没有必要
外部微处理器干预
描述
该TAS5705是20 W，效率高，数字音频功率
放大器用于驱动立体声桥接式扬声器。两
串行数据输入允许多达4个处理
独立的音频通道和无缝集成，
大多数数字音频处理器和MPEG解码器。
该器件接受范围广泛的输入数据和
时钟速率。一个完全可编程的数据路径允许
这些通道被路由到内部扬声器
通过管线级的低音炮的驱动程序或输出或
耳机PWM输出。
该TAS5705是一个从属设备只接收时钟
从外部来源。该TAS5705工作在
384 kHz的开关频率为32-， 48- ， 96-，和192千赫
数据和352.8 kHz的开关频率为44.1- ， 88.2-
和176.4 kHz的数据。 8×过采样结合
与四阶噪声整形器提供了一个平
本底噪声和出色的动态范围从20Hz
到20千赫。
1
2
3
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
的PurePath Digital是德州仪器的商标。
所有其他商标均为其各自所有者的财产。
2008 ，德州仪器
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
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简化应用图
3.3 V
8 V–23 V
DVDD / AVDD
PVDD
OUT_A
LRCLK
数字
音频
来源
SCLK
MCLK
SDIN1
SDIN2
OUT_B
OUT_C
BST_B
BST_A
LC
左
我知道了
控制
2
SDA
SCL
BST_C
LC
BST_D
MUTE（静音）
控制
输入
HPSEL
RESET
PDN
TAS5102
8 V–23 V
OUT_D
右
PLL_FLTP
环
滤波器
PLL_FLTM
SOUT +
SUB_PWM +
SUB_PWM-
BKND_ERR
有效
SIN +
SINθ
故障
RESET
SOUT-
低音炮
HPR_PWM
HPL_PWM
RC
滤波器
TPA6110A2
（ HP放大器）
B0264-01
2
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功能视图
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3
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故障
故障
内部上拉
电阻VREG
理解
电压
保护
4
4
VREG
保护
和
I / O逻辑
动力
On
RESET
AGND
温度。
SENSE
有效
过电流
保护
I
SENSE
GND
OC_ADJ
BST_D
PVDD_D
PWM_D
PWM
RCV
CTRL
定时
门
DRIVE
BTL配置
下拉电阻
OUT_D
PWM控制器
GVDD_CD
调节器
PGND_CD
GVDD_CD
BST_C
PVDD_C
PWM_C
PWM
RCV
CTRL
定时
门
DRIVE
BTL配置
下拉电阻
OUT_C
PGND_CD
BST_B
PVDD_B
PWM_B
PWM
RCV
CTRL
定时
门
DRIVE
BTL配置
下拉电阻
OUT_B
GVDD_AB
调节器
PGND_AB
GVDD_AB
BST_A
PVDD_A
PWM_A
PWM
RCV
CTRL
定时
门
DRIVE
BTL配置
下拉电阻
OUT_A
PGND_AB
B0034-04
图1.功率级功能框图
4
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64 -PIN ， HTQFP包装（顶视图）
PAP包装
（ TOP VIEW ）
64 63 62 61 60 59 58 57 56 55 54 53 52 51 50 49
OUT_A
PVDD_A
PVDD_A
BST_A
GVDD_AB
SSTIMER
TEST1
OC_ADJ
故障
AVDD
AVSS
PLL_FLTM
PLL_FLTP
VR_ANA
DVDD
RESET
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
OUT_D
PVDD_D
PVDD_D
BST_D
GVDD_CD
VREG
GND
GND
SUB_PWM +
SUB_PWM-
HPR_PWM
HPL_PWM
有效
BKND_ERR
MCLK
DVDD
MUTE（静音）
LRCLK
SCLK
SDIN2
SDIN1
DVSSO
VR_DIG
PDN
VREG_EN
OSC_RES
SDA
SCL
HPSEL
STEST
TEST2
DVSS
PGND_AB
OUT_B
OUT_B
PVDD_B
PVDD_B
BST_B
BST_C
PVDD_C
PVDD_C
OUT_C
OUT_C
PGND_CD
PGND_CD
OUT_D
PGND_AB
OUT_A
P0071-01
终端功能
终奌站
名字
AVDD
AVSS
BKND_ERR
号
10
11
35
TYPE
(1)
P
P
DI
上拉
5-V
宽容
终止
(2)
描述
3.3 V模拟电源。需要密切的去耦电容。
模拟3.3 V电源接地
低电平有效。甲后端误差序列是通过将逻辑产生
低到这个终端。该引脚被连接到外部电源
阶段。如果没有外部力量的阶段时，该引脚直接连接到
DVDD 。
高边自举电源的半桥一个
高边自举电源的半桥B
高边自举电源的半桥
高边自举电源的半桥式D
BST_A
BST_B
BST_C
BST_D
(1)
(2)
4
57
56
45
P
P
P
P
TYPE ： A =模拟; D = 3.3 V数字; P =电源/地/去耦; I =输入; O =输出
所有的上拉是20 μA
弱
上拉和下拉全部都是20 μA
弱
下拉。的上拉和下拉包括保证
如果端子悬空正确的输入逻辑电平（上拉
→
逻辑1输入;下拉
→
逻辑0输入） 。设备驱动
上拉输入必须能吸收50
A
同时保持逻辑0电平驱动。设备驱动输入，下拉必须
能源50
A
同时保持逻辑1驱动电平。
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