TAS5704
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SLOS563A - 2008年3月 - 修订2010年8月
20W立体声数字音频功率放大器反馈
检查样品：
TAS5704
1
特点
音频输入/输出
- 20 -W为8 Ω负载从一个18 V电源
- 两个串行音频输入（四个音频
频道）
- 支持多种输出配置：
- 2通道桥接输出（ 20瓦× 2 ）
- 4通道单端输出（ 10瓦× 4 ）
- 2路单端+ 1通道桥接（ 2.1 ）
(10 W × 2 + 20 W)
闭环功率级架构
- 改进PSRR降低电源
性能要求
- 更高的阻尼因子提供了
更严格，更准确的声音
改进的低音响应
- 降低EMC辐射
- 输出功率为独立供应
电压变化
广PVCC范围从（ 10 V至26 V ）
支持32千赫， 192千赫（ DVD音频）样本
价格（ LJ / RJ / I
2
S)
行级低音炮PWM输出
音频/ PWM处理（硬件控制）
- 第4步增益控制（ -3dB ， 3dB时， 9分贝， 12分贝）
- 软静音控制（ 50 ％输出占空比）
工厂校准的内部振荡器启用
自动检测来料来样的
价格
热和短路保护
间隔
2
描述
该TAS5704是20 W，效率高，数字音频功率
放大器用于驱动立体声桥接式扬声器。两
串行数据输入允许多达4个处理
独立的音频通道和无缝集成，
大多数数字音频处理器的接受范围广
输入数据和时钟速率。硬件
可配置的数据路径允许这些通道是
排到通过内置扬声器驱动器或输出
低音炮PWM输出。
该TAS5704是一个奴隶，唯一设备接收所有
时钟从外部来源。该TAS5704工作
在384 kHz的开关频率为32-， 48- ， 96-，和
192 kHz的数据，并在352.8 kHz的开关速度为
44.1- ， 88.2-和176.4 kHz的数据。 8×
过采样结合的四阶噪声
整形提供了扁平本底噪声和极好的
动态范围从20赫兹到20千赫。
该TAS5704的闭环架构
提供了几个好处。高电源
拒绝允许从一个卓越的音频性能
嘈杂的，低成本的供应。高阻尼系数
可以更严格地控制扬声器的运动
从而改进低音响应。最后，
开关边缘速率控制降低EMC辐射
在不牺牲音频性能。
1
2
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
系统中的两个， Audio Precision公司是Audio Precision公司， Inc.的商标。
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PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
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这些器件具有有限的内置ESD保护。引线应短接在一起或设备放置在导电泡棉
储存或搬运过程中，以防止对静电损坏MOS大门。
简化应用框图
桥接负载（ BTL ）模式
3.3 V
10 V–26 V
DVDD / AVDD
AVCC / PVCC
OUT_A
LRCLK
数字
音频
来源
(TAS3x08)
SCLK
MCLK
SDIN1
SDIN2
OUT_B
OUT_C
BST_B
BST_A
LC
BTL
*
左
BST_C
LC
BTL
*
GAIN_x （ 2针）
MUTE（静音）
控制
输入
FORMATx （ 3针）
RESET
PDN
CONFIG_x （ 2针）
SUB_PWM +
PWM_AP
右
BST_D
OUT_D
TAS5601
10 V–26 V
OUT_A
PWM_AN
SUB_PWM-
PLL_FLTP
环
滤波器
PLL_FLTM
PWM_BP
PWM_BN
BST_A
LC
BTL
*
BST_B
低音炮
BKND_ERR
有效
故障
RESET
OUT_B
*请参阅TI应用笔记（ SLOA119 ）的LC滤波器设计BTL （ AD / BD模式）的配置。
B0264-02
2
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单端（ SE ） 2.1模式
3.3 V
10 V–26 V
DVDD / AVDD
AVCC / PVCC
OUT_A
LRCLK
数字
音频
来源
(TAS3x08)
SCLK
MCLK
SDIN1
SDIN2
BST_B
BST_A
LC
SE
*
OUT_B
LC
SE
*
GAIN_x （ 2针）
MUTE（静音）
控制
输入
FORMATx （ 3针）
RESET
PDN
CONFIG_x （ 2针）
OUT_D
BST_C
LC
BTL
*
BST_D
OUT_C
PLL_FLTP
环
滤波器
PLL_FLTM
SUB_PWM +
SUB_PWM-
BKND_ERR
有效
*请参阅TI应用笔记（ SLOA119 ）的LC滤波器设计SE或BTL配置。
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单端（ SE ） 4.0模式
3.3 V
10 V–26 V
DVDD / AVDD
AVCC / PVCC
OUT_A
LRCLK
数字
音频
来源
(TAS3x08)
SCLK
MCLK
SDIN1
SDIN2
BST_B
BST_A
LC
SE
*
OUT_B
LC
SE
*
GAIN_x （ 2针）
MUTE（静音）
控制
输入
FORMATx （ 3针）
RESET
PDN
CONFIG_x （ 2针）
BST_D
LC
SE
*
BST_C
OUT_C
LC
SE
*
OUT_D
PLL_FLTP
环
滤波器
PLL_FLTM
SUB_PWM +
SUB_PWM-
BKND_ERR
有效
*请参阅TI应用笔记（ SLOA119 ）的LC滤波器设计SE配置。
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64 -PIN ， HTQFP包装
PAP包装
（ TOP VIEW ）
64 63 62 61 60 59 58 57 56 55 54 53 52 51 50 49
OUT_B
PGND_B
PGND_B
OUT_A
OUT_A
PGND_A
PGND_A
PVCC_A
PVCC_A
AVDD
AVSS
PLL_FLTM
PLL_FLTP
VR_ANA
DVDD
RESET
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
PGND_C
PGND_C
OUT_D
OUT_D
PGND_D
PGND_D
PVCC_D
PVCC_D
SUB_PWM +
SUB_PWM-
有效
BKND_ERR
MCLK
DVDD
CONFIG_1
CONFIG_2
MUTE（静音）
LRCLK
SCLK
SDIN2
SDIN1
DVSS
VR_DIG
PDN
VREG_EN
OSC_RES
GAIN_1
GAIN_0
FORMAT2
FORMAT1
FORMAT0
DVSSO
PVCC_B
BST_B
VCLAMP_AB
BST_A
AVCC
AGND
绕行
BST_D
VCLAMP_CD
BST_C
PVCC_C
PVCC_C
OUT_C
OUT_C
PVCC_B
OUT_B
P0071-02
引脚功能
针
名字
AGND
AVCC
AVDD
AVSS
BKND_ERR
号
57
58
10
11
37
TYPE
(1)
5-V
宽容
终止
(2)
描述
对于功率级模拟地
模拟电源的功率级。从外部连接到相同的
潜力PVCC 。
3.3 V模拟电源
3.3 V模拟电源地
P
P
P
P
DI
上拉
低电平有效。甲后端误差序列是通过将一个逻辑开始
低到该引脚。连接到外部功率级。如果没有外部
功率级使用，直接连接到DVDD 。
高边自举电源的半桥一个
BST_A
59
P
(1)
(2)
TYPE ： A =模拟; D = 3.3 V数字; P =电源/地/去耦; I =输入; O =输出
所有的上拉是20毫安弱上拉和下拉全部都是20 mA的弱下拉。的上拉和下拉包括保证
如果端子悬空正确的输入逻辑电平（上拉
→
逻辑1输入;下拉
→
逻辑0输入） 。设备驱动
上拉输入必须能吸收50
mA
同时保持逻辑0电平驱动。设备驱动输入，下拉必须
能源50
mA
同时保持逻辑1驱动电平。
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