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位置：首页 > IC型号导航 > 首字符S型号页 > 首字符S的型号第372页 > SY89827LHITR
麦克雷尔INC 。
3.3V 500MHz的双1:10 HSTL扇出
缓冲器/翻译以2： 1多路复用器输入
精密边缘
SY89827L
精密边缘
SY89827L
特点
■
双LVPECL或HSTL输入， 10差分1.5V
HSTL输出兼容
■
Configurable as dual-channel 10 output or a single-
channel 20 output clock driver
■
保证AC参数随温度和
电压：
> 500MHz的F
最大
在设备倾斜< 50ps的
< 1.5ns传输延迟
< 700ps吨
r
/ t
f
时间
精密边缘
描述
该SY89827L是一个高性能总线时钟
驱动器与双1:10单1时二十HSTL （高速
收发器逻辑）输出对。该部分被设计为
在低电压（ 3.3V / 1.8V ）应用程序需要使用
大量的输出来驱动精确对准，超低
歪斜的信号到目的地。输入多路复用
无论从HSTL或LVPECL （低压正射极
耦合逻辑）由CLK_SEL销。输出启用
（ OE1 OE2 & ）是同步的，这样的输出将只
启用/禁用的时候，他们已经在低状态。
这样就避免了产生矮时钟脉冲的任何机会
当设备被启用/禁用的可与发生
异步控制。
该SY89827L具有极低的偏移性能
的<50ps温度和电压性能优异
先前在具有这种标准的产品无法实现的
高数量的输出。该SY89827L是一个可
单节省空间包，从而能够降低整体成本
的解决方案。对于需要更大的HSTL扇出的应用
能力，考虑SY89824L 。
■
低抖动设计
186fs
RMS
相位抖动
■
3.3V core supply, 1.8V output supply
■
输出使能功能
■
Available in a 64-Pin EPAD-TQFP
应用
■
■
■
■
■
高性能电脑
工作站
并行处理器的系统
其他高性能计算
通讯
典型应用电路
主时钟源
LVPECL_CLKA
/ LVPECL_CLKA
冗余备份
时钟源
LVPECL_CLKB
/ LVPECL_CLKB
10
10
主
卡
10
10
冗
卡
SEL1
主/备用时钟选择
（ 2.0ns内切换）
系统采用SY89827L从主时钟的故障安全应用程序切换电路冗余备份时钟。
仅LVPECL输入，显示在该应用程序。
精密Edge是麦克雷尔公司的注册商标。
M9999-073010
hbwhelp@micrel.com或（408） 955-1690
1
冯：F
修订： / 0
发行日期： 2010年7月
麦克雷尔INC 。
精密边缘
SY89827L
封装/订购信息
VCCO
Q0
/Q0
Q1
/Q1
Q2
/Q2
Q3
/Q3
Q4
/Q4
Q5
/Q5
Q6
/Q6
VCCO
订购信息
(1)
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
64 63 62 61 60 59 58 57 56 55 54 53 52 51 50 49
SEL2
HSTL_CLKB
/ HSTL_CLKB
VCCI
HSTL_CLKA
/ HSTL_CLKA
CLK_SEL1
LVPECL_CLKA
/ LVPECL_CLKA
GND
OE1
LVPECL_CLKB
/ LVPECL_CLKB
CLK_SEL2
OE2
SEL1
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32
VCCO
Q7
/Q7
Q8
/Q8
Q9
/Q9
VCCO
VCCO
Q10
/Q10
Q11
/Q11
Q12
/Q12
VCCO
部件编号
SY89827LHI
SY89827LHITR
(2)
SY89827LHY
(3)
SY89827LHYTR
(2, 3)
包装
TYPE
H64-1
H64-1
H64-1
H64-1
操作
范围是多少？
产业
产业
产业
产业
包装
标记
SY89827LHI
SY89827LHI
领导
完
的Sn-Pb
的Sn-Pb
SY89827LHY与
无铅
无铅扎线指标哑光锡
SY89827LHY与
无铅
无铅扎线指标哑光锡
注意事项：
1.联系工厂用于芯片的可用性。骰子是保证在T
A
= 25 ° C，仅直流ELECTRICALS 。
2.磁带和卷轴。
建议用于新设计3.无铅封装。
64-Pin TQFP (H64-1)
功能框图
CLK_SEL1
HSTL_CLKA
/ HSTL_CLKA
LVPECL_CLKA
/ LVPECL_CLKA
SEL1
0
0
1
1
LEN
HSTL_CLKB
/ HSTL_CLKB
LVPECL_CLKB
/ LVPECL_CLKB
0
D
1
0
1
LEN
Q
D
OE2
10
10
VCCO
/Q19
Q19
/Q18
Q18
/Q17
Q17
/Q16
Q16
/Q15
Q15
/Q14
Q14
/Q13
Q13
VCCO
OE1
10
10
Q
0
– Q
9
/Q
0
– /Q
9
Q
Q
10
– Q
19
/Q
10
– /Q
19
CLK_SEL2
SEL2
M9999-073010
hbwhelp@micrel.com或（408） 955-1690
2
麦克雷尔INC 。
精密边缘
SY89827L
真值表
OE1
(1)
OE2
(1)
SEL1
(1)
SEL2
(1)
CLK_SEL1
(1)
CLK_SEL2
(1)
1
1
1
1
1
1
1
1
1
1
1
1
0
0
0
0
1
1
1
1
0
注： 1 。
Q0 – Q9
HSTL_CLKA
LVPECL_CLKA
HSTL_CLKA
HSTL_CLKA
LVPECL_CLKA
LVPECL_CLKA
HSTL_CLKB
LVPECL_CLKB
HSTL_CLKB
LVPECL_CLKB
HSTL_CLKB
LVPECL_CLKB
低
低
低
低
HSTL_CLKA
LVPECL_CLKA
HSTL_CLKB
LVPECL_CLKB
低
/Q0 – /Q9
/ HSTL_CLKA
/ LVPECL_CLKA
/ HSTL_CLKA
/ HSTL_CLKA
/ LVPECL_CLKA
/ LVPECL_CLKA
/ HSTL_CLKB
/ LVPECL_CLKB
/ HSTL_CLKB
/ LVPECL_CLKB
/ HSTL_CLKB
/ LVPECL_CLKB
高
高
高
高
/ HSTL_CLKA
/ LVPECL_CLKA
/ HSTL_CLKB
/ LVPECL_CLKB
高
Q10 – Q19
HSTL_CLKA
LVPECL_CLKA
HSTL_CLKB
LVPECL_CLKB
HSTL_CLKB
LVPECL_CLKB
HSTL_CLKA
HSTL_CLKA
LVPECL_CLKA
LVPECL_CLKA
HSTL_CLKB
LVPECL_CLKB
HSTL_CLKA
LVPECL_CLKA
HSTL_CLKB
LVPECL_CLKB
低
低
低
低
低
/Q10 – /Q19
/ HSTL_CLKA
/ LVPECL_CLKA
/ HSTL_CLKB
/ LVPECL_CLKB
/ HSTL_CLKB
/ LVPECL_CLKB
/ HSTL_CLKA
/ HSTL_CLKA
/ LVPECL_CLKA
/ LVPECL_CLKA
/ HSTL_CLKB
/ LVPECL_CLKB
/ HSTL_CLKA
/ LVPECL_CLKA
/ HSTL_CLKB
/ LVPECL_CLKB
高
高
高
高
高
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
X
X
X
X
0
0
1
1
X
0
0
1
1
1
1
0
0
0
0
1
1
0
0
1
1
X
X
X
X
X
0
1
0
0
1
1
0
0
1
1
X
X
0
1
X
X
0
1
X
X
X
X
X
0
1
0
1
0
1
0
1
0
1
X
X
0
1
X
X
0
1
X
输入具有内部上拉浮输入= 1 。
M9999-073010
hbwhelp@micrel.com或（408） 955-1690
3
麦克雷尔INC 。
精密边缘
SY89827L
引脚说明
PIN码
5, 6
2, 3
8, 9
12, 13
7
14
16
1
11
15
4
引脚名称
HSTL_CLKA
/ HSTL_CLKA
HSTL_CLKB
/ HSTL_CLKB
LVPECL_CLKA
/ LVPECL_CLKA
LVPECL_CLKB
/ LVPECL_CLKB
CLK_SEL1
CLK_SEL2
SEL1
SEL2
OE1
OE2
VCCI
I / O-
输入
输入
输入 -
输入 -
输入 -
输入 -
输入 -
输入 -
输入 -
输入 -
动力
TYPE
HSTL
HSTL
国内
P / U
引脚功能
差分时钟输入的CLK_SEL1 ， SEL1和SEL2选择。
可以悬空，如果没有被选中。浮动输入，如果选择
产生不确定的输出。 HSTL输入信号的要求
external termination 50-to-GND.
差分时钟输入的CLK_SEL1 ， SEL1和SEL2选择。
可以悬空，如果没有被选中。浮动输入，如果选择
产生不确定的输出。 HSTL输入信号的要求
external termination 50-to-GND.
LVPECL 75KΩ
Differential clock input selected by CLK_SEL1, SEL1 and SEL2.
下拉可以悬空。浮动输入，如果选择产生低
在输出端。需要外部端接。参见图1 。
LVPECL
LVTTL /
CMOS
LVTTL /
CMOS
LVTTL /
CMOS
LVTTL /
CMOS
LVTTL /
CMOS
LVTTL /
CMOS
75k
下拉
11k
引体向上
11k
引体向上
11k
引体向上
11k
引体向上
11k
引体向上
11k
引体向上
Differential clock input selected by CLK_SEL2, SEL1 and SEL2.
需要外部端接。参见图1 。
选择HSTL_CLKA输入低电平时，和LVPECL_CLKA
当输入高。
选择HSTL_CLKB输入低电平时，和LVPECL_CLKB
当输入高。
选择输入信号源CLKA时低和CLKB
当为高电平输出Q0 - Q9和/ Q0 - / Q9 。
选择输入信号源CLKA时低和CLKB
当为高电平输出Q10 - Q19和/ Q10 - / Q19 。
使能输入内部同步以防止产生毛刺
Q 0 - Q 9和/ Q0 - / Q9输出。
使能输入内部同步以防止产生毛刺
Q10 - Q19和/ Q10 - / Q19输出。
核心VCC连接到3.3V电源。旁路与0.1μF的
与0.01μF的低ESR电容尽量靠近VCC引脚并行
可能。
输出缓冲器VCC连接到1.8V标称电源。所有VCCO
引脚应在PCB上连接在一起。带旁路
0.1μF与0.01μF的低ESR电容尽量靠近并行
VCCO引脚越好。
地面上。
17, 32, 33,
40, 41, 48, 49, 64
VCCO
动力
10
63, 61, 59, 57, 55
53, 51, 47, 45, 43
62, 60, 58, 56, 54
52, 50, 46, 44, 42
GND
Q0 – Q9
/Q0 – /Q9
Q10 – Q19
/Q10 – /Q19
动力
产量
产量
产量
产量
HSTL
HSTL
HSTL
HSTL
从CLKA差分时钟输出，当SEL1 = LOW和
从CLKB当SEL1 = HIGH 。 HSTL输出（Q和/ Q）绝
be terminated with 50-to-GND. Q outputs are static when
OE1 = LOW. Unused output pairs may be left floating.
差分时钟输出（补）从CLKA当SEL1 =
低电平和从CLKB时SEL1 =高。 HSTL输出（Q和
/Q) must be terminated with 50-to-GND. /Q outputs are static
HIGH，当OE1 = LOW 。未使用的输出对可留
浮动。
从CLKA时SEL2 = LOW和差分输出
CLKB时SEL2 = HIGH 。 HSTL输出（Q和/ Q ）必须
terminated with 50-to-GND. Q outputs are static LOW when
OE2 = LOW. Unused output pairs may be left floating.
从CLKA差分输出（补）时SEL2 = LOW
从CLKB时SEL2 = HIGH 。 HSTL输出（Q和/ Q）的
must be terminated with 50-to-GND. /Q outputs are static HIGH
when OE2 = LOW. Unused output pairs may be left floating.
39, 37, 35, 31, 29
27, 25, 23, 21, 19
38, 36, 34, 30, 28
26, 24, 22, 20, 18
M9999-073010
hbwhelp@micrel.com或（408） 955-1690
4
麦克雷尔INC 。
精密边缘
SY89827L
绝对最大额定值
(Note 1)
电源电压（V
CCI
, V
CCO
） ............... -0.5 + 4.0V
输入电压（V
IN
） ............................................ -0.5到V
CCI
输出电流（I
OUT
） ............................................... -50mA
引线温度（T
领导
，焊接， 20秒。 ） .......... 260℃
存储温度（T
S
） ............................ -65到+ 150°C
ESD额定值，
注3
.................................................. .. >1kV
工作额定值
(Note 2)
电源电压
(V
CCI
） ................................................. .... + 3.3V至+ 3.47V
(V
CCO
） ................................................. .... + 1.6V至+ 2.0V
环境温度（T
A
） .......................... -40 ° C至+ 85°C
封装热阻
TQFP （ θ
JA
)
裸露焊盘焊接到GND ，
Note 4
还是空中（多层PCB ）
.........................................
23°C/W
-200lfpm （多层PCB ）
.....................................
18°C/W
-500lfpm （多层PCB ）
.....................................
15°C/W
裸露焊盘没有焊接到GND （不推荐）
还是空中（多层PCB ）
.........................................
44°C/W
-200lfpm （多层PCB ）
.....................................
36°C/W
-500lfpm （多层PCB ）
.....................................
30°C/W
TQFP （ θ
JC
） ................................................. ........ 4.4 ° C / W
DC电气特性
SYMBOL
V
CCI
I
CCI
V
CCO
电源
: T
A
= -40 ° C至+ 85°C
参数“
V
CC
CORE
I
CC
CORE
V
CC
产量
条件？
MIN
3.13
1.6
TYP
3.3
1.8
140
MAX`
3.47
2.0
170
单位
V
V
mA
空载
SYMBOL
V
OH
V
OL
V
IL
V
IH
HSTL输入/输出：
V
CCI
= 3.3V ±5%, V
CCO
= 1.8V ±10 ％ ，T
A
= -40 ° C至+ 85°C
参数“
条件？
注5
注5
输出高电压
输出低电压
输入高电压
输入低电压
输入交越电压
输入高电流
输入低电平电流
MIN
1.0
0.2
V
X
+0.1
–0.3
+20
0.68
TYP
MAX`
1.2
0.4
1.6
V
X
–0.1
0.9
–350
–500
单位
V
V
V
V
V
A
A
V
X
I
IH
I
IL
注： 1 。
如果绝对最大额定值超出可能会造成永久性损坏设备。这是一个额定值只和功能的操作不
隐含在高于此数据表的操作部分详述的其他条件。暴露在绝对最大RATlNG条件
长时间可能会影响器件的可靠性。
该数据片的限制，不能保证该设备是否超出操作评分操作。
设备是ESD敏感。建议操作注意事项。
强烈推荐焊接EPAD - TQFP封装的裸露焊盘到地平面的PCB板为最大热的
EF网络效率。
Outputs loaded with 50-to-ground.
注2 。
注3 。
Note 4.
注5 。
M9999-073010
hbwhelp@micrel.com或（408） 955-1690
5
麦克雷尔INC 。
3.3V 500MHz的双1:10 HSTL扇出
缓冲器/翻译以2： 1多路复用器输入
精密边缘
SY89827L
精密边缘
SY89827L
特点
s
双LVPECL或HSTL输入， 10差分1.5V
HSTL输出兼容
s
可配置为双通道10输出或单
20路输出时钟驱动器
s
保证AC参数随温度和
电压：
> 500MHz的F
最大
在设备倾斜< 50ps的
< 1.5ns传输延迟
< 700ps吨
r
/ t
f
时间
s
低抖动设计
< 1PS
RMS
周期到周期抖动
< 10马力
PP
总抖动
s
3.3V内核电源， 1.8V输出电源
s
输出使能功能
s
提供64引脚EPAD - TQFP
精密边缘
描述
该SY89827L是一个高性能的总线时钟驱动器
与双1:10单1时20 HSTL （高速
收发器逻辑）输出对。该部分被设计为
在低电压（ 3.3V / 1.8V）应用程序需要使用
大量的输出来驱动精确对准，超
低偏移的信号到目的地。该输入是
无论从HSTL或LVPECL （低压复
正发射极耦合逻辑）由CLK_SEL销。
输出启用（ OE1 OE2 & ）是同步的，以便
该输出才会启用/禁用时，他们
已经处于低状态。这样就避免了任何机会
产生一个侏儒时钟脉冲时，该设备已启用/
残疾人士可以用异步控制发生。
该SY89827L具有极低的偏移
<50ps在温度和电压的性能 -
性能以前在标准无法实现
产品具有如此高数量的输出。该
SY89827L是一个节省空间的封装，
使一个较低的总成本的解决方案。对于应用程序
这需要更大的HSTL扇出能力，考虑
SY89824L.
应用
s
s
s
s
高性能电脑
工作站
并行处理器的系统
其他高性能计算
s
通讯
典型应用电路
主时钟源
LVPECL_CLKA
/ LVPECL_CLKA
冗余备份
时钟源
LVPECL_CLKB
/ LVPECL_CLKB
10
10
主
卡
10
10
冗
卡
SEL1
主/备用时钟选择
（ 2.0ns内切换）
系统采用SY89827L从主时钟的故障安全应用程序切换电路冗余备份时钟。
仅LVPECL输入，显示在该应用程序。
精密Edge是麦克雷尔公司的注册商标。
M9999-011907
hbwhelp@micrel.com或（408） 955-1690
REV ：E
修订： / 0
1
发行日期： 2007年1月
麦克雷尔INC 。
精密边缘
SY89827L
封装/订购信息
VCCO
Q0
/Q0
Q1
/Q1
Q2
/Q2
Q3
/Q3
Q4
/Q4
Q5
/Q5
Q6
/Q6
VCCO
订购信息
(1)
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
VCCO
Q7
/Q7
Q8
/Q8
Q9
/Q9
VCCO
VCCO
Q10
/Q10
Q11
/Q11
Q12
/Q12
VCCO
64 63 62 61 60 59 58 57 56 55 54 53 52 51 50 49
SEL2
HSTL_CLKB
/ HSTL_CLKB
VCCI
HSTL_CLKA
/ HSTL_CLKA
CLK_SEL1
LVPECL_CLKA
/ LVPECL_CLKA
GND
OE1
LVPECL_CLKB
/ LVPECL_CLKB
CLK_SEL2
OE2
SEL1
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32
产品型号
SY89827LHI
SY89827LHITR
(2)
SY89827LHY
(3)
SY89827LHYTR
(2, 3)
包
TYPE
H64-1
H64-1
H64-1
H64-1
操作
范围
产业
产业
产业
产业
包
记号
SY89827LHI
SY89827LHI
领导
完
的Sn-Pb
的Sn-Pb
SY89827LHY与
无铅
无铅扎线指标哑光锡
SY89827LHY与
无铅
无铅扎线指标哑光锡
注意事项：
1.联系工厂用于芯片的可用性。骰子是保证在T
A
= 25 ° C，仅直流ELECTRICALS 。
2.磁带和卷轴。
建议用于新设计3.无铅封装。
64引脚TQFP （ H64-1 ）
功能框图
CLK_SEL1
SEL1
HSTL_CLKA
/ HSTL_CLKA
LVPECL_CLKA
/ LVPECL_CLKA
0
0
1
1
LEN
HSTL_CLKB
/ HSTL_CLKB
LVPECL_CLKB
/ LVPECL_CLKB
0
D
1
0
CLK_SEL2
1
LEN
SEL2
Q
D
OE2
10
10
10
10
VCCO
/Q19
Q19
/Q18
Q18
/Q17
Q17
/Q16
Q16
/Q15
Q15
/Q14
Q14
/Q13
Q13
VCCO
OE1
Q
0
– Q
9
/Q
0
– /Q
9
Q
Q
10
– Q
19
/Q
10
– /Q
19
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2
麦克雷尔INC 。
精密边缘
SY89827L
真值表
OE1
(1)
OE2
(1)
SEL1
(1)
SEL2
(1)
CLK_SEL1
(1)
CLK_SEL2
(1)
1
1
1
1
1
1
1
1
1
1
1
1
0
0
0
0
1
1
1
1
0
注： 1 。
Q0 – Q9
/Q0 – /Q9
Q10 – Q19
/Q10 – /Q19
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
1
0
0
0
0
0
0
0
0
0
0
0
1
1
1
1
1
1
X
X
X
X
0
0
1
1
X
0
0
1
1
1
1
0
0
0
0
1
1
0
0
1
1
X
X
X
X
X
0
1
0
0
1
1
0
0
1
1
X
X
0
1
X
X
0
1
X
X
X
X
X
0
1
0
1
0
1
0
1
0
1
X
X
0
1
X
X
0
1
X
HSTL_CLKA
/ HSTL_CLKA
HSTL_CLKA
/ HSTL_CLKA
LVPECL_CLKA / LVPECL_CLKA LVPECL_CLKA / LVPECL_CLKA
HSTL_CLKA
/ HSTL_CLKA
HSTL_CLKB
/ HSTL_CLKB
HSTL_CLKA
/ HSTL_CLKA
LVPECL_CLKB / LVPECL_CLKB
LVPECL_CLKA / LVPECL_CLKA
HSTL_CLKB
/ HSTL_CLKB
LVPECL_CLKA / LVPECL_CLKA LVPECL_CLKB / LVPECL_CLKB
HSTL_CLKB
/ HSTL_CLKB
HSTL_CLKA
/ HSTL_CLKA
LVPECL_CLKB / LVPECL_CLKB
HSTL_CLKA
/ HSTL_CLKA
HSTL_CLKB
/ HSTL_CLKB
LVPECL_CLKA / LVPECL_CLKA
LVPECL_CLKB / LVPECL_CLKB LVPECL_CLKA / LVPECL_CLKA
HSTL_CLKB
/ HSTL_CLKB
HSTL_CLKB
/ HSTL_CLKB
LVPECL_CLKB / LVPECL_CLKB LVPECL_CLKB / LVPECL_CLKB
低
低
低
低
高
高
高
高
HSTL_CLKA
/ HSTL_CLKA
LVPECL_CLKA / LVPECL_CLKA
HSTL_CLKB
/ HSTL_CLKB
LVPECL_CLKB / LVPECL_CLKB
低
低
低
低
低
高
高
高
高
高
HSTL_CLKA
/ HSTL_CLKA
LVPECL_CLKA / LVPECL_CLKA
HSTL_CLKB
/ HSTL_CLKB
LVPECL_CLKB / LVPECL_CLKB
低
高
输入具有内部上拉浮输入= 1 。
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3
麦克雷尔INC 。
精密边缘
SY89827L
引脚说明
引脚数
5, 6
引脚名称
HSTL_CLKA
/ HSTL_CLKA
I / O
输入
TYPE
HSTL
国内
P / U
引脚功能
差分时钟输入的CLK_SEL1 ， SEL1和SEL2选择。
可以悬空，如果没有被选中。浮动输入，如果选择
产生不确定的输出。 HSTL输入信号的要求
外部端接50Ω到GND 。
差分时钟输入的CLK_SEL1 ， SEL1和SEL2选择。
可以悬空，如果没有被选中。浮动输入，如果选择
产生不确定的输出。 HSTL输入信号的要求
外部端接50Ω到GND 。
75k
下拉
75k
下拉
11k
引体向上
11k
引体向上
11k
引体向上
11k
引体向上
11k
引体向上
11k
引体向上
差分时钟输入的CLK_SEL1 ， SEL1和SEL2选择。
可以悬空。浮动输入，如果选择产生低
在输出端。需要外部端接。参见图1 。
差分时钟输入的CLK_SEL2 ， SEL1和SEL2选择。
需要外部端接。参见图1 。
选择HSTL_CLKA输入低电平时，和LVPECL_CLKA
当输入高。
选择HSTL_CLKB输入低电平时，和LVPECL_CLKB
当输入高。
选择输入信号源CLKA时低和CLKB
当为高电平输出Q0 - Q9和/ Q0 - / Q9 。
选择输入信号源CLKA时低和CLKB
当为高电平输出Q10 - Q19和/ Q10 - / Q19 。
使能输入内部同步以防止产生毛刺
Q 0 - Q 9和/ Q0 - / Q9输出。
使能输入内部同步以防止产生毛刺
Q10 - Q19和/ Q10 - / Q19输出。
核心VCC连接到3.3V电源。旁路与0.1μF的
与0.01μF的低ESR电容尽量靠近VCC引脚并行
可能。
输出缓冲器VCC连接到1.8V标称电源。所有VCCO
引脚应在PCB上连接在一起。带旁路
0.1μF与0.01μF的低ESR电容尽量靠近并行
VCCO引脚越好。
地面上。
HSTL
从CLKA差分时钟输出，当SEL1 = LOW和
从CLKB当SEL1 = HIGH 。 HSTL输出（Q和/ Q）绝
终止与50Ω到GND 。 Q输出是静态的时
OE1 =低。未使用的输出对可能被悬空。
差分时钟输出（补）从CLKA当SEL1 =
低电平和从CLKB时SEL1 =高。 HSTL输出（Q和
/ Q ）必须终止50Ω到GND 。 / Q输出是静态的
HIGH，当OE1 = LOW 。未使用的输出对可留
浮动。
从CLKA时SEL2 = LOW和差分输出
CLKB时SEL2 = HIGH 。 HSTL输出（Q和/ Q ）必须
终止50Ω到GND 。 Q输出是静态的，当低
OE2 =低。未使用的输出对可能被悬空。
从CLKA差分输出（补）时SEL2 = LOW
从CLKB时SEL2 = HIGH 。 HSTL输出（Q和/ Q）的
必须终止与50Ω到GND 。 / Q输出是静态的高
当OE2 =低。未使用的输出对可能被悬空。
2, 3
HSTL_CLKB
/ HSTL_CLKB
输入
HSTL
8, 9
LVPECL_CLKA
/ LVPECL_CLKA
LVPECL_CLKB
/ LVPECL_CLKB
CLK_SEL1
CLK_SEL2
SEL1
SEL2
OE1
OE2
VCCI
输入
LVPECL
12, 13
7
14
16
1
11
15
4
输入
输入
输入
输入
输入
输入
输入
动力
LVPECL
LVTTL /
CMOS
LVTTL /
CMOS
LVTTL /
CMOS
LVTTL /
CMOS
LVTTL /
CMOS
LVTTL /
CMOS
17, 32, 33,
40, 41, 48, 49, 64
VCCO
动力
10
63, 61, 59, 57, 55
53, 51, 47, 45, 43
GND
Q0 – Q9
动力
产量
62, 60, 58, 56, 54
52, 50, 46, 44, 42
/Q0 – /Q9
产量
HSTL
39, 37, 35, 31, 29
Q10 – Q19
产量
27, 25, 23, 21, 19
HSTL
38, 36, 34, 30, 28
/Q10 – /Q19
产量
26, 24, 22, 20, 18
HSTL
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4
麦克雷尔INC 。
精密边缘
SY89827L
绝对最大额定值
（注1 ）
电源电压（V
CCI
, V
CCO
） .............. -0.5 + 4.0V
输入电压（V
IN
） ........................................... -0.5到V
CCI
输出电流（I
OUT
） ............................................... -50mA
引线温度（T
领导
，焊接， 20秒。 ） .......... 260℃
存储温度（T
S
） ........................... -65到+ 150°C
ESD额定值，
注3
.................................................. .. >1kV
工作额定值
（注2 ）
电源电压
(V
CCI
） ................................................. ... + 3.3V至+ 3.47V
(V
CCO
） ................................................. .... + 1.6V至+ 2.0V
环境温度（T
A
） ......................... -40 ° C至+ 85°C
封装热阻
TQFP
(θ
JA
)
裸露焊盘焊接到GND ，
注4
静止空气（多层PCB ） ............... 23 ° C / W
-200lfpm （多层PCB ） ............................. 18 ° C / W
-500lfpm （多层PCB ） ............................. 15 ° C / W
裸露焊盘没有焊接到GND （不推荐）
静止空气（多层PCB ） ............... 44 ° C / W
-200lfpm （多层PCB ） ............................. 36 ° C / W
-500lfpm （多层PCB ） ............................. 30 °C / W
TQFP
(θ
JC
） ................................................. ........ 4.4 ° C / W
DC电气特性
电源
: T
A
= -40 ° C至+ 85°C
符号
V
CCI
V
CCO
I
CCI
参数
V
CC
CORE
V
CC
产量
I
CC
CORE
空载
条件
民
3.13
1.6
典型值
3.3
1.8
140
最大
3.47
2.0
170
单位
V
V
mA
HSTL输入/输出：
V
CCI
= 3.3V
±5%,
V
CCO
= 1.8V
±10%,
T
A
= -40 ° C至+ 85°C
符号
V
OH
V
OL
V
IH
V
IL
V
X
I
IH
I
IL
注： 1 。
参数
输出高电压
输出低电压
输入高电压
输入低电压
输入交越电压
输入高电流
输入低电平电流
条件
注5
注5
民
1.0
0.2
V
X
+0.1
–0.3
0.68
+20
典型值
最大
1.2
0.4
1.6
V
X
–0.1
0.9
–350
–500
单位
V
V
V
V
V
A
A
如果绝对最大额定值超出可能会造成永久性损坏设备。这是一个额定值只和功能的操作不
隐含在高于此数据表的操作部分详述的其他条件。暴露在绝对最大RATlNG条件
长时间可能会影响器件的可靠性。
该数据片的限制，不能保证该设备是否超出操作评分操作。
设备是ESD敏感。建议操作注意事项。
强烈推荐焊接EPAD - TQFP封装的裸露焊盘到地平面的PCB板为最大热的
EF网络效率。
输出50Ω负载对地。
注2 。
注3 。
注4 。
注5 。
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SN68120
STUB591
SN65LBC170DWRG4
STB100NF03L-03-01
SHD115134B
SI4090DY
SST39SF010A-55-4I-NHE
SN74HC74PWTE4
S71WS256PD0JF3SR0
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数量
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操作
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