麦克雷尔INC 。
3.3V， 500MHz的，1:9的微分
HSTL （ 1.5V ）扇出缓冲器/
翻译者
精密边缘
SY89808L
精密边缘
SY89808L
特点
s
9差分HSTL （ 1.5V兼容）输出对
s
500MHz的最大时钟频率
s
三重缓冲使能功能
s
3.3V内核电源， 1.8V输出电源，可降低
精密边缘
描述
该SY89808L是一个高性能总线时钟驱动器与
9差分HSTL （高速收发器逻辑） 1.5V
兼容的输出对。该器件是专为低使用
电压（ 3.3V / 1.8V）应用程序需要大量的
的输出来驱动精确对准，超低歪斜信号
他们的目的地。输入是从任一HSTL或复
LVPECL （低压正射极耦合逻辑）的
CLK_SEL引脚。
输出使能（ OE ）是同步和三重缓冲
从而使输出才会启用/禁用的时候都
已经处于低状态。这就避免了产生的任何潜在
一个侏儒时钟脉冲时，该设备使能/禁止，这可
发生与异步控制。三重缓冲功能
提供了三个时钟延迟的时间OE输入
断言/解除断言时出现时钟的输出。
该SY89808L功能少的超低引脚对引脚歪斜
比25PS 。该SY89808L是采用32引脚TQFP空间
节省包装，从而能够降低整体成本的解决方案。
动力
s
LVPECL和HSTL输入
s
HSTL输出驱动50
以地面无
失调电压
s
低引脚对引脚歪斜（ 25PS最大）
s
保证在-40工业
°
C至+ 85
°
C
温度范围
s
可提供32引脚TQFP封装
应用
s
工作站
s
并行处理器的系统
s
高性能计算
s
通讯
真值表
OE
(1)
CLK_SEL
0
1
0
1
逻辑符号
CLK_SEL
HSTL_CLK
/ HSTL_CLK
0
9
9
LVPECL_CLK
1
/ LVPECL_CLK
EN
启用
逻辑
Q
0
– Q
8
低
低
HSTL_CLK
LVPECL_CLK
/Q
0
– /Q
8
高
高
/ HSTL_CLK
/ LVPECL_CLK
0
0
1
1
Q0 — Q8
/Q0 — /Q8
注意事项：
1. OE（输出使能）信号与该低电平同步
HSTL_CLK和LVPECL_CLK信号。
典型性能
输出幅度
与频率的关系
OE
900
800
振幅（MV ）
700
600
500
400
300
1000
1200
1400
1600
REV ：E
0
200
400
600
精密Edge是麦克雷尔公司的注册商标。
M9999-091405
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频率（MHz）
修订： / 0
1
800
200
发行日期： 2005年9月
麦克雷尔INC 。
精密边缘
SY89808L
封装/订购信息
VCCO
VCCO
/Q0
/Q1
/Q2
订购信息
(1)
产品型号
VCCO
Q3
/Q3
Q4
/Q4
Q5
/Q5
VCCO
Q0
Q1
Q2
VCCI
HSTL_CLK
/ HSTL_CLK
CLK_SEL
LVPECL_CLK
/ LVPECL_CLK
GND
OE
32 31 30 29 28 27 26 25
24
1
2
3
4
5
6
7
8
23
22
封装工作
TYPE
范围
T32-1
T32-1
T32-1
T32-1
产业
产业
产业
产业
包
记号
SY89808LTI
SY89808LTI
领导
完
的Sn-Pb
的Sn-Pb
SY89808LTI
SY89808LTITR
(2)
SY89808LTG
(3)
SY89808LTGTR
(2, 3)
顶视图
21
20
19
18
SY89808LTG与
镍钯金
无铅条线指标无铅
SY89808LTG与
镍钯金
无铅条线指标无铅
17
9 10 11 12 13 14 15 16
/Q8
/Q7
/Q6
VCCO
VCCO
Q8
Q7
Q6
注意事项：
1.联系工厂用于芯片的可用性。骰子是保证在T
A
= 25 ° C，仅直流ELECTRICALS 。
2.磁带和卷轴。
3.无铅封装推荐用于新设计。
32引脚TQFP （ T32-1 ）
引脚说明
引脚数
2, 3
引脚名称
HSTL_CLK ，
/ HSTL_CLK
LVPECL_CLK ，
/ LVPECL_CLK
CLK_SEL
OE
TYPE
HSTL
输入
LVPECL
输入
LVTTL
输入
LVTTL
输入
引脚功能
差分时钟输入的CLK_SEL选择。可以保留，如果不浮动
选择。浮动输入，如果选择产生不确定的输出。 HSTL
输入信号需要外部50Ω端接至GND 。
差分时钟输入的CLK_SEL选择。可以悬空。漂浮的
输入，如果选择产生低的输出（内部75Ω下拉电阻） 。
需要外部端接。 75KΩ上拉。
选择和HSTL_CLK输入低电平时LVPECL_CLK时输出高电平。
11KΩ上拉。
使能输入内部同步，以防止Q0 - Q8的毛刺和
/ Q0- / Q8输出。必须至少三个时钟周期宽，如果
同步于CLK输入，必须符合吨
S
和T
H
需求
（参见AC电气特性） 。如果是异步的，必须是一个最小
的4个时钟周期宽。 11KΩ上拉。
从HSTL_CLK差分时钟输出，当CLK_SEL = LOW和
LVPECL输出当CLK_SEL = HIGH 。 HSTL输出必须被终止
与50Ω到GND。 Q0 Q8输出静态低时， OE =低。未使用
输出对可能被悬空。
从HSTL_CLK差分时钟输出，当CLK_SEL = LOW和
LVPECL输出当CLK_SEL = HIGH 。 HSTL输出必须被终止
与50Ω到GND。 / Q0- / Q8输出静态HIGH，当OE =低。
未使用的输出对可能被悬空。
核心V
CC
连接到3.3V电源。旁路与0.1μF并联
0.01μF的低ESR电容尽量靠近V
CCI
销越好。
输出缓冲器V
CC
连接到1.8V电源。旁路与0.1μF并联
与0.01μF的低ESR电容尽量靠近V
CCO
销越好。所有V
CCO
引脚应在PCB上连接在一起。
地面上。
5, 6
4
8
31, 29, 27, 23,
21, 19, 15, 13,
11
30, 28, 26, 22,
20, 18, 14, 12,
10
1
9, 16, 17, 24,
25, 32
7
Q0–Q8
HSTL
产量
/Q0–/Q8
HSTL
产量
VCCI
VCCO
VCC核心
动力
VCC输出
动力
地
GND
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2
麦克雷尔INC 。
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SY89808L
绝对最大额定值
(1)
电源电压（V
IN
） ..................................... -0.5V到V
CCI
V
CC
端子电位接地引脚
(V
CCI ，
V
CCO
） ............................................ -0.5V到+ 4.0V
直流输出电流，输出高电平（我
OUT
） .................. -50mA
焊接温度（焊接， 20秒） ..................... 260℃
存储温度（T
S
） ....................... -65 ° C至+ 150°C
工作额定值
(2)
电源电压
(V
CCI
） ............................................... 3.15 V至+ 3.45V
(V
CCO
） ................................................. + 1.6V至+ 2.0V
环境温度（T
A
） ......................... -40 ° C至+ 85°C
封装热阻
TQFP
(θ
JA
)
-Still空中.............................................. ............. 50 ° C / W
-500lfpm ................................................ .......... 42 ° C / W
TQFP
(θ
JC
） ................................................. ......... 20 ° C / W
DC电气特性
电源
T
A
= -40 ° C至+ 85°C ，除非另有说明。
符号
V
CCI
V
CCO
I
CCI
参数
V
CC
CORE
V
CC
产量
I
CC
CORE
MAX V
CC
，空载
条件
民
3.15
1.6
—
典型值
3.3
1.8
80
最大
3.45
2.0
110
单位
V
V
mA
HSTL
V
CCI
= 3.3V
±
5%; V
CCO
= 1.8V
±
10%; R
L
= 50Ω到GND ;牛逼
A
= -40 ° C至+ 85°C ，除非另有说明。
符号
V
OH
V
OL
V
IH
V
IL
V
X
I
IH
I
IL
参数
输出高电压
输出低电压
输入高电压
输入低电压
输入交越电压
输入高电流
输入低电平电流
条件
民
1.0
0.2
V
X
+0.1
–0.3
0.68
+20
—
典型值
—
—
—
—
—
—
—
最大
1.2
0.4
1.6
V
X
–0.1
0.9
–350
–500
单位
V
V
V
V
V
A
A
LVPECL
V
CCI
= 3.3V
±
5%; V
CCO
= 1.8V
±
10%; T
A
= -40 ° C至+ 85°C ，除非另有说明。
符号
V
IH
V
IL
I
IH
I
IL
参数
输入高电压
输入低电压
输入高电流
输入低电平电流
条件
民
最大
单位
V
V
A
A
V
CCI
– 1.165 V
CCI
– 0.880
V
CCI
– 1.810 V
CCI
– 1.475
—
0.5
+150
—
LVCMOS / LVTTL
V
CCI
= 3.3V
±
5%; V
CCO
= 1.8V
±
10%; T
A
= -40 ° C至+ 85°C ，除非另有说明。
符号
V
IH
V
IL
I
IH
I
IL
参数
输入高电压
输入低电压
输入高电流
输入低电平电流
条件
民
2.0
—
+20
—
典型值
—
—
—
—
最大
—
0.8
–250
–600
单位
V
V
A
A
注意事项：
如果“绝对最大额定值”超出可能出现1永久性设备损坏。这是一个额定值只和功能的操作不
隐含在高于此数据表的操作部分详述的其他条件。长期在绝对最大ratlng条件
长时间可能会影响器件的可靠性。
2.数据片的限制，不能保证该设备是否超出操作评分操作。
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SY89808L
AC电气特性
V
CCI
= 3.3V
±
5%; V
CCO
= 1.8V
±
10％ ;所有的输出负载是50Ω至GND ;牛逼
A
= -40 ° C至+ 85°C ，除非另有说明。
符号
f
最大
t
pd
t
SKEW
t
SKPP
V
pp
V
CMR
t
S
t
H
t
r
, t
f
t
抖动
参数
最大工作频率
传播延迟
CLK到Q的
SEL到Q的
在智能设备倾斜
部分到部分斜
最小输入摆幅
LVPECL_CLK
共模范围
LVPECL_CLK
OE建立时间
OE保持时间
输出上升/下降时间（ 20 ％ - 80 ％ ）
周期到周期抖动
总抖动
注9
注10
条件
V
OUT
≥
450mV
注3
注3
注4
注5
注6
注7：
注8
民
500
0.800
0.800
—
—
150
–1.5
1.0
0.5
250
典型值
—
1.000
1.200
—
—
—
—
—
—
450
最大
—
1.200
1.700
25
400
—
–0.4
—
—
650
1
10
单位
兆赫
ns
ns
ps
ps
mV
V
ns
ns
ps
ps
RMS
ps
PP
3.差分传播延迟被定义为从所述差动输入信号的交叉点的延迟时间为差分的交叉点
输出信号。
4.内装置歪斜被定义为任何两个相似的延迟路径之间的一个单一的设备在操作中的最坏情况下的差
相同的电压和温度。
5.部件到部件歪斜被定义为在同一操作系统的任何两个设备中的任何两个延迟路径之间的绝对最坏情况差
电压和温度。
6， V
PP
（分钟）被定义为最小的输入差分电压，这将导致没有增加的传播延迟。
7. V
CMR
被定义为所述范围内的哪个在V
IH
电平可能会发生变化，与该设备仍满足传播延迟规范。该
在该表格中的数字参考V
CCI
。在V
IL
电平必须是这样的峰 - 峰电压比小于1.0V和大于或
等于V
PP
（分钟） 。 CMR中范围的下端而变化1： 1结合V
CCI
。在V
CMR
（分）将其固定在3.3V - | V
CMR
（分钟）| 。
8.操作环境的建立时间被定义为相对于该时钟的上升沿。 OE由高到低的转变，确保在输出端保持禁用
在下一个时钟周期。 OE低到高的跳变使下一个输入时钟的正常运行。
9.周期到周期抖动定义：相邻的状态T之间，时间的变化
n
–T
n–1
其中T是的上升沿之间的时间
输出信号。
10.总抖动定义：用一个理想的时钟源
≤
f
最大
在10不超过一个输出边
12
输出边缘将通过以上的偏离
指定的金额。
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精密边缘
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时序图
断言延迟
CLK
去断言延迟
t
S
OE
t
H
Q0 - Q8
注意事项：
1. OE输入信号必须至少具有宽度3个时钟周期。
2.内部使被断言以及被解除断言在时钟的下降沿。
3.内部启用后外部OE的上升沿出现2.5个时钟周期（加上OE的设置时间与时钟的上升沿） 。
4.如果OE不符合吨
S
的t
H
规格在异步应用程序，操作环境必须是最小的宽度4个时钟周期。
HSTL_CLK ， LVPECL_CLK
/ HSTL_CLK ， / LVPECL_CLK
t
PD
Q0 - Q8
/Q0 - /Q8
CLK_SEL
t
PD
Q0 - Q8
/Q0 - /Q8
t
PD
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5
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