麦克雷尔INC 。
SY87700L
引脚说明
引脚数
SOIC
4
5
引脚数
TQFP
2
3
引脚名称
RDINP ，
RDINN
引脚功能
串行数据输入（差分PECL ） ：这些内置线路接收器输入
连接到差分接收串行数据流。内部接收
锁相环恢复嵌入的时钟（ RCLK ）和数据（ RDOUT ）的信息。
传入的数据速率可以是内五个频率范围之一depend-
荷兰国际集团上的FREQSEL引脚的状态。请参见“频率选择”表格。
参考时钟（ TTL输入） ：这个输入是用作参考
内置频率合成器和“培训”频率接收器
PLL以保持它在没有数据的RDIN输入进来的居中。
载波检测（ PECL输入） ：这个输入控制的恢复功能
接收PLL ，并且可以通过载体被驱动检测的光输出
模块或从外部转移检测电路。当此输入为
高的输入数据流（ RDIN ）由接收正常恢复
PLL 。当此输入为低电平输入RDIN的数据将在内部
强制为恒定低电平时，数据输出RDOUT将保持低电平，则
链路故障指示器输出LFIN拉低，时钟恢复PLL
被迫寻找到从REFCLK生成的时钟频率。
频率选择（ TTL输入） ：这些输入选择输出时钟
的频率范围，如图中的“频率选择”表。
分频比选择（ TTL输入） ：这些输入选择之间的比率
输出时钟频率（ RCLK / TCLK ）及REFCLK输入频率为
在“参考频率选择”表格中。
时钟选择（ TTL输入） ：这个输入是用来选择所恢复的
接收器PLL （ CLKSEL =高）或频率的时钟的时钟
合成器（ CLKSEL = LOW）到TCLK输出。
链路故障指示器（ TTL输出） ：该输出指示的情况
输入数据流RDIN 。高电平信号，表示当内部
时钟恢复PLL被锁定到输入数据流。 LFIN会
高，如果光盘为HIGH和RDIN是频率范围内的接收
PLL （ 1000PPM ） 。 LFIN是一个异步输出。
接收数据输出（差分PECL ） ：这些ECL输出10万
表示从输入数据流（ RDIN ）所恢复的数据。这
回收指定针对RCLK的上升沿数据。
时钟输出（差分PECL ） ：这些ECL 100K的输出代表
恢复的时钟用于采样恢复的数据（ RDOUT ） 。
时钟输出（差分PECL ） ：这些ECL 100K的输出代表
无论所恢复的时钟（ CLKSEL =高）用于采样回收
数据（ RDOUT ）或所述频率合成器的发送时钟
（ CLKSEL = LOW） 。
时钟合成PLL环路滤波器。外部环路滤波器引脚的时钟
PLL合成。
时钟恢复PLL环路滤波器。外部环路滤波器引脚接收器
PLL 。
电源电压
(1)
模拟电源电压
(1)
输出电源电压
(1)
地
无连接
7
5
REFCLK
27
26
CD
6
8
9
3
26
17
4
6
7
32
25
16
FREQSEL1,
FREQSEL2,
FREQSEL3
DIVSEL1,
DIVSEL2
CLKSEL
2
31
LFIN
25
24
22
21
19
18
24
23
21
20
18
17
RDOUTP ，
RDOUTN
RCLKP ，
RCLKn
TCLKP ，
TCLKn
11
12
16
15
1
20, 23
13, 14
10
9
10
15
14
27, 28,
29, 30
19, 22
12, 13
1, 8
PLLSP ，
PLLSN
PLLRP ，
PLLRN
V
CC
V
CCA
V
CCO
GND
NC
注意：
1. V
CC
, V
CCA
, V
CCO
必须是相同的值。
M9999-111406
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3
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