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STLC1510
NorthenLite G.lite的DMT收发器
产品预览
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ATM传送
前向纠错&交织
成帧&去成帧
DMT调制和解调
初创&欣欣控制处理
LBGA132
订购号: STLC1510
此外, STLC1510提供下列性能
Tures的:
s
在后台串行和并行网络接口
最终到局端设备
串行接口至AFE芯片STLC1511
访问片外存储器
电时的引导程序存储在ROM中
132球12x12x1.7毫米LBGA封装
耗电量: 0.75瓦
电力增刊: 2.5 V (核心)和3.3 V ( I / O环)
1.0概述
该STLC1510是一个高速调制解调器芯片,亲
在国际志愿组织的G.992.2 DSL接入的数字部分
中心局( CO)的网站。它提供下游
一个字节的ATM之间的上行数据传输
流和使用离散模拟前端芯片
多音( DMT )调制。
该STLC1510符合ITU -T G.992.2
( G.lite的) , G.996.1 ( G.Test ) , G.994.1 ( G.Handshake )
G.997.1 ( G.Ploam ) 。
s
s
s
s
s
s
s
图1.框图
EN_D 950_E M ü
惠普I_Data [7:0 ]
8
惠普I_Addr [2:0 ]
3
ARM 2HP _IN牛逼
AR M_M ODE
LinDr_A GC2
LinDr_AG C1
林德r_Peak
PI_RWN
惠普I_CLK
惠普I_CSN
惠普I_ASN
TXCLK
TxClav
TXENB
TxSOC
ü TXDATA [ 7 : 0 ]
TxAddr [4 :0]的
TXPARITY
TXBP
RXCLK
xClav
RxSOC
URxData [7 :0]的
RxAddr [4 :0]的
RXPARITY
RXENB
HPI
DFE
EPM
ME M
米EM
米EM
BPU
米EM
米EM
FEC
地图
PGM
NIF
TxSOUT [1 :0]的
A_SCLK
CK35M
RxSIN [1 :0]的
L AMB一个巴士
7
7
REF_CLK
VDD3_3
VDD2_5
VSS
龙头
2
2
8
牛逼GB
CTRL
AR M
D95 0
苹果
SPI_ CLK
SPI_ ENB
14
SPI_ DTX
SPI_ DRX
TD我
的pmode [1 :0]的
C模式[ 1 : 0 ]
950_CMO DE
TCK
TM S
trstn
GP的IO [7:0 ]
VDD_PLL
Guard_PLL
VS S_PLL
RES ETN
VCODC
TDO
INF_OUT
2000年11月
这是正在开发的新产品的初步信息。详细信息如有变更,恕不另行通知。
F_ O u那样牛逼
1/40
STLC1510
2.0清单的主要模块
该STLC1510的G.lite DMT收发器主要由形成
下面的块(参见图1 ) :
定时生成块( TGB )
定时生成块生成全局时钟
信号和同步信号的STLC1510 。它
使用输入时钟信号,以推导出主接口
纳尔和输出时钟信号,以及所有synchroni-
所需的矩阵特殊积脉冲之间的协调时间
子块。
嵌入式处理器模块( EPM )
该EPM包括两个嵌入式处理器内核:
在ARM7TDMI ,一个RISC微处理器,以及
D950 ,一个16位DSP处理器。在RISC微处理器的
处理器处理芯片控制, G.lite的启动和
欣欣控制和DSP的初始化。它还imple-
ments的成帧和交织/解交织
需要G.992.2标准功能。
测试访问端口( TAP )
该模块提供测试访问STLC1510
使用JTAG和BIST技术。
HPI接口
块处理单元( BPU )
计算密集型的数字信号处理
功能将在此引擎执行。这台发动机
利用定制的DSP架构,包括
2乘法器/累加器(MAC) 。
主机处理器接口提供让
STLC1510可以任选地通过一个外部控制
微控制器。
3.0暂态能量CAPABILITIES
3.1 ESD
ESD(电子放电)的测试已经per-
形成的人体模型( HBM ) 。
器件的引脚,以便能够承受
最低2000V的HBM的。
数字前端( DFE )
该模块提供的接口,可外接模拟
登录前端(AFE)器件。该模块提供了决策
息,插值的信号采样
ADC和DAC的模拟前端和信号电平显示器 -
荷兰国际集团为模拟AGC 。
3.2闭锁
网络接口( NIF)
的NIF是一个可选择的接口承载ATM信
信号和从STLC1510 。此接口
支持一个并行接口(乌托邦2级)或
串行数据接口。在NIF包括FIFO来缓冲的
呃后台的时钟域之间的数据
端接口和内部时钟。
从任何引脚的最大下沉或源电流
有限的200mA电流,以防止闩锁。
4.0绝对最大额定值
绝对最大额定值,规定如下,
是那些收视率超出该设备的寿命
可能会被削弱。电气规格的会议
当器件受到系统蒸发散是不是暗示
绝对的界限。
下表列出了器件的最小
和最大额定值并随着operating-
条件下,它们定义了限制用于测试设备
前向纠错( FEC )
使用里德 - 前向纠错所做的是
Solomon编码。在R-S FEC编码是per-
在和Transmit形成逐字节的收发器
泰德字节。该确定的两个基本参数
代码的性能是码字的大小,
它由一个或多个DMT符号( S)和
冗余校验字节数R.
映射/解映射器模块( MAP)
映射器/解映射器块( MAP)的执行
位的包装和未包装的星座式编码
器/解码器,用于一个G.992.2 DSL调制解调器。此块
还支持新一代混响和混合泳的。
2/40
STLC1510
表1.绝对最大额定值
符号
VDD3_3
VDD2_5
T
AMB
V
IN
, V
OUT
V
IN5
, V
OUT5
I
IN
, I
OUT
P
D
VESD
我闭锁
<1>
参数
3.3V电源电压w.r.t. VSS (0V)
2.5V电源电压w.r.t. VSS (0V)
环境温度
电压在3.3V的任何标准输入或输出
电压在任何兼容5V输入或输出
1
电流在任何输入或输出
功耗
静电防护
I / O闩锁电流
V < 0V ,V >的Vdd
最低
-0.5
-0.5
-40
-0.5
-0.8
-20
0
2000
200
最大
4
3.3
85
VDD3_3 + 0.5
单位
V
V
°C
V
V
mA
W
V
mA
6.3
20
0.75
-0.8V下冲和过冲6.3V不长于为4ns 。
3/40
STLC1510
图2.球地图。
STLC1510网表
4/40
STLC1510
表2.垫说明
信号
时钟接口
REF_CLK
I
托尔5V CMOS输入
17.168 MHz或35.328 MHz参考
时钟输入。
1
硬件复位(低电平有效)
“1” - 正常运行
'0' - 减少在REF_CLK频率
芯片测试旁路模式
电源模式选择
电源模式选择
时钟模式选择
时钟模式选择
K13
I / O
垫式
描述
BGA
RESETN
D950_CMODE
I
I
托尔5V CMOS输入
托尔5V CMOS输入
E13
C13
PMode_1
PMode_0
CMode_1
CMode_0
I
I
I
I
托尔5V CMOS输入
托尔5V CMOS输入
托尔5V CMOS输入
托尔5V CMOS输入
G1
H1
H2
L1
STLC1511 AFE接口
A_SCLK
CK35M
RxSIN_1
RxSIN_0
TxSOUT_1
TxSOUT_0
SPI_CLK
SPI_ENB
SPI_DTX
SPI_DRX
XTAL_CTRL
I
O
I
I
O
O
O
O
O
I
O
托尔5V CMOS输入
5V托尔3.3V TTL 2毫安摆有限公司
产量
托尔5V CMOS输入
托尔5V CMOS输入
5V托尔3.3V TTL 2毫安摆有限公司
产量
5V托尔3.3V TTL 2毫安摆有限公司
产量
5V托尔3.3V TTL 2毫安摆有限公司
产量
5V托尔3.3V TTL 2毫安摆有限公司
产量
5V托尔3.3V TTL 2毫安摆有限公司
产量
托尔5V CMOS输入
5V托尔3.3V TTL 2毫安摆有限公司
产量
ADC / DAC采样帧时钟
35.328 MHz参考时钟输出。
ADC的串行输入数据
ADC的串行输入数据
DAC的串行输出数据
DAC的串行输出数据
STLC1511控制接口的时钟
TX / RX STLC1511使能控制
信号
TX STLC1511控制数据
RX STLC1511输入控制数据
XTAL输出控制引脚
H14
J14
L14
K14
F14
E14
M14
M13
N14
L13
BGA
STLC1512线路驱动器接口
LinDr_AGC1
LinDr_AGC2
LinDr_Peak
O
O
O
5V托尔3.3V TTL 2毫安摆有限公司
产量
5V托尔3.3V TTL 2毫安摆有限公司
产量
5V托尔3.3V TTL 2毫安摆有限公司
产量
STLC1511 AGC增益控制1
STLC1511 AGC增益控制2
STLC1511峰值控制
2
D13
D14
C14
5/40
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