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STA015 STA015B STA015T
MPEG 2.5第三层音频解码器
带ADPCM能力的
产品预览
单芯片MPEG 2层3解码器
支持:
- 在Layer III在ISO / IEC规定的所有功能
11172-3 ( MPEG 1音频)
- 在Layer III在ISO / IEC规定的所有功能
13818-3.2 ( MPEG 2音频)
- 更低的采样频率的语法扩展,
(不是由ISO指定)称为MPEG 2.5
解码第三层立体声通道,
双通道
单通道
(单声道)
支持所有的MPEG 1 & 2 SAM-
耦频率和EXTEN-
SION到MPEG 2.5 :
48 , 44.1 , 32 , 24 , 22.05 , 16 , 12 , 11, 025 , 8千赫
ACCEPTS MPEG 2.5第三层ELEMEN-
TARY压缩比特流与
数据速率8 kbit / s的高达320千比特/秒
ADPCM编解码能力:
- 从8 kHz到32 kHz的采样频率
- 样本量从8位到32位
- encodingalgorithm : DVI ,
ITU- G726pack ( G723-24 , G721 , G723-40 )
- 音controlandfast转发功能
EASY可编程GPSO接口
用于对编码数据达5Mbit / s的
( TQFP44 & LFBGA 64 )
数字音量
低音&高音控制
的比特流输入接口
EASY可编程ADC输入INTER-
辅助数据提取通过I2C IN-
terface 。
串行PCM输出接口(I
2
S
等格式)
锁相环内部时钟和对于出
PUT PCM时钟发生器
CRC校验和SYNCHRONISATION ER-
通过软件ROR检测INDI-
CATORS
I
2
C控制总线
低功耗2.4V CMOS技术
外部晶振范围宽
频率支持
订购号码:
STA015 ( SO28 )
STA015T ( TQFP44 )
STA015B ( LFBGA 64 )
应用
PC声卡
多媒体播放器
VOICE RECORDERED
描述
该STA015是一个完全集成的高度灵活性
MPEG层III音频解码器,能够执行解
编码层III压缩的基本数据流,
在MPEG 1和MPEG 2的ISO待机动指定
急性呼吸窘迫综合征。该解码器还elementarystreams
通过使用低采样速率,如试样压缩
通过MPEG 2.5田间。
STA015接收通过串行输入数据
输入接口。解码后的信号是一个立体声
单,或双通道数字输出,它可以是
直接发送到D / A转换器,通过将PCM输出
把接口。该接口是软件编程
可燃适应STA015数字输出到
所使用的最常见的DAC结构
市场。
功能STA015芯片划分为DE-
划线在图1和图2 。
2000年2月
1/44
这是对正在开发或正在接受评估新产品的初步信息。详细信息如有变更,恕不另行通知。
STA015-STA015B-STA015T
图1a。框图TQFP44和LFBGA64包
SDA
31
SCL
32
TQFP44
我C控制
34
SDI
SCKR
BIT_EN
36
38
串行
输入
接口
基于DSP的
42
卜FF器
256 x 8
MPEG L III
ADPCM
CORE
& TONE
控制
产量
卜FF器
PCM
产量
接口
44
2
3
2
GPIO
接口
SDO
SCKT
LRCKT
OCLK
数据请求
27
解析器
40
SCK_ADC
CRCK_ADC
SDI_ADC
26
24
ADC
输入
接口
4
系统&音频时钟
GPSO
接口
28
33
25
RESET
15
XTI
13
XTO
22
TESTEN
12
FILT
D99AU1116
GPSO_REQ
GPSO_SCKL
GPSO_DATA
图1b。框图SO28封装
SDA
3
SCL
4
SO28
我C控制
5
6
7
串行
输入
接口
2
SDI
SCKR
BIT_EN
基于DSP的
9
卜FF器
256 x 8
MPEG L III
ADPCM
CORE
& TONE
控制
产量
卜FF器
PCM
产量
接口
10
11
12
SDO
SCKT
LRCKT
OCLK
数据请求
28
解析器
SCK_ADC
CRCK_ADC
SDI_ADC
8
27
25
ADC
输入
接口
系统&音频时钟
26
RESET
21
XTI
20
XTO
24
TESTEN
19
FILT
D99AU1117
2/44
STA015-STA015B-STA015T
图2.引脚连接
VDD_1
VSS_1
SDA
SCL
SDI
SCKR
BIT_EN
SRC_INT / SCK_ADC
SDO
SCKT
LRCKT
OCLK
VSS_2
VDD_2
1
2
3
4
5
6
7
8
9
10
11
12
13
14
D99AU1061
28
27
26
25
24
23
22
OUT_CLK / DATA_REQ
LRCK_ADC
RESET
SDI_ADC
TESTEN
VDD_4
VSS_4
XTI
XTO
FILT
PVSS
PVDD
VDD_3
VSS_3
SO28
21
20
19
18
17
16
15
SRC_INT / SCK_ADC
GPIO /频闪
35
IODATA[7]
IODATA[6]
IODATA[5]
IODATA[4]
BIT_EN
SCKR
SCKT
SDO
44
43
42
41
40
39
38
37
36
34
33
32
31
30
29
北卡罗来纳州
LRCKT
OCLK
GPSO_REQ
VSS_2
VDD_2
VSS_3
VDD_3
北卡罗来纳州
PVDD
PVSS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
SDI
GPSO_DATA
SCL
SDA
VSS_1
VDD_1
GPSO_SCKR
OUT_CLK / DATA_REC
LRCK_ADC
RESET
SDI_ADC
北卡罗来纳州
TQFP44
28
27
26
25
24
23
XTI
VSS_4
北卡罗来纳州
IODATA[3]
IODATA[2]
IODATA[1]
IODATA[0]
VDD_4
FILT
XTO
TESTEN
D99AU1062
8
A
B
C
D
E
F
G
H
7
6
5
4
3
2
1
A1 = SDI
B2 = SCKR
D4 = BIT_EN
D1 = SRC_INT
E2 = SDO
F2 = SCKT
H1 = LRCKT
H3 = OCLK
F3 = VSS_2
E4 = VDD_2
G4 = VSS_3
G5 = VDD_3
F5 = PVDD
G6 = PVSS
G7 = FILT
G8 = XTO
F7 = XTI
E7 = VSS_4
C8 = VDD_4
D7 = TESTEN
A7 = SDI_ADC
B6 = RESET
A5 = LRCK_ADC
C5 = OUT_CLK / DATA_REQ
B5 = VDD_1
B4 = VSS_1
A4 = SDA
B3 = SCL
C2 = GPIO_STROBE
C3 = IODATA [4]
E3 = IODATA [5]
D2 = IODATA [6]
F1 = IODATA [7]
G3 = GPSO_REQ
F8 = IODATA [3]
F6 = IODATA [2]
E6 = IODATA [1]
C7 = IODATA [0]
C6 = GPSO_SCKR
A2 = GPSO_DATA
D00AU1149
LFBGA64
3/44
STA015-STA015B-STA015T
1.概述
1.1 - MP3解码器引擎
MP3解码器引擎是能够解码任何
第三层兼容的比特流: MPEG1 , MPEG2
和MPEG2.5流的支持。除了
音频数据的MP3发动机还per-解码
形式的辅助数据提取:这些数据
可以经由I2C总线被应用程序所检索到
微控制器,以实现特定的
功能。
解码后的音频数据通过软件VOL-
UME控制和双波段均衡器模块BE-
前馈输出的I2S接口。这导致
在无需外接音频处理器。
MP3比特流是用SIM-发送到解码器
PLE串行输入接口(见引脚SDI , SCKR ,
BIT_EN和DATA_REQ ) ,支持输入速率
高达20兆比特/秒。接收到的数据存储在一个
256个字节长的输入缓冲,提供了一种
反馈线(见DATA_REQ引脚)的比特
流源( tipically的MCU ) 。
1.2 - ADPCM编码器/解码器引擎
该器件还嵌入了一个多标准ADPCM
编码器/解码器支持不同的样品
率(从8千赫兹到32千赫兹)和不同
样本大小(从8位到32位) 。在恩
编码过程中的两个不同的接口可以是
用于饲料数据:串行输入接口(同
用于接口还喂MP3比特流)或
ADC输入接口,它提供了一个无缝
用外部的A / D转换器连接。该
目前使用的接口是通过I2C总线选择。
还检索编码数据两个不同的接口
面可供选择: I2C总线或更快
GPSO输出接口。 GPSO界面能
输出数据与比特率高达5兆比特/秒和其
控制引脚( GPSO_SCKR , GPSO_DATA和
GPSO_REQ )可以很容易地进行配置,以
适合目标应用程序。
绝对最大额定值
符号
V
DD
V
i
V
O
T
英镑
T
OPER
电源
在输入引脚电压
在输出引脚电压
储存温度
工作环境温度
参数
价值
-0.3 4
-0.3到V
DD
+0.3
-0.3到V
DD
+0.3
-40到+150
-20至+85
单位
V
V
V
°C
°C
热数据
符号
R
日J- AMB
参数
热阻结到环境
价值
85
单位
° C / W
4/44
STA015-STA015B-STA015T
引脚说明
SO28 TQFP44 LFBGA64
1
29
B5
2
30
B4
3
31
A4
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
32
34
36
38
40
42
44
2
3
5
6
7
8
10
11
12
13
15
19
21
22
24
25
26
27
20
18
16
14
37
39
41
43
35
4
28
33
B3
A1
B2
D4
D1
E2
F2
H1
H3
F3
E4
G4
G5
F5
G6
G7
G8
F7
E7
C8
D7
A7
B6
A5
C5
C7
E6
F6
F8
C3
E3
D2
F1
C2
G3
C6
A2
引脚名称
VDD_1
VSS_1
SDA
SCL
SDI
SCKR
BIT_EN
SRC_INT / SCK_ADC
SDO
SCKT
LRCLKT
OCLK
VSS_2
VDD_2
VSS_3
VDD_3
PVDD
PVSS
FILT
XTO
XTI
VSS_4
VDD_4
TESTEN
SDI_ADC
RESET
LRCK_ADC
OUT_CLK /
DATA_REQ
IODATA[0]
IODATA[1]
IODATA[2]
IODATA[3]
IODATA[4]
IODATA[5]
IODATA[6]
IODATA[7]
GPIO_STROBE
GPSO_REQ
GPSO_SCKR
GPSO_DATA
TYPE
功能
电源电压
i
2
串行数据+
应答
2
I C串行时钟
接收串行数据
接收串行时钟
位启用
线路中断/ ADC的串行
时钟
TransmitterSerial数据( PCM数据)
发送串行时钟
发射器左/右时钟
过采样时钟的DAC
电源电压
电源电压
PLL电源
PLL地面
PLL滤波器分机。电容
康涅狄格州。
晶振输出
晶振输入(时钟输入)
电源电压
测试开启
ADC输入数据
系统复位
ADC左/右时钟
缓冲输出时钟/
数据请求信号
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO信号频闪
GPSO请求信号
GPSO串行时钟
GPSO串行数据
PAD说明
I / O
I
I
I
I
I
O
O
O
I / O
CMOS输入缓冲垫
CMOS输出4mA驱动器
CMOS输入缓冲垫
CMOS输入缓冲垫
CMOS输入缓冲垫
CMOS输入垫缓冲带
CMOS输入缓冲垫
CMOS
CMOS
CMOS
CMOS
CMOS
输出4mA驱动
输出4mA驱动
输出4mA驱动
输入缓冲垫
输出4mA驱动
O
O
I
CMOS输出4mA驱动器
具体的电平输入垫
(见第2.1段)
I
I
I
I
O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
O
I
O
CMOS输入垫缓冲带
CMOS输入缓冲垫
CMOS输入垫缓冲带
CMOS输出缓冲垫
CMOS输出4mA驱动器
CMOS 4毫安施密特触发器
双向缓冲垫
CMOS输出缓冲垫
CMOS输入缓冲垫
CMOS输出缓冲垫
注意:在功能模式中TESTEN必须连接到VDD。
5/44
STA015
STA015B STA015T
MPEG 2.5第三层音频解码器
带ADPCM能力的
单芯片MPEG 2层3解码器
支持:
- 在Layer III在ISO / IEC规定的所有功能
11172-3 ( MPEG 1音频)
- 在Layer III在ISO / IEC规定的所有功能
13818-3.2 ( MPEG 2音频)
- 更低的采样频率的语法exten-
锡永, (不是由ISO指定)称为MPEG 2.5
SO28
TQFP44
解码第三层立体声通道,
双通道,单通道(单声道)
支持所有的MPEG 1 & 2
采样频率和
扩展MPEG 2.5 :
48 , 44.1 , 32 , 24 , 22.05 , 16 , 12 , 11, 025 , 8千赫
ACCEPTS MPEG 2.5第三层
基础压缩比特流
与数据速率8 kbit / s的最高320
kbit / s的
ADPCM编解码能力:
- 从8 kHz到32 kHz的采样频率
- 样本量从8位到32位
- 编码算法: DVI ,
ITU- G726包( G723-24 , G721 , G723-40 )
- 音调控制和快进功能
EASY可编程GPSO接口
用于对编码数据达5Mbit / s的
( TQFP44 & LFBGA 64 )
数字音量控制
数字低音&高音控制
BYPASS MODE外部音频
来源
的比特流输入接口
EASY可编程ADC输入
接口
辅助数据提取VIA我
2
C
界面。
串行PCM输出接口(I
2
S和
其他格式)
锁相环内部时钟和FOR
PCM输出时钟发生器
CRC校验和SYNCHRONISATION
对于软件错误检测
LFBGA64
订购号:
STA015 $ ( SO28 )
STA015T $ ( TQFP44 )
STA015B $ ( LFBGA 8×8 )
指标
I
2
C控制总线
低功耗2.4V CMOS技术
外部晶振范围宽
频率支持
应用
PC声卡
多媒体播放器
录音机
描述
该STA015是一个完全集成的高度灵活性
MPEG层III音频解码器,能够decod-的
ING层III压缩基本流,如
在MPEG 1和MPEG 2 ISO标准规定。
该装置还解码的基本流
通过使用低采样率,光谱压缩
通过MPEG 2.5后指定。 STA015接收输入
通过串行输入接口的数据。该解码
信号是立体声,单声道或双通道数字
输出可被直接发送到D / A变换器,
用PCM输出接口。
该接口是软件编程来适应
在STA015数字输出为最常用的
在市场上使用的DAC结构。该功能
tional STA015芯片分块是描述
图1a和图1b 。
1/55
2004年3月
STA015 STA015B STA015T
图1 。
1A 。框图TQFP44和LFBGA64包。
SDA
31
SCL
32
35
20
18
频闪
TQFP44
I
2
空调控制
34
36
38
串行
输入
接口
GPIO
接口
基于DSP的
16
14
37
39
41
43
IODATA
[7:0]
SDI
SCKR
BIT_EN
数据请求
27
卜FF器
256 x 8
解析器
MPEG L III
ADPCM
CORE
& TONE
控制
产量
卜FF器
PCM
产量
接口
42
44
2
3
4
SDO
SCKT
LRCKT
OCLK
GPSO_REQ
SCK_ADC
LRCK_ADC
SDI_ADC
40
26
24
ADC
输入
接口
系统&音频时钟
GPSO
接口
25
RESET
15
XTI
13
XTO
22
TESTEN
12
FILT
D99AU1116B
28
GPSO_SCKR
33
GPSO_DATA
1B 。框图SO28封装
SDA
3
SCL
4
SO28
我C控制
5
6
7
串行
输入
接口
2
SDI
SCKR
BIT_EN
基于DSP的
9
卜FF器
256 x 8
MPEG L III
ADPCM
CORE
& TONE
控制
产量
卜FF器
PCM
产量
接口
10
11
12
SDO
SCKT
LRCKT
OCLK
28
GPSO_SCKR
SCK_ADC
LRCK_ADC
SDI_ADC
8
27
25
ADC
输入
接口
解析器
系统&音频时钟
26
RESET
21
XTI
20
XTO
24
TESTEN
19
FILT
D99AU1117B
2/55
STA015 STA015B STA015T
图2.引脚连接
VDD_1
VSS_1
SDA
SCL
SDI
SCKR
BIT_EN
SRC_INT / SCK_ADC
SDO
SCKT
LRCKT
OCLK
VSS_2
VDD_2
1
2
3
4
5
6
7
8
9
10
11
12
13
14
D99AU1061A
SRC_INT / SCK_ADC
28
27
26
25
24
23
22
21
20
19
18
17
16
15
GPSO_SCKR
LRCK_ADC
RESET
SDI_ADC
TESTEN
VDD_4
VSS_4
XTI
XTO
FILT
PVSS
PVDD
VDD_3
VSS_3
IODATA[7]
IODATA[6]
SCKT
SDO
GPIO /频闪
35
IODATA[5]
IODATA[4]
BIT_EN
SCKR
44
43
42
41
40
39
38
37
36
34
33
32
31
30
29
28
27
26
25
24
23
北卡罗来纳州
LRCKT
OCLK
GPSO_REQ
VSS_2
VDD_2
VSS_3
VDD_3
北卡罗来纳州
PVDD
PVSS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
SDI
GPSO_DATA
SCL
SDA
VSS_1
VDD_1
GPSO_SCKR
OUT_CLK / DATA_REC
LRCK_ADC
RESET
SDI_ADC
北卡罗来纳州
IODATA[3]
IODATA[2]
北卡罗来纳州
IODATA[1]
VSS_4
IODATA[0]
VDD_4
TESTEN
XTO
FILT
XTI
D99AU1062
8
A
B
C
D
E
F
G
H
7
6
5
4
3
2
1
A1 = SDI
B2 = SCKR
D4 = BIT_EN
D1 = SRC_INT
E2 = SDO
F2 = SCKT
H1 = LRCKT
H3 = OCLK
F3 = VSS_2
E4 = VDD_2
G4 = VSS_3
G5 = VDD_3
F5 = PVDD
G6 = PVSS
G7 = FILT
G8 = XTO
F7 = XTI
E7 = VSS_4
C8 = VDD_4
D7 = TESTEN
A7 = SDI_ADC
B6 = RESET
A5 = LRCK_ADC
C5 = OUT_CLK / DATA_REQ
B5 = VDD_1
B4 = VSS_1
A4 = SDA
B3 = SCL
C2 = GPIO_STROBE
C3 = IODATA [4]
E3 = IODATA [5]
D2 = IODATA [6]
F1 = IODATA [7]
G3 = GPSO_REQ
F8 = IODATA [3]
F6 = IODATA [2]
E6 = IODATA [1]
C7 = IODATA [0]
C6 = GPSO_SCKR
A2 = GPSO_DATA
D00AU1149
LFBGA64
3/55
STA015 STA015B STA015T
1.0概述
1.1 MP3解码器引擎
MP3解码引擎能够解码任何第三层兼容的比特流: MPEG1 , MPEG2和
MPEG2.5流的支持。除了音频数据进行解码的MP3发动机也进行ANCIL-
LARY数据提取:这些数据可通过I检索
2
C总线的微控制器的应用程序,以
为了实现特定的功能。
解码后的音频数据通过一个软件音量控制和一个两波段均衡块前馈
荷兰国际集团输出的I2S接口。这导致不需要外部音频处理器。
MP3比特流是使用一个简单的串行输入接口(见引脚SDI, SCKR , BIT_EN发送到解码器
和DATA_REQ ) ,支持输入速率可达20 Mbit / s的。接收到的数据被存储在一个256字节长的输入
缓冲器,它提供一反馈线(见DATA_REQ销),以将比特流源( tipically一个MCU ) 。
1.2 ADPCM编码器/解码器引擎
该器件还嵌入了一个多标准ADPCM编码器/解码器支持不同的采样率
(从8千赫兹到32千赫兹)和不同的样品量(从8位到32位) 。
在编码过程中的两个不同的接口可以被用来将数据传送:串行输入接口(同
用于接口还喂MP3比特流)或ADC的输入接口,它提供了一个无缝CON-
nection用外部的A / D转换器。目前使用的接口是通过予选
2
C总线。
还检索编码数据两个不同的接口可供选择:我
2
C总线和更快的GPSO输出
界面。 GPSO接口能够输出数据的比特率高达5兆比特/秒,并在其控制引脚
( GPSO_SCKR , GPSO_DATA和GPSO_REQ )可以以很容易地适应目标应用程序进行配置
化。
1.3 BYPASS功能模式
为了允许使用该设备进行后处理辅助音频源的专用旁路模式是可用
能。当该设备被配置在旁路模式中的嵌入式DSP将处理的数字音频数据
通过ADC输入接口和将输出所得到的数据发送到外部DAC来。
可处理包括音量和音调ontrols 。
热数据
符号
RTH J- AMB
参数
热阻结到环境
价值
85
单位
° C / W
绝对最大额定值
符号
V
DD
Vi
V
O
T
T
参数
电源
在输入引脚电压
在输出引脚电压
储存温度
工作环境温度
价值
-0.3 4
-0.3到V
DD
+0.3
-0.3到V
DD
+0.3
-40到+150
-20至+85
单位
V
V
V
°C
°C
英镑
OPER
4/55
STA015 STA015B STA015T
引脚说明
SO28
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
TQFP44
29
30
31
32
34
36
38
40
42
44
2
3
5
6
7
8
10
11
12
13
15
19
21
22
24
25
26
27
20
18
16
14
37
39
41
43
35
4
28
33
注意:
LFBGA64
B5
B4
A4
B3
A1
B2
D4
D1
E2
F2
H1
H3
F3
E4
G4
G5
F5
G6
G7
G8
F7
E7
C8
D7
A7
B6
A5
C5
C7
E6
F6
F8
C3
E3
D2
F1
C2
G3
C6
A2
引脚名称
VDD_1
VSS_1
SDA
SCL
SDI
SCKR
BIT_EN
SRC_INT /
SCK_ADC
SDO
SCKT
LRCKT
OCLK
VSS_2
VDD_2
VSS_3
VDD_3
PVDD
PVSS
FILT
XTO
XTI
VSS_4
VDD_4
TESTEN
SDI_ADC
RESET
LRCK_ADC
IN-CLK /
DATA_REQ
IODATA[0]
IODATA[1]
IODATA[2]
IODATA[3]
IODATA[4]
IODATA[5]
IODATA[6]
IODATA[7]
GPIO_STROBE
GPSO_REQ
GPSO_SCKR
GPSO_DATA
TYPE
功能
电源电压
i
2
串行数据+
应答
I
2
串行时钟
接收串行数据
接收串行时钟
位启用
线路中断/ ADC的串行
时钟
发送串行数据
( PCM数据)
发送串行时钟
发射器左/右时钟
过采样时钟的DAC
电源电压
电源电压
PLL电源
PLL地面
PLL滤波器分机。电容
康涅狄格州。
晶振输出
晶振输入(时钟输入)
电源电压
测试开启
ADC输入数据
系统复位
ADC左/右时钟
缓冲输出时钟/
数据请求信号
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO信号频闪
GPSO请求信号
GPSO串行时钟
GPSO串行数据
PAD说明
I / O
I
I
I
I
I
O
O
O
I / O
CMOS输入缓冲垫
CMOS输出4mA驱动器
CMOS输入缓冲垫
CMOS输入缓冲垫
CMOS输入缓冲垫
CMOS输入缓冲垫
有拉涨
CMOS输入缓冲垫
CMOS输出4mA驱动器
CMOS输出4mA驱动器
CMOS输出4mA驱动器
CMOS输入缓冲垫
CMOS输出4mA驱动器
O
O
I
CMOS输出4mA驱动器
具体的电平输入垫
(见第2.1段)
I
I
I
I
O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
O
I
O
CMOS输入缓冲垫
有拉涨
CMOS输入缓冲垫
CMOS输入缓冲垫
有拉涨
CMOS输出缓冲垫
CMOS输出4mA驱动器
CMOS施密特4毫安
TRIGGER
双向缓冲垫
CMOS输出缓冲垫
CMOS输入缓冲垫
CMOS输出缓冲垫
在功能模式中TESTEN必须连接到VDD ,
5/55
STA015
MPEG 2.5第三层音频解码器
带ADPCM能力的
单芯片MPEG 2层3解码器
支持:
- 在Layer III在ISO / IEC规定的所有功能
11172-3 ( MPEG 1音频)
- 在Layer III在ISO / IEC规定的所有功能
13818-3.2 ( MPEG 2音频)
- 更低的采样频率的语法exten-
锡永, (不是由ISO指定)称为MPEG 2.5
解码第三层立体声通道,
双通道,单通道(单声道)
支持所有的MPEG 1 & 2
采样频率和
扩展MPEG 2.5 :
48 , 44.1 , 32 , 24 , 22.05 , 16 , 12 , 11, 025 , 8千赫
ACCEPTS MPEG 2.5第三层
基础压缩比特流
与数据速率8 kbit / s的最高320
kbit / s的
ADPCM编解码能力:
- 从8 kHz到32 kHz的采样频率
- 样本量从8位到32位
- 编码算法: DVI ,
ITU- G726包( G723-24 , G721 , G723-40 )
- 音调控制和快进功能
EASY可编程GPSO接口
用于对编码数据达5Mbit / s的
( TQFP44 & LFBGA 64 )
数字音量控制
数字低音&高音控制
BYPASS MODE外部音频
来源
的比特流输入接口
EASY可编程ADC输入
接口
辅助数据提取VIA我
2
C
界面。
串行PCM输出接口(I
2
S和
其他格式)
锁相环内部时钟和FOR
PCM输出时钟发生器
CRC校验和SYNCHRONISATION
对于软件错误检测
SO28
TQFP44
LFBGA64
订购号:
STA015 $ ( SO28 )
STA015T $ ( TQFP44 )
STA015B $ ( LFBGA 8×8 )
te
le
so
b
2010年4月
ro
P
uc
d
)-
(s
t
te
le
so
b
O
描述
s)
t(
c
du
ro
P
指标
I
2
C控制总线
低功耗2.4V CMOS技术
外部晶振范围宽
频率支持
应用
PC声卡
多媒体播放器
录音机
该STA015是一个完全集成的高度灵活性
MPEG层III音频解码器,能够decod-的
ING层III压缩基本流,如
在MPEG 1和MPEG 2 ISO标准规定。
该装置还解码的基本流
通过使用低采样率,光谱压缩
通过MPEG 2.5后指定。 STA015接收输入
通过串行输入接口的数据。该解码
信号是立体声,单声道或双通道数字
输出可被直接发送到D / A变换器,
用PCM输出接口。
该接口是软件编程来适应
在STA015数字输出为最常用的
在市场上使用的DAC结构。该功能
tional STA015芯片分块是描述
图1a和图1b 。
1/56
STA015
图1 。
1A 。框图TQFP44和LFBGA64包。
SDA
31
SCL
32
35
20
18
频闪
TQFP44
I
2
空调控制
34
36
38
串行
输入
接口
GPIO
接口
基于DSP的
16
14
37
39
41
43
IODATA
[7:0]
SDI
SCKR
BIT_EN
数据请求
27
卜FF器
256 x 8
解析器
MPEG L III
ADPCM
CORE
& TONE
控制
产量
卜FF器
42
PCM
产量
接口
44
2
3
SCK_ADC
LRCK_ADC
SDI_ADC
40
26
24
ADC
输入
接口
系统&音频时钟
GPSO
接口
25
RESET
15
XTI
13
XTO
22
TESTEN
12
FILT
1B 。框图SO28封装
SDA
SO28
SDI
SCKR
BIT_EN
5
6
7
串行
输入
接口
28
GPSO_SCKR
SCK_ADC
8
l
so
b
te
e
LRCK_ADC
SDI_ADC
27
25
od
r
P
ADC
输入
接口
卜FF器
256 x 8
uc
26
RESET
)-
(s
t
解析器
3
te
le
so
b
O
SCL
4
基于DSP的
MPEG L III
ADPCM
CORE
& TONE
控制
产量
卜FF器
s)
t(
c
du
ro
P
SCKT
LRCKT
4
OCLK
GPSO_REQ
28
33
GPSO_SCKR
GPSO_DATA
D99AU1116B
SDO
I
2
空调控制
9
PCM
产量
接口
10
11
12
SDO
SCKT
LRCKT
OCLK
系统&音频时钟
21
XTI
20
XTO
24
TESTEN
19
FILT
D99AU1117B
2/56
STA015
图2.引脚连接
VDD_1
VSS_1
SDA
SCL
SDI
SCKR
BIT_EN
SRC_INT / SCK_ADC
SDO
SCKT
LRCKT
OCLK
VSS_2
VDD_2
1
2
3
4
5
6
7
8
9
10
11
12
13
14
D99AU1061A
SRC_INT / SCK_ADC
28
27
26
25
24
23
22
21
20
19
18
17
16
15
GPSO_SCKR
LRCK_ADC
RESET
SDI_ADC
TESTEN
VDD_4
VSS_4
XTI
XTO
FILT
PVSS
PVDD
VDD_3
VSS_3
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
28
27
26
25
24
23
北卡罗来纳州
LRCKT
OCLK
GPSO_REQ
VSS_2
VDD_2
VSS_3
VDD_3
北卡罗来纳州
PVDD
PVSS
1
2
3
4
5
6
7
8
9
10
GPSO_DATA
SCL
8
A
B
C
D
E
7
6
5
4
3
te
le
so
b
F
G
H
od
r
P
uc
2
1
)-
(s
t
12
13
14
15
16
11
17
18
te
le
so
b
O
SDA
VSS_1
VDD_1
GPSO_SCKR
OUT_CLK / DATA_REC
LRCK_ADC
RESET
SDI_ADC
北卡罗来纳州
19
20
21
22
s)
t(
c
du
ro
P
GPIO /频闪
VDD_4
IODATA[7]
IODATA[6]
IODATA[5]
IODATA[4]
BIT_EN
SCKR
SCKT
SDO
VSS_4
XTO
北卡罗来纳州
XTI
IODATA[3]
IODATA[2]
IODATA[1]
IODATA[0]
TESTEN
FILT
SDI
D99AU1062
A1 = SDI
B2 = SCKR
D4 = BIT_EN
D1 = SRC_INT
E2 = SDO
F2 = SCKT
H1 = LRCKT
H3 = OCLK
F3 = VSS_2
E4 = VDD_2
G4 = VSS_3
G5 = VDD_3
F5 = PVDD
G6 = PVSS
G7 = FILT
G8 = XTO
F7 = XTI
E7 = VSS_4
C8 = VDD_4
D7 = TESTEN
A7 = SDI_ADC
B6 = RESET
A5 = LRCK_ADC
C5 = OUT_CLK / DATA_REQ
B5 = VDD_1
B4 = VSS_1
A4 = SDA
B3 = SCL
C2 = GPIO_STROBE
C3 = IODATA [4]
E3 = IODATA [5]
D2 = IODATA [6]
F1 = IODATA [7]
G3 = GPSO_REQ
F8 = IODATA [3]
F6 = IODATA [2]
E6 = IODATA [1]
C7 = IODATA [0]
C6 = GPSO_SCKR
A2 = GPSO_DATA
D00AU1149
LFBGA64
3/56
STA015
1.0概述
1.1 MP3解码器引擎
MP3解码引擎能够解码任何第三层兼容的比特流: MPEG1 , MPEG2和
MPEG2.5流的支持。除了音频数据进行解码的MP3发动机也进行ANCIL-
LARY数据提取:这些数据可通过I检索
2
C总线的微控制器的应用程序,以
为了实现特定的功能。
解码后的音频数据通过一个软件音量控制和一个两波段均衡块前馈
荷兰国际集团输出的I2S接口。这导致不需要外部音频处理器。
MP3比特流是使用一个简单的串行输入接口(见引脚SDI, SCKR , BIT_EN发送到解码器
和DATA_REQ ) ,支持输入速率可达20 Mbit / s的。接收到的数据被存储在一个256字节长的输入
缓冲器,它提供一反馈线(见DATA_REQ销),以将比特流源( tipically一个MCU ) 。
1.2 ADPCM编码器/解码器引擎
该器件还嵌入了一个多标准ADPCM编码器/解码器支持不同的采样率
(从8千赫兹到32千赫兹)和不同的样品量(从8位到32位) 。
在编码过程中的两个不同的接口可以被用来将数据传送:串行输入接口(同
用于接口还喂MP3比特流)或ADC的输入接口,它提供了一个无缝CON-
nection用外部的A / D转换器。目前使用的接口是通过予选
2
C总线。
还检索编码数据两个不同的接口可供选择:我
2
C总线和更快的GPSO输出
界面。 GPSO接口能够输出数据的比特率高达5兆比特/秒,并在其控制引脚
( GPSO_SCKR , GPSO_DATA和GPSO_REQ )可以以很容易地适应目标应用程序进行配置
化。
1.3 BYPASS功能模式
为了允许使用该设备进行后处理辅助音频源的专用旁路模式是可用
能。当该设备被配置在旁路模式中的嵌入式DSP将处理的数字音频数据
通过ADC输入接口和将输出所得到的数据发送到外部DAC来。
可处理包括音量和音调ontrols 。
热数据
符号
RTH J- AMB
参数
热阻结到环境
绝对最大额定值
符号
V
DD
Vi
te
le
so
b
V
O
T
英镑
T
od
r
P
电源
uc
)-
(s
t
te
le
so
b
O
价值
85
s)
t(
c
du
ro
P
单位
° C / W
参数
价值
-0.3 4
-0.3到V
DD
+0.3
-0.3到V
DD
+0.3
-40到+150
-20至+85
单位
V
V
V
°C
°C
在输入引脚电压
在输出引脚电压
储存温度
工作环境温度
OPER
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STA015
引脚说明
SO28
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
TQFP44
29
30
31
32
34
36
38
40
42
44
2
3
5
6
7
8
10
11
12
13
15
19
21
22
24
25
26
27
LFBGA64
B5
B4
A4
B3
A1
B2
D4
D1
E2
F2
H1
H3
F3
E4
G4
G5
F5
G6
G7
G8
F7
E7
C8
D7
A7
B6
引脚名称
VDD_1
VSS_1
SDA
SCL
SDI
SCKR
BIT_EN
SRC_INT /
SCK_ADC
SDO
SCKT
LRCKT
OCLK
VSS_2
VDD_2
VSS_3
VDD_3
PVDD
PVSS
FILT
XTO
XTI
VSS_4
VDD_4
TESTEN
TYPE
功能
电源电压
i
2
串行数据+
应答
I
2
串行时钟
接收串行数据
接收串行时钟
位启用
线路中断/ ADC的串行
时钟
发送串行数据( PCM
数据)
发送串行时钟
发射器左/右时钟
过采样时钟的DAC
电源电压
电源电压
PLL电源
PLL地面
PLL滤波器分机。电容
康涅狄格州。
晶振输出
晶振输入(时钟输入)
电源电压
测试开启
PAD说明
I / O
I
I
I
I
I
O
O
O
I / O
CMOS输入缓冲垫
CMOS输出4mA驱动器
CMOS输入缓冲垫
CMOS输入缓冲垫
CMOS输入缓冲垫
CMOS输入缓冲垫
有拉涨
CMOS输入缓冲垫
CMOS输出4mA驱动器
CMOS输出4mA驱动器
CMOS输出4mA驱动器
CMOS输入缓冲垫
CMOS输出4mA驱动器
O
O
I
te
le
so
b
注意:
20
18
16
14
37
39
41
43
35
4
28
33
ro
P
A5
C5
uc
d
SDI_ADC
RESET
)-
(s
t
I
I
I
te
le
so
b
O
ADC输入数据
系统复位
ADC左/右时钟
缓冲输出时钟/
数据请求信号
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO数据线
GPIO信号频闪
GPSO请求信号
GPSO串行时钟
GPSO串行数据
s)
t(
c
du
ro
P
CMOS输出4mA驱动器
具体的电平输入垫
(见第2.1段)
C7
E6
F6
F8
C3
E3
D2
F1
C2
G3
C6
A2
LRCK_ADC
IN-CLK /
DATA_REQ
IODATA[0]
IODATA[1]
IODATA[2]
IODATA[3]
IODATA[4]
IODATA[5]
IODATA[6]
IODATA[7]
GPIO_STROBE
GPSO_REQ
GPSO_SCKR
GPSO_DATA
I
O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
I / O
O
I
O
CMOS输入缓冲垫
有拉涨
CMOS输入缓冲垫
CMOS输入缓冲垫
有拉涨
CMOS输出缓冲垫
CMOS输出4mA驱动器
CMOS施密特4毫安
TRIGGER
双向缓冲垫
CMOS输出缓冲垫
CMOS输入缓冲垫
CMOS输出缓冲垫
在功能模式中TESTEN必须连接到VDD ,
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    电话:0755-82780082
    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

    STA015
    -
    -
    -
    -
    终端采购配单精选

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电话:13410941925
联系人:李先生【原装正品,可开发票】
地址:深圳市福田区福田街道岗厦社区彩田路3069号星河世纪A栋1511A12
STA015
ST
24+
2319
SOP28
原装正品现货,可开增值税专用发票
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电话:0755-83242658
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STA015
ST
24+
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100%原装正品,只做原装正品
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电话:0755-83223003
联系人:朱
地址:福田区红荔路上步工业区201栋西座316
STA015
ST
24+
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全新原装现货,原厂代理。
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电话:0755-83015506-23947236
联系人:朱先生
地址:广东省深圳市福田区华强北路上步工业区101栋518室
STA015
ST
24+
9850
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官方授权代理商入驻
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电话:0755-23613962/82706142
联系人:雷小姐
地址:深圳市福田区华强北街道华红社区红荔路3002号交行大厦一单元711
STA015
ST
2024+
9675
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联系人:业务员
地址:广东省深圳市福田区华强北赛格科技园4栋
STA015
ST
21+
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原装特价现货
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电话:0755-82170267
联系人:李经理
地址:深圳市福田区园岭街道上林社区八卦四路2号先科机电大厦1210
STA015
ST/意法
22+
17555
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有挂就有货 支持订货.备货
QQ: 点击这里给我发消息 QQ:575915585 复制

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