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ST5451

ISDN和HDLC控制器GCI

单片面向ISDN和HDLC

GCI控制器。

GCI和

W / DSI兼容。

全面控制和GCI GCI-工商及科技局

M & C / I通道的管理功能。

完全支持LAPB和LAPD PRO-

母育酚对B或D信道。

轻轻松松INTERFACEABLE与任何一种

标准的非复用或

复用总线微处理器。

与多路复用总线DMA访问

可以处理和存储在同一

在传送的时候两帧

（ 64字节FIFO的Tx ）和八帧

接收（ 64字节FIFO接收）

兼容所有的STMicroelec-

TRONICS ISDN产品家族。

SO28

订购号： ST5451D

引脚连接

（ TOP VIEW ）

概述

ST5451的HDLC和GCI控制器是CMOS税务局局长

CUIT由意法半导体和全面发展

扩散先进的1.2

HCMOS3技

术。

该装置的目的是主要用于ISDN的

应用，在终端（ TE ）和线Termi-

国家（ LT ）。

ST5451可以在处理HDLC数据包

16Kbit的/ s的D信道或64千比特/秒B通道;它可以

具有广泛的PCM信号进行工作中间人

荷兰国际集团从GCI （通用电路接口） DSI

（数字系统接口）任何PCM样

流。

ST5451是一个完整的GCI控制器设计

符合GCI和GCI -工商及科技局（特别税务局局长

扣器接口端子）完全处理

监控（M ）和命令/指示（ C / I ）信

内尔斯。

ST5451可通过于许多不同可以容易地控制

耳鼻喉科一种微处理器或微控制器

具有任一非复用或多路复用总线

结构。

ST5451可以与ST5420 / 1来使用

S接口设备（ SID - μW和SID - GCI ）和

ST5080可编程ISDN组合（ PIC ）在

终端和ST5410 U接口设备

（ UID ）的线路终端。

2000年3月

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是正在开发或正在接受评估新产品的高级信息。详细信息如有变更，恕不

ST5451

框图

引脚说明

名字

INT

MULT

I / M

针

TYPE

功能

片选。低水平使ST5451进行读/写操作。

中断请求被断言ST5451时，它请求服务。

开漏输出。

多路公交车。指示

选择P总线接口。

MULT = 1 ：复用总线和DMA可用。

MULT = 0：地址和数据总线分开。

英特尔/摩托罗拉。当MULT = 1这个引脚选择Intel或

摩托罗拉6805总线。

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ST5451

解复用的微处理器总线接口（ MULT = 0 ）

名字

A0/A5

D0/D7

读/写

针

3-8

17-24

TYPE

I / O

功能

地址总线。从传输地址

P为ST5451 。

数据总线。要传输的数据

P和ST5451 。

读/写。 “1”表示读操作; “0”的写入操作。

启用。读/写操作与此信号同步;其

下降沿马克的动作的结束。

复用的微处理器总线接口（ MULT = 1 I / M

= 1)

名字

AD0/AD7

ALE

针

17-24

TYPE

I / O

功能

地址数据总线。向之间传送地址和数据

和ST5451 。

写。这个信号表示写操作。

阅读。此信号指示读出操作。

下降沿锁存从外部A / D总线上的地址。

复用的微处理器总线接口（ MULT = 1 ; I / M

= 0)

名字

AD0/AD7

读/写

针

17-24

TYPE

I / O

功能

地址数据总线。向之间传送地址和数据

和ST5451 。

读/写。 “1”表示写操作; “0”的写入操作。

数据选通。读/写操作与此同步

信号：其下降沿马克的动作的结束。

地址选通。下降沿锁存的地址从外部

A / D总线。

DMA（直接存储器访问）：仅当MULT = 1

名字

DMA REQ X

DMA REQ

DMA ACK X

DMA ACK

针

TYPE

功能

直接内存访问请求：这些输出断言

设备请求的字节从存储的交换。

直接内存访问应答：这些输入断言

DMA控制器发出信号到HDLC控制器的一个字节是

传送响应于先前传送请求。

GCI接口

名字

OUT

针

TYPE

I / O

功能

数据输出为B和D通道。在GCI模式下输出B1 ，

B 2， M和C / I的信道。在TE模式（ GCI -工商及科技局），它可以为反转

对于M '和C / I '通道的输入数据（见表2）。

数据输入B和D通道。在GCI模式下输入B1，B2 ，男

和C / I通道。在TE模式（ GCI -工商及科技局），它可以反转输出

数据为M'和C / I “通道（见表2）。

数据时钟。它决定了数据转移率GCI频道上

模块接口。

帧同步。这个信号是一个8千赫信号为帧

同步。前缘给人的第一时间基准

在帧位。

数据使能。在TE模式下，该引脚是一个正常的低输入脉冲

高表示当前位时间为D信道传输，在DOUT

引脚。它的目的是与CLK控制的变速被选通

由HDLC控制器向S接口设备的数据。

I / O

DEN

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ST5451

非GCI接口

名字

OUT

DEN

针

TYPE

功能

数据输出。数字输出串行数据。有三种模式：

- HDLC协议复用链路

- HDLC协议的非复用的链接

- 非HDLC协议（透明模式）。

数据输入。数字输入串行数据。三种模式（见教

OUT

数据时钟。它决定了数据转移率。有两种模式：单次或

双比特率。

帧同步。用于模式HDCL协议复用

链接。不关心其他模式。上升沿表示时间

该帧的第一个比特的参考。

数据使能。当高，使数据传输。 D上

OUT

OTHERS

名字

针

TYPE

信号地

RESET

特殊的测试。（保留）必须连接到V

功能

正电源为5V ±5％

- 功能

2 - 1 - HDLC基本功能

2 - 1 - 1 - 在接收方向：

- 通道选择

在GCI信道B1或B2或D可被选择。

B1或B2 ，可以不用M和C / I选择

频道

- 标志检测

零之后连续六个一和AN-

其他零被识别为标记

- 零删除

零，经过连续五个一内

HDLC帧，将被删除

- CRC校验

CRC字段是根据gen-检查

员多项式

+ X

+ 1

- 检查中止

七个或更多个连续的解释

作为中止标志

- 检查空闲

十五个或更多的连续的有间

解释为“空闲”

- 最小lenght检查

与HDLC之间小于n个字节帧

开始和结束标志被忽略：允许val-

UE被3

≤

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这个值是由一个可编程寄存器中设置

- 地址字段识别

4 SAPI和/或3的TEI可以被识别。 Sev-

全部擦除可编程寄存器指示对待识别

认列地址类型。

2 - 1 - 2 - 在发送方向：

- 在TE模式转移控制

D信道数据是由登革引脚发出信号。

- 旗代

一个标志是在开始和在所生成的

每帧的结束。

- 零插入

零是经过连续五个一插

HDLC帧中

- CRC生成

所发送的帧的CRC字段根儿

根据生成多项式ated

+ X

+ 1

- 中止序列生成

HDLC帧可与终止

中止在微处理器控制下顺序

- 帧间的时间填充

标志或空闲状态（连续的）可能会传送

在帧间的时间mitted 。一个可编

BLE位选择模式。

ST5451

2 - 2 - 的FIFO结构

2 - 2 - 1 - 接收FIFO结构

在接收方向上，一个64字节的FIFO存储器是

使用。它被分成8字节的8个块automat-

ically链接。

情况下的64个字节或更少的帧的长度，所述

整个帧可被存储在FIFO中。后

前32个字节已收到

是跨

rupted并且可以读出的现有数据。

如果帧小于64字节长的，在

中断，以便从FIFO读出由32字节块。

万一几个短帧，多达八个可能

存储在FIFO中。后中断，一帧

可用于

最终的其他七

帧是queuedand传送一个接一个。

2 - 2 - 2 - 发送FIFO结构

在发送方向上，一个64字节的FIFO存储器是

表1

- ST5451内部寄存器

地址十六进制

读

接收FIFO

ISTA0

ISTA1

ISTA2

STAR

模式

RFBC

CIR1

CIR2

MONR1

MONR2

CCR

写

发送FIFO

ISTA0

ISTA1

ISTA2

CMDR

模式

TSR

CIX1

CIX2

MONX1/0

MONX1/1

MONX2/0

MONX2/1

MASK0

MASK1

MASK2

CCR

使用结构化的32个字节2个街区。 ST5451

请求发送后32个字节已

写入FIFO 。

如果一个传输请求不包括弹出信息

鼠尾草端， HDLC控制器将请求

通过中断下一个数据块。

2 - 3 - 微处理器接口

三种类型的微处理器接口

可用（ MULT和I / M控制引脚设置DE-

sired接口）。

- 摩托罗拉非复用的家庭。

- 摩托罗拉复用家（ 6805型）

- Intel系列。

您可以连接ST5451到直接内存AC-

塞斯控制器为MC68440或MC6450 （或双

四信道）。

可编程寄存器表示DMA接口

启用。

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