SP9602
SIGNAL PROCESSING EXCELLENCE
双通道， 12位，低功耗电压
输出D / A转换器
s
s
s
s
s
s
s
s
s
s
s
s
低成本
两个12位DAC的一个单芯片
超低功耗 - 16毫瓦（ 8MW / DAC ）
双缓冲输入
±
5V电源工作
电压输出，
±
4.5V范围
中量程预设，零伏输出
保证0.5 LSB INL最大值
保证0.75 LSB DNL最大值
250kHz的四象限乘法带宽
独立的基准输入
28引脚SOIC和DIP塑料
套餐
s
12或8位
p
公共汽车
描述
该
SP9602
是一款低功耗，双通道12位数字 - 模拟转换器。它具有+ 4.5V输出
使用+5伏电源时摆动。该转换器是双缓冲，便于微处理器
界面。每一个12位DAC是独立寻址和两个DAC可能simulta-
使用单一的传输命令neously更新。输出稳定时间规定为为30μs 。
该
SP9602
采用28引脚SOIC和塑料DIP封装，在商用指定
温度范围。
在REF
1
输入
注册
数据
输入
8 MSB的
4 LSB的
LATCH
LATCH
DAC
LATCH
DAC
注册
–
LATCH
DAC
+
VOUT1
在REF
2
–
+
VOUT2
控制逻辑
A
CS
WR1 B1 / B2 WR2 XFER CLR
SP9602DS/02
SP9602双通道， 12位，低功耗电压输出D / A转换器
版权所有1999 Sipex的公司
1
绝对最大额定值
这些压力额定值只，设备的功能操作
在上述的那些操作指示的这些或任何其他
规格部分下面是不是暗示。接触
绝对最大额定值条件下长时间
会影响其可靠性。
V
DD
- GND ................................................ ..................... - 0.3V ， + 6.0V
V
SS
- GND ................................................ .................... + 0.3V ， -6.0V
V
DD
- V
SS ......................................................................................................................
-0.3V, +12.0V
V
REF
..................................................................................... V
SS
, V
DD
D
IN
....................................................................................... V
SS
, V
DD
功耗
塑料DIP ................................................ .......................... 375MW
（减免7MW / ° C以上+ 70 ° C）
小外形................................................ ...................... 375MW
（减免7MW / ° C以上+ 70 ° C）
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2
特定网络阳离子
（续）
（典型值在25℃时，T
民
≤
T
A
≤T
最大
; V
DD
= +5V, V
SS
= -5V, V
REF
= + 3V ; CMOS逻辑电平数字输入;规范适用于所有等级，除非另有说明。 ）
参数
分钟。
稳定性
收益
双极性零
开关特性
t
DS
数据建立时间
140
t
DN
数据保持时间
0
t
WR
把脉冲宽度
t
XFER
转移脉冲宽度
140
140
280
典型值。
15
15
100
100
马克斯。
单位
PPM /°C的
PPM /°C的
ns
ns
ns
ns
ns
民
条件
吨至吨
吨至吨
民
最大
最大
以WR1上升沿
图4
t
WC
共写命令
200
电源要求
V
DD
-J ， -K
1.6
2.5
V
SS
-J ， -K
1.6
2.5
功耗
16
环境和机械
工作温度
-J ， -K
0
+70
存储
-60
+150
套餐
–_N
28引脚塑料DIP
–_S
28引脚SOIC
注意事项：
1.
2.
3.
4.
5.
注5
+ 5V ， + 3 ％ ;注4 ， 5
mA
-5V ， + 3 ％ ;注4 ， 5
mA
mW
°C
°C
积分线性，对于
SP9602,
被测量为的幅度的算术平均值
最大的正偏差和从任何理论值的最大负偏差
给定的输入条件。
微分线性距离的1 LSB的理论值对于任何两个输出步骤的偏差
相邻的数字输入代码。
1 LSB = 2 * V
REF
/4,096.
V
REF
= 0V.
下面的上电顺序的建议，以避免锁存起来： V
SS
(-5V), V
DD
（ + 5V ） ， REFIN 。
+0.25 LSB
DNLE
-0.25 LSB
+0.25 LSB
茵莱
-0.25 LSB
0
茵莱， DNLE图解
CODE
4095
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SP9602双通道， 12位，低功耗电压输出D / A转换器
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3
引脚分配
引脚1 - 北卡罗来纳州 - 无连接。
引脚2 - V
输出2
- 从DAC2电压输出。
引脚3 - V
SS
- -5V电源输入。
引脚4 - V
DD
- + 5V电源输入。
引脚5 - CLR - 清除。门控与WR2 （引脚12） 。
低电平有效。同时清除DAC输出为0V 。
6脚 - REF IN2 - 参考输入的DAC2 。
引脚7 - GND - 接地。
引脚8 - B1 / B2 - 字节1 /字节2 - 选择数据
输入格式。在8引脚为逻辑“ 1 ”选择12
比特模式，并且所有12个数据比特被提供给
DAC （ S）不变;一个逻辑“0”，选择了8位
模式，并在4个LSB被连接到四个
最高有效位，允许一个8位的MSB对齐接口。
引脚9 - A - 地址用于DAC的选择 - 一个
逻辑“0”中选择的DAC 1;一个逻辑“1”的选择
DAC 2 。
引脚10 - REF IN1 - 参考输入的DAC1 。
引脚11 - XFER - 转让。门控与WR2
（引脚12） ;加载所有DAC寄存器同时进行。
低电平有效。
引脚12 - WR2 - 写输入2 - 在联
与XFER （引脚11 ） ，控制数据的传输
从输入寄存器的DAC寄存器。在
使用CLR结合（引脚5） ， DAC寄存器
被迫到1000 0000 0000 ，DAC输出
将沉淀到0V。低电平有效。
引脚 - 28引脚SOIC & DIP
北卡罗来纳州
V
OUT2
V
SS
V
DD
CLR
REF IN 2
GND
B1/B2
A
REF IN 1
XFER
WR2
WR1
CS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
SP9602
28
27
26
25
24
23
22
21
20
19
18
17
16
15
北卡罗来纳州
DB
0
DB
1
DB
2
DB
3
DB
4
DB
5
DB
6
DB
7
DB
8
DB
9
DB
10
DB
11
V
OUT1
引脚13 - WR1 - 写输入1 - 在联
与CS （引脚14） ，使输入寄存器选择，
和控制数据从输入总线传送
到输入寄存器。低电平有效。
引脚14 - CS - 片选 - 允许写
数据输入寄存器和/或从传输数据
输入总线到DAC寄存器。
引脚15 = V
OUT1
- 从DAC1电压输出。
引脚16 - DB
11
- 数据位11 ;最高有效位。
引脚17 - DB
10
- 数据位10 。
引脚18 - DB
9
- 数据位9 。
引脚19 - DB
8
- 数据位8 。
引脚20 - DB
7
- 数据第7位。
引脚21 - DB
6
- 数据第6位。
引脚22 - DB
5
- 数据第5位。
引脚23 - DB
4
- 数据位4 。
引脚24 - DB
3
- 数据位3 。
引脚25 - DB
2
- 数据位2 。
引脚26 - DB
1
- 数据位1 。
引脚27 - DB
0
- 数据位0 ; LSB
引脚28 - 北卡罗来纳州 - 无连接。
SP9602DS/02
SP9602双通道， 12位，低功耗电压输出D / A转换器
版权所有1999 Sipex的公司
4
特点
该
SP9602
是一个非常低功耗，双版本
流行的SP9345 ，四路12位数字 - 模拟
数转换器。这种双电压输出， 12位
数位类比转换器功能
±4.5V
OUT-
使用时把波动
±5
伏电源。输入
使用的编码格式是标准的偏移二进制。 （请
请参阅
表1
下文）。
该转换器利用对每一个双缓冲
12个并行数字输入，方便microproces-
SOR接口。每一个12位DAC独立
寻址和两个DAC可能simulta-
使用单个XFER命令neously更新。
输出稳定时间是在为30μs满指定
12位精度驾驶5Kohm ， 50pF的负载时，
组合。该
SP9602,
双12位数字 -
模拟转换器非常适合于应用程序
如ATE ，过程控制器，机器人和乐器
心理状态。该
SP9602
采用28引脚塑料可
SOIC和塑料DIP封装，规定工作在
商用（0 ° C至+ 70 ° C）温度范围。
位模式中，四个最低显著位（LSB）是
连接到四个最显著位（MSB ） ，
允许一个8位的MSB对齐接口。所有数据
投入使用的是在两种模式下的CS信号使能。
数字输入端被设计为TTL和5V
CMOS兼容。
为了降低DAC满量程输出灵敏度
要在惯例上发现了大比重的MSB的
tional R- 2R梯形电阻， 3个MSB的解码
进入8相同的权重水平。这降低了
每个比特的由4倍的贡献，从而减少
在电阻器的输出灵敏度不匹配和
开关以相同的量。线性误差和
稳定性都得到了改善出于同样的原因。
每个D / A转换器从数据总线由分离
两个寄存器， eachconsistingoflevel - triggeredlatches ，
图1 。
第一个寄存器（输入寄存器）是12位
宽。输入寄存器被选中的地址输入
A
0
AND A
1
并且由CS和WR1信号使能。
在8位模式下，使能信号为8位最高值
通过在B1内的一个逻辑低禁用/ B2以允许4
的LSB的更新。第二寄存器（DAC
寄存器） ，接受解码的3位最高值加上9
LSB的。这两个DAC寄存器更新simulta-
neously两个DAC的使用XFER和WR2
信号。使用CLR和WR2信号或
上电复位（当启用时电源切换
上） DAC寄存器被设置为1000 0000 0000
DAC输出会沉淀到0V 。
使用控制逻辑输入，用户可以完全控制
地址解码，芯片使能，数据传输和
结算的DAC的。控制逻辑输入是
电平触发，而像数据输入， TTL和
CMOS兼容。事实表（表
2)
节目
同的状态相关联的适当的功能
控制逻辑输入。
本身具有精密度实施的DAC
锡永薄膜电阻器网络和CMOS transmis-
锡安门开关。每个D / A转换器，用于
转换成12比特的输入，从它的DAC寄存器向一个
精密电压。
的双极性电压输出
SP9602
创建
片上从DAC的电压输出（V
DAC
）通过
使用运算放大器和两个反馈
所示连接在电阻器
图2中。
这
配置产生+ 4.5V的双极性输出范围
标准偏移二进制编码（见
表1 ） 。
工作原理
该
SP9602
五个主要的功能模块
- 将输入数据多路复用器，数据寄存器，
控制逻辑电路，两个12位的D / A转换器，以及两个
双极性输出电压的放大器。输入数据
多路复用器被设计成连接至任一12-或8-
位微处理器数据总线。输入数据格式
一个逻辑“1”的选择 - 由B1 / B2信号控制
在12位模式，而逻辑“0”中选择的8位
模式。在12位模式中的数据传送到
输入寄存器不改变其格式。在8
输入
最高位
1111
1111
1000
1000
0000
0000
1111
1111
0000
0000
0000
0000
最低位
1111
1110
0001
0000
0001
0000
V
REF
- 1 LSB
V
REF
- 2 LSB
0 + 1 LSB
0
-VREF + 1 LSB
产量
-V
REF
2V
REF
1 LSB =
2
12
表1.偏移二进制编码
SP9602DS/02
SP9602双通道， 12位，低功耗电压输出D / A转换器
版权所有1999 Sipex的公司
5
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