【SN74LVC16128419位总线接口SCAS583J - 1996年11月 - 修订2005年2】,IC型号SN74LVC161284DLG4,SN74LVC161284DLG4 PDF资料,SN74LVC161284DLG4经销商,ic,电子元器件-51电子网

SN74LVC161284

19位总线接口

SCAS583J - 1996年11月 - 修订2005年2月

1.4 kΩ的上拉电阻集成在所有

开漏输出，省去了

分立电阻

ESD保护超过2000伏每

MIL -STD -883方法3015 ;超过200 V

使用机型号（ C = 200 pF的， R = 0 ）

专为IEEE标准1284 -I （ 1级

型）和IEEE标准1284- II （第2级型）

电气规格

流通结构优化PCB

布局

封装选择包括塑料300万

紧缩小外形封装（ DL）和薄膜收缩

小外形（ DGG ）封装

DGG或DL包装

（ TOP VIEW ）

描述/订购信息

该SN74LVC161284是专为3 - V至3.6 V

操作。

这

设备

提供

之间的异步双向通信

数据总线。控制功能的实现

最大限度地减少外部时序要求。

该器件具有8位双向;数据

流中的A到B的方向时DIR是高和

在B到A的方向时， DIR为低。这

设备还具有五个驱动器，其驱动电缆

侧，四个接收器。该SN74LVC161284

有一个接收器专用于主机LOGIC

线和驱动程序来驱动PERI逻辑。

A10

A11

A12

A13

GND

PERI逻辑 -

A14

A15

A16

A17

HOST LOGIC OUT

DIR

Y10

Y11

Y12

Y13

电缆

GND

电缆

PERI LOGIC OUT

C14

C15

C16

C17

HOST逻辑 -

输出驱动器模式是由高驱动器（HD）的控制销来确定。当HD为高电平时，输出在

图腾柱结构，以及在开漏配置时，高清低。这符合该驱动器

要求在IEEE标准1284 -I （ 1级型）和IEEE标准1284 - II规定（级别2型）并行

外设接口规范。除了主机LOGIC IN和PERI逻辑移出，所有的电缆端引脚具有

一个1.4 kΩ的集成上拉电阻。上拉电阻器被关闭，如果相关的输出驱动器在低

状态，或者如果输出电压高于V

CABLE 。如果V

连接线已脱落， PERI LOGIC OUT设置为低。

该装置具有两个电源电压。 V

是专为3 - V至3.6 V的操作。 V

电缆提供的输入

与电缆侧的输出缓冲器仅是专为3 - V至3.6 V和4.7 V至5.5 V的操作。连

当V

CABLE为3 V至3.6 V ，电缆侧I / O引脚5 -V宽容。

该SN74LVC161284的特点是操作从0℃至70℃。

请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用

德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。

PRODUCTION数据信息为出版日期。

产品符合每德州仪器条款规范

标准保修。生产加工并不包括

所有测试参数。

版权

2005年德州仪器

邮政信箱655303

达拉斯，德克萨斯州75265

SN74LVC161284

19位总线接口

SCAS583J - 1996年11月 - 修订2005年2月

描述/订购信息（续）

订购信息

包装

TSSOP - DGG

SSOP - DL

0 ° C至70℃

TSSOP - DGG

SSOP - DL

磁带和卷轴

TAPE

磁带和卷轴

TAPE

磁带和卷轴

订购

产品型号

SN74LVC161284DGGR

SN74LVC161284DL

SN74LVC161284DLR

74LVC161284DGGRG4

74LVC161284DLRE4

74LVC161284DLRG4

LVC161284

包预览

TOP- SIDE

记号

包预览

LVC161284

包装图纸，标准包装数量，热数据，符号和PCB设计准则

可在www.ti.com/sc/package 。

功能表

输入

DIR

产量

漏极开路

图腾柱

漏极开路

图腾柱

模式

A9 -A13至Y9 ， Y13和PERI逻辑 - 以PERI LOGIC OUT

B1 B8至A1 -A8和C14- C17与A14 -A17

B1- B8为A1 -A8 ， A9 -A13至Y9 ， Y13 ， PERI逻辑 - 以PERI LOGIC OUT ，和C14 - C17与A14 -A17

A1 -A8为B1- B8 ， A9 -A13为Y9 ， Y13和PERI逻辑 - 以PERI LOGIC OUT

C14- C17与A14 -A17

A1 -A8为B1- B8 ， A9 -A13为Y9 ， Y13 ， C14 - C17到A14 - A17 ，和PERI逻辑 - 以PERI LOGIC OUT

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SN74LVC161284

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逻辑图

VCC线

DIR

见注释B

另请注意一个

A1A8

B1B8

A9A13

Y9Y13

PERI逻辑 -

PERI LOGIC OUT

A14A17

C14C17

HOST LOGIC OUT

HOST逻辑 -

注：A PMOS晶体管防止反向驱动电流从信号引脚VCC CABLE当VCC电缆开路或接地。

B. PMOS晶体管防止反向驱动从信号引脚VCC电缆电流时， VCC电缆开路或接地。该

PMOS晶体管被关断时，相关联的驱动程序是处于低状态。

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在工作自由空气的温度范围内绝对最大额定值（除非另有说明）

电源电压范围： V

CABLE 。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 -0.5V至7V的

。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 -0.5 V至4.6 V

输入和输出电压范围，V

和V

：电缆端（见注1和2 ）。。。。。。。。。。。。。。。。。。 -2 V至7 V

周侧（见注1 ）。。。。。。。。。。。 -0.5 V到V

+ 0.5 V

输入钳位电流，I

< 0）。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 -20毫安

输出钳位电流，I

＆ LT ; 0）。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 -50毫安

连续输出电流，I

：除了PERI逻辑移出。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。

±50

PERI逻辑输出。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。

±100

连续电流通过每个V

或GND 。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。

±200

输出高灌电流，我

= 5.5 V和V

CABLE = 3V）。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 65毫安

封装的热阻抗，

（见注3 ）： DGG包。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 89 ° C / W

DL包。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 94 ° C / W

存储温度范围，T

英镑

。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。 -65 ℃150 ℃的

超出“绝对最大额定值”列出的强调可能会造成永久性损坏设备。这些压力额定值只，和

该设备在这些或超出下标明的任何其他条件的功能操作“推荐工作条件”不

暗示。暴露于长时间处于最大绝对额定情况下会影响器件的可靠性。

注释：1.如果输入和输出电流额定值是所观察到的输入和输出电压额定值可能被超过。

2.交流输入电压的脉冲持续时间被限制为40纳秒如果振幅大于-0.5V。

3.封装的热阻抗的计算按照JESD 51 。

推荐工作条件（见注4 ）

民

VCC线

VCC

电源电压的电缆端， VCC线

≥

VCC

电源电压

A，B ， DIR和HD

C14C17

VIH

高电平输入电压

HOST逻辑 -

PERI逻辑 -

A，B ， DIR和HD

C14C17

VIL

低电平输入电压

HOST逻辑 -

PERI逻辑 -

周侧

IOH

输入电压

漏极开路输出电压

电缆端

高清低

HD高，B和Y输出

高电平输出电流

A输出和HOST LOGIC OUT

PERI LOGIC OUT

B和Y输出

IOL

低电平输出电流

A输出和HOST LOGIC OUT

PERI LOGIC OUT

2.3

2.6

0.8

1.6

0.8

VCC

5.5

0.5

最大

5.5

3.6

单位

工作自由空气的温度

°C

注4 ：该设备的所有未使用的输入必须在VCC或GND举行，以确保器件正常工作。请参阅TI申请报告，

慢或浮动CMOS输入的影响，

文献编号SCBA004 。

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电气特性在推荐

索= 5V （除非另有说明）

参数

操作

自由的空气

VCC

3.3 V

3.15 V

3.3 V

3.6 V

温度

民

0.4

0.2

0.8

2.23

2.4

2.8

3.1

4.5

0.77

0.2

0.8

3.5

±1

3.5

±20

3.5

100

0.8

1.15

1.65

TYP

最大

范围内，

单位

测试条件

VthH - VTHL为除所有输入

C输入端和主机逻辑 -

输入滞后

VthH - VTHL为主机逻辑 -

VthH - VTHL为C输入

IOH = -14毫安

IOH = -4毫安

IOH = -50

IOH = -0.5毫安

IOL = 14毫安

IOL = 50

IOL = 4毫安

IOL = 84毫安

VI = VCC

VI = GND （上拉电阻）

VI = VCC或GND

VO = VCC

VO = GND （上拉电阻）

VO = VCC或GND

VO = GND （上拉电阻）

VI或VO = 0到7V的

VI = VCC ，

VI = GND （ 12

拉）

IO = 0

HD高，B和Y输出

VOH

HD高时，输出和

HOST LOGIC OUT

PERI LOGIC OUT

B和Y输出

VOL

A输出和HOST LOGIC OUT

PERI LOGIC OUT

C输入端

除了B或C的输入，所有输入

B输出

IOZ

A1A8

漏极开路输出

泄漏到GND ，B和Y输出

IOFF

ICC§

CIO

上拉

控制输入

所有的输入

电缆端

泄漏到VCC ，B和Y输出

3.6 V

3.3 V

VI = VCC或GND

VO = VCC或GND

IOH = -35毫安

VO = 0 V （ Z轴喜）

典型值是在VCC = 3.3 V ， VCC线= 5 V测量， TA = 25 ℃。

VCC线= 4.7 V

§ VCC线= 3.6 V

170的最大电流

每个引脚被添加到ICC ，如果上拉电阻引脚高于VCC 。

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