SN54AS181B ， SN74AS181A
算术逻辑单元/函数发生器
SDAS209B - 1982年12月 - 修订1994年12月
全向前看的高速操作
对长单词
算术操作模式：
=加法
- 减法
- 换档操作对象A的一个位置
- 大小比较
- 十二其它算术操作
逻辑功能模式：
- 异或
比较
- AND，NAND ， OR， NOR
封装选择包括塑料
小外形（N ）封装，陶瓷（ FK ）
芯片载体，标准塑料（ NT）和
陶瓷（ JT ）的300万骤降，以及陶瓷
（ JW ） 600密耳的DIP
SN54AS181B 。 。 。 JT或JW封装
SN74AS181A 。 。 。 N或NT包装
（ TOP VIEW ）
B0
A0
S3
S2
S1
S0
C
n
M
F0
F1
F2
GND
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
V
CC
A1
B1
A2
B2
A3
B3
G
C
n + 4
P
A-B
F3
描述
该SN54AS181B和SN74AS181A算术
逻辑单元（ALU ） /函数发生器产生
75等效门上单片的复杂性
芯片。这些电路执行16个二进制算术
在两个4位字的操作，如图
表1和表2中。这些操作是通过选
四个功能选择（ S0，S1， S2和S3 ）线
并包括加，减，减，和
直线传输。当执行算术
操作时，内部携带被启用
施加低电平电压施加到模式控制
（M ）输入。全先行进位方式使用
生成速度快，同时携带借助于
2级联（ G和P）的输出为4比特
该程序包。
SN54AS181B 。 。 。 FK包装
（ TOP VIEW ）
S2
S1
S0
NC
C
n
M
F0
S3
A0
B0
NC
V
CC
A1
B1
4
5
6
7
8
9
10
3 2 1 28 27 26
25
24
23
22
21
20
19
11
12 13 14 15 16 17 18
A2
B2
A3
NC
B3
G
C
n + 4
NC - 无内部连接
如果高速并不重要，纹波进位（C
n
）输入纹波进位（C
n + 4
）输出是可用的。该
波进位的延迟最小化，以便可以在不进行小型字长算术操作
外部电路。
该SN54AS181B和SN74AS181A适应高电平或低电平有效数据，如果该引脚的名称
解释如下：
引脚数
低电平有效数据（表1）
高电平数据（表2）
2
A0
A0
1
B0
B0
23
A1
A1
22
B1
B1
21
A2
A2
20
B2
B2
19
A3
A3
18
B3
B3
9
F0
F0
10
F1
F1
11
F2
F2
13
F3
F3
7
Cn
Cn
16
CN + 4
CN + 4
15
P
X
17
G
Y
减法是通过1的补码加法来实现，其中的1的补码的减数的是
内部产生。所得到的输出为AB -1 ，这需要一个终端周围或被迫进到提供AB 。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
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达拉斯，德克萨斯州75265
F1
F2
GND
NC
F3
A-B
P
版权
1994年，德州仪器
1
SN54AS181B ， SN74AS181A
算术逻辑单元/函数发生器
SDAS209B - 1982年12月 - 修订1994年12月
描述（续）
该SN54AS181B和SN74AS181A也可以用作比较器。 A = B的输出在内部解码
从函数（ F0，F1， F2，F3）的输出，使得当施加在A相等大小的两个单词和
B输入端，其输出为高电平，指示相等（ A = B ） 。该ALU必须在减法模式
用C
n
= H进行这种比较的时候。 A = B的输出为开路集电极，使得它可以是线与
连接，得到了四个多比特的比较。
n + 4
也可用于提供相对大小
信息。 ALU的必须放置在减法模式通过将功能选择输入端S3 ，S2 ，S1和
S0为L ， H，H，和L分别。
输入
Cn
H
H
L
L
产量
CN + 4
H
L
H
L
ACTIVE-低数据
（图1）
A
≥
B
A<B
A>B
A
≤
B
高电平有效数据
（图2）
A
≤
B
A>B
A<B
A
≥
B
这些线路不仅包含了所有的算术运算设计师的要求，同时也提供了
两个布尔变量，而无需使用外部电路16种可能的功能。这些逻辑功能
由四个功能选择输入以M处于高电平选择禁用内部进位。 16个逻辑
功能详细介绍在表1和2和包括异或，非门，与，或非，与或功能。
典型的添加时间
（ CL = 15 pF的， RL = 280
,
TA = 25 ° C）
包计数
加法
使用时间
先行
′S181
和
携带
个ALU
′S182
发电机
11纳秒
18纳秒
19纳秒
28纳秒
1
2
3或4个
5至16
1
2至5
数
钻头
1至4
5至8
9到16
17 64
CARRY方法
之间的ALU
无
纹波
全部提前看
全部提前看
该SN54AS181B的特点是操作上的整个军用温度范围 - 55 ° C至125°C 。该
SN74AS181A的特点是操作从0℃至70℃。
应用说明
应用程序特定的问题已被确定在SN54AS181B设备。该F0 - F4输出展览
电压瞬变时的一个或多个B数据输入从高至低的状态迁移。所得到的电压
瞬变可以有2 V相对于V的幅度
OL
为5纳秒的宽度在1.5 V的输入阈值
巧合的发生瞬态脉冲与B-数据输入（S ）的高到低的过渡，似乎是
造成内部耦合。
在其中该设备被用于系统的操作，它是可能的传输线效应最小化这种不正常现象。
所述电压瞬态的窄宽度，使脉冲透明的大部分电路;然而，在某些
应用，瞬态可能会导致系统错误。
2
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逻辑符号
S0
S1
S2
S3
M
Cn
A0
B0
23
A1
B1
A2
B2
A3
B3
19
18
22
21
20
6
5
4
3
8
7
2
1
4
C1
P
Q
P
Q
P
Q
P
Q
[8]
13
F3
[3]
11
F2
9
F0
10
F1
（ 0 。 15 ）， CP
0
M
31
（ 0 。 15 ） CG
6(P=Q)
（ 0 。 15 ） CO。
0
ALU
15
17
14
16
CN + 4
P
G
A-B
[1]
[2]
这个符号是按照ANSI / IEEE标准91-1984和IEC出版617-12 。
显示引脚数都为JT ， JW ，N和NT包。
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逻辑图
S3
S2
S1
S0
3
4
5
6
17
18
G
B3
16
19
15
CN + 4
P
A3
13
F3
B2
20
A2
21
11
F2
B1
22
14
A-B
A1
23
10
F1
B0
1
9
A0
M
Cn
2
8
7
F0
显示引脚数都为JT ， JW ，N和NT包。
4
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信号名称
在图1和图2中，极性指示符（）指示关联的输入或输出端为低电平有效用
对于分配给符号内所示的函数。的码元是在这两个图中是相同的。信号
在图1中标号同意基于低电平数据所指示的内部函数中，是使用
与表1中所示的逻辑功能和算术运算的信号名称已变更
在图2中，以容纳所述的逻辑功能和算术运算用于在给定的高电平数据
表2. SN54AS181B和SN74AS181A连同
′S182
可以与信号指定用于
的图1或图2所示。
SN54AS181B,
SN74AS181A
S0
S1
S2
S3
M
Cn
6
5
4
3
8
7
2
1
23
A1
B1
A2
B2
A3
B3
22
21
20
19
18
4
0
M
ALU
0
31 （ 0 。 15）的CG
6(P=Q)
（ 0 。 15 ） CO。
（ 0 。 15 ）， CP
15
17
14
16
P
G
A-B
CN + 4
S0
S1
S2
S3
M
Cn
P
Q
P
Q
P
Q
P
Q
[3]
11
13
6
5
4
3
8
7
2
1
23
F1
F2
F3
A1
B1
A2
B2
A3
B3
22
21
20
19
18
4
0
M
SN54AS181B,
SN74AS181A
ALU
0
31 （ 0 。 15）的CG
6(P=Q)
（ 0 。 15 ） CO。
（ 0 。 15 ）， CP
15
17
14
16
X
Y
A-B
CN + 4
A0
B0
[1]
[2]
9
10
A0
F0
B0
P
Q
P
Q
P
Q
P
Q
[1]
[2]
[3]
9
10
11
13
F0
F1
F2
F3
[8]
[8]
′S182
Cn
P0
G0
P1
G1
P2
G2
P3
G3
P4
G4
P5
G5
P6
G6
P7
G7
1
3
2
5
4
8
7
10
9
14
13
16
15
19
18
21
20
C1
CP0
CG0
CP1
CG1
CP2
CG2
CP3
CG3
CP4
CG4
CP5
CG5
CP6
CG6
CP7
CG7
CO1
CO3
CO5
CO7
6
11
17
22
道道通+ 8
道道通+ 16
道道通+ 24
道道通+ 32
CPG
Cn
X0
Y0
X1
Y1
X2
Y2
X3
Y3
X4
Y4
X5
Y5
X6
Y6
X7
Y7
1
3
2
5
4
8
7
10
9
14
13
16
15
19
18
21
20
C1
′S182
CPG
CP0
CG0
CP1
CG1
CP2
CG2
CP3
CG3
CP4
CG4
CP5
CG5
CP6
CG6
CP7
CG7
CO1
CO3
CO5
CO7
6
11
17
22
道道通+ 8
道道通+ 16
道道通+ 24
道道通+ 32
图1
（表1使用）
图2
（表2使用）
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