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SN74ABT3611
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36
主频先入先出存储器
SCBS127E - 1992年7月 - 修订1998年4月
D
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自由运行CLKA和CLKB可以
异步或重合
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36时钟控制FIFO缓冲数据从
端口A向端口B
邮箱旁路寄存器在每个方向
可编程几乎完全和
几乎空标志
微处理器接口控制逻辑
全旗,几乎满标志
通过CLKA同步
D
D
D
D
D
D
D
空标志和几乎空标志
由CLKB同步
被动的奇偶校验上的每个端口
奇偶校验产生可以选择每
PORT
低功耗先进的BiCMOS技术
支持时钟频率高达67 MHz的
10 ns的快速访问时间
封装选项包括120引脚薄型
四方扁平( PCB)和132引脚塑料四方
平( PQ )软件包
描述
该SN74ABT3611是一个高速,低功耗的BiCMOS时钟的FIFO存储器。它支持时钟频率
高达67 MHz和已读存取时间快10纳秒。 64
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36双端口SRAM FIFO缓冲区数据
端口A向端口B的FIFO有标志,表明空和满的条件和两个可编程标志(几乎
满和几乎空的)来指示何时字的选择号码存储在存储器中。通讯
每个端口之间发生通过两个36位寄存器的邮箱。每个邮箱寄存器都有一个标志信号
当有新邮件已保存。奇偶被动地检查每个端口上,如果不想要的可以忽略不计。
奇偶校验产生可被选择用于从每个端口读取数据。两个或多个设备并联使用来创建
更宽的数据路径。
该SN74ABT3611是一个时钟的FIFO ,这意味着每个端口采用同步接口。所有数据
通过端口传输被选通到端口的时钟被使能信号由低到高的转变。时钟的
每个端口是彼此独立的,并且可以是异步或重合。在使每个端口
被布置成提供微处理器和/或总线之间的简单的双向接口与
同步控制。
满标志( FF),并从FIFO中几乎满(AF)的标志被双级同步的端口的时钟写入
数据的数组( CLKA ) 。空标志( EF )和FIFO几乎空( AE )的标志是两个阶段
同步到端口的时钟,从它的阵列读取数据。
该SN74ABT3611的特点是操作从0℃至70℃。
有关该器件系列的更多信息,请参阅以下应用报告:
FIFO邮箱,旁路寄存器:使用旁路寄存器初始化DMA控制
(文学
数SCAA007 )
奇偶校验生成和奇偶校验功能的高带宽,计算FIFO的应用
(文献编号SCAA015 )
时钟控制FIFO的亚稳态性能(文献编号SCZA004 )
请注意,一个重要的通知有关可用性,标准保修,并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
1998年,德州仪器
邮政信箱655303
达拉斯,德克萨斯州75265
1
SN74ABT3611
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主频先入先出存储器
SCBS127E - 1992年7月 - 修订1998年4月
PCB封装
( TOP VIEW )
AFA
FFA
CSA
ENA
CLKA
W / RA
V
CC
PGA
PEFA
MBF2
工商管理硕士
FS1
FS0
奇/偶
RST
GND
NC
NC
NC
NC
MBB
MBF1
PEFB
PGB
V
CC
NC - 无内部连接
2
邮政信箱655303
达拉斯,德克萨斯州75265
W / RB
CLKB
ENB
CSB
NC
31
32
33
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50
51
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55
56
57
58
59
60
A23
A22
A21
GND
A20
A19
A18
A17
A16
A15
A14
A13
A12
A11
A10
GND
A9
A8
A7
V
CC
A6
A5
A4
A3
GND
A2
A1
A0
NC
NC
120
119
118
117
116
115
114
113
112
111
110
109
108
107
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105
104
103
102
101
100
99
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96
95
94
93
92
91
A24
A25
A26
V
CC
A27
A28
A29
GND
A30
A31
A32
A33
A34
A35
GND
B35
B34
B33
B32
B31
B30
GND
B29
B28
B27
V
CC
B26
B25
B24
B23
1
2
3
4
5
6
7
8
9
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16
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19
20
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30
90
89
88
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86
85
84
83
82
81
80
79
78
77
76
75
74
73
72
71
70
69
68
67
66
65
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63
62
61
B22
B21
GND
B20
B19
B18
B17
B16
B15
B14
B13
B12
B11
B10
GND
B9
B8
B7
V
CC
B6
B5
B4
B3
GND
B2
B1
B0
EFB
AEB
NC
SN74ABT3611
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主频先入先出存储器
SCBS127E - 1992年7月 - 修订1998年4月
PQ包装
( TOP VIEW )
17 16 15 14 13 12 11 10 9
GND
NC
NC
A0
A1
A2
GND
A3
A4
A5
A6
V
CC
A7
A8
A9
GND
A10
A11
V
CC
A12
A13
A14
GND
A15
A16
A17
A18
A19
A20
GND
A21
A22
A23
AFA
FFA
CSA
ENA
CLKA
W / RA
V
CC
PGA
PEFA
GND
MBF2
工商管理硕士
FS1
FS0
奇/偶
RST
GND
NC
NC
NC
NC
MBB
MBF1
GND
PEFB
PGB
V
CC
W / RB
CLKB
ENB
CSB
NC
NC
8
7
6
5
4
3
2
1 132 130 128
126 124
122 120 118
129
131
125 123
121
119
127
117
116
115
114
113
112
111
110
109
108
107
106
105
104
103
102
101
100
99
98
97
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95
94
93
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91
90
89
88
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86
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84
51 52 53 54 55 56 57 58 59 60 61 62 63 64 65 66 67 68 69 70 71 72 73 74 75 76 77 78 79 80 81 82 83
18
19
20
21
22
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24
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26
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28
29
30
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
GND
AEB
EFB
B0
B1
B2
GND
B3
B4
B5
B6
V
CC
B7
B8
B9
GND
B10
B11
V
CC
B12
B13
B14
GND
B15
B16
B17
B18
B19
B20
GND
B21
B22
B23
NC - 无内部连接
采用山一插座IC51-1324-828
V
CC
A24
A25
A26
GND
A27
A28
A29
V
CC
A30
A31
A32
GND
A33
A34
A35
GND
B35
B34
B33
GND
B32
B31
B30
V
CC
B29
B28
B27
GND
B26
B25
B24
V
CC
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达拉斯,德克萨斯州75265
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SN74ABT3611
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主频先入先出存储器
SCBS127E - 1992年7月 - 修订1998年4月
功能框图
CLKA
CSA
W / RA
ENA
工商管理硕士
端口-A
控制
逻辑
Mail1
注册
设备
控制
输出寄存器
输入寄存器
奇偶
GENERATION
奇偶
GEN /检查
MBF1
PEFB
RST
ODD /
PGB
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×
36
SRAM
36
36
A0 – A35
指针
指针
B0 – B35
FF
AF
FIFO
状态 - 标志
逻辑
EF
AE
FS0
FS1
Programmable-
偏移寄存器
PGA
奇偶
GEN /检查
Mail2
注册
CLKB
CSB
W / RB
ENB
MBB
PEFA
MBF2
PORT -B
控制
逻辑
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SN74ABT3611
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主频先入先出存储器
SCBS127E - 1992年7月 - 修订1998年4月
终端功能
终奌站
名字
A0 – A35
AE
AF
B0 – B35
CLKA
CLKB
CSA
CSB
I / O
I / O
O
O
I / O
I
I
I
I
描述
端口的数据。针对A面的36位双向数据端口
几乎空标志。可编程标志同步到CLKB 。 AE是低时字在FIFO的数量是少
于或等于在所述偏移寄存器X的值
几乎满标志。可编程标志同步到CLKA 。 AF为低时的FIFO中的空位置的数目
小于或等于该值的偏移寄存器,X。
端口B的数据。对于B面的36位双向数据端口
端口的时钟。 CLKA是一个连续的时钟,通过端口A同步所有的数据传输,并且可以是异步的
或重合CLKB 。 FF和AF同步到CLKA的由低到高的跳变。
端口B的时钟。 CLKB是一个连续的时钟,通过B口同步所有的数据传送可以是异步的
或重合CLKA 。 EF和AE同步到CLKB的低电平到高电平的转换。
端口片选。 CSA的要低,以使低到高CLKA的过渡到读或写端口A的数据
A0 - A35输出为高阻状态,当CSA高。
端口B的片选。 CSB必须是低以使一个低到高的CLKB的过渡到读或写端口B的数据
B0 - B35输出为高阻状态,当CSB高。
空标志。 EF同步到CLKB低到高的转变。当EF值低时,FIFO是空的,并从读出
它的内存被禁用。数据可以从FIFO中读取到它的输出寄存器时, EF高。 EF被拉低时,
该装置被复位,设置高通过CLKB的第二低到高的转变后的数据加载到FIFO空
内存。
港口-A能。 ENA一定要高,使低到高CLKA的过渡到读或写端口A的数据
端口B启用。 ENB一定要高,使低到高CLKB过渡读写端口B.数据
满标志。 FF同步到CLKA低到高的转变。当FF为低电平时, FIFO已满,并写入到其
内存被禁用。 FF被强制为低电平时,器件复位,并设置了较高的第二低到高的转变
复位后CLKA 。
旗偏移选择。 RST低到高的转变锁存FS0和FS1 ,它加载了四种预设一个值
值到几乎满和几乎空偏移寄存器,X。
端口邮箱选择。高水平的MBA选择一个邮箱注册的端口进行读或写操作。
端口B的邮箱选择。高水平的MBB选择一个邮箱注册的端口B读或写操作。当
B0 - B35输出是活动的,高水平上MBB从MAIL1寄存器输出和一个低级别选择选择数据
FIFO的输出寄存器中的数据并输出。
MAIL1注册标志。 MBF1被设置为低以CLKA的由低到高的跳变将数据写入到MAIL1寄存器。写
到MAIL1寄存器被禁止,而MBF1低。 MBF1被设置为高由低到高的CLKB的过渡时,一个端口乙
读出被选择和MBB是高的。 MBF1被设置为高时,该装置被复位。
Mail2注册标志。 MBF2被设置为低以CLKB的低电平到高电平的转换是将数据写入到mail2寄存器。写
到mail2寄存器被禁止,而MBF2低。 MBF2被设置为高由低到高的CLKA的过渡时,一个端口A
读出被选择和MBA是高的。 MBF2被设置为高时,该装置被复位。
奇/偶校验选择。奇校验,检查每个端口上时,奇/偶高,偶校验检查时,
ODD / EVEN是低的。奇/偶也选择为每个端口产生奇偶校验的类型,如果奇偶校验产生启用
用于读出操作。
端口奇偶校验错误标志。当应用于A0任何字节 - A35失败平价, PEFA低。字节被组织为A0 - A8 ,
A9 - A17 , A18 - A26,和A27 - A35 ,与用作奇偶校验位的每个字节的最显著位。奇偶校验的类型
已检查是通过奇/偶的状态决定。
奇偶树木用来检查A0 - A35输入通过共享mail2寄存器来产生奇偶校验,如果校验生成
被选中PGA 。因此,如果读取奇偶校验产生一个mail2建立由具有CSA低, ENA高,W / RA低,
A35输入 - MBA高, PGA高, PEFA是A0的状态强制为高,不管。
EF
O
ENA
ENB
FF
I
I
O
FS1 , FS0
工商管理硕士
MBB
I
I
I
MBF1
O
MBF2
O
ODD /
I
PEFA
O
( A口)
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电话:13910052844(微信同步)
联系人:刘先生
地址:北京市海淀区增光路27号院增光佳苑2号楼1单元1102室
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