SN65LVDS305
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SLLS744 - 2006年8月
可编程的27 -bit显示串行接口发送器
特点
FlatLink 3G的串行接口技术
兼容接收机FlatLink3G还是这样
作为SN65LVDS306
输入支持24位RGB视频模式
接口
24位RGB数据， 3个控制位，1个奇偶校验位，
2保留位传输一
差分线
SubLVDS差分电压电平
有效的数据吞吐量高达405 Mbps的
三种操作模式以节省电力
- 主动模式的QVGA 17.4毫瓦（典型值）
关断模式
≈
0.5
A
（典型值）
·待机模式
≈
0.5
A
（典型值）
总线交换的增加PCB布局
灵活性
1.8 V电源电压
ESD额定值> 2千伏（ HBM ）
典型应用：主机控制器来
显示屏模块接口
4兆赫， 15兆赫的像素时钟范围
故障安全上的所有CMOS输入
包装： 80码头5毫米
×
5-mm
μBGA
FPC
综合布线
通常
互连
该
SN65LVDS305与显示。相比
并行信号，该SN65LVDS305产出减少
互连的超过20分贝的EMI。
该SN65LVDS305支持三种电源模式
（关机，待机和活动），以节省电力。
在发送时，在PLL锁定到输入
像素时钟， PCLK ，并产生一个内部
高速时钟在数据线的线速度。
该并行数据被锁存的上升沿或下降沿
边缘PCLK的，所选择的外部控制
信号CPOL 。序列化的数据呈现在
串行输出，D ，连同一个重建的PCLK
从内部高速时钟即生成
输出的CLK 。如果PCLK停止，设备进入
待机模式以降低功耗。
并行（ CMOS ）输入总线提供了一个总线交换
功能。交换终端配置的输入
顺序的象素数据的要为R [7：0 ] 。 G [ 7：0] ，
B [ 7：0]时，VS ，HS， DE或B [ 0：7] 。 G [ 0：7]中，R [ 0：7] ， VS ，HS
DE 。这给出了一个PCB设计的灵活性，以更好地
总线匹配到主机控制器的引脚或放
在顶侧或底发射机设备
在PCB的一侧。
描述
该SN65LVDS305串行转换器27
并行数据输入到一个子低压
差分信号（ SubLVDS ）串行输出。它
加载移位寄存器24像素位和3个控制
比特从并行CMOS输入接口。在
除了27个数据位，该装置增加了一个奇偶
位和两个保留位转换成30位的数据字。
每个字是由像素锁存到器件
时钟（ PCLK ） 。奇偶校验位（奇校验），允许
接收器，以检测单个位错误。串行移位
寄存器被上传在30倍的像素时钟数据
率。像素时钟副本是一个单独的输出
差分输出。
FlatLink
3G
液晶显示
司机
LVDS306
CLK
数据
LVDS305
1
4
7
2
5
8
0
3
6
9
#
*
应用
处理器
同
RGB
视频
接口
请注意，一个重要的通知有关可用性，标准保修，并在得克萨斯州的关键应用程序使用
仪器的半导体产品和免责条款及其出现在此数据表的末尾。
FlatLink是德州仪器的商标。
μBGA
是Tessera公司，公司的注册商标..
PRODUCTION数据信息为出版日期。
产品符合占德州条款规范
仪器标准保修。生产加工过程中不
不一定包括所有参数进行测试。
版权所有 2006年，德州仪器
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这些器件具有有限的内置ESD保护。引线应短接在一起或设备放置在导电泡棉
储存或搬运过程中，以防止对静电损坏MOS大门。
描述（续）
该TXEN输入可以用来放SN65LVDS305处于关机状态。该SN65LVDS305进入一个
当前待机模式下，如果输入时钟， PCLK ，停止。这最大限度地减少功率消耗，而不需要
控制的外部端子。该SN65LVDS305的特点是工作在环境空气温度
-40 ° C至85°C 。所有CMOS输入提供故障安全保护输入不受损坏时的功率和避免
电流流进上电时器件的输入。高达2.165 V的输入电压可被施加到所有
CMOS输入，而V
DD
为0 V和1.65 V之间
功能框图
奇偶
CALC
D+
SWAP
Bit29
1
Bit28 = 0
Bit27 = 0
0
[0..26]
8
G[0:7]
8
B[0:7]
SubLVDS
D–
8
R[0:7]
HS
VS
1
30位并行到串行的转换
CLK +
DE
PCLK
0
SubLVDS
CLK “
IPCLK
10
1
CPOL
1
PLL
倍增器
TXEN
故障
压抑
控制/待机显示器
2
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引脚 - 顶视图（续）
SWAP终端的功能
交换终端允许的PCB设计扭转RGB总线，从而尽量减少潜在的信号分频器
由于信号路由。
图1
和
图2
显示基于SWAP的RGB信号端子分配
终端设置。
1
2
3
4
5
6
7
8
9
1
2
3
4
5
6
7
8
9
A
G2
B
G0
C
B6
D
B4
E
B3
F
B1
G
PCLK
H
HS
J
DE
SWAP
VS
B0
B2
B5
B7
G1
G3
G5
G7
R1
R3
R5
R7
G4
G6
R0
R2
R4
R6
A
G5
B
G7
C
R1
R0
G6
G4
G2
G0
B6
B4
B2
B0
G3
G1
B7
B5
B3
B1
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顶视图
D
R3
E
R4
F
R6
G
PCLK
H
HS
J
DE
VS
R7
R5
R2
SN65LVDS305
顶视图
SWAP
SWAP=1
SWAP=0
1.8V
图1.终端SWAP = 0
图2. SWAP终端= 1
4
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