SN65LVDM320
SLLS462 - 2001年8月
高速差分8位寄存收发器
特点
D
8位双向数据存储寄存器
D
全并行访问
并行传输速率
- 缓冲模式：高达475兆
- 触发器模式：高达300兆
- 锁存模式：高达300兆
采用单3.3V电源
低电压差分信号用
350 mV的典型输出电压跨越
50-
负载
总线和逻辑环回功能
非常低的辐射发射
低偏移性能
- 脉冲偏差小于100 ps的
- 输出偏斜小于320 PS
- 部分到部分斜小于1 ns
D
开路差分接收器故障安全
D
D
D
确保了低电平输出
上电复位
12 kV母线引脚的ESD保护
总线引脚保持高阻态时
禁用或V
CC
低于1.5 V的
上电/下无干扰的性能和
热插拔
5V容限LVCMOS输入
D
D
D
D
D
D
应用
D
电信交换
D
打印机和复印机
D
音频调音台
D
自动测试设备
逻辑图
OEB
OMODE1
OMODE2
CLK / LEAB
D
Q
Q
D
DA
IMODE1
IMODE2
CLK / LEBA
Q
RA
Q
Q
OEA
LPBK
ENR
Q
C
D
C
D
C
Q
Q
LPBK
节点
BY
BZ
一，八个通道
请注意，一个重要的通知有关可用性，标准保修，并在德州仪器公司的关键应用程序使用
半导体产品和免责条款及其出现在此数据表的末尾。
由TIA / EIA- 644用的单元间隔的TF低于30％潮流同时限定通过所有信道的并行数据传输。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
2001年，德州仪器
www.ti.com
1
SN65LVDM320
SLLS462 - 2001年8月
描述
该SN65LVDM320是一个8位的数据存储寄存器与差动线路驱动器和接收器是
符合ANSI EIA / TIA -644电兼容多点架构与标准兼容的并行
475 Mbps的传输速率。该SN65LVDM320包括发射机和接收机的数据寄存器，保持
积极不论其相关输出的状态。
对于每个方向的数据流的逻辑元件是由模式控制输入构成。 IMODE1和IMODE2
在B到A（母线侧到数字侧）方向控制数据流时，配置为缓冲液，一个D型触发器，
或D型锁存器。在每个操作模式为A至B （数字的OMODE1和OMODE2中使用的控制数据流
侧母线侧）的方向。当缓冲模式配置，输入数据出现在输出端口。在触发器
模式中，数据被存储在相应的时钟输入， CLKAB / LEAB或CLKBA / LEBA的上升沿。在
锁存模式中，该时钟引脚还可用作高有效透明锁存使能。
数据流是由A侧回送（ LPBK ）输入进一步的控制。当LPBK高， DA输入数据环
返回的RA输出。 B侧的总线数据被环回至在锁存模式中总线通过IMODE的装置和
OMODE逻辑状态。
A侧输出使能/禁止控制是由OEA提供。当OEA低或V
CC
小于2伏，甲
侧处于高阻抗状态。当OEA为高时， A侧处于活动状态（高或低逻辑电平） 。 B侧
输出使能/禁止控制是由OEB提供。当OEB低或V
CC
是小于2V，在B侧处于
高阻抗状态。当OEB为高电平时， B侧处于活动状态（高或低逻辑电平） 。
在A到B和B到一个逻辑单元是活动的，无论它们相关的输出状态。新数据
可输入（在锁存器和触发器模式），或预先存储的数据可以被保留，而相关联的
输出处于高阻抗或无效状态。该SN65LVDM320还包括内部隔离
模（ B侧）和数字（ A侧）的理由增强操作。
该SN65LVDM320的特点是操作从 - 40 ° C至85°C 。
表1.模式功能
输入
CLK / LEAB
X
X
↑
H
（B如下：A ）
L
（B锁存）
X
X
CLK / LEBA
X
X
X
OEA
L
X
X
OEB
L
H
H
ENR
X
X
X
OMODE1
X
L
L
OMODE2
X
L
H
IMODE1
X
X
X
IMODE2
X
X
X
LPBK
X
X
X
隔离
A到B缓冲模式
（参见图1）
A到B触发器模式
（参见图2）
A到B
A到B锁存模式
（参见图3）
B对缓冲区模式
（见图4）
B-到-A触发器模式
（见图5）
B到A
B-到-A锁存模式
（参见图6）
公交车回送锁存模式
（参见图7 ）
DA为RA环回模式
（参见图8至图10）
模式
X
X
H
X
H
L
X
X
X
X
↑
H
（A所示B）
L
（A锁存）
X
X
H
H
L
L
L
L
X
X
X
X
L
L
L
H
L
L
X
H
L
L
X
X
H
L
L
X
X
L
H
L
L
H
H
H
X
H
X
H
X
H
X
L
H
H =水平高， L =水平低， X =不关心，
↑
=低到高
2
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SN65LVDM320
SLLS462 - 2001年8月
表2.引脚说明
针
名字
AGND
1BY - 8BY &
1BZ–8BZ
号
36, 44, 54,
58, 62
64 & 63 ，
60 & 59 ，
56 & 55 ，
52 & 51 ，
46 & 45 ，
42 & 41 ，
38 & 37 ，
34 & 33
18
14
1, 3, 7, 9,
21, 25, 29,
31
5, 11, 15,
19, 23, 27
39
50,
49
48
47
40
13,
17
2, 4, 8, 10,
22, 26, 30,
32
6, 12, 16,
20, 24, 28,
35, 43, 53,
57, 61
描述
模拟（ B面）地
差分I / O对
引脚分配
SN65LVDM320DGG
（标记为LVDM320 ）
（ TOP VIEW ）
CLK / LEBA
CLK / LEAB
1DA–8DA
B面到A端时钟输入或锁存使能
A面到B面的时钟输入或锁存使能
单端输入
DGND
ENR
IMODE1
IMODE2
LPBK
OEA
OEB
OMODE1,
OMODE2
RA
数字（ A面）地
接收器差分数据使能
B面到A端的缓冲区，触发器或锁存模式控制
总线环回控制（见表3）
A-侧环回启用
A端输出使能
B侧的输出使能
A侧与B侧的缓冲器，触发器或锁存模式控制和
总线环回控制（见表3）
单端输出
VCC
电源电压
1DA
1RA
2DA
2RA
DGND
VCC
3DA
3RA
4DA
4RA
DGND
VCC
OMODE1
CLK / LEAB
DGND
VCC
OMODE2
CLK / LEBA
DGND
VCC
5DA
5RA
DGND
VCC
6DA
6RA
DGND
VCC
7DA
7RA
8DA
8RA
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
64
63
62
61
60
59
58
57
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
1BY
1BZ
AGND
VCC
2BY
2BZ
AGND
VCC
3BY
3BZ
AGND
VCC
4BY
4BZ
IMODE1
IMODE2
LPBK
OEA
5BY
5BZ
AGND
VCC
6BY
6BZ
OEB
ENR
7BY
7BZ
AGND
VCC
8BY
8BZ
表3.逻辑IMODE
IMODE1
0
0
1
1
IMODE2
0
1
0
1
模式功能
（B侧的一侧）
卜FF器
倒装佛罗里达州运
LATCH
公交车回送
IMODE1
0
0
1
1
表4. OMODE逻辑
IMODE2
0
1
0
1
模式功能
（A侧面B侧）
卜FF器
倒装佛罗里达州运
LATCH
公交车回送
所有IMODE和OMODE引脚要高的差分总线环回锁存模式。
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SN65LVDM320
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高速差分8位寄存收发器
特点
D
8位双向数据存储寄存器
D
全并行访问
并行传输速率
- 缓冲模式：高达475兆
- 触发器模式：高达300兆
- 锁存模式：高达300兆
采用单3.3V电源
低电压差分信号用
350 mV的典型输出电压跨越
50-
负载
总线和逻辑环回功能
非常低的辐射发射
低偏移性能
- 脉冲偏差小于100 ps的
- 输出偏斜小于320 PS
- 部分到部分斜小于1 ns
D
开路差分接收器故障安全
D
D
D
确保了低电平输出
上电复位
12 kV母线引脚的ESD保护
总线引脚保持高阻态时
禁用或V
CC
低于1.5 V的
上电/下无干扰的性能和
热插拔
5V容限LVCMOS输入
D
D
D
D
D
D
应用
D
电信交换
D
打印机和复印机
D
音频调音台
D
自动测试设备
逻辑图
OEB
OMODE1
OMODE2
CLK / LEAB
D
Q
Q
D
DA
IMODE1
IMODE2
CLK / LEBA
Q
RA
Q
Q
OEA
LPBK
ENR
Q
C
D
C
D
C
Q
Q
LPBK
节点
BY
BZ
一，八个通道
请注意，一个重要的通知有关可用性，标准保修，并在德州仪器公司的关键应用程序使用
半导体产品和免责条款及其出现在此数据表的末尾。
由TIA / EIA- 644用的单元间隔的TF低于30％潮流同时限定通过所有信道的并行数据传输。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
2001年，德州仪器
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SN65LVDM320
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描述
该SN65LVDM320是一个8位的数据存储寄存器与差动线路驱动器和接收器是
符合ANSI EIA / TIA -644电兼容多点架构与标准兼容的并行
475 Mbps的传输速率。该SN65LVDM320包括发射机和接收机的数据寄存器，保持
积极不论其相关输出的状态。
对于每个方向的数据流的逻辑元件是由模式控制输入构成。 IMODE1和IMODE2
在B到A（母线侧到数字侧）方向控制数据流时，配置为缓冲液，一个D型触发器，
或D型锁存器。在每个操作模式为A至B （数字的OMODE1和OMODE2中使用的控制数据流
侧母线侧）的方向。当缓冲模式配置，输入数据出现在输出端口。在触发器
模式中，数据被存储在相应的时钟输入， CLKAB / LEAB或CLKBA / LEBA的上升沿。在
锁存模式中，该时钟引脚还可用作高有效透明锁存使能。
数据流是由A侧回送（ LPBK ）输入进一步的控制。当LPBK高， DA输入数据环
返回的RA输出。 B侧的总线数据被环回至在锁存模式中总线通过IMODE的装置和
OMODE逻辑状态。
A侧输出使能/禁止控制是由OEA提供。当OEA低或V
CC
小于2伏，甲
侧处于高阻抗状态。当OEA为高时， A侧处于活动状态（高或低逻辑电平） 。 B侧
输出使能/禁止控制是由OEB提供。当OEB低或V
CC
是小于2V，在B侧处于
高阻抗状态。当OEB为高电平时， B侧处于活动状态（高或低逻辑电平） 。
在A到B和B到一个逻辑单元是活动的，无论它们相关的输出状态。新数据
可输入（在锁存器和触发器模式），或预先存储的数据可以被保留，而相关联的
输出处于高阻抗或无效状态。该SN65LVDM320还包括内部隔离
模（ B侧）和数字（ A侧）的理由增强操作。
该SN65LVDM320的特点是操作从 - 40 ° C至85°C 。
表1.模式功能
输入
CLK / LEAB
X
X
↑
H
（B如下：A ）
L
（B锁存）
X
X
CLK / LEBA
X
X
X
OEA
L
X
X
OEB
L
H
H
ENR
X
X
X
OMODE1
X
L
L
OMODE2
X
L
H
IMODE1
X
X
X
IMODE2
X
X
X
LPBK
X
X
X
隔离
A到B缓冲模式
（参见图1）
A到B触发器模式
（参见图2）
A到B
A到B锁存模式
（参见图3）
B对缓冲区模式
（见图4）
B-到-A触发器模式
（见图5）
B到A
B-到-A锁存模式
（参见图6）
公交车回送锁存模式
（参见图7 ）
DA为RA环回模式
（参见图8至图10）
模式
X
X
H
X
H
L
X
X
X
X
↑
H
（A所示B）
L
（A锁存）
X
X
H
H
L
L
L
L
X
X
X
X
L
L
L
H
L
L
X
H
L
L
X
X
H
L
L
X
X
L
H
L
L
H
H
H
X
H
X
H
X
H
X
L
H
H =水平高， L =水平低， X =不关心，
↑
=低到高
2
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SN65LVDM320
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表2.引脚说明
针
名字
AGND
1BY - 8BY &
1BZ–8BZ
号
36, 44, 54,
58, 62
64 & 63 ，
60 & 59 ，
56 & 55 ，
52 & 51 ，
46 & 45 ，
42 & 41 ，
38 & 37 ，
34 & 33
18
14
1, 3, 7, 9,
21, 25, 29,
31
5, 11, 15,
19, 23, 27
39
50,
49
48
47
40
13,
17
2, 4, 8, 10,
22, 26, 30,
32
6, 12, 16,
20, 24, 28,
35, 43, 53,
57, 61
描述
模拟（ B面）地
差分I / O对
引脚分配
SN65LVDM320DGG
（标记为LVDM320 ）
（ TOP VIEW ）
CLK / LEBA
CLK / LEAB
1DA–8DA
B面到A端时钟输入或锁存使能
A面到B面的时钟输入或锁存使能
单端输入
DGND
ENR
IMODE1
IMODE2
LPBK
OEA
OEB
OMODE1,
OMODE2
RA
数字（ A面）地
接收器差分数据使能
B面到A端的缓冲区，触发器或锁存模式控制
总线环回控制（见表3）
A-侧环回启用
A端输出使能
B侧的输出使能
A侧与B侧的缓冲器，触发器或锁存模式控制和
总线环回控制（见表3）
单端输出
VCC
电源电压
1DA
1RA
2DA
2RA
DGND
VCC
3DA
3RA
4DA
4RA
DGND
VCC
OMODE1
CLK / LEAB
DGND
VCC
OMODE2
CLK / LEBA
DGND
VCC
5DA
5RA
DGND
VCC
6DA
6RA
DGND
VCC
7DA
7RA
8DA
8RA
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
64
63
62
61
60
59
58
57
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
1BY
1BZ
AGND
VCC
2BY
2BZ
AGND
VCC
3BY
3BZ
AGND
VCC
4BY
4BZ
IMODE1
IMODE2
LPBK
OEA
5BY
5BZ
AGND
VCC
6BY
6BZ
OEB
ENR
7BY
7BZ
AGND
VCC
8BY
8BZ
表3.逻辑IMODE
IMODE1
0
0
1
1
IMODE2
0
1
0
1
模式功能
（B侧的一侧）
卜FF器
倒装佛罗里达州运
LATCH
公交车回送
IMODE1
0
0
1
1
表4. OMODE逻辑
IMODE2
0
1
0
1
模式功能
（A侧面B侧）
卜FF器
倒装佛罗里达州运
LATCH
公交车回送
所有IMODE和OMODE引脚要高的差分总线环回锁存模式。
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