SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
2
D
-55 ° C至125 ° C工作温度
D
D
范围， QML处理
加工MIL -PRF- 38535 （ QML ）
性能
- SMJ320C30-40 （ 50 ns的周期）
40 MFLOPS
20 MIPS
- SMJ320C30-50 （ 40 ns的周期）
50 MFLOPS
25 MIPS
两个1K字
×
32位单周期
双访问片内RAM块
验证阿达编译
64-Word
×
32位指令缓存
32位指令和数据字，
24位地址
三十二分之四十〇位浮点型点/整数乘法器
和算术逻辑单元（ ALU ）
并行ALU和乘法器执行中
单曲循环
片上直接存储器访问（DMA）
控制器并行I / O和CPU
手术
整数，浮点和逻辑
操作
一个4K字
×
32位单周期
双访问片内ROM块
D
2个32位外部端口
D
D
（ 24和13位地址）
两个串行端口支持
8位/ 16位/ 24位/ 32位传输
包装
- 181引脚栅格阵列封装陶瓷
（ GB后缀）
- 196引脚陶瓷四方扁平封装用
不导电连接杆（ HFG后缀）
SMD批准40-和50 - MHz的版本
两个地址发生器与八
辅助寄存器和两个辅助
注册运算单元（ ARAUs ）
零开销循环利用单周期
分支机构
联锁说明
多支持
32位桶式移位器
八扩展精度寄存器
（蓄电池）
两个和三个操作数指令
有条件的调用和返回
块重复功能
制造使用增强性能
植入式CMOS （ EPICt ）在得克萨斯州
仪器
2个32位定时器
D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
D
描述
该SMJ320C30内部总线连接和专用数字信号处理器（DSP）指令集具有的速度和
灵活地执行最多50 MFLOPS 。该SMJ320C30设备通过实现功能的优化速度
在硬件的其它处理器通过软件或微码实现。这种硬件密集型的方法
提供性能以前在单个芯片上不可用。强调了系统总成本，导致
在较便宜的处理器，其可以被设计成当前使用昂贵的位片处理器的系统。
D
SMJ320C30-40 ： 50 ns的单周期执行时间， 5 ％的供应
D
SMJ320C30-50 ： 40 ns的单周期执行时间， 5 ％的供应
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
EPIC是德州仪器的商标。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
关于产品符合MIL PRF 38535 ，所有参数进行测试
除非另有说明。在所有其他产品，生产
加工不一定包括所有参数进行测试。
版权
2004年，德州仪器
邮政信箱1443
休斯敦，得克萨斯州77251-1443
1
SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
描述（续）
181 - GB针栅阵列封装
（ BOTTOM VIEW ）
A B C D E F G H J K L M N P
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
196引脚HFG四方扁平封装
（顶视图）
1
147
DVDD DVSS
VDD
VDD
VSS
DVSS
DVDD
49
50
98
99
该SMJ320C30可以在单个整数或浮点数据执行并行乘法和ALU操作
周期。每个处理器还具有一个通用寄存器文件中，一个程序的高速缓存，专门ARAUs ，
内部双存取存储器，一个DMA通道支持并发I / O，以及一个简短的机器周期时间。
高的性能和易用性是这些特征的结果。
通用的应用程序是由大的地址空间，多接口的增强，内部
和外部产生的等待状态，两个外部接口端口，两个定时器，两个串行端口，以及多种
中断结构。该SMJ320C30支持各种各样的系统的应用程序从主处理器向
专用的协处理器。
高级语言的支持是很容易通过一个基于寄存器的架构实现的，大的地址空间，
强大的寻址模式，灵活的指令集，并支持良好的浮点运算。
有关更多信息，设计用于低温操作时，请参阅德州仪器
应用报告
320C3x ， 320C4x和320MCM42x电灵敏度，在寒冷的温度，
文学
数SGUA001 。
2
邮政信箱1443
休斯敦，得克萨斯州77251-1443
148
VSS
196
SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
功能框图
缓存
(64
×
32)
内存
块0
(1K
×
32)
24
32
24
内存
1座
(1K
×
32)
32
32
24
24
PDATA总线
PADDR巴士
RDY
HOLD
HOLDA
STRB
读/写
D31 D0
A23 A0
DDATA总线
MUX
DADDR1巴士
DADDR2巴士
DMADATA巴士
DMAADDR巴士
32
24
32
24
24
32
24
DMA控制器
串口0
全局控制
注册
串口控制
注册
接收/发送
（ R / X）定时器寄存器
数据传输
注册
数据接收
注册
串行端口1
串口控制
注册
接收/发送
（ R / X）定时器寄存器
FSX1
DX1
CLKX1
FSR1
DR1
CLKR1
FSX0
DX0
CLKX0
FSR0
DR0
CLKR0
MUX
IR
PC
RESET
INT （3 - 0）
IACK
MC / MP
XF(1,0)
VDD
IODVDD
ADVDD
PDVDD
DDVDD
MDVDD
VSS
DVSS
CVSS
IVSS
VBBP
VSUBS
X1
X2 / CLKIN
H1
H3
动车组（ 6 - 0 ）
呼吸道合胞病毒（ 10 - 0 ）
CPU1
CPU2
REG1
REG2
CPU1
REG1
REG2
32
32
倍增器
40
40
32-Bit
桶
移
ALU
40
延伸期
精确
注册
(R7R0)
40
源地址
注册
Destination-
地址
注册
Transfer-
计数器
注册
外设地址总线
调节器
40
40
40
32
外围数据总线
40
DISP0 ， IR0 ， IR1
ARAU0
BK
ARAU1
24
24
32
32
32
32
其他
注册
(12)
辅
注册
（ AR0 - AR7 ）
24
24
32
32
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休斯敦，得克萨斯州77251-1443
数据传输
注册
数据接收
注册
定时器0
全局控制
注册
定时器周期
注册
定时器，计数器
注册
定时器1
全局控制
注册
定时器周期
注册
定时器，计数器
注册
港口管理
主控制
注册
扩充控制
注册
TCLK1
TCLK0
3
MUX
只读存储器
块
(4K
×
32)
32
XRDY
MSTRB
IOSTRB
XR / W
XD31XD0
XA12 -XA0
SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
存储器映射
图1示出存储器映射的SMJ320C30 。见
TMS320C3X用户指南
（文献编号
SPRU031 ），用于该存储器映射的详细说明。图2示出了复位，中断和陷阱
矢量/分支存储器映射位置。图3示出了外围总线存储器映射寄存器。
0h
复位，中断，陷阱
向量和保留
位置（ 64 ） （外部
STRB活动）
0h
复位，中断，
陷阱向量，并保留
地点（ 192 ）
只读存储器
（内部）
外
STRB活动
（ 8M字 - 64字）
7FFFFFh
800000h
801FFFh
802000h
803FFFh
804000h
805FFFh
806000h
807FFFh
808000h
0FFFh
1000h
外
STRB活动
（ 8M字 - 4K字）
7FFFFFh
800000h
801FFFh
802000h
803FFFh
804000h
805FFFh
806000h
807FFFh
808000h
扩展总线
MSTRB活动
（ 8K字）
版权所有
（ 8K字）
扩展总线
IOSTRB活动
（ 8K字）
版权所有
（ 8K字）
外设总线
内存映射
注册
（ 6K字内）
RAM块0
（ 1K字内）
RAM块1
（ 1K字内）
03Fh
040h
0BFh
0C0h
扩展总线
MSTRB活动
（ 8K字）
版权所有
（ 8K字）
扩展总线
IOSTRB活动
（ 8K字）
版权所有
（ 8K字）
外设总线
内存映射
注册
（ 6K字内）
RAM块0
（ 1K字内）
RAM块1
（ 1K字内）
8097FFh
809800h
809BFFh
809C00h
809FFFh
80A000h
8097FFh
809800h
809BFFh
809C00h
809FFFh
80A000h
外
STRB活动
（ 8M字 - 40K字）
0FFFFFFh
（一）微处理器模式
0FFFFFFh
外
STRB活动
（ 8M字 - 40K字）
（二）微电脑模式
图1.内存映射
4
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SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
内存映射（续）
00h
01h
02h
03h
04h
05h
06h
07h
08h
09h
0Ah
0Bh
0Ch
1Fh
20h
陷阱0
RESET
INT0
INT1
INT2
INT3
XINT0
RINT0
XINT1
RINT1
TINT0
TINT1
DINT
版权所有
00h
01h
02h
03h
04h
05h
06h
07h
08h
09h
0Ah
0Bh
0Ch
1Fh
20h
陷阱0
RESET
INT0
INT1
INT2
INT3
XINT0
RINT0
XINT1
RINT1
TINT0
TINT1
DINT
版权所有
.
.
.
3Bh
3Ch
3Fh
TRAP 27
版权所有
3Bh
3Ch
BFH
.
.
.
TRAP 27
版权所有
（一）微处理器模式
（一）微型计算机模式
图2.复位，中断和陷阱向量/分行内存映射位置
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5
SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
2
D
--55 ° C至125 ° C工作温度
D
D
D
D
D
D
D
D
D
D
D
范围， QML处理
加工MIL -PRF- 38535 （ QML ）
性能
- SMJ320C30-40 （ 50 ns的周期）
-
40 MFLOPS
20 MIPS
- SMJ320C30-50 （ 40 ns的周期）
-
50 MFLOPS
25 MIPS
两个1K字
×
32位单周期
双访问片内RAM块
验证阿达编译
64-Word
×
32位指令缓存
32位指令和数据字，
24位地址
三十二分之四十〇位浮点/整数乘法器
和算术逻辑单元（ ALU ）
并行ALU和乘法器执行中
单曲循环
片上直接存储器访问（DMA）
控制器并行I / O和CPU
手术
整数，浮点和逻辑
操作
一个4K字
×
32位单周期
双访问片内ROM块
D
2个32位外部端口
D
D
D
D
D
D
D
D
D
D
D
D
D
描述
（ 24和13位地址）
两个串行端口支持
8位/ 16位/ 24位/ 32位传输
包装
- 181引脚栅格阵列封装陶瓷
-
（ GB后缀）
- 196引脚陶瓷四方扁平封装用
-
不导电连接杆（ HFG后缀）
SMD批准40-和50 - MHz的版本
两个地址发生器与八
辅助寄存器和两个辅助
注册运算单元（ ARAUs ）
零开销循环利用单周期
分支机构
联锁说明
多支持
32位桶式移位器
八扩展精度寄存器
（蓄电池）
两个和三个操作数指令
有条件的调用和返回
块重复功能
制造使用增强性能
植入式CMOS （ EPICt ）在得克萨斯州
仪器
2个32位定时器
该SMJ320C30内部总线连接和专用数字信号处理器（DSP）指令集具有的速度和
灵活地执行最多50 MFLOPS 。该SMJ320C30设备通过实现功能的优化速度
在硬件的其它处理器通过软件或微码实现。这种硬件密集型的方法
提供性能以前在单个芯片上不可用。强调了系统总成本，导致
在较便宜的处理器，其可以被设计成当前使用昂贵的位片处理器的系统。
D
SMJ320C30-40 ： 50 ns的单周期执行时间， 5 ％的供应
D
SMJ320C30-50 ： 40 ns的单周期执行时间， 5 ％的供应
请注意，一个重要的通知有关可用性，标准保修，并且在关键的应用程序中使用
德州仪器公司的半导体产品和免责条款及其出现在此数据表的末尾。
EPIC是德州仪器的商标。
PRODUCTION数据信息为出版日期。
产品符合每德州仪器条款规范
标准保修。生产加工并不包括
所有测试参数。
版权
2004年，德州仪器
关于产品符合MIL -PRF- 38535 ，所有参数进行测试
除非另有说明。在所有其他产品，生产
加工不一定包括所有参数进行测试。
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1
SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
描述（续）
181 - GB针栅阵列封装
（底视图）
A B C D E F G H J K L M N P
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
196引脚HFG四方扁平封装
（ TOP VIEW ）
196
1
DVDD DVSS
VDD
VSS
148
147
VDD
VSS
DVSS
DVDD
49
50
98
99
该SMJ320C30可以在单个整数或浮点数据执行并行乘法和ALU操作
周期。每个处理器还具有一个通用寄存器文件中，一个程序的高速缓存，专门ARAUs ，
内部双存取存储器，一个DMA通道支持并发I / O，以及一个简短的机器周期时间。
高的性能和易用性是这些特征的结果。
通用的应用程序是由大的地址空间，多接口的增强，内部
和外部产生的等待状态，两个外部接口端口，两个定时器，两个串行端口，以及多种
中断结构。该SMJ320C30支持各种各样的系统的应用程序从主处理器向
专用的协处理器。
高级语言的支持是很容易通过一个基于寄存器的架构实现的，大的地址空间，
强大的寻址模式，灵活的指令集，并支持良好的浮点运算。
有关更多信息，设计用于低温操作时，请参阅德州仪器
应用报告
320C3x ， 320C4x和320MCM42x电灵敏度，在寒冷的温度，
文学
数SGUA001 。
2
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SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
功能框图
缓存
(64
×
32)
内存
块0
(1K
×
32)
24
32
24
内存
1座
(1K
×
32)
32
24
只读存储器
块
(4K
×
32)
32
32
24
PDATA总线
RDY
HOLD
HOLDA
STRB
读/写
D31-
-D0
A23-
-A0
PADDR巴士
DDATA总线
MUX
DADDR1巴士
DADDR2巴士
DMADATA巴士
DMAADDR巴士
32
24
32
24
24
32
24
DMA控制器
全局控制
注册
IR
PC
RESET
INT(3-
-0)
IACK
MC / MP
XF(1,0)
V
DD
IODV
DD
ADV
DD
PDV
DD
DDV
DD
MDV
DD
V
SS
DV
SS
CV
SS
IV
SS
V
BBP
V
SUBS
X1
X2/CLKIN
H1
H3
EMU(6-
-0)
RSV(10-
-0)
MUX
CPU1
CPU2
REG1
REG2
CPU1
REG1
REG2
32
32
倍增器
40
40
40
32
延伸期
精确
注册
(R7-
-R0)
40
40
32-Bit
桶
移
ALU
40
40
源地址
注册
Destination-
地址
注册
Transfer-
计数器
注册
外设地址总线
MUX
XRDY
MSTRB
IOSTRB
XR / W
XD31-
-XD0
XA12-
-XA0
串口0
串口控制
注册
接收/发送
（ R / X）定时器寄存器
数据传输
注册
数据接收
注册
串行端口1
串口控制
注册
接收/发送
（ R / X）定时器寄存器
数据传输
注册
FSX1
DX1
CLKX1
FSR1
DR1
CLKR1
FSX0
DX0
CLKX0
FSR0
DR0
CLKR0
调节器
40
外围数据总线
数据接收
注册
定时器0
DISP0 ， IR0 ， IR1
ARAU0
ARAU1
全局控制
注册
定时器周期
注册
定时器，计数器
注册
定时器1
全局控制
注册
定时器周期
注册
定时器，计数器
注册
港口管理
主控制
注册
扩充控制
注册
TCLK1
TCLK0
BK
24
24
32
32
32
32
其他
注册
(12)
辅
注册
(AR0-
-AR7)
24
24
32
32
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3
SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
存储器映射
图1示出存储器映射的SMJ320C30 。见
TMS320C3X用户指南
（文献编号
SPRU031 ），用于该存储器映射的详细说明。图2示出了复位，中断和陷阱
矢量/分支存储器映射位置。图3示出了外围总线存储器映射寄存器。
0h
复位，中断，陷阱
向量和保留
位置（ 64 ） （外部
STRB活动）
0h
0BFh
0C0h
0FFFh
1000h
复位，中断，
陷阱向量，并保留
地点（ 192 ）
只读存储器
（内部）
外
STRB活动
（ 8M字 - 4K字）
-
扩展总线
MSTRB活动
（ 8K字）
版权所有
（ 8K字）
扩展总线
IOSTRB活动
（ 8K字）
版权所有
（ 8K字）
外设总线
内存映射
注册
（ 6K字内）
RAM块0
（ 1K字内）
RAM块1
（ 1K字内）
03Fh
040h
外
STRB活动
（ 8M字 - 64字）
-
7FFFFFh
800000h
801FFFh
802000h
803FFFh
804000h
805FFFh
806000h
807FFFh
808000h
扩展总线
MSTRB活动
（ 8K字）
版权所有
（ 8K字）
扩展总线
IOSTRB活动
（ 8K字）
版权所有
（ 8K字）
外设总线
内存映射
注册
（ 6K字内）
RAM块0
（ 1K字内）
RAM块1
（ 1K字内）
7FFFFFh
800000h
801FFFh
802000h
803FFFh
804000h
805FFFh
806000h
807FFFh
808000h
8097FFh
809800h
809BFFh
809C00h
809FFFh
80A000h
8097FFh
809800h
809BFFh
809C00h
809FFFh
80A000h
外
STRB活动
（ 8M字 - 40K字）
-
0FFFFFFh
（一）微处理器模式
0FFFFFFh
外
STRB活动
（ 8M字 - 40K字）
-
（二）微电脑模式
图1.内存映射
4
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SMJ320C30
数字信号处理器
SGUS014H - 1991年2月 - 修订2004年6月
内存映射（续）
00h
01h
02h
03h
04h
05h
06h
07h
08h
09h
0Ah
0Bh
0Ch
1Fh
20h
RESET
INT0
INT1
INT2
INT3
XINT0
RINT0
XINT1
RINT1
TINT0
TINT1
DINT
版权所有
陷阱0
00h
01h
02h
03h
04h
05h
06h
07h
08h
09h
0Ah
0Bh
0Ch
1Fh
20h
RESET
INT0
INT1
INT2
INT3
XINT0
RINT0
XINT1
RINT1
TINT0
TINT1
DINT
版权所有
陷阱0
.
.
.
3Bh
3Ch
3Fh
TRAP 27
版权所有
3Bh
3Ch
BFH
.
.
.
TRAP 27
版权所有
（一）微处理器模式
（一）微型计算机模式
图2.复位，中断和陷阱向量/分行内存映射位置
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