【SC68C2550B5 V ， 3.3 V和2.5 V双UART ， 5兆比特/秒（最大），与16】,IC型号SC68C2550BIB48,SC68C2550BIB48 PDF资料,SC68C2550BIB48经销商,ic,电子元器件-51电子网

SC68C2550B

5 V ， 3.3 V和2.5 V双UART ， 5兆比特/秒（最大），与16字节

FIFO和68模式

接口

牧师03 - 2009年10月9日

产品数据表

1.概述

该SC68C2550B是一个双通道通用异步收发器

（UART）用于串行数据通信。它的主要功能是将并行

数据转换成串行数据，反之亦然。 UART可处理的串行数据速率高达5兆比特/秒。

该SC68C2550B提供增强型UART功能：16字节FIFO ，调制解调器

控制接口， DMA方式传输数据。 DMA方式的数据传输是通过控制

该FIFO触发电平与TXRDYn和RXRDYn信号。片内的状态寄存器

提供错误指示和运行状态的用户。系统中断和

调制解调器控制功能，可通过软件进行定制，以满足特定连接的C用户的需求。

内部环回功能使车载诊断。独立的可编程

提供波特率发生器来选择发送和接收波特率。

该SC68C2550B工作在5 V ， 3.3 V和2.5 V和工业温度范围内，

并且是在一个塑料LQFP48封装。

2.特点

2通道UART，具有68模式（摩托罗拉）

接口

5 V ， 3.3 V和2.5 V操作

可承受5V电压输入专用管脚

工业温度范围

高达5 Mbit / s的数据速率为5 V和3.3 V和3 Mbit / s的2.5 V

16字节的发送FIFO ，以减少外部CPU的带宽需求

16字节的接收FIFO错误佛罗里达州AGS ，以减少的带宽要求

外部CPU

独立的发送和接收UART控制

四个可选的接收FIFO中断触发水平

软件可选波特率发生器

标准异步错误和帧位（起始，停止位，奇偶溢出中断）

发送，接收，线路状态和数据设置中断独立控制

完全可编程的字符格式：

5 ，6，7 ，或8位的字符

偶，奇或无奇偶格式

1, 1

或2个停止位

波特率产生（DC到5兆位/秒）

假起始位检测

对于数据总线引脚D7到D0 ，看

表22 “极限参数” 。

恩智浦半导体

SC68C2550B

5 V ， 3.3 V和2.5 V双UART ， 5兆比特/秒（最大），与16字节FIFO

完整的状态报告功能

双向数据总线和控制总线三态输出TTL驱动能力。

行中止的产生和检测

内置诊断功能：

对于通信链路故障隔离的环回控制

优先级的中断控制系统

调制解调器控制功能（ CTS ， RTS ， DSR ， DTR ， RI ， CD）

3.订购信息

表1中。

订购信息

包

名字

SC68C2550BIB48

LQFP48

描述

塑料低廓四方扁平的封装; 48线索;

体7

1.4 mm

VERSION

SOT313-2

类型编号

SC68C2550B_3

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恩智浦半导体

SC68C2550B

5 V ， 3.3 V和2.5 V双UART ， 5兆比特/秒（最大），与16字节FIFO

4.框图

SC68C2550B

发送

FIFO

D0到D7

读/写

RESET

数据总线

和

控制

逻辑

发送

移

TXA ， TXB

互连公交线路

和

控制信号的

接受

FIFO

接受

移

RXA ， RXB

A0到A3

SELECT

逻辑

DTRA ， DTRB

RTSA ， RTSB

OP2A ， OP2B

调制解调器

控制

逻辑

IRQ

TXRDYA ， TXRDYB

RXRDYA ， RXRDYB

打断

控制

逻辑

时钟和

波特率

发电机

CTSA ， CTSB

RIA ， RIB

CDA ， CDB

DSRA ， DSRB

002aab334

XTAL1

XTAL2

图1 。

SC68C2550B的框图

SC68C2550B_3

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恩智浦半导体

SC68C2550B

5 V ， 3.3 V和2.5 V双UART ， 5兆比特/秒（最大），与16字节FIFO

5.管脚信息

5.1钢钉

43 TXRDYA

39 DSRA

38 CTSA

40 CDA

42 V

41 RIA

RXB

RXA

TXRDYB

TXA

TXB

OP2B

37北卡罗来纳州

36 RESET

35 DTRB

34 DTRA

33 RTSA

32 OP2A

31 RXRDYA

30 IRQ

北卡罗来纳州29

28 A0

27 A1

26 A2

25北卡罗来纳州

GND 24

002aab335

48 D4

47 D3

46 D2

R / W 15

45 D1

国开行16

SC68C2550BIB48

CS 10

A3 11

北卡罗来纳州12

XTAL1 13

XTAL2 14

GND 17

RXRDYB 18

DSRB 20

RIB 21

RTSB 22

CTSB 23

图2 。

引脚CON组fi guration为LQFP48

5.2引脚说明

表2中。

符号

CDA

国开行

引脚说明

针

TYPE

描述

地址0选择位。

内部寄存器地址选择。

地址1选择位。

内部寄存器地址选择。

地址2选择位。

内部寄存器地址选择。

地址3 。

A3用于选择通道A或通道B.逻辑低电平选择通道A ，

而逻辑高电平选择通道B （见

表3 ）

载波检测（低电平有效）。

这两个输入与UART通道A相关

B有关。该引脚为逻辑0表明承运人已通过调制解调器进行检测

该信道。

片选（低电平有效）。

该引脚使用户能够与CPU之间的数据传输

SC68C2550B用于信道（多个）处理。每个UART （A ， B）得到解决

由A3 。看

表3中。

清除发送（低电平有效）。

这两个输入与UART通道A相关

B.通过对CTSN引脚为逻辑0表示modem或数据集准备接受

发送从SC68C2550B数据。状态通过读取MSR测试[4]。该引脚有

UART的发送或接收操作没有影响。

CTSA

CTSB

SC68C2550B_3

44 D0

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恩智浦半导体

SC68C2550B

5 V ， 3.3 V和2.5 V双UART ， 5兆比特/秒（最大），与16字节FIFO

表2中。

符号

DSRA

DSRB

引脚说明

- 续

针

TYPE

I / O

数据设置就绪（低电平有效）。

这两个输入与UART通道相关联，

A到B.该引脚上的逻辑0表示modem或数据集已经上电，并且

准备好与UART的数据交换。该引脚对UART的发送或没有影响

接收操作。

数据终端就绪（低电平有效）。

这两个输出与UART相关

通道A- B有关。该引脚为逻辑0表明SC68C2550B处于开机状态

并准备就绪。该引脚可通过调制解调器控制寄存器来控制。写逻辑1

MCR [ 0 ]将设置DTRn输出引脚为逻辑0 ，使调制解调器。该引脚为逻辑1

后写入逻辑0 MCR [ 0 ] ，或复位后。该引脚对UART的无影响

发送或接收操作。

信号和电源地。

中断请求。

从UART通道中断AB是国内线或功能

作为一个单一的IRQ中断。该引脚转换为逻辑0 （如果中断使能

可以通过其相关的内部寄存器寻址每个信道来确定，

通过CS和A3 。一个外部上拉电阻必须连接该引脚和V之间

输出2 （用户自定义网络）。

此功能与通道A和B的关联

这些引脚的状态是德网络通过MCR [ 3 ]的软件设置，定义用户。

OP2A / OP2B为逻辑0时， MCR [ 3 ]被设置为逻辑1。 OP2A / OP2B为逻辑1时

MCR [ 3 ]设置为逻辑0 ，这两个引脚的输出是复位后高。

（ [ 7：0 ] D）从外部逻辑低电平在这个引脚传输数据总线的内容

CPU到正在去定义网络地址，通过内部寄存器位A [ 2 ： 0 ] 。该引脚上的逻辑高电平

将加载一个内部寄存器德通过网络地址定义的内容位A [ 2 ： 0 ]上

SC68C2550B数据总线（D [ 7：0] ），用于通过一个外部的CPU访问。

复位（低电平有效）。

该引脚上的逻辑0将复位内部寄存器和所有的输出。

UART发送器输出和接收器输入在复位期间被禁用。（见

第7.10节“ SC68C2550B外部复位状态”

初始化的细节。）

振铃指示（低电平有效）。

这两个输入与UART通道相关联，

A到B.该引脚上的逻辑0表示调制解调器已经从接收到振铃信号

电话线。在这个输入引脚为逻辑1转换将产生一个中断。

请求发送（低电平有效）。

这两个输出与UART相关

通道A-B有关的RTSN引脚为逻辑0表示发送器的数据就绪

并等待发送。写入逻辑1的调制解调器控制寄存器MCR [ 1 ]将设置该管脚

为逻辑0，表示数据是可用的。复位后，该引脚将被设置为逻辑1，该引脚

对UART ？的发送或接收操作没有影响。

接收数据A，B。

这些输入与串行信道数据发送到相关联的

SC68C2550B接收输入电路， A-B 。该RXN信号将复位期间逻辑1时，空闲

（无数据）时，或当发射器处于关闭状态。在本地环回模式下， RXN

输入引脚被禁用，并且发送被连接到UART数据接收输入，在内部。

描述

数据总线（双向）。

这些管脚是8位， 3态数据总线用于传送

信息或来自用于控制的CPU 。 D0是最显着的一点和FI RST数据位

在发送或接收串行数据流。

DTRA

DTRB

GND

IRQ

17, 24

OP2A

OP2B

读/写

RESET

RIA

RIB

RTSA

RTSB

RXA

RXB

SC68C2550B_3

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