SC660E
SMBus的系统时钟缓冲器，用于移动应用程序
特点
10个输出缓冲器，高时钟扇出的应用
每个输出可以在内部禁用EMI和功率
消费减少。
每组2个时钟输出，独立的电源
用于混合电压应用。
< 250PS的输出时钟之间的偏斜。
28引脚SSOP封装，最小的电路板空间
单输出三态引脚可测性
产品说明
该设备是高扇出系统时钟分配器。其
主要应用是建立在大量的时钟
支持多种时钟负载是需要为参考
转制到单个现有时钟。高达30 pF的负载
支持。此组件的主要应用是在哪里
长迹线被用于从其生成传输时钟
设备的负荷。 EMI和degra-的创建
波形的上升和下降时间dation被大大降低
运行一个单一的参考时钟走至该设备，然后
用它来重新生成由驱动短迹线的时钟
使用SC660生成的时钟，在所述目标设备
因此，电磁干扰被最小化和电路板空间节省。
框图
VDDB
引脚配置
SDRAM （0： 1）
SDRAM（ 2：3）
SDRAM4
鳍
SDRAM5
VDD
SDATA
SCLOCK
OE
I2C
SDRAM（ 6：7）
SDRAM（ 8:9 ）
VDDB
SDRAM0
SDRAM1
VSS
VDDB
SDRAM2
SDRAM3
VSS
鳍
VDDB
SDRAM4
VSS
VDD
SDATA
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
VDDB
SDRAM9
SDRAM8
VSS
VDDB
SDRAM7
SDRAM6
VSS
OE
VDDB
SDRAM5
VSS
VSS
SCLOCK
1.0版， 2006年12月6日
2200 LAURELWOOD路，圣克拉拉， CA 95054
联系电话： （ 408 ） 855-0555
传真： （ 408 ） 855-0550
第1页5
www.SpectraLinear.com
SC660E
引脚说明
PIN号
9
2,3,6,7,11,18,22,23
,26,27
20
名字
鳍
SDRAM（ 0 ：9）
OE
PWR
-
VDDB
-
I / O
I
O
I
TYPE
PAD
BUF1
PAD
描述
该引脚被连接到输入端的参考时钟。这个时钟
必须在10.0到100.0兆赫的范围内。
低偏移的输出时钟。
缓冲输出使能引脚。该引脚为低电平它用于放置
在三态条件：所有的输出时钟（ 10 CLK1 ） 。这
有利于在生产板级测试是
此设备产生的时钟容易实现。
具有内部上拉电阻。
串行数据的SMBus控制接口。该引脚接收
数据流来自SMBus总线和输出
确认为有效数据。
串行时钟的SMBus控制接口。
接地引脚的时钟输出缓冲器。必须将这些引脚
返回到相同的电位，以减小输出时钟偏差。
功率输出时钟缓冲器。
引脚器件的核心逻辑。
14
SDATA
VDD
I / O
PAD
15
4, 8, 12, 16, 17, 21,
25
1, 5, 10, 19, 24, 28
13
SCLOCK
VSS
VDDB
VDD
VDD
I
PWR
PAD
-
-
-
-
-
PWR
PWR
最大额定值
[1]
输入电压相对于VSS ： ................................ VSS - 0.3V
输入电压相对于VDDQ或AVDD ： ........... VDD + 0.3V
存储温度： -65 ................................. C到+ 150℃
工作温度： .................................... 0℃到+ 85℃
最大电源： .............................................. 3.5V ..
该器件包含电路，以防止损坏，由于高静电压或电场的投入;但是，注意事
应该采取避免应用大于最大额定电压至该电路更高的任何电压。为了正确
操作中， Vin和Vout的应被约束的范围内
VSS< （VIN或Vout）外部<VDD
未使用的输入必须始终连接到一个适当的逻辑电平（ VSS或VDD ） 。
注意：
1.任何输入或I / O引脚上的电压不能超过在电电源引脚。电源排序不是必需的。
1.0版， 2006年12月6日
页2的5
SC660E
2线SMBus控制接口
2线控制接口实现了一个只写奴隶
界面。该装置不能被读回。子寻址
不支持，所以前面所有字节必须以发送
改变控制字节之一。 2线控制
接口可以单独启用每个时钟输出
或禁用。
在正常的数据传输时， SDATA信号仅改变
当SDCLK信号为低，并且是稳定的，当SDCLK是
高。有两个例外。高向低转变
上SDATA而SDCLK是高是用来表示的起始
一个数据传送周期。低到SDATA而高转换
SDCLK是高电平表示一个数据传输周期的结束。数据
总是发送作为完整的8位字节，在此之后的
确认信号。一个传输周期的第一个字节是
7位地址与读/写位为LSB 。数据
发送MSB科幻RST 。
该设备将要写入响应10字节的数据（最多）到
地址
D2
通过生成的应答（低）信号
SDATA线下接收到每个字节。该设备将
不响应任何其他控制接口的条件。 Previ-
ously设置控制寄存器保留。
串口控制寄存器
继确认的地址字节，两个额外的
字节必须发送：
1. “命令
CODE
“字节，并
2. “字节
计数“
字节。
虽然在该命令中的数据（位）被认为是“不
关心“ ;它必须被发送并且将被确认。
后命令代码和字节数已经
确认，则该序列（字节0 ，字节1和字节2）
下面描述将是有效的，并承认。
字节0 ：
功能选择寄存器（ 1
=启用， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
1
1
1
1
1
1
针＃
-
-
-
-
7
6
3
2
版权所有
版权所有
版权所有
版权所有
SDRAM3 （活动= 1 ，强制低= 0 ）
SDRAM2 （活动= 1 ，强制低= 0 ）
SDRAM1 （活动= 1 ，强制低= 0 ）
SDRAM0 （活动= 1 ，强制低= 0 ）
描述
字节1 ：
时钟寄存器
（ 1 =允许， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
1
1
1
1
1
1
针＃
27
26
23
22
-
-
-
-
描述
SDRAM9 （活动= 1 ，强制低= 0 ）
SDRAM8 （活动= 1 ，强制低= 0 ）
SDRAM7 （活动= 1 ，强制低= 0 ）
SDRAM6 （活动= 1 ，强制低= 0 ）
版权所有
版权所有
版权所有
版权所有
字节2 ：时钟寄存器
（ 1 =允许， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
0
0
0
0
1
1
针＃
18
11
-
-
-
-
-
-
描述
SDRAM5 （活动= 1 ，强制低= 0 ）
SDRAM4 （活动= 1 ，强制低= 0 ）
未使用
未使用
未使用
未使用
未使用
未使用
1.0版， 2006年12月6日
第3 5
SC660E
电气特性
参数
VIL
VIH
IIL
IIH
VOL
VOH
IOZ
国际直拨电话
66
国际直拨电话
100
ISDD
ISC
TIR
静态电源电流
短路电流
输入上升时间
描述
输入低电压
输入高电压
输入低电平电流
输入高电流
输出低电压
IOL = 40毫安
输出高电压
IOH = 30毫安
三态泄漏电流
动态电源电流
分钟。
-
2.0
-66
-
-
2.4
-
-
-
-
25
2.4
典型值。
-
-
-
-
-
-
-
-
-
-
-
-
马克斯。
0.8
-
-
66
0.4
-
10
160
220
4
-
-
单位
VDC
VDC
A
A
VDC
VDC
A
mA
mA
mA
mA
nS
输入频率= 66MHz的 - 所有的输出上
在30 pF负载
输入频率100兆赫 - 对所有输出
在30 pF负载
所有输出禁用无输入时钟
1输出的时间 - 30秒
0.8至2.4伏特
所有输出（见缓冲规格）
使用3.3V电源所有输出
（见缓冲规格）
条件
-
-
VDD = VDD1通VDD5 = 3.3V 5 ％ ， TA = -40°C至+ 85°C
开关特性
参数
-
TSKEW
TSKEW
TJCC
描述
输出占空比
缓冲输出/输出歪斜的所有缓冲区
输出
缓冲器输入到输出偏斜
抖动周期循环
[2]
绝对抖动（峰峰值）
[2]
分钟。
45
-
2.0
典型值。
50
-
4.0
马克斯。
55
250
5.0
50
150
单位
%
pS
nS
pS
pS
@ 35 pF的负载
@ 35 pF的负载
条件
（ 50/50 ）测量1.5V
35 pF负载测量温度为1.5V
VDD = VDD1通VDD5 = 3.3V 5 ％ ， TA = -40°C至+ 85°C
TB40_类型缓冲器特性（所有时钟输出）
参数
IOH
民
IOH
最大
IOL
民
IOL
最大
Zo
TRF
民
TRF
最大
描述
上拉电流最小
上拉电流最大
下拉电流最小值
下拉电流最大
动态输出阻抗
上升/下降时间最小
0.4 V和2.4 V
上升/下降时间最大
0.4 V和2.4 V
分钟。
30
75
30
75
8
-
-
典型值。
-
-
-
-
-
-
-
马克斯。
39
109
40
103
15
1.33
1.33
单位
mA
mA
mA
mA
欧
nS
nS
VOUT = 1.5V
VOUT = 0.4
VOUT = 1.2V
66和100兆赫
30 pF负载
30 pF负载
条件
VOUT = VDD - 1.5V左右
VDD = VDD1通VDD5 = 3.3V 5 ％ ， TA = -40°C至+ 85°C
注意：
2.这种抖动是添加剂与输入时钟的抖动。
1.0版， 2006年12月6日
第4 5
SC660E
订购信息
产品型号
SC660EYB
28引脚SSOP
套餐类型
产品流程
商业， -40 85℃
包图
28引脚（5.3 MM）紧缩小型封装O28
14
1.14
1
1.14 DIA 。
引脚1号。
1.14
7.50
8.10
单位为毫米MIN 。
马克斯。
15
10.00
10.40
28
飞机座位
0.65 BSC 。
0.235 MIN 。
压力表飞机
2.00
马克斯。
1.65
1.85
0.05
0.21
0.25
0 ° MIN 。
0.10
0.22
0.38
5.00
5.60
1.25参考。
0.55
0.95
0°-8°
51-85079-*C
虽然SLI审查了所有信息在此的准确性和可靠性，光谱线性公司对使用任何税务局局长不承担任何责任
cuitry或任何专利或将导致每次使用其它第三方权利的侵犯。本产品适用于使用
正常的商业应用程序，我们不保证也不是用于生命支持应用，关键的医疗器械，或任何其他应用程序
化需要扩展级温度范围，高可靠性，或任何其他特殊的环境要求，除非根据附加
由光谱线公司线性光谱处理公司通过光谱线公司，并表示书面协议保留更改任何的权利
电路或规格，恕不另行通知。
1.0版， 2006年12月6日
页5
SC660E
SMBus的系统时钟缓冲器，用于移动应用程序
产品特点
§
§
§
§
§
§
10输出缓冲器用于高时钟扇出的应用
每个输出可以在内部禁用和EMI
降低功耗。
每个组的2个时钟独立的电源
输出，用于混合电压应用。
< 250PS的输出时钟之间的偏斜。
28引脚SSOP封装，最小的电路板空间
单路输出三态引脚可测性
产品说明
该设备是高扇出系统时钟分配器。其
主要应用是建立在大量的
时钟需要支持多种时钟负载
被引用到一个现有的时钟。负荷
高达30 pF的支持。这一初步应用
成分是其中的长迹线用于传输
时钟从发电设备的负荷。该
创建的EMI和波形上升的降解
和下降时间通过运行一个大大减少
参考时钟跟踪到该设备，然后用它来
再生是通过使用驱动较短的痕迹时钟
在SC660生成的时钟，在所述目标设备
因此，电磁干扰被最小化和董事会地产
保存。
框图
VDDB
引脚配置
SDRAM （0： 1）
SDRAM（ 2：3）
SDRAM4
鳍
SDRAM5
VDD
SDATA
SCLOCK
OE
I2C
SDRAM（ 6：7）
SDRAM（ 8:9 ）
VDDB
SDRAM0
SDRAM1
VSS
VDDB
SDRAM2
SDRAM3
VSS
鳍
VDDB
SDRAM4
VSS
VDD
SDATA
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
VDDB
SDRAM9
SDRAM8
VSS
VDDB
SDRAM7
SDRAM6
VSS
OE
VDDB
SDRAM5
VSS
VSS
SCLOCK
赛普拉斯半导体公司
3901北一街
圣何塞，加利福尼亚95134.电话： 408-043-2600
http://www.cypress.com
文件编号： 38-07025修订版**
12/17/2002
第1页8
SC660E
SMBus的系统时钟缓冲器，用于移动应用程序
引脚说明
针
号
9
2,3,6,7,1
1,18,22,2
3,26,27
20
针
名字
鳍
SDRAM（ 0 ：9）
PWR
-
VDDB
I / O
I
O
TYPE
PAD
BUF1
描述
该引脚被连接到输入端的参考时钟。这个时钟
必须在10.0到100.0兆赫的范围内。
低偏移的输出时钟。
OE
-
I
PAD
14
SDATA
VDD
I / O
PAD
15
4, 8, 12,
16, 17,
21, 25
1, 5, 10,
19, 24,
28
13
SCLOCK
VSS
VDD
I
PWR
PAD
-
缓冲输出使能引脚。该引脚为低电平它用于放置
在三态条件：所有的输出时钟（ 10 CLK1 ） 。这
有利于在生产板级测试是
此设备产生的时钟容易实现。
具有内部上拉电阻。
串行数据的SMBus控制接口。该引脚接收
数据流来自SMBus总线和输出
确认为有效数据。
串行时钟的SMBus控制接口。
接地引脚的时钟输出缓冲器。必须将这些引脚
返回到相同的电位，以减小输出时钟偏差。
功率输出时钟缓冲器。
VDDB
-
PWR
-
VDD
-
PWR
-
引脚器件的核心逻辑。
最大额定值
1
该器件包含电路，以保护输入
不受损坏，由于高静电压或电
电压相对于VSS ：
电压相对于VDD ：
存储温度：
工作温度：
最大电源：
-0.3V
0.3V
-65 ° C至+ 150°C
-40℃至+ 85℃
7V
场;然而，应采取预防措施，以避免
应用高于最大值的任何电压的
额定电压至该电路。为了正常工作，输入电压
和Vout的应被约束的范围内
VSS< （VIN或Vout）外部<VDD
未使用的输入必须始终连接到一个适当的
逻辑电压电平（ VSS或VDD） 。
1
多个耗材：在任何输入或I / O引脚上的电压不能超过电期间的电源引脚。电源排序不是必需的。
赛普拉斯半导体公司
3901北一街
圣何塞，加利福尼亚95134.电话： 408-043-2600
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12/17/2002
第2页8
SC660E
SMBus的系统时钟缓冲器，用于移动应用程序
2线SMBus控制接口
2线控制接口实现了一个只写从站接口。该装置不能被读回。子
处理不被支持，因而前面所有字节必须以改变的控制字节1被发送。 2-
线控接口，允许每个时钟输出，可以单独启用或禁用。
在正常的数据传输时， SDATA信号只有当SDCLK信号为低的变化，并且是稳定的时
SDCLK高。有两个例外。高到SDATA低的转变，而SDCLK高来
表示一个数据传输周期的开始。低到SDATA而SDCLK很高很高的过渡表示的结束
数据传送周期。数据总是被作为完整的8位字节，在这之后的应答被产生。第一
一个传输周期的字节是与读/写位为LSB的7位地址。数据首先传送MSB 。
该设备将要写入响应10字节的数据（ max）与地址
D2
通过生成应答（低）
下面的接收每个字节上的SDATA线信号。该设备将不向任何其他的控制界面响应
条件。以前设置控制寄存器保留。
串口控制寄存器
注意：
该引脚号列中列出的受影响的针数适用。该@Pup列给出了状态真
上电。字节被设置为只对真正的力量了显示的值，而不是当PWR_DWN ＃引脚被激活。
下面的地址字节（ D2）的确认，两个额外的字节必须发送：
1 ） “命令
CODE
“字节，并
2 ） “字节
计数“
字节。
虽然在这两个字节中的数据（位）被认为是“不关心”的，它们必须被发送，并且会被确认。
后命令代码和字节数已经承认，下面描述的序列（字节
0 ， 1字节，字节2 ，... ）将是有效的，并承认。
字节0 ：功能选择寄存器（ 1
=启用， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
1
1
1
1
1
1
针＃
-
-
-
-
7
6
3
2
描述
版权所有
版权所有
版权所有
版权所有
SDRAM3 （活动= 1 ，强制低= 0 ）
SDRAM2 （活动= 1 ，强制低= 0 ）
SDRAM1 （活动= 1 ，强制低= 0 ）
SDRAM0 （活动= 1 ，强制低= 0 ）
赛普拉斯半导体公司
3901北一街
圣何塞，加利福尼亚95134.电话： 408-043-2600
http://www.cypress.com
文件编号： 38-07025修订版**
12/17/2002
第3页8
SC660E
SMBus的系统时钟缓冲器，用于移动应用程序
串口控制寄存器（续）
字节1 ：时钟寄存器
（ 1 =允许， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
1
1
1
1
1
1
针＃
27
26
23
22
-
-
-
-
描述
SDRAM9 （活动= 1 ，强制低= 0 ）
SDRAM8 （活动= 1 ，强制低= 0 ）
SDRAM7 （活动= 1 ，强制低= 0 ）
SDRAM6 （活动= 1 ，强制低= 0 ）
版权所有
版权所有
版权所有
版权所有
字节2 ：时钟寄存器
（ 1 =允许， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
0
0
0
0
1
1
针＃
18
11
-
-
-
-
-
-
描述
SDRAM5 （活动= 1 ，强制低= 0 ）
SDRAM4 （活动= 1 ，强制低= 0 ）
未使用
未使用
未使用
未使用
未使用
未使用
赛普拉斯半导体公司
3901北一街
圣何塞，加利福尼亚95134.电话： 408-043-2600
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12/17/2002
第4页8
SC660E
SMBus的系统时钟缓冲器，用于移动应用程序
电气特性
特征
输入低电压
输入高电压
输入低电平电流
输入高电流
输出低电压
IOL = 40毫安
输出高电压
IOH = 30毫安
三态泄漏电流
动态电源电流
国际直拨电话
100
静态电源电流
短路电流
输入上升时间
ISDD
ISC
TIR
-
-
25
2.4
-
-
-
-
220
4
-
-
mA
mA
mA
nS
符号
VIL
VIH
IIL
IIH
VOL
VOH
IOZ
国际直拨电话
66
-
2.4
-
-
-
-
-
-
民
-
2.0
-66
66
0.4
-
10
160
典型值
-
-
最大
0.8
-
单位
VDC
VDC
A
A
VDC
VDC
A
mA
输入频率= 66MHz的 - 所有的输出上
在30 pF负载
输入频率100兆赫 - 对所有输出
在30 pF负载
所有输出禁用无输入时钟
1输出的时间 - 30秒
0.8至2.4伏特
所有输出（见缓冲规格）
使用3.3V电源所有输出
（见缓冲规格）
条件
-
-
VDD = VDD1通VDD5 = 3.3V
±5%,
， TA = -40°C至+ 85°C
开关特性
特征
输出占空比
缓冲了输入/输出歪斜所有
缓冲器输出
缓冲器输入到输出偏斜
抖动循环周期*
绝对抖动（峰
峰值） *
符号
-
TSKEW
TSKEW
TJCC
TJabs
民
45
-
2.0
典型值
50
-
4.0
最大
55
250
5.0
50
150
单位
%
pS
nS
pS
pS
@ 35 pF的负载
@ 35 pF的负载
条件
（ 50/50 ）测量1.5V
35 pF负载测量温度为1.5V
VDD = VDD1通VDD5 = 3.3V
±5%,
， TA = -40°C至+ 85°C
*这种抖动是添加剂与输入时钟的抖动。
赛普拉斯半导体公司
3901北一街
圣何塞，加利福尼亚95134.电话： 408-043-2600
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文件编号： 38-07025修订版**
12/17/2002
第5页8
SC660E
SMBus的系统时钟缓冲器，用于移动应用程序
产品特点
§
§
§
§
§
§
10输出缓冲器用于高时钟扇出的应用
每个输出可以在内部禁用和EMI
降低功耗。
每个组的2个时钟独立的电源
输出，用于混合电压应用。
< 250PS的输出时钟之间的偏斜。
28引脚SSOP封装，最小的电路板空间
单路输出三态引脚可测性
产品说明
该设备是高扇出系统时钟分配器。其
主要应用是建立在大量的
时钟需要支持多种时钟负载
被引用到一个现有的时钟。负荷
高达30 pF的支持。这一初步应用
成分是其中的长迹线用于传输
时钟从发电设备的负荷。该
创建的EMI和波形上升的降解
和下降时间通过运行一个大大减少
参考时钟跟踪到该设备，然后用它来
再生是通过使用驱动较短的痕迹时钟
在SC660生成的时钟，在所述目标设备
因此，电磁干扰被最小化和董事会地产
保存。
框图
VDDB
引脚配置
SDRAM （0： 1）
SDRAM（ 2：3）
SDRAM4
鳍
SDRAM5
VDD
SDATA
SCLOCK
OE
I2C
SDRAM（ 6：7）
SDRAM（ 8:9 ）
VDDB
SDRAM0
SDRAM1
VSS
VDDB
SDRAM2
SDRAM3
VSS
鳍
VDDB
SDRAM4
VSS
VDD
SDATA
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
VDDB
SDRAM9
SDRAM8
VSS
VDDB
SDRAM7
SDRAM6
VSS
OE
VDDB
SDRAM5
VSS
VSS
SCLOCK
赛普拉斯半导体公司
3901北一街
圣何塞，加利福尼亚95134.电话： 408-043-2600
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SC660E
SMBus的系统时钟缓冲器，用于移动应用程序
引脚说明
针
号
9
2,3,6,7,1
1,18,22,2
3,26,27
20
针
名字
鳍
SDRAM（ 0 ：9）
PWR
-
VDDB
I / O
I
O
TYPE
PAD
BUF1
描述
该引脚被连接到输入端的参考时钟。这个时钟
必须在10.0到100.0兆赫的范围内。
低偏移的输出时钟。
OE
-
I
PAD
14
SDATA
VDD
I / O
PAD
15
4, 8, 12,
16, 17,
21, 25
1, 5, 10,
19, 24,
28
13
SCLOCK
VSS
VDD
I
PWR
PAD
-
缓冲输出使能引脚。该引脚为低电平它用于放置
在三态条件：所有的输出时钟（ 10 CLK1 ） 。这
有利于在生产板级测试是
此设备产生的时钟容易实现。
具有内部上拉电阻。
串行数据的SMBus控制接口。该引脚接收
数据流来自SMBus总线和输出
确认为有效数据。
串行时钟的SMBus控制接口。
接地引脚的时钟输出缓冲器。必须将这些引脚
返回到相同的电位，以减小输出时钟偏差。
功率输出时钟缓冲器。
VDDB
-
PWR
-
VDD
-
PWR
-
引脚器件的核心逻辑。
最大额定值
1
该器件包含电路，以保护输入
不受损坏，由于高静电压或电
电压相对于VSS ：
电压相对于VDD ：
存储温度：
工作温度：
最大电源：
-0.3V
0.3V
-65 ° C至+ 150°C
-40℃至+ 85℃
7V
场;然而，应采取预防措施，以避免
应用高于最大值的任何电压的
额定电压至该电路。为了正常工作，输入电压
和Vout的应被约束的范围内
VSS< （VIN或Vout）外部<VDD
未使用的输入必须始终连接到一个适当的
逻辑电压电平（ VSS或VDD） 。
1
多个耗材：在任何输入或I / O引脚上的电压不能超过电期间的电源引脚。电源排序不是必需的。
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2线SMBus控制接口
2线控制接口实现了一个只写从站接口。该装置不能被读回。子
处理不被支持，因而前面所有字节必须以改变的控制字节1被发送。 2-
线控接口，允许每个时钟输出，可以单独启用或禁用。
在正常的数据传输时， SDATA信号只有当SDCLK信号为低的变化，并且是稳定的时
SDCLK高。有两个例外。高到SDATA低的转变，而SDCLK高来
表示一个数据传输周期的开始。低到SDATA而SDCLK很高很高的过渡表示的结束
数据传送周期。数据总是被作为完整的8位字节，在这之后的应答被产生。第一
一个传输周期的字节是与读/写位为LSB的7位地址。数据首先传送MSB 。
该设备将要写入响应10字节的数据（ max）与地址
D2
通过生成应答（低）
下面的接收每个字节上的SDATA线信号。该设备将不向任何其他的控制界面响应
条件。以前设置控制寄存器保留。
串口控制寄存器
注意：
该引脚号列中列出的受影响的针数适用。该@Pup列给出了状态真
上电。字节被设置为只对真正的力量了显示的值，而不是当PWR_DWN ＃引脚被激活。
下面的地址字节（ D2）的确认，两个额外的字节必须发送：
1 ） “命令
CODE
“字节，并
2 ） “字节
计数“
字节。
虽然在这两个字节中的数据（位）被认为是“不关心”的，它们必须被发送，并且会被确认。
后命令代码和字节数已经承认，下面描述的序列（字节
0 ， 1字节，字节2 ，... ）将是有效的，并承认。
字节0 ：功能选择寄存器（ 1
=启用， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
1
1
1
1
1
1
针＃
-
-
-
-
7
6
3
2
描述
版权所有
版权所有
版权所有
版权所有
SDRAM3 （活动= 1 ，强制低= 0 ）
SDRAM2 （活动= 1 ，强制低= 0 ）
SDRAM1 （活动= 1 ，强制低= 0 ）
SDRAM0 （活动= 1 ，强制低= 0 ）
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串口控制寄存器（续）
字节1 ：时钟寄存器
（ 1 =允许， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
1
1
1
1
1
1
针＃
27
26
23
22
-
-
-
-
描述
SDRAM9 （活动= 1 ，强制低= 0 ）
SDRAM8 （活动= 1 ，强制低= 0 ）
SDRAM7 （活动= 1 ，强制低= 0 ）
SDRAM6 （活动= 1 ，强制低= 0 ）
版权所有
版权所有
版权所有
版权所有
字节2 ：时钟寄存器
（ 1 =允许， 0 =停止）
位
7
6
5
4
3
2
1
0
@Pup
1
1
0
0
0
0
1
1
针＃
18
11
-
-
-
-
-
-
描述
SDRAM5 （活动= 1 ，强制低= 0 ）
SDRAM4 （活动= 1 ，强制低= 0 ）
未使用
未使用
未使用
未使用
未使用
未使用
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电气特性
特征
输入低电压
输入高电压
输入低电平电流
输入高电流
输出低电压
IOL = 40毫安
输出高电压
IOH = 30毫安
三态泄漏电流
动态电源电流
国际直拨电话
100
静态电源电流
短路电流
输入上升时间
ISDD
ISC
TIR
-
-
25
2.4
-
-
-
-
220
4
-
-
mA
mA
mA
nS
符号
VIL
VIH
IIL
IIH
VOL
VOH
IOZ
国际直拨电话
66
-
2.4
-
-
-
-
-
-
民
-
2.0
-66
66
0.4
-
10
160
典型值
-
-
最大
0.8
-
单位
VDC
VDC
A
A
VDC
VDC
A
mA
输入频率= 66MHz的 - 所有的输出上
在30 pF负载
输入频率100兆赫 - 对所有输出
在30 pF负载
所有输出禁用无输入时钟
1输出的时间 - 30秒
0.8至2.4伏特
所有输出（见缓冲规格）
使用3.3V电源所有输出
（见缓冲规格）
条件
-
-
VDD = VDD1通VDD5 = 3.3V
±5%,
， TA = -40°C至+ 85°C
开关特性
特征
输出占空比
缓冲了输入/输出歪斜所有
缓冲器输出
缓冲器输入到输出偏斜
抖动循环周期*
绝对抖动（峰
峰值） *
符号
-
TSKEW
TSKEW
TJCC
TJabs
民
45
-
2.0
典型值
50
-
4.0
最大
55
250
5.0
50
150
单位
%
pS
nS
pS
pS
@ 35 pF的负载
@ 35 pF的负载
条件
（ 50/50 ）测量1.5V
35 pF负载测量温度为1.5V
VDD = VDD1通VDD5 = 3.3V
±5%,
， TA = -40°C至+ 85°C
*这种抖动是添加剂与输入时钟的抖动。
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