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集成电路
数据表
SAA7206H
DVB解扰器兼容
产品speci fi cation
取代1996年的数据10月2日
在集成电路， IC02文件
1996年10月9日
飞利浦半导体
产品speci fi cation
DVB解扰器兼容
目录
1
2
3
4
5
6
7
7.1
7.2
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7.7
8
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14
14.1
14.2
14.3
14.3.1
14.3.2
14.3.3
14.4
15
16
特点
概述
订购信息
快速参考数据
框图
钉扎
功能说明
MPEG-2系统的解析
PES级解扰
解扰器的核心
微控制器接口
输出接口
边界扫描测试
编程解扰器
极限值
处理
热特性
DC特性
AC特性
包装外形
焊接
介绍
再溢流焊接
波峰焊
QFP
SO
方法（ QFP和SO ）
修复焊接接头
释义
生命支持应用
SAA7206H
1996年10月9日
2
飞利浦半导体
产品speci fi cation
DVB解扰器兼容
1
特点
SAA7206H
解扰器，基于超解扰器
机制的算法与数据流解码和块
破译。解扰器与一个64位的初始化
控制字（CW ）在一个传输的开始
选定的数据包流的数据包的有效载荷
标识（PID ） 。解扰器上运行
传输流分组或打包的基本
流（PES ）数据包的有效载荷
微控制器的支持;只用于控制，没有具体
解扰任务由执行
微控制器。然而，解析和处理
条件访问信息（如EMM和ECM
数据）被左到系统微控制器
边界扫描测试端口，用于边界扫描。
2
概述
输入的数据完全符合传输流
（TS）的MPEG-2系统规范的定义
输入数据信号; [前向纠错（ FEC ）
接口]
- 调制解调器数据输入总线（ 8位）
- 有效的输入数据指示符
- 错误的数据包的指标
- 第一个数据包的字节指标
- 字节选通信号（异步模式） 。
该接口可被编程为两种模式中的一种：
- 异步模式;字节选通输入信号
（ MBCLK ） < 9兆赫，用于连接到一个调制解调器（ FEC）的
- 同步模式; MBCLK不被使用。数据
传递到与同步解扰器
芯片的时钟（ DCLK ） [9 MHz（典型值）与33 ％的关税
周期。
无需外部存储器
有效比特率; F
位
≤
72兆赫
控制接口; 8位复用的数据/地址，
内存映射I / O （ 90CE201单片机并行
总线兼容） ，在与微控制器组合
中断信号（ IRQ）
输出端口是相同的输入数据接口
（解复用器接口）
- 除了包错误指示器（ MB / MB） ，如
解扰器转换的有源MB的信号输出到
传输流中的' transport_error_indicator '位
- 除了字节选通输入信号（ MBCLK ），如
数据被输送到多路分解器，同步
与其中产生的解扰器芯片时钟
由多路分解器
3
订购信息
该SAA7206H （ DVB标准）是专为使用
基于MPEG-2的数字电视接收机，装有
有条件的访问过滤器。这种接收机是将
实施中，例如，数字视频广播
前集箱，或集成数字电视接收器。
一个多路分解器/解扰器系统的一个例子
构，包含信道解码器模块，一
多路分离器，一个系统控制器和一个条件
接入系统示于图3 。的主要功能
解密器是解扰的MPEG-2的TS的有效负载
包或PES包。此外，解扰器
检索条件接入（ CA）的数据〔如
授权管理信息（ EMM ）和
授权控制信息（ECM），等]从流
并且将其传递到系统微控制器用于处理。
包
类型编号
名字
SAA7206H
QFP64
描述
塑料四方扁平的封装; 64导线（导线长度1.95毫米） ;
身体14
×
20
×
2.8 mm
VERSION
SOT319-2
1996年10月9日
3
飞利浦半导体
产品speci fi cation
DVB解扰器兼容
4
快速参考数据
符号
V
DDD
V
DDD （核心）
P
合计
f
CLK
T
AMB
5
参数
数字电源电压
数字电源电压为芯
总功耗
时钟频率
工作环境温度
V
DDD （核心）
= 3.3 V,
V
DDD
= 5 V ，C
L
= 15 pF的
占空比= 30 ％至55％
条件
0
分钟。
典型值。
SAA7206H
马克斯。
5.5
3.6
250
9
70
V
V
单位
mW
兆赫
°C
框图
手册，全页宽
TC1
61
TC0
60
MIN7到MIN0
47至50
53至56
MB / MB MBCLK
MDV
则msync
44
45
43
59
TDI
TCK
TMS
TRST
18
19
20
46
测试控制块
为
边界扫描测试
和
扫描测试
传输流
和
AF PARSER
22
DCLK
62
POR
TDO
DAT7
to
DAT0
DCS
读/写
A1
A0
IRQ
37
SAA7206
包
鉴定
银行
控制
字
银行
7至9
12至16
3
63
4
5
1
微控制器
接口
流
解码
块
解码
条件
ACCESS
过滤器
40
24, 25,
28日至31日，
34, 35
产量
接口
2, 17, 23, 27,
33, 52, 58
38
39
OE
DATO0
to
DATO7
DVO
SYNCO
VDDD （核心）
VDDD1
to
VDDD9
36
6, 11, 21, 26,
32, 41, 51, 57, 64
10, 42
MGG313
VSSD1到VSSD7
VSSD1(core),
VSSD2(core)
图1框图。
1996年10月9日
4
飞利浦半导体
产品speci fi cation
DVB解扰器兼容
6
钉扎
符号
IRQ
V
SSD1
DCS
A1
A0
V
DDD1
DAT7
DAT6
DAT5
V
SSD1(core)
V
DDD2
DAT4
DAT3
DAT2
DAT1
DAT0
V
SSD2
TDI
TCK
TMS
V
DDD3
DCLK
V
SSD3
DATO0
DATO1
V
DDD4
V
SSD4
DATO2
DATO3
DATO4
DATO5
V
DDD5
V
SSD5
DATO6
DATO7
V
DDD （核心）
TDO
DVO
SYNCO
针
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
39
I / O
O
GND
I
I
I
供应
I / O
I / O
I / O
GND
供应
I / O
I / O
I / O
I / O
I / O
GND
I
I
I
供应
I
GND
O
O
供应
GND
O
O
O
O
供应
GND
O
O
供应
O
O
O
数字地面1
解扰器片选输入端（低电平有效）
A1 =地址/数据指标输入
A0 =高字节指示输入
数字供电电压1 （ + 5V ）
微控制器的双向数据总线的第7位
微控制器的双向数据总线6位
微控制器的双向数据总线5位
为核心的数字地面1
数字供电电压2 （ + 5V）
微控制器的双向数据总线4位
微控制器的双向数据总线3位
单片机的双向数据总线位2
微控制器的双向数据总线位1
微控制器的双向数据总线的位0
数字地2
边界扫描测试数据输入
边界扫描测试时钟输入
边界扫描测试模式选择输入
数字供电电压3 （ +5 V）
描述
SAA7206H
中断请求输出的微控制器（低电平有效，漏极开路输出）
9兆赫解扰器芯片时钟输入（占空比范围： 3055 ％）
数字地面3
数据输出到多路分解器的位0
数据输出到多路分解器1位
数字供电电压4 （ + 5V）
数字地4
数据输出到多路分解器2位
数据输出到多路分用器3位
数据输出到多路分用器4位
数据输出到多路分解器5位
数字供电电压5 （ +5 V）
数字地5
数据输出到多路分解器6位
数据输出到多路分解器7位
数字电源电压为芯（ + 3.3V ）
边界扫描测试数据输出
有效的输出数据指标
表示传输数据包的网络连接第一个输出字节（同步）
1996年10月9日
5
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