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集成电路
数据表
SAA3323
对于DCC系统驱动处理器
初步speci fi cation
在集成电路， IC01文件
1994年5月
飞利浦半导体
飞利浦半导体
初步speci fi cation
对于DCC系统驱动处理器
特点
工作电源电压： 2.7 3.6 V
低功耗： 84毫瓦（典型值）
单芯片数字均衡器，磁带格式和错误
更正
8位快闪模拟 - 数字转换器（ADC ），用于低
误符号率
两个切换无限脉冲响应（ IIR）滤波器
节
每个主要的10抽头有限脉冲响应（ FIR）滤波器
数据信道，具有8位的系数，对于所有主
频道
10抽头的FIR滤波器对AUX通道
模拟和数字输出的眼睛
通过内部辅助信封触发中断信号线
例如加工标签，计数器和其他
强大的可编程数字PLL时钟提取装置
低功耗睡眠模式
压摆率限制电磁兼容性（ EMC ）
友好的输出
数码卡片盒（ DCC ）优化的错误
更正
可编程的符号同步策略胶带
输入数据
主导轴伺服可能时单片机控制
播放和录制
订购信息
包
类型编号
引脚
SAA3323H
SAA3323GP
记
80
80
脚位
TQFP80
(1)
QFP80
(1)
材料
塑料
塑料
SAA3323
主导轴伺服的频率和相位调节
在播放过程中
动态随机存取存储器的选择（ DRAM）的
和静态随机存取存储器（SRAM）的类型为
系统随机存取存储器（RAM）的
便签RAM的单片机系统RAM
精密自适应子带集成接口
编码（ PASC ）数据总线
三线微“ L3 ”界面
防止无效的辅助数据
录音间的无缝连接。
概述
对SAA3323进行了驱动处理器功能
DCC系统。这个功能是建立数字均衡器，
纠错和磁带格式的功能。数码
均衡器的目的是为使用DCC读放大器
TDA1318 TDA1380或。磁带格式和错误
校正电路用于与PASC集成电路使用
SAA2003和SAA2013 ，写放大器TDA1319或
TDA1381.
CODE
SOT315-1
SOT318-2
1.当使用回流焊接，建议在干包装说明
“质量参考
钱袋子“
遵循。钱袋子可以使用代码9398 510 34011订购。
1994年5月
2
飞利浦半导体
初步speci fi cation
对于DCC系统驱动处理器
框图
SAA3323
手册，全页宽
SAA3323
Digital-
到模拟
变流器
ANAEYE
RDSYNC
RDMUX
BIAS
Vref的（p）的
VREF （N ）
相
锁定
环
零
路口
FIR
(1)
IIR
(2)
类似物
至数字
变流器
TAPE
输入
卜FF器
SBDIR
SBMCLK
SBEF
SBDA
SBCL
SBWS
辅
信封
发现
均衡器
模块
子带
I
2
S
接口
内部数据总线
TAPE
产量
卜FF器
TCLOCK
WDATA
错误
校正
内存
接口
控制
接口
速度
乌尔达
RESET
睡觉
L3REF
L3DATA
8 11
6
MLB761
A11至A16
L3MODE
PINO1
PINO2
OEN
D0到D7
L3INT
文
A0到A10
（ 1 ） FIR =有限脉冲响应。
（ 2 ） IIR =无限脉冲响应。
图1框图。
1994年5月
3
L3CLK
PINI
飞利浦半导体
初步speci fi cation
对于DCC系统驱动处理器
钉扎
针
符号
QFP80
SBWS
SBCL
SBDA
SBDIR
SBMCLK
乌尔达
L3MODE
L3CLK
L3DATA
L3INT
V
DD1
V
SS1
L3REF
RESET
睡觉
CLK24
AZCHK
MCLK
TEST3
ERCOSTAT
OEN
A10/RAS
V
DD2
V
SS2
D7
D6
D5
D4
D3
D2
D1
V
DD7
V
SS7
D0
A0
A1
A2
A3
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
37
38
TQFP80
79
80
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
35
36
字选择的子带PASC接口
位时钟分频PASC接口
为子带的PASC接口数据线
方向线为子带的PASC接口
主时钟分频PASC接口
不可靠的数据
模线L3接口
位时钟线为三层接口
对于L3接口的串行数据线
L3中断输出
数字电源电压
数字地
L3总线时序参考
复位SAA3323
SAA3323的睡眠模式选择
24.576 MHz的时钟输入
通道0和通道7方位监控
6.144 MHz的时钟输出
TEST3输出;不连接
ERCO状态，符号错误率的测量
输出使能RAM
针对SRAM ; DRAM RAS
数字电源电压
数字地
数据SRAM
数据SRAM
数据SRAM
数据SRAM
数据SRAM ; DRAM数据
数据SRAM ; DRAM数据
数据SRAM ; DRAM数据
数字电源电压为RAM的
对于RAM数字地
数据SRAM ; DRAM数据
针对SRAM ;地址DRAM
针对SRAM ;地址DRAM
针对SRAM ;地址DRAM
针对SRAM ;地址DRAM
描述
SAA3323
TYPE
(1)
I / O（1 mA）的
I / O（1 mA）的
I / O（1 mA）的
O（1 mA）的
I
O（1 mA）的
I
I
I / O （ 2毫安）
O（1 mA）的
S
S
O（1 mA）的
I
I
I
O（1 mA）的
O（1 mA）的
O（1 mA）的
O（1 mA）的
O（ 2毫安）
O（ 2毫安）
S
S
I / O （4 mA）的
I / O （4 mA）的
I / O （4 mA）的
I / O （4 mA）的
I / O （4 mA）的
I / O （4 mA）的
I / O （4 mA）的
S
S
I / O （4 mA）的
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
1994年5月
4
飞利浦半导体
初步speci fi cation
对于DCC系统驱动处理器
SAA3323
针
符号
QFP80
A4
V
SS3
V
DD3
A5
A6
A7
A12/PINO5
A14/PINO1
A16/PINO3
A15/PINO4
文
A13/PINO2
A8
V
DD4
V
SS4
A9/CAS
A11
速度
PINO2
WDATA
TCLOCK
V
SS5
V
DD5
TEST2
RDMUX
V
REF（ P）
V
REF（ N）
SUBSTR
BIAS
V
SSA
V
DDA
ANAEYE
RDSYNC
V
DD6
V
SS6
CHTST1
CHTST2
TEST0
TEST1
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
77
TQFP80
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
针对SRAM ;地址DRAM
数字地
数字电源电压
针对SRAM ;地址DRAM
针对SRAM ;地址DRAM
针对SRAM ;地址DRAM
针对SRAM ;端口扩展输出5
针对SRAM ;端口扩展输出1
针对SRAM ;端口扩展输出3
针对SRAM ;端口扩展输出4
写使能的RAM
针对SRAM ;端口扩展输出2
针对SRAM ;地址DRAM
数字电源电压
数字地
针对SRAM ; CAS的DRAM
地址SRAM
端口扩展输出2
串行输出，写入扩增fi er
3.072 MHz时钟输出，带I / O
数字地
数字电源电压
测试模式选择;不连接
读出放大器器的模拟输入多路复用
ADC正参考电压
ADC负参考电压
基板连接
偏置电流的ADC
模拟地
模拟电源电压
模拟眼图输出
同步输出读扩增fi er
数字电源电压
数字地
信道测试引脚1
信道测试引脚2
测试模式选择;不连接
测试模式选择;不连接
描述
TYPE
(1)
O（ 2毫安）
S
S
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
O（ 2毫安）
S
S
O（ 2毫安）
O（ 2毫安）
O
t
（1 mA）的
O（1 mA）的
O（1 mA）的
S
S
I
pd
I
A
I
A
I
A
I
A
I
A
S
S
O
A
O（1 mA）的
S
S
O（1 mA）的
O（1 mA）的
I
pd
I
pd
脉冲宽度调制（ PWM ）绞盘控制输出的甲板
t
（1 mA）的
1994年5月
5
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