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位置:首页 > IC型号导航 > 首字符S型号页 > 首字符S的型号第1368页 > S3C4530A
S3C4530A
产品概述
1
产品概述
介绍
三星的S3C4530A 16位/ 32位RISC微控制器是一款高性价比,高性能的微控制器
溶液为基于以太网的系统。集成的以太网控制器,所述S3C4530A ,被设计用于在使用中
管理通信集线器和路由器。
在S3C4530A是围绕一个优秀的CPU内核: 16位/ 32位ARM7TDMI RISC处理器所设计的
先进RISC机器公司的ARM7TDMI内核是一个低功耗,通用微处理器宏单元
这是因为在特定应用和定制专用集成电路使用而开发的。它的简单,优雅,
全静态设计特别适合于对成本敏感和功率敏感的应用。
在S3C4530A提供了一个可配置的8 KB的统一高速缓存/ SRAM和以太网控制器,从而降低了总
系统的成本。大多数片上功能块已被使用的是高密度脂蛋白合成器和设计
S3C4530A已经在国家的最先进的三星的ASIC测试环境中得到了充分的验证。
重要的外设功能包括两个HDLC通道缓冲区描述符,双UART通道全
调制解调器接口信号和32字节的缓冲区, 2路GDMA , 2个32位定时器和26个可编程I / O口。
板载逻辑包括一个中断控制器, DRAM / SDRAM控制器,以及一个控制器,用于ROM / SRAM和
闪存。在系统管理器中包括一个内部32位系统总线仲裁器和一个外部存储器
控制器。
以下集成的片上功能进行了详细的本用户手册中的说明:
- 8 KB的统一高速缓存/ SRAM
— I
2
C接口
■以太网控制器
HDLC控制器
- GDMA
- UART
- 定时器
可编程I / O端口
中断控制器
1-1
产品概述
S3C4530A
特点
架构
集成系统的嵌入式以太网
应用
完全16位/ 32位RISC架构
小/大端模式支持基本的
内部结构是大端。
所以,小端模式仅适用于支持
外部存储器。
高效,功能强大的ARM7TDMI内核
具有成本效益的基于JTAG的调试解决方案
边界扫描
数据对齐逻辑
尾数翻译
一十分之百兆位每秒的运算
完全符合IEEE 802.3标准
MII ( 10 / 100Mbps的)或7线10 Mbps接口
站管理信号
片上的CAM (最多21目的地址)
用PAUSE功能的全双工模式
长/短包模式
PAD代
系统管理
8位/ 16位/ 32位外部总线支持
ROM / SRAM,闪速存储器,DRAM和
外部I / O
一个外部总线主机总线请求/
确认销
支持EDO /正常或SDRAM
可编程访问周期( 0-7个等待周期)
四字深度写缓冲
高性价比的存储器到外设DMA
接口
的HDLCS
HDLC协议的特点:
标志检测和同步
零插入和删除
空闲检测和传输
FCS生成和检测( 16位)
终止检测和传输
地址检索模式(可扩展到4个字节)
可选的CRC或无CRC模式
自动CRC生成器预设
数字PLL模块的时钟恢复
波特率发生器
NRZ / NRZI / FM /曼彻斯特的数据格式
TX / RX
环回和自动回声模式
TX / RX FIFO中有8个字( 8
×
32位)深度
可选1字或4个字的数据传输模式
数据对齐逻辑
尾数翻译
可编程中断
调制解调器接口
高达10 Mbps的操作
基于八位HDLC帧的长度
双通道DMA缓冲区描述符的Tx / Rx上
每个HDLC
统一的指令/数据缓存
两路,组相联的,统一的8 KB的缓存
支持的LRU (最近最少使用)协议
缓存可配置为内部SRAM
I
2
C接口
只有主模式下工作
串行时钟产生波特率发生器
以太网控制器
DMA引擎,连拍模式
的DMA的Tx / Rx缓冲器(256字节的Tx ,256字节
RX )
MAC的Tx / Rx FIFO缓冲器( 80字节TX, 16个字节
RX )
1-2
S3C4530A
产品概述
DMA控制器
2通道通用DMA存储器,用于─
内存,内存到UART , UART至内存
无需CPU干预的数据传输
通过软件或外部DMA请求启动
递增或递减的源或
在8位, 16位或32位数据的目的地址
转帐
4 ,数据突发模式
可编程I / O
26个可编程I / O口
引脚可单独配置为输入,输出或
I / O模式的专用信号
中断控制器
21个中断源,其中包括4个外部
中断源
正常或快速中断模式( IRQ , FIQ )
优先级的中断处理
个UART
与基于DMA的两个UART (串行I / O)模块
或基于中断的操作
高速( 460Kbps ) UART支持, 32
字节的Tx / Rx FIFO和调制解调器接口信号
支持为5位, 6位, 7位或8位的串行数据
发送和接收
自动波特率检测
八个控制字符比较软件
控制
可编程的波特率
1或2个停止位
奇或偶校验
中止的产生和检测
奇偶,溢出错误和帧错误检测
×16
时钟模式
红外( IR ) TX / RX的支持(IRDA )
PLL
外部时钟可以通过片上相乘
PLL来提供高频系统时钟
输入频率范围为1040兆赫
输出频率是输入时钟的5倍。
为了获得50MHz的输入时钟频率应为
10兆赫。
工作电压范围
3.3 V
±
5
%
工作温度范围
o
o
0℃至+ 70℃
工作频率
高达50 MHz
套餐类型
计时器
两个可编程32位定时器
间隔模式或切换模式操作
208引脚QFP
1-3
产品概述
S3C4530A
ARM7TDMI
32位CPU RISE
6-bank
只读存储器
SRAM
FL灰
4-bank
DRAM
4-bank
I / O
设备
公共汽车
CPU接口
内存
调节器
刷新
控制
8-Kbyte
统一网络版
缓存
4-Word
卜FF器
系统
公共汽车
ARBITER
公交Rounter
SCL
SDA
26个I / O端口,包括
4 :外部INT REQ 。
2 :定时器输出( 0,1)
2 :外部DMA请求。
2 :外部DMA ACK
14 : UART
控制台或
调制解调器I / F
I
2
C
26通用I / O端口
Interruput控制器
UART 0,1
32位定时器0,1
GDMA 0,1
PLL
TAP控制器JTAG
苹果
TX FIFO ( 80字节)
Rx FIFO的(16字节)
MII或
7-wire
BDMA的RAM
Tx缓冲器(256字节)
Rx缓冲区(256字节)
CAM ( 128字节)
2通道的HDLCS
用的DMA
以太网控制器
2通道BDMA
远程
PORT A,B
图1-1 。 S3C4530A框图
1-4
S3C4530A
V
DD
V
SS
nUADSR1/P<23>
UATXD1/P<24>
nUADTR1/P<25>
NDTRA
RXDA
NRTSA
TXDA
NCTSA
V
DD
V
SS
NDCDA
RXCA
nSYNCA
TXCA
NDTRB
RXDB
NRTSB
TXDB
V
DD
V
SS
NCTSB
NDCDB
RXCB
nSYNCB
TXCB
CRS / CRS_ 10M
RX DV / LINK_10M
RXD<0>/RXD_10M
V
DD
V
SS
RXD<1>
RXD<2>
RXD<3>
RX ERR
RX_CLK/RXCLK_10M
COL/COL_10M
TXD<0>/TXD_10M
TXD<1>/LOOP_10M
V
DD
V
SS
TXD<2>
TXD<3>
Tx_ERR/POCMP_10M
TXCLK/TXCLK_10M
TX_EN/TXEN_10M
MDIO
MDC
V
DD
V
SS
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
29
30
31
32
33
34
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42
43
44
45
46
47
48
49
50
51
52
S3C4530A
(208-QFP)
图1-2 。 S3C4530A引脚分配图
156
155
154
153
152
151
150
149
148
147
146
145
144
143
142
141
140
139
138
137
136
135
134
133
132
131
130
129
128
127
126
125
124
123
122
121
120
119
118
117
116
115
114
113
112
111
110
109
108
107
106
105
V
SS
V
DD
XDATA<16>
XDATA<15>
XDATA<14>
XDATA<13>
XDATA<12>
XDATA<11>
XDATA<10>
XDATA<9>
XDATA<8>
XDATA<7>
XDATA<6>
V
SS
V
DD
XDATA<5>
XDATA<4>
XDATA<3>
XDATA<2>
XDATA<1>
XDATA<0>
ADDR<21>
ADDR<20>
ADDR<19>
ADDR<18>
V
SS
V
DD
ADDR<17>
ADDR<16>
ADDR<15>
ADDR<14>
ADDR<13>
ADDR<12>
ADDR<11>
ADDR<10>/AP
ADDR<9>
ADDR<8>
V
SS
V
DD
ADDR<7>
ADDR<6>
ADDR<5>
ADDR<4>
ADDR<3>
ADDR<2>
ADDR<1>
ADDR<0>
ExtMACK
ExtMREQ
nWBE<3>/DQM<3>
V
SS
V
DD
V
DDA
V
SSA
滤波器
V
DD
V
SS
TCK
TMS
TDI
TD0
nTRST信号
TMODE
UCLK
V
DD
V
SS
nECS<0>
nECS<1>
nECS<2>
nECS<3>
nEWAIT
诺埃
BOSIZE<0>
BOSIZE<1>
nRCS<0>
CLKOEN
SDCLK / MCLKO
V
DD
V
SS
XCLK
V
SS
n重设
CLKSEL
nRCS<1>
nRCS<2>
nRCS<3>
nRCS<4>
nRCS<5>
nSDCS<0>/nRAS<0>
nSDCS<1>/nRAS<1>
nSDCS<2>/nRAS<2>
V
DD
V
SS
nSDCS<3>/nRAS<3>
nSDRAS/nCAS<0>
nSDCAS/nCAS<2>
CKE/nCAS<2>
nCAS<3>
NDWE
DQM<0>/nWBE<0>
DQM<1>/nWBE<1>
DQM<2>/nWBE<2>
V
DD
V
SS
53
54
55
56
57
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70
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90
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208
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206
205
204
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202
201
200
199
198
197
196
195
194
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191
190
189
188
187
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180
179
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160
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157
V
SS
V
DD
UARXD1/P<22>
nUADTR0/P<21>
UATXD0/P<20>
nUADSR0/P<19>
UARXD0/P<18>
SDA
SCA
P<17>/TOUT1
V
SS
V
DD
P<16>/TOUT0
P<15>/nXDACK<1>
P<14>/nXDACK<0>
P<13>/nXDREQ<1>
P<12>/nXDREQ<0>
P<11>/XINREQ<3>
P<10>/XINREQ<2>
P<9>/XINREQ<1>
V
SS
V
DD
P<8>/XINREQ<0>
P<7>/nUARTS1
P<6>/nUACTS1
P<5>/nUADCD1
P<4>/nUARTS0
P<3>/nUACTS0
P<2>/nUADCD0
P<1>
V
SS
V
DD
P<0>
XDATA<31>
XDATA<30>
XDATA<29>
XDATA<28>
XDATA<27>
XDATA<26>
XDATA<25>
V
SS
V
DD
XDATA<24>
XDATA<23>
XDATA<22>
XDATA<21>
XDATA<20>
XDATA<19>
XDATA<18>
XDATA<17>
V
SS
V
DD
产品概述
1-5
S3C4530A
产品概述
1
产品概述
介绍
三星的S3C4530A 16位/ 32位RISC微控制器是一款高性价比,高性能的微控制器
溶液为基于以太网的系统。集成的以太网控制器,所述S3C4530A ,被设计用于在使用中
管理通信集线器和路由器。
在S3C4530A是围绕一个优秀的CPU内核: 16位/ 32位ARM7TDMI RISC处理器所设计的
先进RISC机器公司的ARM7TDMI内核是一个低功耗,通用微处理器宏单元
这是因为在特定应用和定制专用集成电路使用而开发的。它的简单,优雅,
全静态设计特别适合于对成本敏感和功率敏感的应用。
在S3C4530A提供了一个可配置的8 KB的统一高速缓存/ SRAM和以太网控制器,从而降低了总
系统的成本。大多数片上功能块已被使用的是高密度脂蛋白合成器和设计
S3C4530A已经在国家的最先进的三星的ASIC测试环境中得到了充分的验证。
重要的外设功能包括两个HDLC通道缓冲区描述符,双UART通道全
调制解调器接口信号和32字节的缓冲区, 2路GDMA , 2个32位定时器和26个可编程I / O口。
板载逻辑包括一个中断控制器, DRAM / SDRAM控制器,以及一个控制器,用于ROM / SRAM和
闪存。在系统管理器中包括一个内部32位系统总线仲裁器和一个外部存储器
控制器。
以下集成的片上功能进行了详细的本用户手册中的说明:
- 8 KB的统一高速缓存/ SRAM
— I
2
C接口
■以太网控制器
HDLC控制器
- GDMA
- UART
- 定时器
可编程I / O端口
中断控制器
1-1
产品概述
S3C4530A
特点
架构
集成系统的嵌入式以太网
应用
完全16位/ 32位RISC架构
小/大端模式支持基本的
内部结构是大端。
所以,小端模式仅适用于支持
外部存储器。
高效,功能强大的ARM7TDMI内核
具有成本效益的基于JTAG的调试解决方案
边界扫描
数据对齐逻辑
尾数翻译
一十分之百兆位每秒的运算
完全符合IEEE 802.3标准
MII ( 10 / 100Mbps的)或7线10 Mbps接口
站管理信号
片上的CAM (最多21目的地址)
用PAUSE功能的全双工模式
长/短包模式
PAD代
系统管理
8位/ 16位/ 32位外部总线支持
ROM / SRAM,闪速存储器,DRAM和
外部I / O
一个外部总线主机总线请求/
确认销
支持EDO /正常或SDRAM
可编程访问周期( 0-7个等待周期)
四字深度写缓冲
高性价比的存储器到外设DMA
接口
的HDLCS
HDLC协议的特点:
标志检测和同步
零插入和删除
空闲检测和传输
FCS生成和检测( 16位)
终止检测和传输
地址检索模式(可扩展到4个字节)
可选的CRC或无CRC模式
自动CRC生成器预设
数字PLL模块的时钟恢复
波特率发生器
NRZ / NRZI / FM /曼彻斯特的数据格式
TX / RX
环回和自动回声模式
TX / RX FIFO中有8个字( 8
×
32位)深度
可选1字或4个字的数据传输模式
数据对齐逻辑
尾数翻译
可编程中断
调制解调器接口
高达10 Mbps的操作
基于八位HDLC帧的长度
双通道DMA缓冲区描述符的Tx / Rx上
每个HDLC
统一的指令/数据缓存
两路,组相联的,统一的8 KB的缓存
支持的LRU (最近最少使用)协议
缓存可配置为内部SRAM
I
2
C接口
只有主模式下工作
串行时钟产生波特率发生器
以太网控制器
DMA引擎,连拍模式
的DMA的Tx / Rx缓冲器(256字节的Tx ,256字节
RX )
MAC的Tx / Rx FIFO缓冲器( 80字节TX, 16个字节
RX )
1-2
S3C4530A
产品概述
DMA控制器
2通道通用DMA存储器,用于─
内存,内存到UART , UART至内存
无需CPU干预的数据传输
通过软件或外部DMA请求启动
递增或递减的源或
在8位, 16位或32位数据的目的地址
转帐
4 ,数据突发模式
可编程I / O
26个可编程I / O口
引脚可单独配置为输入,输出或
I / O模式的专用信号
中断控制器
21个中断源,其中包括4个外部
中断源
正常或快速中断模式( IRQ , FIQ )
优先级的中断处理
个UART
与基于DMA的两个UART (串行I / O)模块
或基于中断的操作
高速( 460Kbps ) UART支持, 32
字节的Tx / Rx FIFO和调制解调器接口信号
支持为5位, 6位, 7位或8位的串行数据
发送和接收
自动波特率检测
八个控制字符比较软件
控制
可编程的波特率
1或2个停止位
奇或偶校验
中止的产生和检测
奇偶,溢出错误和帧错误检测
×16
时钟模式
红外( IR ) TX / RX的支持(IRDA )
PLL
外部时钟可以通过片上相乘
PLL来提供高频系统时钟
输入频率范围为1040兆赫
输出频率是输入时钟的5倍。
为了获得50MHz的输入时钟频率应为
10兆赫。
工作电压范围
3.3 V
±
5
%
工作温度范围
o
o
0℃至+ 70℃
工作频率
高达50 MHz
套餐类型
计时器
两个可编程32位定时器
间隔模式或切换模式操作
208引脚QFP
1-3
产品概述
S3C4530A
ARM7TDMI
32位CPU RISE
6-bank
只读存储器
SRAM
FL灰
4-bank
DRAM
4-bank
I / O
设备
公共汽车
CPU接口
内存
调节器
刷新
控制
8-Kbyte
统一网络版
缓存
4-Word
卜FF器
系统
公共汽车
ARBITER
公交Rounter
SCL
SDA
26个I / O端口,包括
4 :外部INT REQ 。
2 :定时器输出( 0,1)
2 :外部DMA请求。
2 :外部DMA ACK
14 : UART
控制台或
调制解调器I / F
I
2
C
26通用I / O端口
Interruput控制器
UART 0,1
32位定时器0,1
GDMA 0,1
PLL
TAP控制器JTAG
苹果
TX FIFO ( 80字节)
Rx FIFO的(16字节)
MII或
7-wire
BDMA的RAM
Tx缓冲器(256字节)
Rx缓冲区(256字节)
CAM ( 128字节)
2通道的HDLCS
用的DMA
以太网控制器
2通道BDMA
远程
PORT A,B
图1-1 。 S3C4530A框图
1-4
S3C4530A
V
DD
V
SS
nUADSR1/P<23>
UATXD1/P<24>
nUADTR1/P<25>
NDTRA
RXDA
NRTSA
TXDA
NCTSA
V
DD
V
SS
NDCDA
RXCA
nSYNCA
TXCA
NDTRB
RXDB
NRTSB
TXDB
V
DD
V
SS
NCTSB
NDCDB
RXCB
nSYNCB
TXCB
CRS / CRS_ 10M
RX DV / LINK_10M
RXD<0>/RXD_10M
V
DD
V
SS
RXD<1>
RXD<2>
RXD<3>
RX ERR
RX_CLK/RXCLK_10M
COL/COL_10M
TXD<0>/TXD_10M
TXD<1>/LOOP_10M
V
DD
V
SS
TXD<2>
TXD<3>
Tx_ERR/POCMP_10M
TXCLK/TXCLK_10M
TX_EN/TXEN_10M
MDIO
MDC
V
DD
V
SS
1
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S3C4530A
(208-QFP)
图1-2 。 S3C4530A引脚分配图
156
155
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V
SS
V
DD
XDATA<16>
XDATA<15>
XDATA<14>
XDATA<13>
XDATA<12>
XDATA<11>
XDATA<10>
XDATA<9>
XDATA<8>
XDATA<7>
XDATA<6>
V
SS
V
DD
XDATA<5>
XDATA<4>
XDATA<3>
XDATA<2>
XDATA<1>
XDATA<0>
ADDR<21>
ADDR<20>
ADDR<19>
ADDR<18>
V
SS
V
DD
ADDR<17>
ADDR<16>
ADDR<15>
ADDR<14>
ADDR<13>
ADDR<12>
ADDR<11>
ADDR<10>/AP
ADDR<9>
ADDR<8>
V
SS
V
DD
ADDR<7>
ADDR<6>
ADDR<5>
ADDR<4>
ADDR<3>
ADDR<2>
ADDR<1>
ADDR<0>
ExtMACK
ExtMREQ
nWBE<3>/DQM<3>
V
SS
V
DD
V
DDA
V
SSA
滤波器
V
DD
V
SS
TCK
TMS
TDI
TD0
nTRST信号
TMODE
UCLK
V
DD
V
SS
nECS<0>
nECS<1>
nECS<2>
nECS<3>
nEWAIT
诺埃
BOSIZE<0>
BOSIZE<1>
nRCS<0>
CLKOEN
SDCLK / MCLKO
V
DD
V
SS
XCLK
V
SS
n重设
CLKSEL
nRCS<1>
nRCS<2>
nRCS<3>
nRCS<4>
nRCS<5>
nSDCS<0>/nRAS<0>
nSDCS<1>/nRAS<1>
nSDCS<2>/nRAS<2>
V
DD
V
SS
nSDCS<3>/nRAS<3>
nSDRAS/nCAS<0>
nSDCAS/nCAS<2>
CKE/nCAS<2>
nCAS<3>
NDWE
DQM<0>/nWBE<0>
DQM<1>/nWBE<1>
DQM<2>/nWBE<2>
V
DD
V
SS
53
54
55
56
57
58
59
60
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104
208
207
206
205
204
203
202
201
200
199
198
197
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195
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192
191
190
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164
163
162
161
160
159
158
157
V
SS
V
DD
UARXD1/P<22>
nUADTR0/P<21>
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nUADSR0/P<19>
UARXD0/P<18>
SDA
SCA
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V
SS
V
DD
P<16>/TOUT0
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SS
V
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P<8>/XINREQ<0>
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P<2>/nUADCD0
P<1>
V
SS
V
DD
P<0>
XDATA<31>
XDATA<30>
XDATA<29>
XDATA<28>
XDATA<27>
XDATA<26>
XDATA<25>
V
SS
V
DD
XDATA<24>
XDATA<23>
XDATA<22>
XDATA<21>
XDATA<20>
XDATA<19>
XDATA<18>
XDATA<17>
V
SS
V
DD
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