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位置:首页 > IC型号导航 > 首字符R型号页 > 首字符R的型号第81页 > RIVA128ZX
RIVA 128ZX
128位3D多媒体加速器
初步数据
主要特点
快速32位的VGA / SVGA
高性能的128位2D / GUI / DirectDraw的
促进
互动性,真实感Direct3D的加速度
化有先进的特效
引脚排列与RIVA 128向后兼容
海量1.6Gbytes /秒, 100MHz的128位宽的
现象8字节SGRAM帧缓存接口
增加了对成本敏感的16Mbit的SDRAM支持
现象8字节的帧缓冲应用
视频加速的的DirectDraw / DirectVideo ,
的MPEG -1/2和的Indeo
- 平面4 : 2 : 0和包装4 : 2 : 2色彩空间
转变
- X和Y平滑上下缩放
250MHz的调色板-DAC支持高达
1600x1200@85Hz
NTSC和PAL输出闪烁过滤器
多功能视频端口和串行接口
框图
总线主控DMA加速图形端口
( AGP ) 1.0接口,支持133MHz的2倍
数据传输模式
总线主控DMA的PCI 2.1接口
ACPI电源管理接口支持
0.35微米CMOS 5LM
300 PBGA
描述
该RIVA128ZX 提供无与伦比的2D和3D
性能,满足的所有要求
主流的PC图形市场,微软
PC'97 。 RIVA128ZX融合的所有特征
RIVA 128加现象8字节的SDRAM和SGRAM
基于帧存储,并支持AGP 2X的数据传输
FER 。它提供了最先进的Direct3D AC-
celeration解决方案,并提供VGA领导,
2D和视频性能,从而实现了一系列的
通过对DVD ,会期从3D游戏的应用
tercast 和视频会议。
1.6 GB的/秒
内部总线
带宽
DMA总线
视频端口
DMA引擎
CCIR656
视频
PCI / AGP
主持人
接口
FIFO /
DMA
图形引擎
128位2D
Direct3D
DMA引擎
内部总线
调色板DAC
YUV - RGB ,
X & 洁牙机
8MByte
SDRAM / SGRAM
接口
监视器/
TV
VGA
128位
接口
1998年6月
本数据表中的信息可随时更改
7071857 00
1/85
RIVA128ZX
128位3D多媒体加速器
目录
1
2
RIVA128ZX 300PBGA器件的引脚.............................................. .........................................
引脚说明......................................................................................................................
2.1加速图形端口( AGP )接口.......................................... ...........
2.2 2.1 PCI本地总线接口............................................ ............................................
2.3 FRAMEBUFFER接口............................................... ...............................................
2.4视频PORT.........................................................................................................................
2.5设备使能信号.............................................. .................................................. ..
2.6显示接口..........................................................................................................
2.7视频DAC和PLL的模拟信号........................................... ...............................
2.8电源..................................................................................................................
2.9 TEST......................................................................................................................................
THE RIVA128ZX概述.............................................. .................................................. ..
3.1平衡PC SYSTEM......................................................................................................
3.2主机接口...............................................................................................................
3.3 2D加速.............................................................................................................
3.4 3D引擎...........................................................................................................................
3.5视频PROCESSOR............................................................................................................
3.6视频PORT.........................................................................................................................
3.7直接RGB输出成本低的PAL / NTSC编码器....................................... ..
3.8支撑作用STANDARDS..............................................................................................
3.9决议SUPPORTED..............................................................................................
3.10客户评估套件.............................................. ..............................................
3.11一站式制造包装.............................................. .............................
加速图形端口( AGP )接口........................................... ..................
4.1 RIVA128ZX AGP接口.............................................. ................................................
4.2 AGP总线TRANSACTIONS..................................................................................................
2.1 PCI局部总线INTERFACE.................................................................................................
5.1 RIVA128ZX PCI接口.............................................. .................................................
5.2 PCI时序规格.............................................. .................................................
FRAMEBUFFER接口.......................................................................................................
6.1 SDRAM接口............................................................................................................
6.2 SGRAM接口............................................................................................................
6.3 SDRAM / SGRAM访问和命令........................................... .....................
6.4布局FRAMEBUFFER时钟信号............................................ ....................
6.5 FRAMEBUFFER接口时序规格............................................. .......
视频播放ARCHITECTURE...........................................................................................
7.1视频转换器管道.............................................. .................................................. ...
视频端口..................................................................................................................................
8.1视频接口端口特性............................................. ..................................
8.2双向MEDIA PORT轮询命令中使用MPC ..............................
8.3时序图..............................................................................................................
8.4 656主模式.............................................................................................................
8.5 VBI处理在视频端口........................................... ......................................
8.6结垢视频端口............................................ ...............................................
BOOT ROM INTERFACE...............................................................................................................
4
5
5
5
7
7
8
8
8
8
9
10
10
10
11
11
11
12
12
12
12
13
13
14
15
15
23
23
24
30
31
32
35
37
37
42
43
45
45
46
47
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52
52
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3
4
5
6
7
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9
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128位3D多媒体加速器
10
11
RIVA128ZX
55
57
57
57
58
59
60
61
63
63
63
64
64
64
64
65
65
66
67
67
68
68
69
69
69
上电复位CONFIGURATION........................................................................................
显示接口...................................................................................................................
11.1 PALETTE -DAC ......................................................................................................................
11.2像素模式支持.............................................. .................................................
11.3硬件光标.........................................................................................................
11.4串行INTERFACE.............................................................................................................
11.5模拟接口..........................................................................................................
11.6电视输出支持........................................................................................................
在电路板测试......................................................................................................
12.1测试模块.......................................................................................................................
12.2校验和测试................................................................................................................
电气规范................................................ ..................................................
13.1绝对最大额定值.............................................. ..........................................
13.2操作条件............................................... .................................................. 。
13.3 DC SPECIFICATIONS...........................................................................................................
13.4电气特性............................................... ...........................................
13.5 DAC特性............................................... .................................................. ...
13.6频率合成特性.............................................. ..................
包装尺寸规格............................................... .....................................
14.1 300引脚球栅阵列封装........................................... ...................................
REFERENCES................................................................................................................................
12
13
14
15
16订购信息..........................................................................................................
附录...............................................................................................................................................
A
PCI配置寄存器............................................... ..............................................
A.1寄存器说明PCI配置空间....................................
3/85
1
笔记
RIVA128ZX
4/85
4
FBD[17]
FBD[19]
FBD[21]
FBD[23]
FBDQM[2]
FBA[0]
FBA[2]
FBA[4]
FBA[6]
FBA[8]
FBDQM[5]
FBD[41]
FBD[43]
FBD[45]
FBD[47]
FBD[56]
FBD[57]
1
2
3
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
RIVA128ZX 300PBGA器件的引脚
1
2
FBD[18]
FBD[20]
FBD[22]
FBDQM[0]
FBA[9]
FBA[1]
FBA[3]
FBA[5]
FBA[7]
FBCLK1
FBDQM[7]
FBD[40]
FBD[42]
FBD[44]
FBD[46]
FBD[58]
FBD[59]
FBD[27]
FBD[26]
FBD[25]
FBD[15]
FBD[13]
FBD[11]
FBD[9]
FBDQM[1]
FBWE #
FBRAS #
FBA[10]
FBDQM[4]
FBD[55]
FBD[54]
FBD[53]
FBD[60]
FBD[61]
FBD[30]
VDD
FBD[24]
FBD[14]
FBD[12]
FBD[10]
FBD[8]
FBDQM[3]
FBCAS #
FBCS0
FBCS1
FBDQM[6]
VDD
FBD[52]
FBD[51]
FBD[62]
FBD[63]
VDD
网卡
VDD
VDD
VDD
A
FBD[4]
FBD[6]
FBD[7]
B
FBD[3]
FBD[5]
FBD[16]
C
FBD[1]
FBD[2]
FBD[28]
D
FBCKE
VDD
VDD
VDD
VDD
FBCLK0
FBD[0]
FBD[29]
E
FBCLKFB
VDD
VDD
FBD[48]
SCL
FBCLK2
FBD[31]
FBD[50]
FBD[39]
FBD[38]
F
MP_AD[4]
MPCLAMP
VDD
MP_AD[6]
网卡
SDA
FBD[49]
FBD[37]
FBD[36]
G
MP_AD[3]
VDD
MPFRAME # MP_AD [7]
MP_AD[5]
FBD[35]
FBD[34]
FBD[33]
FBD[32]
H
MP_AD[0]
GND
GND
GND
GND
MP_AD[2]
MPSTOP #
MPCLK
网卡
FBDQM [12] FBDQM [14] FBDQM [15] FBDQM [13]
J
GND
GND
GND
GND
FBDQM [8] MPDTACK # MP_AD [1]
FBD[118]
FBD[119]
FBD[105]
FBD[104]
K
FBD[73]
GND
GND
GND
GND
FBDQM[9]
FBD[87]
FBDQM [10] FBDQM [11]
FBD[116]
FBD[117]
FBD[107]
FBD[106]
L
FBD[75]
GND
GND
GND
GND
FBD[86]
FBD[85]
FBD[72]
FBD[114]
FBD[115]
FBD[109]
FBD[108]
M
FBD[77]
网卡
FBD[84]
FBD[83]
FBD[74]
FBD[112]
FBD[113]
FBD[111]
FBD[110]
N
FBD[79]
VDD
FBD[82]
FBD[81]
FBD[76]
网卡
FBD[102]
FBD[103]
FBD[121]
FBD[120]
P
FBD[89]
网卡
FBD[80]
FBD[71]
FBD[78]
VDD
FBD[100]
FBD[101]
FBD[123]
FBD[122]
R
VDD
网卡
HOSTVDD HOSTVDD
基于主机
FBD[70]
FBD[69]
FBD[88]
网卡
FBD[98]
FBD[99]
FBD[125]
FBD[124]
T
FBD[91]
基于主机
XTALOUT
PCIRST #
AGPST[1]
FBD[68]
FBD[67]
FBD[90]
HOSTVDD
基于主机
HOSTVDD
基于主机
VDD
FBD[97]
FBD[127]
FBD[126]
U
DACVDD
VREF
PCIINTA #
PCIGNT #
FBD[66]
FBD[65]
FBD[92]
PCIAD [30] PCIAD [26] PCICBE # [3] PCIAD [20] PCIAD [16] PCITRDY #
PCIPAR
HOSTVDD PCICBE # [ 0 ]
FBD[96]
VIDVSYNC VIDHSYNC
V
COMP
PLLVDD
PCIREQ #
AGPST[2]
FBD[64]
FBD[95]
AGPPIPE # PCIAD [28] PCIAD [24] PCIAD [22]
PCIAD [18] PCIFRAME # PCISTOP # PCIAD [15] PCIAD [11]
PCIAD[6]
PCIAD [2] TESTMODE ROMCS #
W
XTALIN
PCICLK
AGPST[0]
FBD[93]
FBD[94]
PCIAD [31] PCIAD [ 27 ]
AGPAD-
STB1
PCIAD[21]
PCIAD[17]
PCIIRDY # PCICBE # [1] PCIAD [ 13 ]
PCIAD[9]
PCIAD[4]
PCIAD[0]
PCIAD[7]
PCIAD[5]
NIC =无内部连接。请勿连接到这些引脚。
VDD=3.3V
带星号的信号被定义为将来的扩展。看
引脚说明,
第2,第5页。
PCIIDSEL /
PCI-
PCIAD [29] PCIAD [25] PCIAD [23] PCIAD [19] PCICBE # [2]
AGPRBF #
DEVSEL #
PCIAD [14] PCIAD [12] PCIAD [10]
PCIAD[8]
AGPAD-
STB0
PCIAD[3]
PCIAD[1]
128位3D多媒体加速器
Y
绿色
GND
RSET
128位3D多媒体加速器
2
2.1
引脚说明
加速图形端口( AGP )接口
I / O
I
描述
RIVA128ZX
信号
AGPST [2 :0]的
AGP的状态总线提供来自所述仲裁器的信息的RIVA128ZX于它可以
DO 。
AGPST [2 :0]的
唯一有意义的RIVA128ZX时
PCIGNT #
为有效。当
PCIGNT #
被解除断言,这些信号没有意义并且必须被忽略。
000
001
010
011
100
101
110
111
表示先前请求的优先级低的读取或刷新数据正在
返回到RIVA128ZX 。
表示先前请求高优先级读出的数据被返回到
该RIVA128ZX 。
表示该RIVA128ZX是提供低优先级的写入数据为先前
排队的写命令。
表示该RIVA128ZX是提供高优先级的写入数据为先前
排队的写命令。
版权所有
版权所有
版权所有
指示RIVA128ZX已经获准开始公车交易
化。该RIVA128ZX可以通过排队断言AGP请求
AGPPIPE #
or
通过发出启动一个PCI交易
PCIFRAME # 。 AGPST [2 :0]的
总是一个
从核心逻辑( AGP芯片组)和一个输入到RIVA128ZX输出。
AGPRBF #
O
读缓冲区满时,指的RIVA128ZX准备接受先前请求
低优先级的读数据或没有。当
AGPRBF #
被断言的仲裁器是不允许
返回(低优先级)读取数据到RIVA128ZX 。这个信号应通过一个上拉
4.7KΩ电阻(尽管它应该是把车停在主板芯片组) 。
流水线读的断言RIVA128ZX (当Master )来表示一个完整的
宽度读地址是由目标来排队。该RIVA128ZX入队1
要求每个时钟上升沿时
AGPPIPE #
为有效。当
AGPPIPE #
DE-是
没有维护新的请求跨排队
PCIAD [31:0 ] 。 AGPPIPE #
在持续
从RIVA128ZX三态信号,并且是一输入到目标(核心逻辑)。
总线选通信号对AGP 2X的数据传输模式,提供定时
PCIAD [ 15:00 ]
PCIAD [ 31:16 ]
分别。所供给的数据的代理驱动这些信号。
AGPPIPE #
O
AGPADSTB0,
AGPADSTB1
I / O
2.2
2.1 PCI本地总线接口
I / O
I
描述
PCI时钟。这个信号提供定时对PCI总线上的所有交易,除
PCIRST #
PCIINTA # 。
所有的PCI信号被采样到的上升沿
PCICLK
所有定时参数被定义为相对于该边缘。
PCI复位。这个信号被用来把寄存器,音序器和信号以一致的
状态。当
PCIRST #
为有效信号是三态的所有输出。
32位复用的地址和数据总线。一个总线事务由一个地址相
接着是一个或多个数据段。
信号
PCICLK
PCIRST #
PCIAD [31 :0]的
I
I / O
5/85
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    电话:0755-82780082
    联系人:杨小姐
    地址:深圳市福田区振兴路156号上步工业区405栋3层

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    -
    -
    -
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电话:0755-83242658
联系人:廖先生
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