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16位I / O扩展器IC
PT8300
描述
PT8300是采用CMOS技术,提供16位的I / O扩展串行输入,并行输出
8位并行输入串行输出移位寄存器功能。 8输入管脚或16输出管脚可以配置
以级联或并联结构。并行到串行数据的转换过程中读取的串行数据的
通过内置的独立的寄存器使能串行输入并行输出和并行输入到
串行输出。装在28个引脚, SOP封装, PT8300提供8个输入或16输出引脚,可
被配置成级联结构。引脚分配和应用电路进行了优化
简单的PCB布局和节省成本的好处。
特点
CMOS技术
低功耗:
- 宽工作电源电压范围: V
DD
= 3 5.5V
- 工作温度范围宽:大= -20 + 75 ℃
并行到串行数据的转换过程中读取的串行数据的
提供8个输出管脚或8个输入/输出引脚
施密特触发输入( DI1 , DI2 , CLK ,锁存器, / RESET ,上拉)
提供并行数据输入( P8到P15 )
所提供的上拉电阻的端口漏极开路( P8到P15 )
正常输出端口提供( P0到P7 )
支持端口扩展
应用
MCU外围设备
串行总线系统的数据通信
PT8300 V1.8
-1-
2006年2月,
PT8300 V1.8
P0
P1
P2
P3
P4
P5
P6
P7
P8
P9
P10 P11
P12
P13 P4
P15
16位I / O扩展器IC
上拉
27
框图
VDD
28
VSS
1
-2-
LATCH
RESET
I0
锁定16位
I7
O0
O7
O8
I8
CLK
DI
RESET
Q0
CLK
DI
D0
LATCH
4
O15
I15
CLK
3
DI1
26
移位寄存器1 : 16位移位寄存器串行到并行
Q15
DO
/ RESET
2
14
CLKO
DI2
16
移位寄存器2 : 16位移位寄存器并行到串行
D15
DO
LATCHO
13
DO2
25
DO1
15
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PT8300
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16位I / O扩展器IC
PT8300
引脚配置
VSS
/ RESET
CLK
LATCH
P15
P14
P13
P12
P11
P10
P9
P8
LATCHO
CLKO
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
VDD
上拉
DI1
DO2
P0
P1
P2
P3
P4
P5
P6
P7
DI2
DO1
PT8300
引脚说明
引脚名称
VSS
/ RESET
CLK
LATCH
P15 ~ P8
LATCHO
CLKO
DO1 , DO2
DI1 ,DI2
P7 ~ P0
上拉
VDD
I / O
-
I
I
I
I / O
O
O
O
I
O
I
-
描述
地
复位引脚(活动:低)
时钟输入引脚
锁存输入引脚
并行数据输入/输出管脚
锁存器输出引脚
时钟输出引脚
串行数据输出引脚
串行数据输入引脚
并行数据输出引脚
P8到P15控制引脚的内部电阻
当P8到P15的输出状态,上拉引脚必须
连接到V
DD
.
当P8到P15是输入状态,上拉引脚必须
连接到Vss 。
PIN号
1
2
3
4
5 ~ 12
13
14
15, 25
26, 16
17 ~ 24
27
28
PT8300 V1.8
-3-
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16位I / O扩展器IC
PT8300
功能说明
PT8300是一个I / O扩展器IC它单独生成一个16位串行输入,并行输出
移位寄存器和并行输入到串行输出移位寄存器,用于读取所述串行输入的目的
即并行到串行数据输出转换过程中产生的数据。
当/ RESET引脚连接到VSS ,引脚的输出 - P0到P7是0。如果上拉引脚
连接到VSS或打开,引脚输出 - P8到P15是浮动的。如果上拉引脚连接
VDD时, P8到P15引脚1 。
不使用任何引脚
如果任何的输入,输出或I / O ( P8到P15 )管脚的没有被使用,则在下列条件中所列出的
表必须认真遵守。
当不使用一个输出管脚,它必须保持开放。未使用的输入引脚只能被设置为
高还是低。但是应当注意的是,当不使用一个输入管脚,它不能开启。
当I / O引脚 - P8到P15 - 都没有用,一定条件下必须遵循的。如果其中任何一个引脚,
P8到P15连接到VSS ,上拉引脚也必须连接到VSS 。如果任何这些引脚
- P8到P15 - 被连接到VDD ,则内部移位寄存器1 (Q8至Q15 )必须被设置为1,如果
这些引脚 - P8到P15 - 没有连接到VSS或VDD的,那么下面的任一项
条件必须遵守:
1)上拉引脚必须连接到VDD和移位寄存器1 (Q8至Q15 )必须被设置为1,或
2 )上拉引脚必须连接到VSS和移位寄存器1 ( Q8至Q15 ),必须设置为0 。
必须指出的是,当P8到P15的不在使用时,它们必须被设置为高电平或低电平。
引脚类型未使用
输出引脚
输入引脚
条件
未使用的输出引脚必须保持打开或没有连接
未使用的输入引脚必须要么被设置为高或低。
它不能保持开启。
连接到VSS
上拉引脚必须连接到VSS
连接到VDD
移位寄存器1( Q1到Q15 )被设置为1
的任何一个条件,必须遵循:
1.上拉引脚连接到VDD和班
寄存器1( Q1到Q15 )被设置为1 。
无连接
2.上拉引脚连接到VSS ,并移
寄存器1 (Q8至Q15 )被设置为0 。
3.当P8到P15的不在使用时,它们必须
既可以设置为高或低。
I / O引脚( P8到P15 )
PT8300 V1.8
-4-
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16位I / O扩展器IC
PT8300
手术
1. P0到P15中是不确定的,当电源被接通,但如果/ RESET被设置为LOW时, P0到P7的是在
低状态。如果上拉引脚连接到VSS , P8到P15是浮动的。如果上拉引脚
连接到VDD , P8到P15在高状态。
2. P0的到P15的状态被加载到移位寄存器1在插销/ LATCHO的下降沿。
3.在CLK的下降沿,加载到移位的数据的16位串行输出寄存器1(移
寄存器2)依次从DO1 (DO2 )上进行。
4.在CLK的上升沿, 16位串行数据被写入到移位寄存器1 (移位寄存器2)
从DI1 ( DI2 ) 。
5.在锁存/ LATCHO的上升沿,写入的数据被输出以并行的方式向
P0到P15 。
6.移位寄存器1的负载要被外部施加的数据和与该锁存的内容的数据。
到并行输出锁存器。
7.当LATCH / LATCHO是CLK的第16位到来后激活,并行输出
锁存发送P0至P15通过存储已被写入到移位寄存器2中的数据
移位寄存器1和2继续进行移位操作,直到CLK的第16位和DO1 ( DO2 )
输出串行数据到达。
8.串行数据被用于控制开关模式操作(输入
输出) P8到P15 。当
P8到P15用作输出引脚,上拉必须设置为HIGH 。
操作时序图
/ RESET
LATCH / LATCHO
CLK / CLKO
DI1/DI2
DO1/DO2
P0
P1
P15
1
2
3
4
5
16
DI0
DI1
DI2
DI3
5 DI1
做0
做1
DO 2
做3
DO 1 5
DI
0-1
DI0
DI
1-1
DI1
DI
15-1
5 DI1
PT8300 V1.8
-5-
2006年2月,
普林斯顿科技公司
16位I / O扩展器IC
描述
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PT8300
PT8300是采用CMOS技术,提供16位的I / O扩展串行输入,并行输出
8位并行输入串行输出移位寄存器功能。 8输入管脚或16输出管脚可以配置
以级联或并联结构。并行到串行数据的转换过程中读取的串行数据是
通过对串行输入内置独立的寄存器使能并行输出和并行输入串行
输出。装在28个引脚, SO封装, PT8300提供8个输入或16个输出引脚,以被配置
置的成层叠结构。引脚分配和应用电路,便于PCB优化
布局和节省成本的好处。
特点
CMOS技术
低功耗:
宽工作电源电压范围: V
DD
= 3 5.5V
工作温度范围宽:大= -20到+75
o
C
并行到串行数据的转换过程中读取的串行数据的
提供8引脚输出或8输入/输出引脚
施密特触发输入( DI1 , DI2 , CLK ,锁存器, / RESET ,上拉)
提供并行数据输入( P8到P15 )
所提供的上拉电阻的端口漏极开路( P8到P15 )
正常输出端口提供( P0到P7 )
支持端口扩展
应用
MCU外围设备
串行总线系统的数据通讯
PT 8300 V 1.0
1
更新时间2000年10月
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16位I / O扩展器IC
引脚配置
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PT8300
VSS
/ R (E S) (E T)
CLK
l位于建华
P15
P14
P13
P12
P 11
P10
P9
P8
l位于 H 2 O
CLKO
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
VDD
上拉
I1
DO2
P0
P1
P2
P3
P4
P5
P6
P7
I2
DO1
PT 8300 V 1.0
2
更新时间2000年10月
普林斯顿科技公司
16位I / O扩展器IC
应用CIRICUIT 1
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PT8300
5V
P8 TO P15
VCC
VSS
/ R (E S) (E T) P ü L L ü P
I1
CLK
DO2
l位于建华
P0
P15
P1
P14
P2
P13
P3
P12
P4
P 11
P5
P10
P6
P9
P7
P8
I2
l位于 H 2 O
DO1
CLKO
P0到P7
M CU
PT 8300 V 1.0
3
更新时间2000年10月
16位I / O扩展器IC
应用电路2
PT 8300 V 1.0
5V
VCC
I / O端口
P0
UT P UT P8到P15
P15
P7
l位于通道
CL
I1
O2
P7
l位于通道
CL
I1
DO2
UT PU牛逼
P15
第8页至P15
P0
to
P7
P0
to
P7
P0
V SS
V CC
P8
P T 8 30 0
P0
I / O端口
V SS
P8
V CC
5V
5V
I / O端口
VSS
P8
P T 8 30 0
P牛逼83 0 0
P0
to
P7
P7
第8页至P15
ü TPU牛逼
P15
LATCH
CL
DI1
DO 2
普林斯顿科技公司
4
LAT 2 CH 2 O
CL
01
DI2
/ RE SE牛逼
PU L L UP
LAT 2 CH 2 O
CLK
做1
I2
/ RE SE牛逼
PU L LU P
LAT 2 CH 2 O
CLK
做1
I2
/ RE SET
PU LL ü P
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