【发布数据表PMC-2010336第1期PM7383 FREEDM - 32A256帧引擎和数据链路管】,IC型号PM7383,PM7383 PDF资料,PM7383经销商,ic,电子元器件-51电子网

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第1期

PM7383 FREEDM - 32A256

帧引擎和数据链路管理32A256

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FRAME发动机和DATALINK

经理32A256

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问题2： 2001年8月

PMC- Sierra公司

105 - 8555巴克斯特广场伯纳比，加拿大BC V5A 4V7 604 .415.6000

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FEATURES...............................................................................................1

应用................................................. ....................................... 4

参考................................................. ........................................ 5

框图................................................ .................................... 6

说明................................................. ........................................ 7

引脚图................................................ ........................................ 11

引脚说明................................................ ................................ 12

功能说明................................................ ................ 44

8.1

8.2

8.3

高速多厂商集成协议

（ H- MVIP ） ............................................. ......................................... 44

高级数据链路控制（ HDLC ）协议......... 44

接收通道分配器............................................... 0.45

8.3.1

8.3.2

8.3.3

8.3.4

8.3.5

8.4

线路接口转换器（ LIT ） ....................................... 47

线路接口................................................ ................. 48

优先编码器................................................ ............. 48

通道分配器................................................ .......... 49

环回控制................................................ ....... 49

接收HDLC处理器/部分数据包缓冲... 49

8.4.1

8.4.2

HDLC处理器................................................ ............ 50

部分数据包缓冲处理器..................................... 50

8.5

接收任何- PHY接口............................................. ... 52

8.5.1

FIFO存储与控制.............................................. 53

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8.5.2

8.6

轮询控制和管理................................... 54

传输任何- PHY接口............................................. 54

8.6.1

8.6.2

FIFO存储与控制.............................................. 54

轮询控制和管理................................... 56

8.7

TRANSMIT HDLC控制器/部分数据包BUFFER57

8.7.1

8.7.2

发送HDLC处理器............................................. 57

部分传输数据包缓冲处理器...................... 58

8.8

发送通道分配器.............................................. 60

8.8.1

8.8.2

8.8.3

8.8.4

线路接口转换器（ LIT ） ....................................... 62

线路接口................................................ ................. 63

优先编码器................................................ ............. 63

通道分配器................................................ .......... 64

8.9

8.10

8.11

性能监控................................................ ....... 64

JTAG测试访问端口接口................................... 64

微处理器接口............................................. 64

普通模式寄存器描述........................................ 68

9.1

微处理器访问的寄存器..................... 68

测试特点说明............................................... ........ 159

10.1

10.2

TEST MODE寄存器............................................... .......... 159

JTAG测试端口............................................... ...................... 160

10.2.1

10.2.2

识别寄存器................................................ ..161

边界扫描寄存器.............................................. 161

OPERATIONS.......................................................................................180

11.1

TOCTL连接................................................ ............ 180

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11.2

JTAG支持................................................ ........................ 180

功能时序................................................ .......................... 187

12.1

12.2

12.3

12.4

12.5

12.6

12.7

接收H- MVIP链路的定时............................................ ... 187

TRANSMIT H- MVIP链路的定时............................................ 0.188

接收非H- MVIP链路的定时....................................... 190

传送非H- MVIP链路的定时.................................... 191

接收APPI时序............................................... .............. 193

TRANSMIT APPI时序............................................... ........... 197

BERT接口................................................ ..................... 200

绝对最大额定值............................................... ......... 202

直流特性................................................ .................... 203

FREEDM - 32A256时序特性................................. 206

订购和热信息...................................... 220

机械信息................................................ ............. 221

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图列表

图1 - H- MVIP协议........................................... .......................... 44

图2 - HDLC帧............................................. .................................. 45

图3 - CRC生成器............................................. .......................... 45

图4 - 部分数据包缓冲结构.................................. 51

图5 - 部分数据包缓冲结构.................................. 58

图6 - 输入观察CELL （ IN_CELL ） ................................... 176

图7 - 输出单元（ OUT_CELL ） .......................................... ............ 177

图8 - 双向CELL （ IO_CELL ） ........................................ 178 ....

图9 - 布局输出允许和双向CELLS179

图10 - 边界扫描结构...................................... 181

图11 - TAP控制器有限状态机......................... 183

图12 - 接收8.192 Mbps的H- MVIP链路的定时......................... 187

图13 - 接收2.048Mbps的H- MVIP链路的定时......................... 188

图14 - 发送8.192 Mbps的H- MVIP链路的定时....................... 189

图15 - 发送2.048Mbps的H- MVIP链路的定时....................... 189

图16 - 但没有接收链路的定时............................ 190

图17 - 信道化T1 / J1接收链路的定时........................ 191

图18 - 信道化E1接收链路的定时............................ 191

图19 - 但没有TRANSMIT链路的定时.......................... 192

图20 - 信道化T1 / J1 TRANSMIT链路的定时..................... 192

图21 - 信道化E1发送链路的定时.......................... 193

图22 - 接收APPI时序（正常传送） ..................... 193

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