PLL701-17
低EMI的扩频时钟乘法器
特点
扩频时钟发生器，具有可选
乘数（ 1X，2X ， 2.94x和4倍） 。
参考输入频率为16MHz - 60MHz的。
输出频率范围： 16MHz至200MHz的。
中心扩频调制。
TTL / CMOS兼容的输出。
3.3V工作电压。
低短期抖动。
采用8引脚150mil SOIC封装。
引脚配置
鳍
S2^
S1^
S0
v
1
8
VDD
S3
v
FOUT
GND
PLL701-17
2
3
4
7
6
5
FIN = 16 60兆赫
注意：
V ：为30kΩ内部上拉下来。 ^ ：为30kΩ内部上拉。
描述
该PLL701-17是一个扩频时钟
发电机设计用于减少电磁干扰的目的
在高速数字系统中，具有可选的中心
扩频调制幅度（见下表） 。该
倍增因数可以从4倍数中选择
模式。该器件可工作在很宽的范围内
输入频率，并提供1倍， 2倍。 2.94x和4倍
调制时钟输出。
输出时钟（ FOUT ）选择
S3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
S2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
S1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
S0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
FIN范围
（兆赫）
16
16
16
16
16
16
16
16
-
-
-
-
-
-
-
-
40
40
40
40
40
40
40
40
扩频调制
FOUT
X1
X1
X1
X1
X2
X2
X2
X2
X2
X2
X4
X4
X2.94
X2.94
X2.94
X2.94
频率
大小
±0.75%
±1.00%
±1.25%
±1.50%
±0.25%
±0.50%
±0.75%
±1.00%
±1.25%
±1.50%
±0.25%
±0.50%
±0.25%
±0.50%
±0.75%
±1.00%
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FIN / 512
24 - 60
24 - 60
24 - 50
24 - 50
16
16
16
16
-
-
-
-
40
40
40
40
FIN / 1024
散热片/ 1000
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
www.phaselink.com
PLL701-17
低EMI的扩频时钟乘法器
框图
鳍
PLL
SST
FOUT
S(0:3)
控制
逻辑
引脚说明
名字
鳍
S2
S1
S0
GND
FOUT
S3
VDD
数
1
2
3
4
5
6
7
8
TYPE
I
I
I
I
P
O
I
P
描述
输入时钟连接。 16MHz至60MHz的。
数字控制输入选择倍频因子和SST调制
幅度。具有内部上拉。
数字控制输入选择倍频因子和SST调制
幅度。具有内部上拉。
数字控制输入选择倍频因子和SST调制
幅度。具有内部上拉下来。
接地连接。
SST调制时钟输出。调制前的频率合成
通过用1X，2X ， 4X 2.94Xor乘以输入频率，这取决于S（ 0 ：3）。
数字控制输入选择倍频因子和SST调制
幅度。具有内部上拉下来。
3.3V电源连接。
电气规格
1.绝对最大额定值
参数
电源电压
输入电压， DC
输出电压，直流
储存温度
工作环境温度*
结温
焊接温度（焊接， 10秒）
ESD保护，人体模型
符号
V
DD
V
I
V
O
T
S
T
A
T
J
分钟。
-0.5
-0.5
-65
-40
马克斯。
4.6
V
DD
+0.5
V
DD
+0.5
150
85
125
260
2
单位
V
V
V
°C
°C
°C
°C
kV
超出长时间最大额定值所指明的限制条件下的曝光装置的可能会造成永久性的损坏
装置，并影响了产品的可靠性。这些条件表示在这些或任何其它的应力只等级，并且该器件的功能性操作
上述本说明书中提到的操作限制条件是不是暗示。
*
注意：
工作温度是由设计，所有部件（商业和工业）保证，但测试的唯一的商业档次。
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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转06年1月17日第2页
PLL701-17
低EMI的扩频时钟乘法器
2.直流/交流规范
参数
电源电压
电源电流
输入高电压
输入低电压
输入高电流
输入低电平电流
输出高电压
输出低电压
输入频率
回收的F中断
IN
输入电容
上拉电阻
下拉电阻
短路电流
3.3V的动态电源电流
符号
V
DD
I
DD
V
IH
V
IL
I
IH
I
IL
V
OH
V
OL
F
IN
条件
15pF的负载， FOUT = 16MHz时
5pF的负载， FOUT = 200MHz的
分钟。
2.97
典型值。
9
25
马克斯。
3.63
单位
V
mA
mA
V
V
A
A
0.7* V
DD
0.3* V
DD
100
100
I
OH
= 5毫安，V
DD
=3.3V
I
OL
= 6毫安，V
DD
=3.3V
S3 = 0或S3-S2 = 1-1
S3-S2-S1=1-0-1
S3-S2-S1=1-0-0
2.4
16
24
24
1
3
30
30
50
7
21
0.4
40
50
60
C
in1
R
pu
R
pd
I
sc
I
DD
兆赫
兆赫
兆赫
ms
pF
k
k
mA
mA
mA
引脚2 ， 3
PIN码4,7
无负载， FOUT = 16MHz时
无负载， FOUT = 200MHz的
3.时序特性
参数
上升时间
符号
T
r
条件
10 ％ 90 ％ VDD ， 15pF的负载， FOUT≤100MHz
10 ％ 90 ％ VDD ， 10pF的负载， FOUT≤150MHz
10 ％ 90 ％ VDD ， 5pF的负载， FOUT≤200MHz
90 ％10％的VDD ， 15pF的负载， FOUT≤100MHz
90 ％10％的VDD ， 10pF的负载， FOUT≤150MHz
90 ％10％的VDD ， 5pF的负载， FOUT≤200MHz
测量在50 ％ VDD
在输出频率范围3.3V @
分钟。
典型值。
2
1.5
1
2
1.5
1
50
马克斯。
3
2
1.5
3
2
1.5
55
100
单位
ns
ns
ns
ns
ns
ns
%
PS峰
下降时间
输出占空比
循环周期抖动
T
f
D
T
T
CYC- CYC
45
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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转06年1月17日第3页
PLL701-17
低EMI的扩频时钟乘法器
功能说明
可选择的扩频和调制频率和幅度
该PLL701-17提供可选择的扩频调制频率，以及可选择的调制
震级。选择是通过连接销2（S2 ），3（ S 1 ），4（ S 0）制成，并且如图7（ S3），以逻辑“0 ”或“ 1 ” ，
根据该输出时钟选择表（第1页） 。
为默认的值（ 0 ： 3 ）通过内部上拉和下拉电阻
选择引脚4和7 （ S0和S3 ）都为30kΩ的内部下拉电阻，而引脚2和3 （ S1和S2）
必须为30kΩ内部上拉电阻。这种内部下拉（或拉）电阻会拉输入值到
逻辑“0 ”（或“一”分别）在默认情况下，即当该引脚与VDD之间没有任何连接（ GND
分别） 。为了覆盖内部下拉（上拉） ，该引脚必须连接到VDD （ GND
分别） 。
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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转06年1月17日第4页
PLL701-17
低EMI的扩频时钟乘法器
包装信息
8引脚窄体SOIC （毫米）
SOIC
符号
A
A1
B
C
D
E
H
L
e
分钟。
1.47
0.10
0.33
0.19
4.80
3.80
5.80
0.38
1.27 BSC
马克斯。
1.73
0.25
0.51
0.25
4.95
4.00
6.20
1.27
A1
B
C
L
e
E
H
D
A
订购信息
对于部分订购，请联系我们的销售部：
47745弗里蒙特大道，弗里蒙特，CA 94538 ， USA
联系电话： （ 510 ） 492-0990传真： （ 510 ） 492-0991
产品型号
此设备的顺序号是以下的组合：
设备数量，包装类型和工作温度范围
PLL701-17 X X X -R
产品型号
无=管
R =卷带
无=师范大学包装
L =绿色包装
套餐类型
S = SOIC
温度
C =商业
I =工业
订单号
PLL701-17SC
PLL701-17SC-R
PLL701-17SCL
PLL701-17SCL-R
记号
P701-17SC
P701-17SC
P701-17SCL
P701-17SCL
封装选项
SOIC-管
SOIC -磁带和卷轴
SOIC -管（绿色）
SOIC -磁带和卷轴（绿色）
PhaseLink公司保留在任何时候更改其产品或规格，或两者兼而有之，恕不另行通知。信息
提供了PhaseLink被认为是准确和可靠。然而， PhaseLink使得有关所述的准确性无担保或保证
信息，不应承担任何损失或对本产品的使用或依赖造成任何性质的破坏。
生命支持政策：
PhaseLink的产品不得用于无生命支持设备或系统中的关键组件
快递PhaseLink公司的总裁书面批准。
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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转06年1月17日第5页
PLL701-17
低EMI的扩频时钟乘法器
特点
扩频时钟发生器，具有可选
乘数（ 1X，2X ， 2.94x和4倍） 。
参考输入频率为16MHz - 60MHz的。
输出频率范围： 16MHz至200MHz的。
中心扩频调制。
TTL / CMOS兼容的输出。
3.3V工作电压。
低短期抖动。
采用8引脚150mil SOIC封装。
引脚配置
鳍
S2^
S1^
S0
v
1
8
VDD
S3
v
FOUT
GND
PLL701-17
2
3
4
7
6
5
FIN = 16 60兆赫
注意：
V ：为30kΩ内部上拉下来。 ^ ：为30kΩ内部上拉。
描述
该PLL701-17是一个扩频时钟
发电机设计用于减少电磁干扰的目的
在高速数字系统中，具有可选的中心
扩频调制幅度（见下表） 。该
倍增因数可以从4倍数中选择
模式。该器件可工作在很宽的范围内
输入频率，并提供1倍， 2倍。 2.94x和4倍
调制时钟输出。
输出时钟（ FOUT ）选择
S3
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
S2
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
S1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
S0
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
FIN范围
（兆赫）
16
16
16
16
16
16
16
16
-
-
-
-
-
-
-
-
40
40
40
40
40
40
40
40
扩频调制
FOUT
X1
X1
X1
X1
X2
X2
X2
X2
X2
X2
X4
X4
X2.94
X2.94
X2.94
X2.94
频率
大小
±0.75%
±1.00%
±1.25%
±1.50%
±0.25%
±0.50%
±0.75%
±1.00%
±1.25%
±1.50%
±0.25%
±0.50%
±0.25%
±0.50%
±0.75%
±1.00%
转06年1月17日第1页
FIN / 512
24 - 60
24 - 60
24 - 50
24 - 50
16
16
16
16
-
-
-
-
40
40
40
40
FIN / 1024
散热片/ 1000
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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PLL701-17
低EMI的扩频时钟乘法器
框图
鳍
PLL
SST
FOUT
S(0:3)
控制
逻辑
引脚说明
名字
鳍
S2
S1
S0
GND
FOUT
S3
VDD
数
1
2
3
4
5
6
7
8
TYPE
I
I
I
I
P
O
I
P
描述
输入时钟连接。 16MHz至60MHz的。
数字控制输入选择倍频因子和SST调制
幅度。具有内部上拉。
数字控制输入选择倍频因子和SST调制
幅度。具有内部上拉。
数字控制输入选择倍频因子和SST调制
幅度。具有内部上拉下来。
接地连接。
SST调制时钟输出。调制前的频率合成
通过用1X，2X ， 4X 2.94Xor乘以输入频率，这取决于S（ 0 ：3）。
数字控制输入选择倍频因子和SST调制
幅度。具有内部上拉下来。
3.3V电源连接。
电气规格
1.绝对最大额定值
参数
电源电压
输入电压， DC
输出电压，直流
储存温度
工作环境温度*
结温
焊接温度（焊接， 10秒）
ESD保护，人体模型
符号
V
DD
V
I
V
O
T
S
T
A
T
J
分钟。
-0.5
-0.5
-65
-40
马克斯。
4.6
V
DD
+0.5
V
DD
+0.5
150
85
125
260
2
单位
V
V
V
°C
°C
°C
°C
kV
超出长时间最大额定值所指明的限制条件下的曝光装置的可能会造成永久性的损坏
装置，并影响了产品的可靠性。这些条件表示在这些或任何其它的应力只等级，并且该器件的功能性操作
上述本说明书中提到的操作限制条件是不是暗示。
*
注意：
工作温度是由设计，所有部件（商业和工业）保证，但测试的唯一的商业档次。
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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转06年1月17日第2页
PLL701-17
低EMI的扩频时钟乘法器
2.直流/交流规范
参数
电源电压
电源电流
输入高电压
输入低电压
输入高电流
输入低电平电流
输出高电压
输出低电压
输入频率
回收的F中断
IN
输入电容
上拉电阻
下拉电阻
短路电流
3.3V的动态电源电流
符号
V
DD
I
DD
V
IH
V
IL
I
IH
I
IL
V
OH
V
OL
F
IN
条件
15pF的负载， FOUT = 16MHz时
5pF的负载， FOUT = 200MHz的
分钟。
2.97
典型值。
9
25
马克斯。
3.63
单位
V
mA
mA
V
V
A
A
0.7* V
DD
0.3* V
DD
100
100
I
OH
= 5毫安，V
DD
=3.3V
I
OL
= 6毫安，V
DD
=3.3V
S3 = 0或S3-S2 = 1-1
S3-S2-S1=1-0-1
S3-S2-S1=1-0-0
2.4
16
24
24
1
3
30
30
50
7
21
0.4
40
50
60
C
in1
R
pu
R
pd
I
sc
I
DD
兆赫
兆赫
兆赫
ms
pF
k
k
mA
mA
mA
引脚2 ， 3
PIN码4,7
无负载， FOUT = 16MHz时
无负载， FOUT = 200MHz的
3.时序特性
参数
上升时间
符号
T
r
条件
10 ％ 90 ％ VDD ， 15pF的负载， FOUT≤100MHz
10 ％ 90 ％ VDD ， 10pF的负载， FOUT≤150MHz
10 ％ 90 ％ VDD ， 5pF的负载， FOUT≤200MHz
90 ％10％的VDD ， 15pF的负载， FOUT≤100MHz
90 ％10％的VDD ， 10pF的负载， FOUT≤150MHz
90 ％10％的VDD ， 5pF的负载， FOUT≤200MHz
测量在50 ％ VDD
在输出频率范围3.3V @
分钟。
典型值。
2
1.5
1
2
1.5
1
50
马克斯。
3
2
1.5
3
2
1.5
55
100
单位
ns
ns
ns
ns
ns
ns
%
PS峰
下降时间
输出占空比
循环周期抖动
T
f
D
T
T
CYC- CYC
45
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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PLL701-17
低EMI的扩频时钟乘法器
功能说明
可选择的扩频和调制频率和幅度
该PLL701-17提供可选择的扩频调制频率，以及可选择的调制
震级。选择是通过连接销2（S2 ），3（ S 1 ），4（ S 0）制成，并且如图7（ S3），以逻辑“0 ”或“ 1 ” ，
根据该输出时钟选择表（第1页） 。
为默认的值（ 0 ： 3 ）通过内部上拉和下拉电阻
选择引脚4和7 （ S0和S3 ）都为30kΩ的内部下拉电阻，而引脚2和3 （ S1和S2）
必须为30kΩ内部上拉电阻。这种内部下拉（或拉）电阻会拉输入值到
逻辑“0 ”（或“一”分别）在默认情况下，即当该引脚与VDD之间没有任何连接（ GND
分别） 。为了覆盖内部下拉（上拉） ，该引脚必须连接到VDD （ GND
分别） 。
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转06年1月17日第4页
PLL701-17
低EMI的扩频时钟乘法器
包装信息
8引脚窄体SOIC （毫米）
SOIC
符号
A
A1
B
C
D
E
H
L
e
分钟。
1.47
0.10
0.33
0.19
4.80
3.80
5.80
0.38
1.27 BSC
马克斯。
1.73
0.25
0.51
0.25
4.95
4.00
6.20
1.27
A1
B
C
L
e
E
H
D
A
订购信息
对于部分订购，请联系我们的销售部：
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联系电话： （ 510 ） 492-0990传真： （ 510 ） 492-0991
产品型号
此设备的顺序号是以下的组合：
设备数量，包装类型和工作温度范围
PLL701-17 X X X -R
产品型号
无=管
R =卷带
无=师范大学包装
L =绿色包装
套餐类型
S = SOIC
温度
C =商业
I =工业
订单号
PLL701-17SC
PLL701-17SC-R
PLL701-17SCL
PLL701-17SCL-R
记号
P701-17SC
P701-17SC
P701-17SCL
P701-17SCL
封装选项
SOIC-管
SOIC -磁带和卷轴
SOIC -管（绿色）
SOIC -磁带和卷轴（绿色）
PhaseLink公司保留在任何时候更改其产品或规格，或两者兼而有之，恕不另行通知。信息
提供了PhaseLink被认为是准确和可靠。然而， PhaseLink使得有关所述的准确性无担保或保证
信息，不应承担任何损失或对本产品的使用或依赖造成任何性质的破坏。
生命支持政策：
PhaseLink的产品不得用于无生命支持设备或系统中的关键组件
快递PhaseLink公司的总裁书面批准。
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转06年1月17日第5页
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