PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
特点
可选择750kHz的800MHz的范围内。
低相位噪声输出（ @ 10kHz的频率
胶印， -140dBc / Hz的为19.44MHz ， -127dBc / Hz时
106.25MHz ， -125dBc / Hz的为155.52MHz ， -
110dBc / Hz的为622.08MHz的） 。
CMOS （ PLL602-37 ） ， PECL （ PLL602-35和
PLL602-38 ）或LVDS （ PLL602-39 ）输出。
12 25MHz的晶振输入。
无需外部负载电容要求。
输出使能选择。
可选择的1/16至32倍倍频。
工作电压为3.3V 。
采用16引脚封装（TSSOP或3x3mm的QFN ） 。
引脚配置
（ TOP VIEW ）
VDD
XIN
XOUT
SEL3^
SEL2^
OE
GND
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
SEL0^
SEL1^
GND
CLKC
VDD
CLKT
GND
GND
PLL 602-3X
该PLL602-35 （ PECL倒置OE ） ， PLL602-37
（CMOS） ， PLL602-38 （ PECL ）和PLL602-39 （LVDS）
是高性能和低相位噪声XO IC
芯片。它们提供的相位噪声性能低
为-125dBc在1kHz偏移量（在155MHz的）和一个典型的
RMS的4PS RMS抖动（在155MHz的） 。他们接受
从12根本并联谐振模式晶体
25MHz的。
VDD / GND *
描述
XIN
SEL0 ^ / VDD *
10
XOUT
SEL3^
SEL2^
OE
13
14
15
16
12
11
SEL1^
9
8
7
6
5
GND
CLKC
VDD
CLKT
PLL602-3X
1
2
3
4
GND
GND
SEL
OE
PLL
（相
锁定
环）
^:
*:
Q
Q
内部上拉
在3×3包， PLL602-35 / -38没有SEL0可供选择：引脚
10 VDD ，引脚11是GND 。然而， PLL602-37 / -39有SEL0
（引脚10） ，并且销11为VDD。见引脚分配表的详细信息。
XIN
XOUT
振荡器
扩音器
输出使能逻辑电平
产品编号
PLL602-3x
PLL旁路
PLL602-38
PLL602-35
PLL602-37
PLL602-39
OE
0（默认）
1
0
1（默认）
状态
输出启用
三州
三州
输出启用
OE输入：通过PECL电平PLL602-38定义的逻辑状态
通过CMOS电平的定义逻辑状态
PLL602-35/-37/-39
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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转05年11月28日第1页
GND
GND
框图
PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
频率选择表
SEL3
SEL2
SEL1
SEL0
选择的乘数
0
0
0
1
1
1
1
1
1
1
0
1
1
0
0
0
1
1
1
1
1
1
1
0
1
1
0
0
1
1
1
0
1
1
0
1
0
1
0
1
散热片×32
FIN / 8
散热片×2
FIN / 2
FIN / 16
散热片×4
FIN / 4
鳍×8
鳍×16
无乘法
注意：
SEL0不可用（始终为“ 1”）为PLL602-35和PLL602-38在3x3mm的包
引脚说明PLL602-35和PLL602-38 （见PLL602-37 / -39下一页）
名字
XIN
XOUT
OE
GND
CLKT
CLKC
SEL0
SEL1
SEL2
SEL3
VDD
TSSOP
引脚数
2
3
6
7,8,9,10,14
11
13
16
15
5
4
1, 12
采用3x3mm QFN
引脚数
12
13
16
1,2,3,4,8,11
5
7
无法使用
9
15
14
6,10
TYPE
I
I
I
P
O
O
I
I
I
I
P
描述
晶振输入。见第3页上的晶体规格。
晶振输出。见第3页上的晶体规格。
输出使能引脚（见第1页OE逻辑状态表） 。
地面上。
真正的输出PECL
互补输出PECL 。
乘数选择引脚。这些引脚有一个内部上拉
这将默认SEL为“1”时，没有连接到GND 。
电源。
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
引脚说明PLL602-37 / -39 （见PLL602-35 / -38前页）
名字
XIN
XOUT
OE
GND
CLKT
CLKC
SEL0
SEL1
SEL2
SEL3
VDD
TSSOP
引脚数
2
3
6
7,8,9,10,14
11
13
16
15
5
4
1, 12
采用3x3mm QFN
引脚数
12
13
16
1,2,3,4,8
5
7
10
9
15
14
6,11
TYPE
I
I
I
P
O
O
I
I
I
I
P
描述
晶振输入。见第3页上的晶体规格。
晶振输出。见第3页上的晶体规格。
输出使能引脚（见第1页OE逻辑状态表） 。
地面上。
真正的输出LVDS （ PLL602-39 ）
（N / C为PLL602-37 ）
互补输出LVDS （ PLL602-39 ）
（ CMOS出来PLL602-37 ） 。
乘数选择引脚。这些引脚有一个内部上拉
这将默认SEL为“1”时，没有连接到GND 。
电源。
电气规格
1.绝对最大额定值
参数
电源电压
输入电压， DC
输出电压，直流
储存温度
工作环境温度*
结温
焊接温度（焊接， 10秒）
ESD保护，人体模型
符号
V
DD
V
I
V
O
T
S
T
A
T
J
分钟。
-0.5
-0.5
-65
-40
马克斯。
4.6
V
DD
+0.5
V
DD
+0.5
150
85
125
260
2
单位
V
V
V
°C
°C
°C
°C
kV
超出长时间最大额定值所指明的限制条件下的曝光装置的可能会造成永久性的损坏
装置，并影响了产品的可靠性。这些条件代表了一个额定值，以及设备在这些功能操作或任何其他CON-
ditions上述本说明书中提到的操作限制是不是暗示。
*
注意：
工作温度是由设计，所有部件（商业和工业）保证，但测试的唯一的商业档次。
2.水晶规格
参数
晶体谐振器频率
水晶装载评级
推荐ESR
符号
F
XIN
C
L（ XTAL ）
R
E
条件
水货基本模式
AT切割
分钟。
12
典型值。
20
马克斯。
25
30
单位
兆赫
pF
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PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
3.通用电气规格
参数
电源电流，
动态（带
加载输出）
工作电压
输出时钟
占空比
短路
当前
符号
I
DD
V
DD
条件
PECL / LVDS / CMOS
Fout<24MHz
24MHz<Fout<96MHz
96MHz<Fout<800MHz
分钟。
典型值。
马克斯。
25/25/15
65/45/30
100/80/40
3.63
55
55
55
单位
mA
V
%
mA
2.97
@ 50% V
DD
（ CMOS）的
@ 1.25V （ LVDS ）
@
V
DD
- 1.3V （ PECL ）
45
45
45
50
50
50
±50
4.抖动规范
参数
条件
随着电容去耦BE-
吐温VDD和GND 。
超过10,000次。
频率
19.44MHz
77.76MHz
155.52MHz
622.08MHz
19.44MHz
77.76MHz
155.52MHz
622.08MHz
155.52MHz
622.08MHz
分钟。
典型值。
2.2
3.5
4.3
5.0
17
25
27
35
2.6
2.5
马克斯。
单位
周期抖动
RMS
1
ps
周期抖动峰到
PEAK
1
随着电容去耦BE-
吐温VDD和GND 。
超过10,000次。
集成12千赫至20兆赫
ps
集成RMS抖动
2
4
4
ps
5.相位噪声指标
参数
相位噪声
2
相对的
载波
（典型值）
频率
19.44MHz
77.76MHz
155.52MHz
622.08MHz
@10Hz
-80
-72
-65
-55
@100Hz
-108
-103
-95
-85
@1kHz
-132
-122
-120
-109
@10kHz
-142
-130
-125
-115
@100kHz
-150
-125
-121
-110
单位
dBc的/赫兹
6. CMOS电气特性
参数
输出驱动电流
输出时钟的上升/下降时间
符号
I
OH
I
OL
条件
V
OH
= V
DD
-0.4V, V
DD
=3.3V
V
OL
= 0.4V, V
DD
= 3.3V
0.3V 3.0V与15 pF负载
分钟。
10
10
典型值。
马克斯。
单位
mA
mA
ns
2.4
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PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
7. LVDS电气特性
参数
输出电压差
V
DD
幅度变化
输出高电压
输出低电压
失调电压
偏移幅度变化
关机泄漏
输出短路电流
符号
V
OD
V
OD
V
OH
V
OL
V
OS
V
OS
I
OXD
I
OSD
条件
分钟。
247
-50
典型值。
355
1.4
1.1
1.2
3
±1
-5.7
马克斯。
454
50
1.6
1.375
25
±10
-8
单位
mV
mV
V
V
V
mV
uA
mA
R
L
= 100
（见图）
0.9
1.125
0
V
OUT
= V
DD
或GND
V
DD
= 0V
8. LVDS开关特性
参数
差分时钟上升时间
差分时钟下降时间
LVDS电平测试电路
OUT
符号
t
r
t
f
条件
R
L
= 100
C
L
= 10 pF的
（见图）
分钟。
0.2
0.2
典型值。
0.7
0.7
马克斯。
1.0
1.0
单位
ns
ns
LVDS转换电路测试
OUT
50
C
L
= 10pF的
V
OD
V
OS
V
差异
R
L
= 100
50
C
L
= 10pF的
OUT
OUT
LVDS Transistion时间波形
OUT
0V （差分）
OUT
80%
V
差异
20%
0V
80%
20%
t
R
t
F
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
特点
可选择750kHz的800MHz的范围内。
低相位噪声输出（ @ 10kHz的频率
胶印， -140dBc / Hz的为19.44MHz ， -127dBc / Hz时
106.25MHz ， -125dBc / Hz的为155.52MHz ， -
110dBc / Hz的为622.08MHz的） 。
CMOS （ PLL602-37 ） ， PECL （ PLL602-35和
PLL602-38 ）或LVDS （ PLL602-39 ）输出。
12 25MHz的晶振输入。
无需外部负载电容要求。
输出使能选择。
可选择的1/16至32倍倍频。
工作电压为3.3V 。
采用16引脚封装（TSSOP或3x3mm的QFN ） 。
引脚配置
（ TOP VIEW ）
VDD
XIN
XOUT
SEL3^
SEL2^
OE
GND
GND
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
SEL0^
SEL1^
GND
CLKC
VDD
CLKT
GND
GND
PLL 602-3X
该PLL602-35 （ PECL倒置OE ） ， PLL602-37
（CMOS） ， PLL602-38 （ PECL ）和PLL602-39 （LVDS）
是高性能和低相位噪声XO IC
芯片。它们提供的相位噪声性能低
为-125dBc在1kHz偏移量（在155MHz的）和一个典型的
RMS的4PS RMS抖动（在155MHz的） 。他们接受
从12根本并联谐振模式晶体
25MHz的。
VDD / GND *
描述
XIN
SEL0 ^ / VDD *
10
XOUT
SEL3^
SEL2^
OE
13
14
15
16
12
11
SEL1^
9
8
7
6
5
GND
CLKC
VDD
CLKT
PLL602-3X
1
2
3
4
GND
GND
SEL
OE
PLL
（相
锁定
环）
^:
*:
Q
Q
内部上拉
在3×3包， PLL602-35 / -38没有SEL0可供选择：引脚
10 VDD ，引脚11是GND 。然而， PLL602-37 / -39有SEL0
（引脚10） ，并且销11为VDD。见引脚分配表的详细信息。
XIN
XOUT
振荡器
扩音器
输出使能逻辑电平
产品编号
PLL602-3x
PLL旁路
PLL602-38
PLL602-35
PLL602-37
PLL602-39
OE
0（默认）
1
0
1（默认）
状态
输出启用
三州
三州
输出启用
OE输入：通过PECL电平PLL602-38定义的逻辑状态
通过CMOS电平的定义逻辑状态
PLL602-35/-37/-39
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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GND
GND
框图
PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
频率选择表
SEL3
SEL2
SEL1
SEL0
选择的乘数
0
0
0
1
1
1
1
1
1
1
0
1
1
0
0
0
1
1
1
1
1
1
1
0
1
1
0
0
1
1
1
0
1
1
0
1
0
1
0
1
散热片×32
FIN / 8
散热片×2
FIN / 2
FIN / 16
散热片×4
FIN / 4
鳍×8
鳍×16
无乘法
注意：
SEL0不可用（始终为“ 1”）为PLL602-35和PLL602-38在3x3mm的包
引脚说明PLL602-35和PLL602-38 （见PLL602-37 / -39下一页）
名字
XIN
XOUT
OE
GND
CLKT
CLKC
SEL0
SEL1
SEL2
SEL3
VDD
TSSOP
引脚数
2
3
6
7,8,9,10,14
11
13
16
15
5
4
1, 12
采用3x3mm QFN
引脚数
12
13
16
1,2,3,4,8,11
5
7
无法使用
9
15
14
6,10
TYPE
I
I
I
P
O
O
I
I
I
I
P
描述
晶振输入。见第3页上的晶体规格。
晶振输出。见第3页上的晶体规格。
输出使能引脚（见第1页OE逻辑状态表） 。
地面上。
真正的输出PECL
互补输出PECL 。
乘数选择引脚。这些引脚有一个内部上拉
这将默认SEL为“1”时，没有连接到GND 。
电源。
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
引脚说明PLL602-37 / -39 （见PLL602-35 / -38前页）
名字
XIN
XOUT
OE
GND
CLKT
CLKC
SEL0
SEL1
SEL2
SEL3
VDD
TSSOP
引脚数
2
3
6
7,8,9,10,14
11
13
16
15
5
4
1, 12
采用3x3mm QFN
引脚数
12
13
16
1,2,3,4,8
5
7
10
9
15
14
6,11
TYPE
I
I
I
P
O
O
I
I
I
I
P
描述
晶振输入。见第3页上的晶体规格。
晶振输出。见第3页上的晶体规格。
输出使能引脚（见第1页OE逻辑状态表） 。
地面上。
真正的输出LVDS （ PLL602-39 ）
（N / C为PLL602-37 ）
互补输出LVDS （ PLL602-39 ）
（ CMOS出来PLL602-37 ） 。
乘数选择引脚。这些引脚有一个内部上拉
这将默认SEL为“1”时，没有连接到GND 。
电源。
电气规格
1.绝对最大额定值
参数
电源电压
输入电压， DC
输出电压，直流
储存温度
工作环境温度*
结温
焊接温度（焊接， 10秒）
ESD保护，人体模型
符号
V
DD
V
I
V
O
T
S
T
A
T
J
分钟。
-0.5
-0.5
-65
-40
马克斯。
4.6
V
DD
+0.5
V
DD
+0.5
150
85
125
260
2
单位
V
V
V
°C
°C
°C
°C
kV
超出长时间最大额定值所指明的限制条件下的曝光装置的可能会造成永久性的损坏
装置，并影响了产品的可靠性。这些条件代表了一个额定值，以及设备在这些功能操作或任何其他CON-
ditions上述本说明书中提到的操作限制是不是暗示。
*
注意：
工作温度是由设计，所有部件（商业和工业）保证，但测试的唯一的商业档次。
2.水晶规格
参数
晶体谐振器频率
水晶装载评级
推荐ESR
符号
F
XIN
C
L（ XTAL ）
R
E
条件
水货基本模式
AT切割
分钟。
12
典型值。
20
马克斯。
25
30
单位
兆赫
pF
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
3.通用电气规格
参数
电源电流，
动态（带
加载输出）
工作电压
输出时钟
占空比
短路
当前
符号
I
DD
V
DD
条件
PECL / LVDS / CMOS
Fout<24MHz
24MHz<Fout<96MHz
96MHz<Fout<800MHz
分钟。
典型值。
马克斯。
25/25/15
65/45/30
100/80/40
3.63
55
55
55
单位
mA
V
%
mA
2.97
@ 50% V
DD
（ CMOS）的
@ 1.25V （ LVDS ）
@
V
DD
- 1.3V （ PECL ）
45
45
45
50
50
50
±50
4.抖动规范
参数
条件
随着电容去耦BE-
吐温VDD和GND 。
超过10,000次。
频率
19.44MHz
77.76MHz
155.52MHz
622.08MHz
19.44MHz
77.76MHz
155.52MHz
622.08MHz
155.52MHz
622.08MHz
分钟。
典型值。
2.2
3.5
4.3
5.0
17
25
27
35
2.6
2.5
马克斯。
单位
周期抖动
RMS
1
ps
周期抖动峰到
PEAK
1
随着电容去耦BE-
吐温VDD和GND 。
超过10,000次。
集成12千赫至20兆赫
ps
集成RMS抖动
2
4
4
ps
5.相位噪声指标
参数
相位噪声
2
相对的
载波
（典型值）
频率
19.44MHz
77.76MHz
155.52MHz
622.08MHz
@10Hz
-80
-72
-65
-55
@100Hz
-108
-103
-95
-85
@1kHz
-132
-122
-120
-109
@10kHz
-142
-130
-125
-115
@100kHz
-150
-125
-121
-110
单位
dBc的/赫兹
6. CMOS电气特性
参数
输出驱动电流
输出时钟的上升/下降时间
符号
I
OH
I
OL
条件
V
OH
= V
DD
-0.4V, V
DD
=3.3V
V
OL
= 0.4V, V
DD
= 3.3V
0.3V 3.0V与15 pF负载
分钟。
10
10
典型值。
马克斯。
单位
mA
mA
ns
2.4
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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PLL602-35/-37/-38/-39
750kHz的 - 800MHz的低相位噪声乘数XO
通用低相位噪声的IC
7. LVDS电气特性
参数
输出电压差
V
DD
幅度变化
输出高电压
输出低电压
失调电压
偏移幅度变化
关机泄漏
输出短路电流
符号
V
OD
V
OD
V
OH
V
OL
V
OS
V
OS
I
OXD
I
OSD
条件
分钟。
247
-50
典型值。
355
1.4
1.1
1.2
3
±1
-5.7
马克斯。
454
50
1.6
1.375
25
±10
-8
单位
mV
mV
V
V
V
mV
uA
mA
R
L
= 100
（见图）
0.9
1.125
0
V
OUT
= V
DD
或GND
V
DD
= 0V
8. LVDS开关特性
参数
差分时钟上升时间
差分时钟下降时间
LVDS电平测试电路
OUT
符号
t
r
t
f
条件
R
L
= 100
C
L
= 10 pF的
（见图）
分钟。
0.2
0.2
典型值。
0.7
0.7
马克斯。
1.0
1.0
单位
ns
ns
LVDS转换电路测试
OUT
50
C
L
= 10pF的
V
OD
V
OS
V
差异
R
L
= 100
50
C
L
= 10pF的
OUT
OUT
LVDS Transistion时间波形
OUT
0V （差分）
OUT
80%
V
差异
20%
0V
80%
20%
t
R
t
F
47745弗里蒙特大道，弗里蒙特，加利福尼亚州94538电话：（ 510 ） 492-0990传真：（ 510 ） 492-0991
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